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• 基于Quartus II免費(fèi)IP核的雙端口RAM設(shè)計(jì)實(shí)例免費(fèi)下載

  資源簡(jiǎn)介：　　QuartusII中利用免費(fèi)IP核的設(shè)計(jì) 　　作者：雷達(dá)室 　　以設(shè)計(jì)雙端口RAM為例說明。 　　Step1：打開QuartusII，選擇File—New Project Wizard，創(chuàng)建新工程，出現(xiàn)圖示對(duì)話框，點(diǎn)擊Next；

  標(biāo)簽： Quartus RAM IP核 雙端口

  上傳時(shí)間： 2014-12-28

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• 基于Quartus II免費(fèi)IP核的雙端口RAM設(shè)計(jì)實(shí)例免費(fèi)下載

  資源簡(jiǎn)介：　　QuartusII中利用免費(fèi)IP核的設(shè)計(jì) 　　作者：雷達(dá)室 　　以設(shè)計(jì)雙端口RAM為例說明。 　　Step1：打開QuartusII，選擇File—New Project Wizard，創(chuàng)建新工程，出現(xiàn)圖示對(duì)話框，點(diǎn)擊Next；

  標(biāo)簽： Quartus RAM IP核 雙端口

  上傳時(shí)間： 2013-10-18

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• 基于Actel FPGA的雙端口RAM設(shè)計(jì)免費(fèi)下載

  資源簡(jiǎn)介：基于Actel FPGA 的雙端口RAM 設(shè)計(jì)雙端口RAM 芯片主要應(yīng)用于高速率、高可靠性、對(duì)實(shí)時(shí)性要求高的場(chǎng)合，如實(shí)現(xiàn)DSP與PCI 總線芯片之間的數(shù)據(jù)交換接口電路等。但普通雙端口RAM 最大的缺點(diǎn)是在兩個(gè)CPU發(fā)生競(jìng)爭(zhēng)時(shí)，有一方CPU 必須等待，因而降低了訪問效率。IDT 公...

  標(biāo)簽： Actel FPGA RAM 雙端口

  上傳時(shí)間： 2013-10-22

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• 基于Actel FPGA的雙端口RAM設(shè)計(jì)免費(fèi)下載

  資源簡(jiǎn)介：基于Actel FPGA 的雙端口RAM 設(shè)計(jì)雙端口RAM 芯片主要應(yīng)用于高速率、高可靠性、對(duì)實(shí)時(shí)性要求高的場(chǎng)合，如實(shí)現(xiàn)DSP與PCI 總線芯片之間的數(shù)據(jù)交換接口電路等。但普通雙端口RAM 最大的缺點(diǎn)是在兩個(gè)CPU發(fā)生競(jìng)爭(zhēng)時(shí)，有一方CPU 必須等待，因而降低了訪問效率。IDT 公...

  標(biāo)簽： Actel FPGA RAM 雙端口

  上傳時(shí)間： 2013-10-19

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• 基于Quartus的雙端口RAM的完整設(shè)計(jì)流程免費(fèi)下載

  資源簡(jiǎn)介：基于Quartus的雙端口RAM的完整設(shè)計(jì)流程，包括建立的工程仿真實(shí)現(xiàn)

  標(biāo)簽： Quartus RAM 雙端口 設(shè)計(jì)流程

  上傳時(shí)間： 2014-06-04

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• 任意時(shí)鐘配比的異步fifo.含有synplify ip庫中的雙端口RAM。用于處理多時(shí)鐘域問題。免費(fèi)下載

  資源簡(jiǎn)介：任意時(shí)鐘配比的異步fifo.含有synplify ip庫中的雙端口RAM。用于處理多時(shí)鐘域問題。

  標(biāo)簽： synplify fifo RAM 時(shí)鐘

  上傳時(shí)間： 2014-12-04

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• 利用vhdl編寫的雙端口RAM程序免費(fèi)下載

  資源簡(jiǎn)介：利用vhdl編寫的雙端口RAM程序，不帶數(shù)據(jù)糾錯(cuò)處理

  標(biāo)簽： vhdl RAM 編寫 雙端口

  上傳時(shí)間： 2016-10-02

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• 很精彩的雙端口RAM應(yīng)用筆記免費(fèi)下載

  資源簡(jiǎn)介：很精彩的雙端口RAM應(yīng)用筆記，對(duì)搞單片機(jī)、FPGA的都有幫助。

  標(biāo)簽： RAM 雙端口 應(yīng)用筆記

  上傳時(shí)間： 2017-03-20

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• 基于Quartus II 5.0編寫的正弦波發(fā)生器免費(fèi)下載

  資源簡(jiǎn)介：基于Quartus II 5.0編寫的正弦波發(fā)生器，可控頻率，用vhdl編寫的

  標(biāo)簽： Quartus 5.0 II 編寫

  上傳時(shí)間： 2014-01-17

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• 異步FIFO是用來適配不同異步FIFO采用了格雷（GRAY）變換技術(shù)和雙端口RAM實(shí)現(xiàn)了不同時(shí)鐘域之間的數(shù)據(jù)無損傳輸免費(fèi)下載

  資源簡(jiǎn)介：異步FIFO是用來適配不同時(shí)鐘域之間的相位差和頻率飄移的重要模塊。本文設(shè)計(jì)的異步FIFO采用了格雷（GRAY）變換技術(shù)和雙端口RAM實(shí)現(xiàn)了不同時(shí)鐘域之間的數(shù)據(jù)無損傳輸。該結(jié)構(gòu)利用了GRAY變換的特點(diǎn)，使得整個(gè)系統(tǒng)可靠性高和抗干擾能力強(qiáng)，系統(tǒng)可以工作在讀寫時(shí)鐘...

  標(biāo)簽： FIFO GRAY RAM 適配

  上傳時(shí)間： 2013-08-08

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• PCM9880是一塊PC/104界面的雙端口隔離CAN總線通訊卡免費(fèi)下載

  資源簡(jiǎn)介：PCM9880是一塊PC/104界面的雙端口隔離CAN總線通訊卡，它提供PC與控制器局域網(wǎng)之間的連接。采用高性能的SJA1000控制器和82C250收發(fā)器，每個(gè)端口工作的波特率可達(dá)1Mbps。內(nèi)置CAN控制器具有總線仲裁和帶錯(cuò)誤偵測(cè)自動(dòng)重復(fù)傳輸功能，有效的避免了數(shù)據(jù)丟失，確保了...

  標(biāo)簽： 9880 PCM 104 CAN

  上傳時(shí)間： 2014-01-16

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• 網(wǎng)絡(luò)控制器和鏈路控制器的CPU即是通過讀寫雙端口RAM芯片完成網(wǎng)絡(luò)層與數(shù)據(jù)鏈路層的原語交互。mailbox中寫入的是原語的類型免費(fèi)下載

  資源簡(jiǎn)介：網(wǎng)絡(luò)控制器和鏈路控制器的CPU即是通過讀寫雙端口RAM芯片完成網(wǎng)絡(luò)層與數(shù)據(jù)鏈路層的原語交互。mailbox中寫入的是原語的類型，而雙端口RAM的其它存儲(chǔ)空間則存放各種服務(wù)原語的參數(shù)。

  標(biāo)簽： mailbox CPU RAM 網(wǎng)絡(luò)控制器

  上傳時(shí)間： 2015-04-03

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• 雙端口RAM的VHDL語言實(shí)現(xiàn)。完全在CPLD芯片上測(cè)試通過。可以實(shí)現(xiàn)對(duì)存儲(chǔ)器讀操作的同時(shí)對(duì)另外一個(gè)空間寫操作免費(fèi)下載

  資源簡(jiǎn)介：雙端口RAM的VHDL語言實(shí)現(xiàn)。完全在CPLD芯片上測(cè)試通過。可以實(shí)現(xiàn)對(duì)存儲(chǔ)器讀操作的同時(shí)對(duì)另外一個(gè)空間寫操作

  標(biāo)簽： CPLD VHDL RAM 操作

  上傳時(shí)間： 2015-10-15

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• 在modolsim平臺(tái)下仿真完成了一個(gè)雙端口RAM的實(shí)現(xiàn)免費(fèi)下載

  資源簡(jiǎn)介：在modolsim平臺(tái)下仿真完成了一個(gè)雙端口RAM的實(shí)現(xiàn)，希望有用。

  標(biāo)簽： modolsim RAM 仿真 雙端口

  上傳時(shí)間： 2016-01-07

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• 采用Verilog語言描述的FIFO和雙端口RAM源代碼。免費(fèi)下載

  資源簡(jiǎn)介：采用Verilog語言描述的FIFO和雙端口RAM源代碼。

  標(biāo)簽： Verilog FIFO RAM 語言

  上傳時(shí)間： 2014-01-19

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• at91rm9200乒乓算法采集兩塊雙端口RAM中的數(shù)據(jù)存儲(chǔ)到SD卡免費(fèi)下載

  資源簡(jiǎn)介：at91rm9200乒乓算法采集兩塊雙端口RAM中的數(shù)據(jù)存儲(chǔ)到SD卡

  標(biāo)簽： 9200 RAM at 91

  上傳時(shí)間： 2013-12-07

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• 雙端口RAM方式的數(shù)據(jù)通信,速度非常快!免費(fèi)下載

  資源簡(jiǎn)介：雙端口RAM方式的數(shù)據(jù)通信,速度非常快!

  標(biāo)簽： RAM 雙端口 方式 數(shù)據(jù)通信

  上傳時(shí)間： 2014-09-01

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• 高速雙端口RAM的vhdl實(shí)現(xiàn)。包含仿真波形免費(fèi)下載

  資源簡(jiǎn)介：高速雙端口RAM的vhdl實(shí)現(xiàn)。包含仿真波形

  標(biāo)簽： vhdl RAM 雙端口 仿真

  上傳時(shí)間： 2016-09-28

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• 在ucos-ii下用LPC2290的spi端口驅(qū)動(dòng)M65的液晶屏免費(fèi)下載

  資源簡(jiǎn)介：在ucos-ii下用LPC2290的spi端口驅(qū)動(dòng)M65的液晶屏，可以任意開辟區(qū)域顯示

  標(biāo)簽： ucos-ii 2290 LPC spi

  上傳時(shí)間： 2014-06-12

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• 這是在max+plusII環(huán)境下編譯的雙端口存儲(chǔ)器模擬實(shí)驗(yàn)免費(fèi)下載

  資源簡(jiǎn)介：這是在max+plusII環(huán)境下編譯的雙端口存儲(chǔ)器模擬實(shí)驗(yàn)

  標(biāo)簽： plusII max 環(huán)境 下編譯

  上傳時(shí)間： 2016-12-10

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• 異步FIFO是用來適配不同時(shí)鐘域之間的相位差和頻率飄移的重要模塊。本文設(shè)計(jì)的異步FIFO采用了格雷（GRAY）變換技術(shù)和雙端口RAM實(shí)現(xiàn)了不同時(shí)鐘域之間的數(shù)據(jù)無損傳輸。該結(jié)構(gòu)利用了GRAY變換的特點(diǎn)免費(fèi)下載

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  標(biāo)簽： FIFO GRAY RAM 時(shí)鐘域

  上傳時(shí)間： 2017-05-27

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• 這是個(gè)雙端口雙端口RAM的定義免費(fèi)下載

  資源簡(jiǎn)介：這是個(gè)雙端口雙端口RAM的定義，當(dāng)然讀者在此基礎(chǔ)上還可以擴(kuò)充

  標(biāo)簽： RAM 雙端口 定義

  上傳時(shí)間： 2014-01-06

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• at91rm9200雙端口RAM驅(qū)動(dòng)及測(cè)試程序免費(fèi)下載

  資源簡(jiǎn)介：at91rm9200雙端口RAM驅(qū)動(dòng)及測(cè)試程序，支持信號(hào)量搶占，支持連續(xù)讀取及重定位。

  標(biāo)簽： 9200 RAM at 91

  上傳時(shí)間： 2013-12-24

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• 用雙端口RAM實(shí)現(xiàn)異步fifo免費(fèi)下載

  資源簡(jiǎn)介：用雙端口RAM實(shí)現(xiàn)異步fifo，采用格雷碼，避免產(chǎn)生毛刺。

  標(biāo)簽： fifo RAM 雙端口

  上傳時(shí)間： 2016-10-10

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• 定制一個(gè)雙端口RAM免費(fèi)下載

  資源簡(jiǎn)介：定制一個(gè)雙端口RAM，DualPortRAM

  標(biāo)簽： RAM 定制 雙端口

  上傳時(shí)間： 2014-02-02

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• IDT7132/7142 是一種高速 2k×8 雙端口靜態(tài) RAM免費(fèi)下載

  資源簡(jiǎn)介：IDT7132/7142 是一種高速 2k×8 雙端口靜態(tài) RAM，它擁有兩套完全獨(dú)立的 數(shù)據(jù)、地址和讀寫控制線。文中分析了雙端口 RAM（DPRAM）的設(shè)計(jì)方案。并 以 IDT7132/7142 為例介紹了雙端口 RAM 的時(shí)序、競(jìng)爭(zhēng)和并行通訊接口設(shè)計(jì)以及 雷達(dá)仿真平臺(tái)中的應(yīng)用。

  標(biāo)簽： 7132 7142 IDT RAM

  上傳時(shí)間： 2014-01-20

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• 基于Avalon總線的8051MCU IP核的設(shè)計(jì)免費(fèi)下載

  資源簡(jiǎn)介：設(shè)計(jì)了一款基于Avalon總線的8051MCU IP核。它支持MCS-51指令集，優(yōu)化內(nèi)部的結(jié)構(gòu)，通過采用流水線技術(shù)、指令映射技術(shù)、指令預(yù)取技術(shù)、微代碼技術(shù)等極大的提高了IP核的工作速度，使IP核在100MHz時(shí)鐘下，能夠單周期執(zhí)行一條指令。本設(shè)計(jì)使用Modelsim軟件完成了功...

  標(biāo)簽： Avalon 8051 MCU 總線

  上傳時(shí)間： 2013-11-02

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• 基于FPGA的GPIB接口IP核的研究與設(shè)計(jì)免費(fèi)下載

  資源簡(jiǎn)介：基于FPGA的GPIB接口IP核的研究與設(shè)計(jì)

  標(biāo)簽： FPGA GPIB 接口 IP核

  上傳時(shí)間： 2013-11-04

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• 基于SOPC技術(shù)的異步串行通信IP核的設(shè)計(jì)免費(fèi)下載

  資源簡(jiǎn)介：介紹了SoPC（System on a ProgRAMmable Chip）系統(tǒng)的概念和特點(diǎn)，給出了基于PLB總線的異步串行通信（UART）IP核的硬件設(shè)計(jì)和實(shí)現(xiàn)。通過將設(shè)計(jì)好的UART IP核集成到SoPC系統(tǒng)中加以驗(yàn)證，證明了所設(shè)計(jì)的UART IP核可以正常工作。該設(shè)計(jì)方案為其他基于SoPC系統(tǒng)IP核...

  標(biāo)簽： SOPC IP核 異步串行通信

  上傳時(shí)間： 2013-11-12

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• 基于FPGA的GPIB接口IP核的研究與設(shè)計(jì)免費(fèi)下載

  資源簡(jiǎn)介：基于FPGA的GPIB接口IP核的研究與設(shè)計(jì)

  標(biāo)簽： FPGA GPIB 接口 IP核

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