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  • 汽車底盤測功機測控系統的研究.rar

    隨著科學技術的發展,汽車結構不斷完善,人們對汽車的性能更加關注。汽車本身是一個復雜的系統,在使用過程中,隨著行駛里程的增加和使用時間的延續,汽車技術狀況可能不斷惡化,需要定期進行檢測。汽車底盤測功機是一種不解體檢驗汽車性能的檢測設備,采用現代電測和計算機技術,模擬汽車在各種路面行駛阻力,使汽車的道路試驗項目移至室內進行,減少室外環境變化對測試的影響,能夠很好的改善試驗人員的試驗環境和提高測試精度。 本文首先介紹了汽車底盤測功機的發展歷史和研究現狀,闡明了研究汽車底盤測功機測控系統的目的和意義,給出了汽車底盤測功機的結構和工作原理,在詳細分析汽車道路上和底盤測功機上運行受力情況的基礎上,建立了測功機電模擬模型。采用電模擬阻力加載裝置,不僅省去了繁瑣的慣性飛輪裝置,簡化了底盤測功機的結構,而且實現了慣性阻力的無級模擬。在系統硬件上,設計了轉速轉矩信號的采集電路和前端信號處理電路,提高了采集數據的準確性,保證系統的精度,并給出了勵磁控制電路的設計與實現。在通訊上,設計CAN和USB互相轉化的接口電路,不僅實現上下位機之間的通訊,而且還突破了傳統底盤測功機上下位機通訊速率慢的瓶頸。在控制策略上,采用積分分離PID算法,實現轉速、勵磁電流和轉矩、勵磁電流的兩個雙閉環控制器,滿足了汽車底盤測功機不同運行狀況的需求。在軟件上,采用模塊化編程的思想,從而增強了程序的可移植性和靈活性。最后,構建了實驗平臺,對系統進行了實驗研究,實驗結果表明:系統能滿足汽車性能測試的要求。

    標簽: 汽車底盤 測功 測控系統

    上傳時間: 2013-06-12

    上傳用戶:問題問題

  • 基于電力電子網絡的變流系統研究.rar

    電力電子系統的集成化是現今電力電子技術發展的趨勢,系統的模塊化和標準化技術是目前電力電子領域的重要研究方向。研究基于電力電子網絡的變流系統,對復雜電力電子裝置的系統級集成具有重要意義,是電力電子系統集成技術的基本組成部分。本文從變流系統的功率流和信息流雙重分布性的角度出發。對電力電子系統網絡(Power Electronics System Network,PES—Net)的模型和變流系統的通信需求進行分析,提出實時電力電子系統網絡(Real—time power electronics system network,RT—PES—Net);并對基于新網絡的分布式控制及管理方案和模塊化軟件方案等內容進行系統的研究,提出基于棧操作的實時軟件構建方案。本文的研究將為變流系統的控制結構和軟件方案標準化提供參考和理論依據,為應用系統的集成提供解決方案。 復雜中大功率變流系統是網絡化分布式控制系統的應用對象。首先,論文以復雜系統為研究對象,分析了應用系統的功率流和信息流在空間結構上的對偶關系和雙重分布的特性;在電力電子集成模塊(Power Electronics Building Blocks,PEBB)的基礎上,研究了變流系統的網絡化分布式控制方案,并得出系統組構的初步構想,總結出適合復雜電力電子系統集成的標準化理論。 接著,論文對電力電子網絡模型進行了研究。分析了現有各類總線網絡和目前用于電力電子應用系統的網絡,從結構、速率和協議等各個方面將兩類網絡進行了系統的對比。明確了電力電子系統網絡(PES—Net)的定義,分析并總結復雜電力電子實時系統所需網絡必需具備的條件。根據現有網絡技術背景,綜合控制結構和網絡需求,提出了電力電子系統網絡(PES—Net)的模型。 為滿足變流系統的實時控制,論文對分布式控制結構的通信需求進行了研究。以網絡控制系統(Networked Control System,NCS)為背景,對變流器系統控制信息延時因素進行了分析;通過對典型電力電予系統的分析,歸納和總結了系統的控制功能和控制內容,對系統不同層次的控制任務進行了響應時間需求分析和網絡的分層配置;通過對仿真結果的分析,研究了應用系統內模塊控制信息延時對不同應用系統的性能影響和對開關頻率的限制。根據變流系統對控制延時的接受程度,將電力電子復雜系統歸為兩大類:1)零延時系統;2)定延時系統。針對上述兩類系統,論文給出了電力電子網絡(PES—Net)的通道容量和應用系統開關周期的計算方法。 論文對開放式、分布式的電力電子系統網絡(PES—Net)的硬件組成和同步方案進行了研究,提出新的實時網絡和系統級集成方案。根據主節點和從節點的控制任務需求,分別從功能和系統結構的角度對開放式網絡的硬件構成進行研究;根據控制系統的接口需求分析,對節點的通用性設計進行重點討論。針對網絡的同步問題,本文分析了簡單有效的解決方法,即基于數據結構的同步補償方案;此外,論文提出基于實時高速電力電子系統同絡(RT-PES-Net)的同步方案,研究適合變流器實時控制的網絡結構和相應的硬件配置。根據應用控制和通信系統所需的各種操作,論文對實時網絡的管理進行了討論,研究了信息幀管理和相應的硬件設置,并對各種工作模式下所需的通信時間進行了計算和比較。基于實時網絡系統及其管理方案,論文給出了組構以PEBB為基礎的變流系統的方案。 論文對基于RT-PES-Net的模塊化軟件方案進行了研究。首先,將控制軟件與功率硬件進行解耦,使得軟件設計與硬件部分分離。在分析電力電子軟件特性的前提下,論文提出基于棧操作的模塊化軟件方案,增加子程序實時構件的內聚性;對軟件模塊化的通用性進行研究,分析模塊接口參數和變量的申明和配置,并研究參數的定標,對構件進行分類;分析子程序實時構件在執行速度上的優點。論文對電力電子系統控制軟件(Powerr Electronics System Control Software,PES-CS)的組構和集成進行研究,簡化軟件主框架。 最后,論文分別對RT-PES-Net和模塊化軟件方案進行了相應的實驗研究和分析。論文對提出的實時電力電子系統網絡(RT-PES-Net)進行了通信實驗,將新網絡拓撲對變流系統的延時影響與舊網絡系統的延時影響進行比較,總結新網絡系統在控制實時性、提高開關頻率、網絡可擴展性和管理靈活度等方面的優勢。論文針對RT-PES-Net進行應用研究,驗證該網絡可解決網絡通信失步所造成的問題。論文對基于通用型實時構件和棧操作的模塊化軟件方案進行實驗驗證,為標準化軟件庫的建立和系統級集成提供參考方案。 網絡化的控制結構研究是復雜電力電子系統級集成研究的關鍵。本課題針對復雜變流系統提出了實時電力電子系統網絡(RT-PES-Net),并以該網絡為基礎對分布式控制結構及相應的網絡化管理方案和模塊化軟件方案展開一系列研究,為電力電子控制系統提供標準化、開放式的網絡參考體系,并以此結構來快速構建終端復雜變流系統,為實現標準的應用系統組構提供參考方案,有助于解決電力電子標準化推廣所面臨的難題。論文為應用系統的即插即用和動態重構提供了研究基礎,從而為最終實現復雜變流器的應用系統級集成提供系統化的理論和方法依據。同時,論文的研究開拓了電力電子系統集成和標準化研究的一個新方向。

    標簽: 電力電子 網絡 系統研究

    上傳時間: 2013-06-15

    上傳用戶:silenthink

  • 基于DSP實現G729語音編碼算法.rar

    高速發展的DSP技術為語音信號處理領域提供了良好的發展平臺,使得實時實現各種復雜的算法稱為可能。G.729語音編碼是國際電信聯盟(ITU-T)于1996年獲準通過的采用共軛結構代數碼激勵線性預測技術的具有8 kbit/s碼速率的語音算法建議,廣泛應用于數字移動通信、IP電話和數字衛星通信中。本文研究了G.729語音編碼原理和在TMS320C5416定點DSP芯片上實時實現該編碼器過程中的軟、硬件設計。主要涉及有以下幾方面內容: 1.介紹語音編碼技術和DSP技術的發展概況。 2.研究了基于CELP結構的G.729編碼的算法原理。 3.根據G.729聲碼器實時實現的需要,介紹硬件平臺的組成,研究了系統軟件的設計和基于算法和實時需要的軟件優化。 4.利用DSP代碼調試工具對系統性能進行分析,得出測試結果。

    標簽: G729 DSP 語音編碼

    上傳時間: 2013-07-11

    上傳用戶:woshiayin

  • 基于FPGA的OFDM基帶系統研究.rar

    近幾年來,OFDM(Orthogonal Frequency Division Multiplexing)技術引起了人們的廣泛注意,根據這項新技術,很多相關協議被提出來。其中WiMax(Wireless MetropolitanArea Networks)代表空中接口滿足IEEE 802.16標準的寬帶無線通信系統,IEEE標準在2004年定義了空中接口的物理層(PHY),即802.16d協議。該協議規定數據傳輸采用突發模式,調制方式采用OFDM技術,傳輸速率較高且實現方便、成本低廉,已經成為首先推廣應用的商業化標準。 本文主要對IEEE802.16d OFDM系統物理層進行研究,并在XILINX公司的Virtexpro II芯片上實現了基帶算法。 首先討論了OFDM基本原理及其關鍵技術。根據IEEE802.16d OFDM系統的物理層發送端流程搭建了基帶仿真鏈路,利用MATLAB/SIMULINK仿真了OFDM系統在有無循環前綴(CP)、多徑數目不同等情況下的性能變化。由于同步算法和信道估計算法計算量都很大,為了找到適合采用FPGA實現的算法,分析了同步誤差和不同信道估計算法對接收信號的影響,并結合計算量的大小提出了一種新的聯合同步算法,以及得出了LS信道估計算法最適合802.16d系統的結論。 其次,完成了基帶發射機和接收機的FPGA硬件電路實現。為了使系統的時鐘頻率更高,采用了流水線的結構。設計中采用編寫Verilog程序和使用IP核相結合的辦法,實現了新的聯合同步算法,并且通過簡化結構,避免了信道估計算法中的繁瑣除法。利用ISE9. 2i和Modelsim6.Oc軟件平臺對程序進行設計、綜合和仿真,并將仿真結果和MATLAB軟件計算結果相對比。結果表明,采用16位數據總線可達到理想的精度。 最后,采用串口通信的方式對基帶系統進行了驗證。通過串口通信從功能上表明該系統確實可行。 關鍵詞:IEEE802. 16d; OFDM; 同步;信道估計;基帶系統

    標簽: FPGA OFDM 基帶

    上傳時間: 2013-07-31

    上傳用戶:1757122702

  • 射頻功放數字預失真技術研究及其FPGA實現.rar

    隨著無線通信技術的不斷發展和社會需求的日益增長,對通信系統的傳輸質量和容量的要求也越來越大。現代通信系統為了追求更高的數據速率和頻譜效率,更趨向于采用非恒定包絡的調制方式,而非恒定包絡調制方式對功率放大器的非線性非常敏感,加上現代通信系統對功率放大器的效率提出了更高的要求,以及功率放大器本身有限的線性度,這就使功率放大器線性化技術成為無線通信系統的關鍵技術之一。 本文對功率放大器的線性化技術進行了系統的研究。首先,介紹功率放大器的非線性特性、記憶效應產生原理和常見的各種線性化技術,重點研究了目前流行的自適應數字預失真技術原理。其次,介紹了功率放大器的無記憶模型和有記憶模型,以及兩種實用的預失真實現方法--查表法和多項式法,在此基礎上重點研究了基于QRD_RLS自適應算法的記憶多項式法預失真技術,對該算法進行了Matlab仿真分析,為后面的FPGA實現奠定基礎。最后,確定了數字預失真實現的架構,介紹了與QRD_RLS算法實現相關的CORDIC技術、復數Givens旋轉及Systolic陣等原理,詳細闡述了基于CORDIC技術的復數QRD_RLS算法的Systolic實現,從而在FPGA上實現了數字預失真。 在軟件無線電思想的指導下,本文利用System Generator軟件完成了基于QRD_RLS算法的記憶多項式法的數字預失真的FPGA設計,并且在硬件平臺上檢驗了預失真效果。

    標簽: FPGA 射頻功放 數字預失真

    上傳時間: 2013-04-24

    上傳用戶:84425894

  • 基于USB2.0FPGA的高速數據采集系統的研究與設計.rar

    隨著科學技術的快速發展和數據采集系統的廣泛應用,人們對數據采集系統的速度、精度、易操作性以及實時性的要求也在不斷地提高。通用串行總線USB作為一種新型的微機總線接口規范,以其使用方便、易于擴展、速度快等優點而被廣泛地應用于數據采集系統中。現場可編程門陣列最大的特點是結構靈活,開發周期較短,適合于實時信號處理,已被廣泛應用于通信、數據采集、圖像處理等諸多領域。 @@ 本文充分利用USB和FPGA的上述優點,設計了一種基于USB2.0技術和FPGA技術相結合的高速數據采集系統。 @@ 首先,對數據采集基本理論及系統相關技術進行了簡單地介紹。 @@ 其次,對以ADC轉換器(TLC5510)、FPGA芯片(EP1C6Q240C8)為控制器和USB接口芯片(CY7C68013A-56,簡稱FX2)為主的數據采集系統進行了硬件設計和分析,并在此設計的基礎上給出相應的原理圖、PCB。硬件設計主要包括FPGA與ADC和FX2之間的接口電路設計以及硬件邏輯設計。 @@ 再次,根據系統需求,對系統軟件部分進行了設計,分三部分:一是為滿足FX2在USB上的最大傳輸速率而編寫的固件程序;二是在PC機中的WindowsXP系統下利用GPD編寫USB設備驅動程序;三是充分了解FX2的主要功能特點,并編寫出應用程序。 @@ 最后,對系統的軟硬件進行了調試,給出了調試結果和分析,對出現的問題給出了解決方案。結果表明,系統符合設計要求。 @@關鍵詞:USB2.0;FPGA;SOPC;數據采集;固件;

    標簽: FPGA USB 2.0

    上傳時間: 2013-06-21

    上傳用戶:cath

  • 基于FPGA的通用異步收發器的設計.rar

    通用異步收發器(Universal Asynchronous Receiver Transmitter,UART)是一種能同時支持短距離和長距離數據傳輸的串行通信接口,被廣泛應用于微機和外設之間的數據交換。像8251、NS8250、NS16550等都是常用的UART芯片,但是這些專用的串行接口芯片的缺點是數據傳輸速率比較慢,難以滿足高速率數據傳輸的場合,而更重要的就是它們都具有不可移植性,因此要利用這些芯片來實現PC機和FPGA芯片之間的通信,勢必會增加接口連線的復雜程度以及降低整個系統的穩定性和有效性。 本課題就是針對UART的特點以及FPGA設計具有可移植性的優勢,提出了一種基于FPGA芯片的嵌入式UART設計方法,其中主要包括狀態機的描述形式以及自頂向下的設計方法,利用硬件描述語言來編制UART的各個子功能模塊以及頂層模塊,之后將其集成到FPGA芯片的內部,這樣不僅能解決傳統UART芯片的缺點而且同時也使整個系統變得更加具有緊湊性以及可靠性。 本課題所設計的LIART支持標準的RS-232C傳輸協議,主要設計有發送模塊、接收模塊、線路控制與中斷仲裁模塊、Modem控制模塊以及兩個獨立的數據緩沖區FIFO模塊。該模塊具有可變的波特率、數據幀長度以及奇偶校驗方式,還有多種中斷源、中斷優先級、較強的抗干擾數據接收能力以及芯片內部自診斷的能力,模塊內分開的接收和發送數據緩沖寄存器能實現全雙工通信。除此之外最重要的是利用IP模塊復用技術設計數據緩沖區FIFO,采用兩種可選擇的數據緩沖模式。這樣既可以應用于高速的數據傳輸環境,也能適合低速的數據傳輸場合,因此可以達到資源利用的最大化。 在具體的設計過程中,利用Synplify Pro綜合工具、ModelSim仿真工具、ISE集成的軟件開發環境中對各個功能模塊進行綜合優化、仿真驗證以及下載實現。各項數據結果表明,本課題中所設計的UART滿足預期設計目標。

    標簽: FPGA 異步收發器

    上傳時間: 2013-08-02

    上傳用戶:rocketrevenge

  • 基于FPGA的高速矩陣運算算法研究.rar

    矩陣運算是描述許多工程問題中不可缺少的數學關系,矩陣運算具有執行效率好、速度快、集成度高等優點,并且隨著動態可配置技術的發展,靈活性也有了很大的提高。因此,尋找矩陣運算的高速實現方法是具有很大的現實意義,能夠為高速運算應用提供技術支持。 為了提高研究成果的實用性與商用性,本文主要針對某種體積小、運算速度和性能要求很高的特殊場合設計并實現基于FPGA的矩陣運算功能。通過系統地研究FPGA功能結構、設計原理、DSP接口、IEEE-754標準,深入學習浮點數及矩陣的基礎運算以及硬件編程語言等內容,根據矩陣運算的特點和原理,討論了硬件設計方面重點對具體核心器件結構、特點以及有關FPGA的設計流程和控制器Verilog HDL硬件編程語言代碼方面內容,確定了基于FPGA浮點運算及矩陣運算單元的Verilog HDL設計方法,在Quartus II平臺上對其仿真、記錄運算結果,并對采集到的數據結果進行了深入分析與總結。 本設計通過幾種矩陣算法利用FPGA和MATLAB分別進行了實現測試,驗證了設計結果的正確性,證明了本設計中矩陣運算速率的實用性與高效性,提高了系統資源利用率和系統可靠性,為今后在工程、軍事、通訊等生產生活各個領域應用打下良好基礎。

    標簽: FPGA 矩陣運算 算法研究

    上傳時間: 2013-07-07

    上傳用戶:xuanjie

  • 基于FPGA的SATAⅡ協議研究與實現.rar

    現代的計算機追求的是更快的速度、更高的數據完整性和靈活性。無論從物理性能,還是從電氣性能來看,現今的并行總線都已出現了某些局限,無法提供更高的數據傳輸率。而SATA以其傳輸速率快、支持熱插拔、可靠的數據傳輸等特點,得到各行業越來越多的支持。 目前市場上的SATA IP CORE都是面向IC設計的,不利于在FPGA上集成,因此,本文在Xilinx公司的Virtex5系列FPGA上實現SATAⅡ協議,對SATA技術的推廣、國內邏輯IP核的發展都有一定的意義。 本文將SATAⅡ協議的FPGA實現劃分成物理層、鏈路層、傳輸層和應用層四個模塊。提出了物理層串行收/發器設計以及物理鏈路初始化方案。分析了鏈路層模塊結構,給出了作為SATAⅡ鏈路層核心的狀態機的設計。為滿足SATAⅡ協議3.0Gbps的速率,采用擴大數據處理位寬的方法,設計完成了鏈路層的16b/20b編碼模塊,同時為提高數據傳輸可靠性和信號的穩定性,分別實現了鏈路層CRC校驗模塊和并行擾碼模塊。在描述協議傳輸層的模塊結構的基礎上,給出了作為傳輸層核心的狀態機的設計,并以DMA DATA OUT命令的操作為例介紹了FIS在傳輸層中的處理過程。完成了命令層協議狀態機的設計,并實現了SATAⅡ新增功能NCQ技術,從而使得數據傳輸更加有效。最后為使本設計應用更加廣泛,設計了基于AHB總線的用戶接口。 本設計采用Verilog HDL語言對需要實現的電路進行描述,并使用Modelsim軟件仿真。仿真結果表明,本文設計的邏輯電路可靠穩定,與SATAⅡ協議定義功能一致。

    標簽: FPGA SATA 協議研究

    上傳時間: 2013-06-16

    上傳用戶:cccole0605

  • 基于CCSDS標準的幀同步算法研究及其FPGA實現.rar

    隨著航天技術的發展,載人飛船、空間站等復雜航天器對空-地或空-空之間數據傳輸速率的要求越來越高。在此情況下,為了提高空間通信中數據傳輸的可靠性,保證接收端分路系統能和發送端一致,必須要經過幀同步。對衛星基帶信號處理來說,幀同步是處理的第一步也是關鍵的一步。只有正確幀同步才能獲取正確的幀數據進行數據處理。因此,幀同步的效率,將直接影響到整個衛星基帶信號處理的結果。 @@ 本設計在研究CCSDS標準及幀同步算法的基礎上,利用硬件描述語言及ISE9.2i開發平臺在基于FPGA的硬件平臺上設計并實現了單路數據輸入及兩路合路數據輸入的幀同步算法,并解決了其中可能存在的幀滑動及模糊度問題。在此基礎之上,針對兩路合路輸入時可能存在的兩路輸入不同步或幀滑動在兩路中分布不均勻問題,設計實現了兩路并行幀同步算法,并利用ModelSim SE 6.1f工具對上述算法進行了前仿真和后仿真,仿真結果表明上述算法符合設計要求。 @@ 本論文首先介紹了課題研究的背景及國內外研究現狀,其次介紹了與本課題相關的基礎理論及系統的軟硬件結構。然后對單路數據輸入幀同步、兩路數據合路輸入幀同步和兩路并行幀同步算法的具體設計及實現過程進行了詳細說明,并給出了后仿真結果及結果分析。最后,對論文工作進行了總結和展望,分析了其中存在的問題及需要改進的地方。 @@關鍵詞 FPGA;CCSDS;幀同步:模糊度;幀滑動

    標簽: CCSDS FPGA 標準

    上傳時間: 2013-06-11

    上傳用戶:liglechongchong

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