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光<b>回波</b>

VIP專區-嵌入式/單片機編程源碼精選合集系列（16）

VIP專區-嵌入式/單片機編程源碼精選合集系列（16）資源包含以下內容：1. OHMETER/TEMPERATURE SENSING PROGRAM for pic16c5x.2. VOLTMETER/AD CONVERTER PROGRAM.3. Interface HT1621 to PIC16C5X.4. linux pda 輸入法.5. PDA上的X86模擬器.6. verilog浮點乘發器.7. verilog浮點乘發器.8. verilog浮點乘發器.9. verilog浮點乘發器.10. c語言浮點乘發器.11. 我自己寫的ds1820b溫度測量程序.12. verilog寫的回波抵消程序.13. DMDD的嵌入式系統構件源代碼.14. AVR pocsag解碼.15. ATMEL-Wireless and Microcontrollers 2000 flash api.16. 液晶GXM12232的間接訪問源碼。僅供參考。.17. 24c256的編程。（改載）.18. 實用遙控器解碼程序.19. 實用遙控器編碼程序1.20. 偽隨機序列編碼源程序.21. 凌陽數據采集遠程.22. cpld數據采集測頻.23. 鍵盤設計 ,好東東啊.24. ADUC8XX代碼.25. ADUC8XX代碼.26. ADUC8XX代碼.27. PPC上可以在對話框中加入菜單的例程（兩種方式實現）.28. 公開源代碼的嵌入式操作系統r&s!建議學習！.29. SHOWFAT 顯示磁盤FAT信息.30. WINHEX11V2 顯示磁盤及文件信息.31. 步進電機控制試驗.32. Test Timer_A PWM Functions.33. 嵌入式操作系統及開發環境by 李駒光.34. 類linux操作系統的源代碼.35. MiniWeb 在嵌入式平臺上運行的WEB源代碼.36. 嵌入式http源代碼的文檔資料.37. ucfs2004.38. 幾個值得學習的C源程序.39. 基于44b0X核心的開發板的源代碼.40. 能夠測轉速的小程序.

標簽： 公差實用技術

上傳時間： 2013-04-15

上傳用戶：eeworm
液位測量中的信號采集與處理

在超聲波探頭上施加一電脈沖信號，探頭發出超聲波，在遇到不同介質界面時被反射，超聲波探頭接收回波并將之變為電脈沖信號。利用P89LPC935 的捕捉功能測量發射波和回波之間的時間間隔，通過環境溫

標簽： 液位測量信號采集

上傳時間： 2013-06-06

上傳用戶：cee16
基于FPGA的雷達信號處理系統設計.rar

雷達信號處理是雷達系統的重要組成部分。在數字信號處理技術飛速發展的今天，雷達信號處理中也普遍使用數字信號處理技術。而現場可編程門陣列（FPGA）在數字信號處理中的廣泛應用，使得FPGA在雷達信號處理中也占據了重要地位。針對脈壓雷達信號處理的FPGA實現，本文在以下幾個方面展開研究：首先對幾種主要的脈沖壓縮信號進行了詳細的分析，得出了各種信號的特點及其處理方式；并比較了各種方式的優缺點。其次對幾種基本的雷達信號處理如脈沖壓縮、動目標檢測（MTD）、恒虛警（CFAR）等詳細地闡述了其原理；列舉了各種信號處理經常采用的實現方法，對各種方法進行了比較研究；并針對線性調頻信號在MATLAB環境中對雷達回波信號處理進行仿真。接下來，在Xilinx ISE6.3i軟件集成環境下，通過對Xilinx提供的免費IP核的調用，并與VHDL語言相結合，進行雷達信號處理的FPGA實現。

標簽： FPGA 雷達信號處理系統設計

上傳時間： 2013-06-24

上傳用戶：lingzhichao
高分辨率合成孔徑雷達視頻模擬器FPGA實現技術研究

在合成孔徑雷達的研究和研制工作中，合成孔徑雷達模擬技術具有十分重要的作用。本文以440MHz帶寬線性調頻信號，采樣頻率500MHz高分辨合成孔徑雷達視頻模擬器為研究對象。首先對模擬器的幾項主要技術進行分析，在對點目標回波信號模型分析研究的基礎上，對點目標原始回波數據進行模擬并做了成像驗證，從而為硬件實現提供了正確的信號模型；針對傳統的“波形存儲直讀法”方案，即在計算機平臺上用模擬軟件產生原始回波數據并存儲，再通過計算機接口實現數據傳輸，最后完成數模轉換產生視頻信號這一過程，分析指出該方案在實現高分辨率時的速度和容量瓶頸。　　針對具體的設計要求，圍繞速度和容量問題，本文著眼于高分辨率SAR模擬器的FPGA實現研究，指出FPGA實時生成點目標原始回波數據是其實現的核心；針對這一核心問題，充分利用現代VLSI設計中的流水線技術與并行陣列技術以及FPGA的優良性能和豐富資源，在時間上采用同步流水結構、空間上采用并行陣列形式，將速度和容量問題統一為數據的高速生成問題；給出了系統總體設計思想，該方案不需要大容量存儲器單元，大大減少模擬器復雜度；對原始回波數據實時生成模塊的各主要單元給出了結構并進行了仿真，結果表明FPGA可以滿足課題設計要求；同時，對該模擬器片上系統的實現、增強人機交互性，給出了人機界面的設計思路。　　分析指出了點目標原始回波數據實時生成模塊通過并行擴展即可實現多點目標的原始回波數據實時生成；最后對復雜場景目標模擬器的實現進行了構思，指出了傳統方案在改進的基礎上實現高分辨率視頻模擬器的可行性。本文首次提出以FPGA實現高分辨率合成孔徑雷達原始回波數據實時生成的思想，為國內業界在此方向做了一些理論和實踐上的有益探索，對于國內高分辨率合成孔徑雷達的研制具有一定的實際意義。

標簽： FPGA 高分辨率合成孔徑雷達視頻

上傳時間： 2013-04-24

上傳用戶：阿四AIR
基于USB和FPGA技術的高性能數據采集模塊的設計與實現

在合成孔徑雷達的研究和研制工作中，合成孔徑雷達模擬技術具有十分重要的作用。本文以440MHz帶寬線性調頻信號，采樣頻率500MHz高分辨合成孔徑雷達視頻模擬器為研究對象。首先對模擬器的幾項主要技術進行分析，在對點目標回波信號模型分析研究的基礎上，對點目標原始回波數據進行模擬并做了成像驗證，從而為硬件實現提供了正確的信號模型；針對傳統的“波形存儲直讀法”方案，即在計算機平臺上用模擬軟件產生原始回波數據并存儲，再通過計算機接口實現數據傳輸，最后完成數模轉換產生視頻信號這一過程，分析指出該方案在實現高分辨率時的速度和容量瓶頸。　　針對具體的設計要求，圍繞速度和容量問題，本文著眼于高分辨率SAR模擬器的FPGA實現研究，指出FPGA實時生成點目標原始回波數據是其實現的核心；針對這一核心問題，充分利用現代VLSI設計中的流水線技術與并行陣列技術以及FPGA的優良性能和豐富資源，在時間上采用同步流水結構、空間上采用并行陣列形式，將速度和容量問題統一為數據的高速生成問題；給出了系統總體設計思想，該方案不需要大容量存儲器單元，大大減少模擬器復雜度；對原始回波數據實時生成模塊的各主要單元給出了結構并進行了仿真，結果表明FPGA可以滿足課題設計要求；同時，對該模擬器片上系統的實現、增強人機交互性，給出了人機界面的設計思路。　　分析指出了點目標原始回波數據實時生成模塊通過并行擴展即可實現多點目標的原始回波數據實時生成；最后對復雜場景目標模擬器的實現進行了構思，指出了傳統方案在改進的基礎上實現高分辨率視頻模擬器的可行性。本文首次提出以FPGA實現高分辨率合成孔徑雷達原始回波數據實時生成的思想，為國內業界在此方向做了一些理論和實踐上的有益探索，對于國內高分辨率合成孔徑雷達的研制具有一定的實際意義。

標簽： FPGA USB 性能數據采集模塊

上傳時間： 2013-05-26

上傳用戶：alia
磁共振用超導磁體的磁場均勻性研究

隨著生物工程及醫學影像學的發展，磁共振成像在醫學診斷學方面發揮著越來越重要的角色。磁場的均勻性是大型醫療設備——核磁共振(MRI)成像的理論基礎，是評價該設備的一個重要的技術參數，磁場的均勻性分析也是電磁場理論分析的一個重要方向。良好、穩定的磁場均勻性對核磁共振圖像的信噪比(SNR)的提高有重要的意義，同時也是飽和壓脂序列實現的唯一條件。該課題的主要內容是在介紹磁共振成像原理與磁共振超導磁體的超導勻場線圈的形狀及位置的基礎上，分析各個線圈中電流的大小與空間某點磁場強度的關系。同時借鑒磁共振成像原理，設計輔助測量水膜，對空間某一特定半徑的球體腔內各點的磁場強度進行自動化測量。在當前使用的被動式勻場的基礎上，利用分析軟件，對線圈的選擇及電流的大小進行計算與優化。實驗結果表明效果良好，磁場均勻度有很大的改善。采用的主要方法是利用磁共振成像原理及傅里葉轉化技術去設計一種精確、方便、快捷的勻場方法。通過計算機模擬及有限元分析的方法進行計算、優化，最終得到理想的磁場均勻度。良好的磁場均勻性是磁共振成像的基礎，是飽和壓脂序列(FATSAT)、平面回波成像(EPI)、彌散成像、頻譜分析等一系列近幾年新出現的先進序列實現的前提條件。從而為臨床醫學提供了一種先進的檢查手段，為疾病診治的及時性、準確性、可靠性及病灶確切位置的判斷都提供了基礎。該文所介紹的磁場均勻性測量、分析方法以及在此基礎上設計的勻場計算分析軟件已在多臺磁共振安裝調試過程中得到應用，達到了預期的目的，能夠滿足現場調試的要求。該方法對于今后超導磁體磁共振的磁場均勻性調試，及在醫學影像學方面的發展有很好的應用價值。該項技術在該領域的推廣必然會提高磁場均勻性的精度，推動醫學影像學及臨床診斷學的發展。并能帶來良好的社會效益及經濟效益，具有關闊的應用前景。

標簽： 磁共振超導磁體磁場

上傳時間： 2013-04-24

上傳用戶：tianjinfan
基于AT89C52單片機的多超聲信號融合處理系統設計

本文設計并實現了一種多超聲信號融合處理系統，主要用于移動機器人超聲測距導航。系統針對超聲回波信號的特點，使用AT89C52 單片機對來自多個超聲波傳感器的微弱回波信號進行數字處理，并通過RS-

標簽： 89C C52 AT 89

上傳時間： 2013-07-14

上傳用戶：kbnswdifs
基于ARM的超聲波液位計的研制

液位是工業生產中常見的測量參數，化工、石油、污水處理等各類工廠企業都要進行液位測量。目前，液位檢測技術飛速發展，新的液位測量儀表量程大、精度高、功能全，我國新型液位儀表大多依靠進口。由于超聲波測量液位具有非接觸測量、可測低溫介質、能夠定點和連續測量等優點，近年來，超聲液位測量技術取得了長足的進步，己成功應用于江河水位、化學和制藥工業、食品加工、罐裝液位等多種領域。本文研制的是基于ARM的超聲波液位計。傳統的超聲波液位計一般使用8位的單片機作處理器，采用電子元件捕捉到超聲波回波信號后產生中斷，判斷超聲波的傳播時間。本文提出了使用32位ARM芯片做處理器，采用數字信號處理的方法來判斷超聲波傳播時間的設計方案。本文使用高性能的ARM7TDMI-S內核的芯片LPC2119作為系統的運算控制器，加強了系統對超聲波回波信號的處理能力；使用A/D轉換器將回波信號轉換為數字信號，采用數字濾波處理信號，利用數值處理來判斷超聲波回波信號的起始點，提高了液位的測量精度；采用單換能器收發一體式電路設計，簡化了液位的計算；利用LPC2119芯片內部的CAN總線控制器設計了CAN總線通信接口；選用一線式數字溫度傳感器DSl8820進行溫度補償，避免了由于環境溫度的變化而產生的測量誤差。ARM芯片豐富的內部資源和I/0口線有利于今后擴展功能，升級系統。本超聲波液位計使用方便，精度高，能滿足工業生產中的要求。

標簽： ARM 超聲波液位計

上傳時間： 2013-04-24

上傳用戶：lwt123
基于ARM的雷達信號處理系統的研究

隨著信息技術的飛速發展，人們對數據采集、信號處理的要求越來越高：不僅要求高速、高精度和高實時，還要求數據采集，處理設備便攜化、網絡化和智能化，并具有友好的人機界面。傳統的8/16位單片機因資源極度受限，難以滿足上述要求；而傳統的信號處理過程都是依賴于PC完成，則存在著安裝麻煩、價格昂貴且電磁兼容性差等缺點。嵌入式系統是一個快速發展的領域，嵌入式系統的研究內容涉及到計算機學科的各個方面。將嵌入式系統引入雷達信號處理系統，能極大的提高系統的實時性和靈活性。本文的研究正是基于ARM的雷達信號處理系統。本文在對線性調頻連續波雷達測速測距研究的基礎上，討論了一種軟硬件配置靈活、結構精簡的雷達信號處理系統，其硬件平臺以ARM處理器，可編程邏輯器件FPGA，和DSP為核心，擴展了UART、LCD、網口、IDE、觸摸屏、PS/2和USB等外圍接口，可實現對線性調頻連續波雷達回波信號進行數據采集、脈沖壓縮、恒虛警檢測、航跡相關，航跡顯示等處理，相關數據的存儲。在軟件設計方面，完成Bootloader，Linux2.4操作系統在系統上的移植，在此基礎上對實現了對網口、IDE、LCD等模塊的驅動程序編寫，并在MiniGUI上進行基于顯示終端需求的圖形用戶界面開發。

標簽： ARM 雷達信號處理系統

上傳時間： 2013-04-24

上傳用戶：Shoen
可重構FPGA通訊糾錯進化電路及其實現

ASIC對產品成本和靈活性有一定的要求.基于MCU方式的ASIC具有較高的靈活性和較低的成本,然而抗干擾性和可靠性相對較低,運算速度也受到限制.常規ASIC的硬件具有速度優勢和較高的可靠性及抗干擾能力,然而不是靈活性較差,就是成本較高.與傳統硬件(CHW)相比,具有一定可配置特性的場可編程門陣列(FPGA)的出現,使建立在可再配置硬件基礎上的進化硬件(EHW)成為智能硬件電路設計的一種新方法.作為進化算法和可編程器件技術相結合的產物,可重構FPGA的研究屬于EHW的研究范疇,是研究EHW的一種具體的實現方法.論文認為面向分類的專用類可重構FPGA(ASR-FPGA)的研究,可使可重構電路粒度劃分的針對性更強、設計更易實現.論文研究的可重構FPGA的BCH通訊糾錯碼進化電路是一類ASR-FPGA電路的具體方法,具有一定的實用價值.論文所做的工作主要包括:(1)BCH編譯碼電路的設計——求取實驗用BCH碼的生成多項式和校驗多項式及其相應的矩陣并構造實驗用BCH碼;(2)建立基于可重構FPGA的基核——構造具有可重構特性的硬件功能單元,以此作為可重構BCH碼電路的設計基礎;(3)構造實現可重構BCH糾錯碼電路的方法——建立可重構糾錯碼硬件電路算法并進行實驗驗證;(4)在可重構糾錯碼電路基礎上,構造進化硬件控制功能塊的結構,完成各進化RLA控制模塊的驗證和實現.課題是將可重構BCH碼的編譯碼電路的實現作為一類ASR-FPGA的研究目標,主要成果是根據可編程邏輯電路的特點,選擇一種可編程樹的電路模型,并將它作為可重構FPGA電路的基核T;通過對循環BCH糾錯碼的構造原理和電路結構的研究,將基核模型擴展為能滿足糾錯碼電路需要的糾錯碼基本功能單元T;以T作為再劃分的基本單元,對FPGA進行"格式化",使T規則排列在FPGA上,通過對T的控制端的不同配置來實現糾錯碼的各個功能單元;在可重構基核的基礎上提出了糾錯碼重構電路的嵌套式GA理論模型,將嵌套式GA的染色體串作為進化硬件描述語言,通過轉換為相應的VHDL語言描述以實現硬件電路;采用RLA模型的有限狀態機FSM方式實現了可重構糾錯碼電路的EHW的各個控制功能塊.在實驗方面,利用Xilinx FPGA開發系統中的VHDL語言和電路圖相結合的設計方法建立了循環糾錯碼基核單元的可重構模型,進行循環糾錯BCH碼的電路和功能仿真,在Xilinx公司的Virtex600E芯片進行了FPGA實現.課題在研究模型上選取的是比較基本的BCH糾錯碼電路,立足于解決基于可重構FPGA核的設計的基本問題.課題的研究成果及其總結的一套ASR-FPGA進化硬件電路的設計方法對實際的進化硬件設計具有一定的實際指導意義,提出的基于專用類基核FPGA電路結構的研究方法為新型進化硬件的器件結構的設計也可提供一種借鑒.

標簽： FPGA 可重構通訊糾錯

上傳時間： 2013-07-01

上傳用戶：myworkpost