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對(duì)光學(xué)系統(tǒng)中常用的正弦振幅型透射光柵進(jìn)行了仿真，仿真結(jié)果有衍射圖案和光強(qiáng)沿x軸方向的曲線(xiàn)。
標(biāo)簽： 光學(xué)系統(tǒng) 仿真 正弦 振幅
上傳時(shí)間： 2016-06-04
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運(yùn)用Matlab模擬波動(dòng)光光學(xué)的實(shí)驗(yàn)現(xiàn)象，包括小孔衍射，單縫衍射，雙縫衍射，分振幅，分波面干涉，以及多光路干涉。
標(biāo)簽： Matlab 模擬 光學(xué) 實(shí)驗(yàn)
上傳時(shí)間： 2016-10-16
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在常規(guī)超聲波檢測(cè)中獲取和識(shí)別衍射波的方法及其在工作實(shí)踐中的應(yīng)用
上傳時(shí)間： 2018-07-14
上傳用戶(hù)：mcsun
1前言光譜儀是測(cè)量光源和物質(zhì)光譜特性的重要裝置，它在顏色顯示，視覺(jué)效果比對(duì)和生物化學(xué)領(lǐng)域有著廣泛的應(yīng)用。近年來(lái)，電荷耦合器件CCD取得了飛速的發(fā)展，工藝日趨完善，已能批量制造完全沒(méi)有缺陷的高可靠性低成六的CCD芯片，這種器件有很寬的光譜響應(yīng)特性，完全可以代替感光乳劑，應(yīng)用在光譜測(cè)量上"，因此，設(shè)計(jì)出配合CCD光譜儀器使用的光學(xué)結(jié)構(gòu)對(duì)于儀器的小型化有著重大的意義.2微型CCD光譜儀的光學(xué)結(jié)構(gòu)設(shè)計(jì)2.1光柵的選擇與設(shè)計(jì)在光譜儀核心元件分光器件的發(fā)展歷程中，經(jīng)歷了色散校鏡到衍射光柵到采用干涉調(diào)制元件和信息變換技術(shù)的演化。近年來(lái)聲光調(diào)造器件AOTF的技術(shù)和應(yīng)用也有了很大發(fā)展，沒(méi)有機(jī)械活動(dòng)件，全固態(tài)、電子調(diào)諸.結(jié)構(gòu)小而牢周，可承受震動(dòng)沖擊等一系列優(yōu)點(diǎn)，使其具有明顯的技術(shù)和應(yīng)用競(jìng)爭(zhēng)力2.3。本設(shè)計(jì)中選擇閃耀光柵。因?yàn)楣馀锱c其他分光元件相比較，有許多優(yōu)點(diǎn)。首先，光柵的角色散率幾乎和波長(zhǎng)無(wú)關(guān)，這對(duì)光譜的波長(zhǎng)測(cè)量很有利。其二，光棚的分辨率比棱鏡大，價(jià)格也較低，其三，光柵不受材料透過(guò)率的限制，它可以在整個(gè)光學(xué)光譜區(qū)中應(yīng)用。
標(biāo)簽： ccd 光譜儀器 光學(xué)結(jié)構(gòu)
上傳時(shí)間： 2022-06-22
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傅立葉變換在科學(xué)與工程技術(shù)幾乎所有的領(lǐng)域里具有廣泛的應(yīng)用，但隨著研究范圍的不斷發(fā)展，也逐漸暴露出傅立葉變換在處理某些問(wèn)題時(shí)的局限性，體現(xiàn)在，它是一種全局性的變換，得到的是信號(hào)的整體頻譜，因而無(wú)法表述出信號(hào)的時(shí)頻局部信息，而這些特性正是非平穩(wěn)信號(hào)的最根本也是最關(guān)鍵的性質(zhì)，為了分析和處理這類(lèi)信號(hào)，分?jǐn)?shù)階傅立葉變換應(yīng)運(yùn)而生。目前，分?jǐn)?shù)階傅立葉變換已被應(yīng)用在解微分方程、量子力學(xué)、衍射理論和光學(xué)傳輸、光學(xué)系統(tǒng)和光信號(hào)處理、光圖像處理等許多方向。論文首先介紹了分?jǐn)?shù)階傅立葉變換的定義以及性質(zhì)。接著簡(jiǎn)要介紹了分?jǐn)?shù)階傅立葉變換在不同領(lǐng)域的應(yīng)用。將分?jǐn)?shù)階傅立葉變換的定義式分成三部分，推導(dǎo)出具體的實(shí)現(xiàn)方案，在時(shí)空二元性理論的基礎(chǔ)上，首先得到空間上的光學(xué)分?jǐn)?shù)階傅立葉變換的實(shí)現(xiàn)，也即采用兩個(gè)透鏡中間隔開(kāi)一定空間距離的方案。進(jìn)而類(lèi)比空間上的這種模型，給出時(shí)間上光學(xué)分?jǐn)?shù)階傅立葉變換的實(shí)現(xiàn)方式。基于推導(dǎo)出的分?jǐn)?shù)階傅立葉變換的實(shí)現(xiàn)，應(yīng)用到光脈沖在光纖中的傳輸上，我們研究了各種因素對(duì)脈沖傳輸過(guò)程中展寬壓縮分裂等現(xiàn)象的影響，分別為不同預(yù)啾系數(shù)時(shí)光脈沖在傳輸過(guò)程中的展寬快慢、不同階次的分?jǐn)?shù)階傅立葉變換后的傳輸性能、不同脈沖寬度的傳輸性能、不同脈沖光功率下的傳輸性能。并最終對(duì)這些不同因素對(duì)傳輸性能的影響進(jìn)行了分析、總結(jié)與展望。
上傳時(shí)間： 2022-06-25
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ASIC對(duì)產(chǎn)品成本和靈活性有一定的要求.基于MCU方式的ASIC具有較高的靈活性和較低的成本,然而抗干擾性和可靠性相對(duì)較低,運(yùn)算速度也受到限制.常規(guī)ASIC的硬件具有速度優(yōu)勢(shì)和較高的可靠性及抗干擾能力,然而不是靈活性較差,就是成本較高.與傳統(tǒng)硬件(CHW)相比,具有一定可配置特性的場(chǎng)可編程門(mén)陣列(FPGA)的出現(xiàn),使建立在可再配置硬件基礎(chǔ)上的進(jìn)化硬件(EHW)成為智能硬件電路設(shè)計(jì)的一種新方法.作為進(jìn)化算法和可編程器件技術(shù)相結(jié)合的產(chǎn)物,可重構(gòu)FPGA的研究屬于EHW的研究范疇,是研究EHW的一種具體的實(shí)現(xiàn)方法.論文認(rèn)為面向分類(lèi)的專(zhuān)用類(lèi)可重構(gòu)FPGA(ASR-FPGA)的研究,可使可重構(gòu)電路粒度劃分的針對(duì)性更強(qiáng)、設(shè)計(jì)更易實(shí)現(xiàn).論文研究的可重構(gòu)FPGA的BCH通訊糾錯(cuò)碼進(jìn)化電路是一類(lèi)ASR-FPGA電路的具體方法,具有一定的實(shí)用價(jià)值.論文所做的工作主要包括:(1)BCH編譯碼電路的設(shè)計(jì)——求取實(shí)驗(yàn)用BCH碼的生成多項(xiàng)式和校驗(yàn)多項(xiàng)式及其相應(yīng)的矩陣并構(gòu)造實(shí)驗(yàn)用BCH碼;(2)建立基于可重構(gòu)FPGA的基核——構(gòu)造具有可重構(gòu)特性的硬件功能單元,以此作為可重構(gòu)BCH碼電路的設(shè)計(jì)基礎(chǔ);(3)構(gòu)造實(shí)現(xiàn)可重構(gòu)BCH糾錯(cuò)碼電路的方法——建立可重構(gòu)糾錯(cuò)碼硬件電路算法并進(jìn)行實(shí)驗(yàn)驗(yàn)證;(4)在可重構(gòu)糾錯(cuò)碼電路基礎(chǔ)上,構(gòu)造進(jìn)化硬件控制功能塊的結(jié)構(gòu),完成各進(jìn)化RLA控制模塊的驗(yàn)證和實(shí)現(xiàn).課題是將可重構(gòu)BCH碼的編譯碼電路的實(shí)現(xiàn)作為一類(lèi)ASR-FPGA的研究目標(biāo),主要成果是根據(jù)可編程邏輯電路的特點(diǎn),選擇一種可編程樹(shù)的電路模型,并將它作為可重構(gòu)FPGA電路的基核T;通過(guò)對(duì)循環(huán)BCH糾錯(cuò)碼的構(gòu)造原理和電路結(jié)構(gòu)的研究,將基核模型擴(kuò)展為能滿(mǎn)足糾錯(cuò)碼電路需要的糾錯(cuò)碼基本功能單元T;以T作為再劃分的基本單元,對(duì)FPGA進(jìn)行"格式化",使T規(guī)則排列在FPGA上,通過(guò)對(duì)T的控制端的不同配置來(lái)實(shí)現(xiàn)糾錯(cuò)碼的各個(gè)功能單元;在可重構(gòu)基核的基礎(chǔ)上提出了糾錯(cuò)碼重構(gòu)電路的嵌套式GA理論模型,將嵌套式GA的染色體串作為進(jìn)化硬件描述語(yǔ)言,通過(guò)轉(zhuǎn)換為相應(yīng)的VHDL語(yǔ)言描述以實(shí)現(xiàn)硬件電路;采用RLA模型的有限狀態(tài)機(jī)FSM方式實(shí)現(xiàn)了可重構(gòu)糾錯(cuò)碼電路的EHW的各個(gè)控制功能塊.在實(shí)驗(yàn)方面,利用Xilinx FPGA開(kāi)發(fā)系統(tǒng)中的VHDL語(yǔ)言和電路圖相結(jié)合的設(shè)計(jì)方法建立了循環(huán)糾錯(cuò)碼基核單元的可重構(gòu)模型,進(jìn)行循環(huán)糾錯(cuò)BCH碼的電路和功能仿真,在Xilinx公司的Virtex600E芯片進(jìn)行了FPGA實(shí)現(xiàn).課題在研究模型上選取的是比較基本的BCH糾錯(cuò)碼電路,立足于解決基于可重構(gòu)FPGA核的設(shè)計(jì)的基本問(wèn)題.課題的研究成果及其總結(jié)的一套ASR-FPGA進(jìn)化硬件電路的設(shè)計(jì)方法對(duì)實(shí)際的進(jìn)化硬件設(shè)計(jì)具有一定的實(shí)際指導(dǎo)意義,提出的基于專(zhuān)用類(lèi)基核FPGA電路結(jié)構(gòu)的研究方法為新型進(jìn)化硬件的器件結(jié)構(gòu)的設(shè)計(jì)也可提供一種借鑒.
標(biāo)簽： FPGA 可重構(gòu) 通訊 糾錯(cuò)
上傳時(shí)間： 2013-07-01
上傳用戶(hù)：myworkpost
特點(diǎn)： 精確度0.1%滿(mǎn)刻度 可作各式數(shù)學(xué)演算式功能如:A+B/A-B/AxB/A/B/A&B(Hi or Lo)/|A|/ 16 BIT類(lèi)比輸出功能 輸入與輸出絕緣耐壓2仟伏特/1分鐘(input/output/power) 寬范圍交直流兩用電源設(shè)計(jì) 尺寸小,穩(wěn)定性高
標(biāo)簽： 微電腦 數(shù)學(xué)演算 隔離傳送器
上傳時(shí)間： 2014-12-23
上傳用戶(hù)：ydd3625
基于傅里葉計(jì)算全息技術(shù)，結(jié)合菲涅爾雙隨機(jī)相位加密系統(tǒng)，提出了一種數(shù)字圖像加密方法。該方法以傅里葉計(jì)算全息圖記錄菲涅爾衍射雙隨機(jī)相位加密圖像，傅里葉計(jì)算全息加密圖像隱藏了原圖像大小尺度信息，而且再現(xiàn)多個(gè)圖像，必須針對(duì)加密圖像共軛方可解密，提高了圖像加密的安全性，并且解決了普通方法加密圖像難存儲(chǔ)的問(wèn)題，作為原始明文的擁有者，兩個(gè)隨機(jī)相位板，應(yīng)用波長(zhǎng)，兩次菲涅爾衍射的距離都可作為解密密鑰。
上傳時(shí)間： 2013-10-23
上傳用戶(hù)：YYRR
特點(diǎn)(FEATURES) 精確度0.1%滿(mǎn)刻度 (Accuracy 0.1%F.S.) 可作各式數(shù)學(xué)演算式功能如:A+B/A-B/AxB/A/B/A&B(Hi or Lo)/|A| (Math functioA+B/A-B/AxB/A/B/A&B(Hi&Lo)/|A|/etc.....) 16 BIT 類(lèi)比輸出功能(16 bit DAC isolating analog output function) 輸入/輸出1/輸出2絕緣耐壓2仟伏特/1分鐘(Dielectric strength 2KVac/1min. (input/output1/output2/power)) 寬范圍交直流兩用電源設(shè)計(jì)(Wide input range for auxiliary power) 尺寸小,穩(wěn)定性高(Dimension small and High stability)
標(biāo)簽： 微電腦 數(shù)學(xué)演算 輸出 隔離傳送器
上傳時(shí)間： 2013-11-24
上傳用戶(hù)：541657925
a_bit equ 20h ;個(gè)位數(shù)存放處 b_bit equ 21h ;十位數(shù)存放處 temp equ 22h ;計(jì)數(shù)器寄存器 star: mov temp,#0 ;初始化計(jì)數(shù)器 stlop: acall display inc temp mov a,temp cjne a,#100,next ;=100重來(lái) mov temp,#0 next: ljmp stlop ;顯示子程序 display: mov a,temp ;將temp中的十六進(jìn)制數(shù)轉(zhuǎn)換成10進(jìn)制 mov b,#10 ;10進(jìn)制/10=10進(jìn)制 div ab mov b_bit,a ;十位在a mov a_bit,b ;個(gè)位在b mov dptr,#numtab ;指定查表啟始地址 mov r0,#4 dpl1: mov r1,#250 ;顯示1000次 dplop: mov a,a_bit ;取個(gè)位數(shù) MOVC A,@A+DPTR ;查個(gè)位數(shù)的7段代碼 mov p0,a ;送出個(gè)位的7段代碼
標(biāo)簽： 直接驅(qū)動(dòng) 數(shù)碼管 計(jì)數(shù)器 程序
上傳時(shí)間： 2013-11-06
上傳用戶(hù)：lx9076
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