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內(nèi)核設(shè)計

  • 基于EDA技術的單片機IP核設計

    本文介紹了利用EDA技術設計出與MCS-51系列微處理器指令集完全兼容的8位嵌入式微處理器芯片的IP核,并經過驗證獲得了滿意的效果。

    標簽: EDA 單片機 IP核

    上傳時間: 2013-10-28

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  • 基于EDA技術的單片機IP核設計

    本文介紹了利用EDA技術設計出與MCS-51系列微處理器指令集完全兼容的8位嵌入式微處理器芯片的IP核,并經過驗證獲得了滿意的效果。

    標簽: EDA 單片機 IP核

    上傳時間: 2013-11-14

    上傳用戶:qq1604324866

  • 一種基于8051核SoC引導程序的設計與實現

    引導程序的開發是系統芯片設計的重要組成部分。針對基于8051核的某控制系統芯片的具體要求,提出了一種系統芯片引導程序的設計策略。該策略思路是:當系統上電復位后,開始執行固化在系統芯片中的引導程序,并加載存儲于片外串行接口Flash的用戶程序到片內SRAM中;加載完成后,程序無條件跳到SRAM中執行用戶程序。在分析該系統芯片組成的基礎上,重點闡述了引導程序開發面臨的問題、解決的思路、引導程序的具體實現及開發編譯環境的配置。該方案對其它系統芯片引導程序的設計具有一定的參考價值。

    標簽: 8051 SoC 引導程序

    上傳時間: 2013-11-23

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  • 4x4鍵盤的設計與制作

    三種方法讀取鍵值􀂄 使用者設計行列鍵盤介面,一般常採用三種方法讀取鍵值。􀂉 中斷式􀂄 在鍵盤按下時產生一個外部中斷通知CPU,並由中斷處理程式通過不同位址讀資料線上的狀態判斷哪個按鍵被按下。􀂄 本實驗採用中斷式實現使用者鍵盤介面。􀂉 掃描法􀂄 對鍵盤上的某一行送低電位,其他為高電位,然後讀取列值,若列值中有一位是低,表明該行與低電位對應列的鍵被按下。否則掃描下一行。􀂉 反轉法􀂄 先將所有行掃描線輸出低電位,讀列值,若列值有一位是低表明有鍵按下;接著所有列掃描線輸出低電位,再讀行值。􀂄 根據讀到的值組合就可以查表得到鍵碼。4x4鍵盤按4行4列組成如圖電路結構。按鍵按下將會使行列連成通路,這也是見的使用者鍵盤設計電路。 //-----------4X4鍵盤程序--------------// uchar keboard(void) { uchar xxa,yyb,i,key; if((PINC&0x0f)!=0x0f) //是否有按鍵按下 {delayms(1); //延時去抖動 if((PINC&0x0f)!=0x0f) //有按下則判斷 { xxa=~(PINC|0xf0); //0000xxxx DDRC=0x0f; PORTC=0xf0; delay_1ms(); yyb=~(PINC|0x0f); //xxxx0000 DDRC=0xf0; //復位 PORTC=0x0f; while((PINC&0x0f)!=0x0f) //按鍵是否放開 { display(data); } i=4; //計算返回碼 while(xxa!=0) { xxa=xxa>>1; i--; } if(yyb==0x80) key=i; else if(yyb==0x40) key=4+i; else if(yyb==0x20) key=8+i; else if(yyb==0x10) key=12+i; return key; //返回按下的鍵盤碼 } } else return 17; //沒有按鍵按下 }

    標簽: 4x4 鍵盤

    上傳時間: 2013-11-12

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  • 用VHDL語言進行MCS-51兼容單片機ip核開發

    用VHDL語言進行MCS-51兼容單片機ip核開發  

    標簽: VHDL MCS 51兼容 語言

    上傳時間: 2013-10-28

    上傳用戶:nem567397

  • 基于Quartus II免費IP核的雙端口RAM設計實例

      QuartusII中利用免費IP核的設計   作者:雷達室   以設計雙端口RAM為例說明。   Step1:打開QuartusII,選擇File—New Project Wizard,創建新工程,出現圖示對話框,點擊Next;

    標簽: Quartus RAM IP核 雙端口

    上傳時間: 2014-12-28

    上傳用戶:fghygef

  • 基于FPGA的GPIB接口IP核的研究與設計

    基于FPGA的GPIB接口IP核的研究與設計

    標簽: FPGA GPIB 接口 IP核

    上傳時間: 2013-11-04

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  • ISE新建工程及使用IP核步驟詳解

    ISE新建工程及使用IP核步驟詳解

    標簽: ISE IP核 工程

    上傳時間: 2013-11-18

    上傳用戶:peterli123456

  • ISE_IP核創建教程及DDR3_ip核使用注意事項

    ISE_IP核創建教程及DDR3_ip核使用注意事項

    標簽: ISE_IP DDR ip 教程

    上傳時間: 2013-11-11

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  • 基于NiosII軟核處理器的步進電機接口設計

        NiosII軟核處理器是Altera公司開發,基于FPGA操作平臺使用的一款高速處理器,為了適應高速運動圖像采集,提出了一種基于NiosII軟核處理的步進電機接口設計,使用verilog HDL語言完成該接口設計,最后通過QuartusII軟件,給出了實驗仿真結果。

    標簽: NiosII 軟核處理器 步進電機 接口設計

    上傳時間: 2014-12-28

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