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全加器

  • 基于DSP的全數字電氣傳動控制板的研制,以傳動系統中起核心作用的調速裝置為研究對象

    基于DSP的全數字電氣傳動控制板的研制,以傳動系統中起核心作用的調速裝置為研究對象,背景是國家863計劃的攻關項目。論文的目的有兩個:一是實現數字調速裝置的國有化,二是研制具有自主知識產權的調速控制板。 論文通過學習和借鑒國外產品先進的設計理念和國內現有的優秀成果,提出了設計數字平臺的方案,實現控制裝置的數字化、通用化。通過構建數字化平臺,達到一板多用的目的,使一塊控制板在硬件不加改動或稍加改動的情況下,通過對軟件進行改動即可應用于交、直流調速,無功補償等方面,同時實現控制的實時性、可靠性。在硬件設計中提出了DSP+ASIC結構,即DSP+FPGA的實時信號處理系統,為實現系統的實時響應奠定了硬件基礎。

    標簽: DSP 全數字 傳動系統 電氣傳動

    上傳時間: 2015-09-04

    上傳用戶:sqq

  • 8051系列單片機仿真軟件 Windows9x 漢化版)編輯、模擬、調試、仿真器

    8051系列單片機仿真軟件 Windows9x 漢化版)編輯、模擬、調試、仿真器, 全中文Windows界面,可以直接編寫匯編語言程序, 生成寫目標文件,支持單步、斷點等調試、仿真方式, 根本不用學就會使用的軟件。 該軟件小巧好用,功能齊全、免安裝,解壓縮后即可使用。

    標簽: Windows9x 8051 單片機仿真軟件 仿真器

    上傳時間: 2015-09-20

    上傳用戶:極客

  • 數字通信系統的設計及其性能和所傳輸的數字信號的統計特性有關。所謂 加擾技術

    數字通信系統的設計及其性能和所傳輸的數字信號的統計特性有關。所謂 加擾技術,就是不增加多余度而擾亂信號,改變數字信號的統計特性,使其近 似于白噪聲統計特性的一種技術。這種技術的基礎是建立在反饋移位寄存器序 列(偽隨機序列)理論之上的。解擾是加擾的逆過程,恢復原始的數字信號。 如果數字信號具有周期性,則信號頻譜為離散的譜線,由于電路的非線 性,在多路通信系統中,這些譜線對相鄰信道的信號造成串擾。而短周期信號 經過擾碼器后,周期序列變長,譜線頻率變低,產生的非線性分量落入相鄰信 道之外,因此干擾減小。 在有些數字通信設備中,從碼元“0”和“1”的交變點提取定時信息,若 傳輸的數字信號中經常出現長的“1”或“0”游程,將影響位同步的建立和保 持。而擾碼器輸出的周期序列有足夠多的“0”、“1”交變點,能夠保證同步 定時信號的提取。

    標簽: 數字通信系統 性能 傳輸 數字信號

    上傳時間: 2014-01-23

    上傳用戶:star_in_rain

  • 全中文介紹ARM系統的設計全過程包括存儲器及外圍芯片的選型

    全中文介紹ARM系統的設計全過程包括存儲器及外圍芯片的選型,各單元電路的設計、調試等。系統的各功能模塊工作原理與應用編程示例,包括通用I/O口、串行接口、定時器、中斷控制器、GDMA控制器、MAC控制器等的工作原理與編程示例,Flash存儲器的編程與擦除等。uClinux操作系統上的應用程序的設計。

    標簽: ARM 存儲器 外圍芯片

    上傳時間: 2013-12-26

    上傳用戶:mhp0114

  • 應用vhdl語言進行加法器的設計

    應用vhdl語言進行加法器的設計,比較器的設計,隨著vhdl語言的應用越來越廣泛,其重要性也更加明確。希望對大家有所幫助。

    標簽: vhdl 語言 加法器

    上傳時間: 2015-11-11

    上傳用戶:gut1234567

  • 用verlog語言編的一些基礎實驗,適合于FPGA/CPLD的初學者。內容包括8位優先編碼器

    用verlog語言編的一些基礎實驗,適合于FPGA/CPLD的初學者。內容包括8位優先編碼器,乘法器,除法器,多路選擇器,二進制轉BCD碼,加法器,減法器等等。

    標簽: verlog FPGA CPLD 8位

    上傳時間: 2013-12-29

    上傳用戶:siguazgb

  • java媒體播放器源代碼

    java媒體播放器源代碼,使用winnape的皮膚,其中包括皮膚載入器源代碼等全在包中

    標簽: java 媒體播放器 源代碼

    上傳時間: 2015-11-27

    上傳用戶:ma1301115706

  • 最新最全的Windows CE 培訓資料

    最新最全的Windows CE 培訓資料,我上傳好幾次都沒有成功. 強烈推薦. 全書內容包括:本書分為上篇、中篇和下篇三個部分,上篇為Windows CE .NET結構分析,中篇為Windows CE .NET情景分析,下篇為實驗。每一篇又劃分為若干章。上篇包含有引言,Windows CE .NET體系結構,處理器調度,儲存管理,文件系統和設備管理等六章。中篇包含有系統初始化,處理器調度過程,分頁處理,檔案處理和驅動器加載等五章。下篇包含有Windows CE .NET應用開發,Windows CE .NET系統開發,評測與總結以及實習等四章。 上篇的重點在于分析Windows CE .NET核心的結構以及工作原理。這個部分是掌握Windows CE .NET的基礎。 中篇重點在于分析Windows CE .NET核心的實際運行過程。如果說上篇的是從靜態的角度分析Windows CE .NET核心,那么中篇則是試圖從動態的角度給讀者一個有關Windows CE .NET核心的描述。希望讀者能夠通過對中篇的閱讀理解,在頭腦中形成有關Windows CE .NET核心的多方位的運作情景。 下篇行動終端。對理論的掌握最終要應用到實務中。相信讀者們會在應用Windows CE .NET的應用中不斷取得成功。

    標簽: Windows CE 培訓資料

    上傳時間: 2013-12-12

    上傳用戶:songrui

  • Engine Wenday 2.13 Beta1 免費版 全創意功能:它不但可以實現一二級分類

    Engine Wenday 2.13 Beta1 免費版 全創意功能:它不但可以實現一二級分類, 而且可以,實現二級的 圖文 簡明 一級 多項 單頁 實現一級的圖文 簡明 單頁 本系統適合于個人的網站,公司的網站,二級分類圖文管理 一二級相容的管理,以一些小型信息網站的管理等。 集成所見即所得編輯器

    標簽: Engine Wenday Beta1 2.13

    上傳時間: 2015-12-17

    上傳用戶:zhaiye

  • 函數名稱:CRC-16 Process 函數原型:INT16U make_crc16(INT8U *msgaddr,INT8U datalen) 函數功能:進行CRC校驗和產生CRC代碼.這個函數

    函數名稱:CRC-16 Process 函數原型:INT16U make_crc16(INT8U *msgaddr,INT8U datalen) 函數功能:進行CRC校驗和產生CRC代碼.這個函數只影響全局變量crc16. 校驗字放在字符串最后,低8位在前高8位在后. msgaddr : 進行CRC16校驗的據塊的首地址 datalen : 進行CRC16校驗的據塊的個數 CRC-ITU的計算算法如下: a.寄存器組初始化為全"1"(0xFFFF)。 b.寄存器組向右移動一個字節。 c.剛移出的那個字節與數據字節進行異或運算,得出一個指向值表的索引。 d.索引所指的表值與寄存器組做異或運算。 f.數據指針加1,如果數據沒有全部處理完,則重復步驟b。 g.寄存器組取反,得到CRC,附加在數據之后(這一步可省略)。

    標簽: CRC INT 16 make_crc

    上傳時間: 2015-12-21

    上傳用戶:llandlu

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