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基于FPGA實現的一種新型數字鎖相環(huán)
標簽： FPGA 新型數字 鎖相環(huán)
上傳時間： 2013-08-07
上傳用戶：2467478207
相關于fpga的vga顯示的控制，包括模塊，設計思路，方案等重要代碼
標簽： fpga vga 控制
上傳時間： 2013-08-11
上傳用戶：青春給了作業(yè)95
介紹了應用VHDL技術設計嵌入式全數字鎖相環(huán)路的方法，詳細敘述了其工作原理和設計思想，并用可編程邏輯器件FPGA實現。
標簽： VHDL 嵌入式 全數字 鎖相環(huán)路
上傳用戶：yare
基于FPGA的全數字鎖相環(huán)設計,內有設計過程和設計思想
標簽： FPGA 全數字 鎖相環(huán)
上傳時間： 2013-08-13
上傳用戶：fqscfqj
verilog編寫基于fpga的鑒相器模塊
標簽： verilog fpga 編寫 模塊
上傳時間： 2013-08-19
上傳用戶：18752787361
基于FPGA設計數字鎖相環(huán)，提出了一種由微分超前/滯后型檢相器構成數字鎖相環(huán)的Verilog-HDL建模方案
標簽： FPGA 數字鎖相環(huán)
上傳用戶：Huge_Brother
針對高頻感應加熱電源中用傳統的模擬鎖相環(huán)跟蹤頻率所存在的問題,提出一種非常適合于高頻感應加熱的\r\n新型的數字鎖相環(huán)。使用FPGA 內底層嵌入功能單元中的數字鎖相環(huán)74HCT297 ,并添加少量的數字電路來實現。最后利\r\n用仿真波形驗證該設計的合理性和有效性。整個設計負載范圍寬、鎖相時間短,現已成功應用于100 kHz/ 30 kW 的感應加\r\n熱電源中。
標簽： 高頻感應 加熱電源 模擬鎖相環(huán) 頻率
上傳時間： 2013-08-22
上傳用戶：nairui21
關于數字鎖相環(huán)的一點東西,可以下來看看\r\n
標簽： 數字鎖相環(huán)
上傳時間： 2013-08-26
上傳用戶：7891
Verilog實現的DDS正弦信號發(fā)生器和測頻測相模塊，DDS模塊可產生兩路頻率和相位差均可預置調整的值正弦波，頻率范圍為20Hz-5MHz，相位范圍為0°-359°，測量的數據通過引腳傳輸給單片機，單片機進行計算和顯示。
標簽： Verilog DDS 正弦信號發(fā)生器 模塊
上傳時間： 2013-08-28
上傳用戶：asdfasdfd
用allegro畫的ddr存儲器電路。六層板設計，很好的參考資料
標簽： allegro ddr 存儲器 六層板
上傳時間： 2013-09-06
上傳用戶：ddddddos
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