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  • dxp2004教程-附安裝方法

    附件有二個文當,都是dxp2004教程 ,第一部份DXP2004的相關快捷鍵,以及中英文對照的意思。第二部份細致的講解的如何使用DXP2004。 dxp2004教程第一部份: 目錄 1 快捷鍵 2 常用元件及封裝 7 創建自己的集成庫 12 板層介紹 14 過孔 15 生成BOM清單 16 頂層原理圖: 16 生成PCB 17 包地 18 電路板設計規則 18 PCB設計注意事項 20 畫板心得 22 DRC 規則英文對照 22 一、Error Reporting 中英文對照 22 A : Violations Associated with Buses 有關總線電氣錯誤的各類型(共 12 項) 22 B :Violations Associated Components 有關元件符號電氣錯誤(共 20 項) 22 C : violations associated with document 相關的文檔電氣錯誤(共 10 項) 23 D : violations associated with nets 有關網絡電氣錯誤(共 19 項) 23 E : Violations associated with others 有關原理圖的各種類型的錯誤 (3 項 ) 24 二、 Comparator 規則比較 24 A : Differences associated with components 原理圖和 PCB 上有關的不同 ( 共 16 項 ) 24 B : Differences associated with nets 原理圖和 PCB 上有關網絡不同(共 6 項) 25 C : Differences associated with parameters 原理圖和 PCB 上有關的參數不同(共 3 項) 25 Violations  Associated withBuses欄 —總線電氣錯誤類型 25 Violations Associated with Components欄 ——元件電氣錯誤類型 26 Violations Associated  with documents欄 —文檔電氣連接錯誤類型 27 Violations Associated with Nets欄 ——網絡電氣連接錯誤類型 27 Violations Associated with Parameters欄 ——參數錯誤類型 28 dxp2004教程第二部份 路設計自動化( Electronic Design Automation ) EDA 指的就是將電路設計中各種工作交由計算機來協助完成。如電路圖( Schematic )的繪制,印刷電路板( PCB )文件的制作執行電路仿真( Simulation )等設計工作。隨著電子工業的發展,大規模、超大規模集成電路的使用是電路板走線愈加精密和復雜。電子線路 CAD 軟件產生了, Protel 是突出的代表,它操作簡單、易學易用、功能強大。 1.1 Protel 的產生及發展 1985 年 誕生 dos 版 Protel 1991 年 Protel for Widows 1998 年 Protel98 這個 32 位產品是第一個包含 5 個核心模塊的 EDA 工具 1999 年 Protel99 既有原理圖的邏輯功能驗證的混合信號仿真,又有了 PCB 信號完整性 分析的板級仿真,構成從電路設計到真實板分析的完整體系。 2000 年 Protel99se 性能進一步提高,可以對設計過程有更大控制力。 2002 年 Protel DXP 集成了更多工具,使用方便,功能更強大。 1.2 Protel DXP 主要特點 1 、通過設計檔包的方式,將原理圖編輯、電路仿真、 PCB 設計及打印這些功能有機地結合在一起,提供了一個集成開發環境。 2 、提供了混合電路仿真功能,為設計實驗原理圖電路中某些功能模塊的正確與否提供了方便。 3 、提供了豐富的原理圖組件庫和 PCB 封裝庫,并且為設計新的器件提供了封裝向導程序,簡化了封裝設計過程。 4 、提供了層次原理圖設計方法,支持“自上向下”的設計思想,使大型電路設計的工作組開發方式成為可能。 5 、提供了強大的查錯功能。原理圖中的 ERC (電氣法則檢查)工具和 PCB 的 DRC (設計規則檢查)工具能幫助設計者更快地查出和改正錯誤。 6 、全面兼容 Protel 系列以前版本的設計文件,并提供了 OrCAD 格式文件的轉換功能。 7 、提供了全新的 FPGA 設計的功能,這好似以前的版本所沒有提供的功能。

    標簽: 2004 dxp 教程 安裝方法

    上傳時間: 2015-01-01

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  • Protel DXP2004詳細教程

    目錄 目錄 1 快捷鍵 2 常用元件及封裝 7 創建自己的集成庫 12 板層介紹 14 過孔 15 生成BOM清單 16 頂層原理圖: 16 生成PCB 17 包地 18 電路板設計規則 18 PCB設計注意事項 20 畫板心得 22 DRC 規則英文對照 22 一、Error Reporting 中英文對照 22 A : Violations Associated with Buses 有關總線電氣錯誤的各類型(共 12 項) 22 B :Violations Associated Components 有關元件符號電氣錯誤(共 20 項) 22 C : violations associated with document 相關的文檔電氣錯誤(共 10 項) 23 D : violations associated with nets 有關網絡電氣錯誤(共 19 項) 23 E : Violations associated with others 有關原理圖的各種類型的錯誤 (3 項 ) 24 二、 Comparator 規則比較 24 A : Differences associated with components 原理圖和 PCB 上有關的不同 ( 共 16 項 ) 24 B : Differences associated with nets 原理圖和 PCB 上有關網絡不同(共 6 項) 25 C : Differences associated with parameters 原理圖和 PCB 上有關的參數不同(共 3 項) 25 Violations  Associated withBuses欄 —總線電氣錯誤類型 25 Violations Associated with Components欄 ——元件電氣錯誤類型 26 Violations Associated  with documents欄 —文檔電氣連接錯誤類型 27 Violations Associated with Nets欄 ——網絡電氣連接錯誤類型 27 Violations Associated with Parameters欄 ——參數錯誤類型 28  

    標簽: Protel 2004 DXP 教程

    上傳時間: 2013-11-21

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  • crc任意位生成多項式 任意位運算 自適應算法 循環冗余校驗碼(CRC

    crc任意位生成多項式 任意位運算 自適應算法 循環冗余校驗碼(CRC,Cyclic Redundancy Code)是采用多項式的 編碼方式,這種方法把要發送的數據看成是一個多項式的系數 ,數據為bn-1bn-2…b1b0 (其中為0或1),則其對應的多項式為: bn-1Xn-1+bn-2Xn-2+…+b1X+b0 例如:數據“10010101”可以寫為多項式 X7+X4+X2+1。 循環冗余校驗CRC 循環冗余校驗方法的原理如下: (1) 設要發送的數據對應的多項式為P(x)。 (2) 發送方和接收方約定一個生成多項式G(x),設該生成多項式 的最高次冪為r。 (3) 在數據塊的末尾添加r個0,則其相對應的多項式為M(x)=XrP(x) 。(左移r位) (4) 用M(x)除以G(x),獲得商Q(x)和余式R(x),則 M(x)=Q(x) ×G(x)+R(x)。 (5) 令T(x)=M(x)+R(x),采用模2運算,T(x)所對應的數據是在原數 據塊的末尾加上余式所對應的數據得到的。 (6) 發送T(x)所對應的數據。 (7) 設接收端接收到的數據對應的多項式為T’(x),將T’(x)除以G(x) ,若余式為0,則認為沒有錯誤,否則認為有錯。

    標簽: crc CRC 多項式 位運算

    上傳時間: 2014-11-28

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  • crc任意位生成多項式 任意位運算 自適應算法 循環冗余校驗碼(CRC

    crc任意位生成多項式 任意位運算 自適應算法 循環冗余校驗碼(CRC,Cyclic Redundancy Code)是采用多項式的 編碼方式,這種方法把要發送的數據看成是一個多項式的系數 ,數據為bn-1bn-2…b1b0 (其中為0或1),則其對應的多項式為: bn-1Xn-1+bn-2Xn-2+…+b1X+b0 例如:數據“10010101”可以寫為多項式 X7+X4+X2+1。 循環冗余校驗CRC 循環冗余校驗方法的原理如下: (1) 設要發送的數據對應的多項式為P(x)。 (2) 發送方和接收方約定一個生成多項式G(x),設該生成多項式 的最高次冪為r。 (3) 在數據塊的末尾添加r個0,則其相對應的多項式為M(x)=XrP(x) 。(左移r位) (4) 用M(x)除以G(x),獲得商Q(x)和余式R(x),則 M(x)=Q(x) ×G(x)+R(x)。 (5) 令T(x)=M(x)+R(x),采用模2運算,T(x)所對應的數據是在原數 據塊的末尾加上余式所對應的數據得到的。 (6) 發送T(x)所對應的數據。 (7) 設接收端接收到的數據對應的多項式為T’(x),將T’(x)除以G(x) ,若余式為0,則認為沒有錯誤,否則認為有錯

    標簽: crc CRC 多項式 位運算

    上傳時間: 2014-01-16

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  • java入門編程合集

    題目:古典問題:有一對兔子,從出生后第3個月起每個月都生一對兔子,小兔子長到第三個月后每個月又生一對兔子,假如兔子都不死,問每個月的兔子總數為多少?    //這是一個菲波拉契數列問題 public class lianxi01 { public static void main(String[] args) { System.out.println("第1個月的兔子對數:    1"); System.out.println("第2個月的兔子對數:    1"); int f1 = 1, f2 = 1, f, M=24;      for(int i=3; i<=M; i++) {       f = f2;       f2 = f1 + f2;       f1 = f;       System.out.println("第" + i +"個月的兔子對數: "+f2);          } } } 【程序2】    題目:判斷101-200之間有多少個素數,并輸出所有素數。 程序分析:判斷素數的方法:用一個數分別去除2到sqrt(這個數),如果能被整除, 則表明此數不是素數,反之是素數。    public class lianxi02 { public static void main(String[] args) {     int count = 0;     for(int i=101; i<200; i+=2) {      boolean b = false;      for(int j=2; j<=Math.sqrt(i); j++)      {         if(i % j == 0) { b = false; break; }          else           { b = true; }      }         if(b == true) {count ++;System.out.println(i );}                                   }     System.out.println( "素數個數是: " + count); } } 【程序3】    題目:打印出所有的 "水仙花數 ",所謂 "水仙花數 "是指一個三位數,其各位數字立方和等于該數本身。例如:153是一個 "水仙花數 ",因為153=1的三次方+5的三次方+3的三次方。 public class lianxi03 { public static void main(String[] args) {      int b1, b2, b3; 

    標簽: java 編程

    上傳時間: 2017-12-24

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  • 車用CAN總線抗電磁干擾能力研究.rar

    本文主要圍繞車用CAN總線抗電磁干擾能力進行了研究。 首先,在在參考國內外相關研究資料的基礎上,依據FORD公司的ES-XW7T-1A278-AC電磁兼容標準、IS07637-3對非電源線的瞬態傳導抗干擾測試標準和IS011452-4大電流注入(BCI)電磁兼容性標準,利用瑞士EMTEST公司的UCS-200M、CSW500D等設備,搭建了3個用于測試CAN總線抗干擾能力的實驗平臺。 在所搭建的測試平臺上,著重從CAN總線通訊介質選擇和CAN節點抗干擾設計兩個方面進行了理論分析和對比實驗研究,得出了當采用屏蔽雙絞線和非屏蔽雙絞線作為總線通訊介質時,影響其抗干擾能力的因素;當CAN總線節點采用的不同的物理層參數時,如光耦、共模線圈、磁珠、濾波電容、分裂端接電阻、不同的總線發送電平、不同的CAN收發器等,對CAN總線抗干擾能力的影響,給出了一些增強CAN節點電路抗干擾能力的建議及一種推薦電路。 最后提出了一種新的提高CAN總線抗干擾能力的方法,即通過把CAN總線的CANH和CANL數據線分別通過一個電阻連接到總線收發器的地和電源端,使總線的差分電平整體下拉,從而降低總線收發器對某些干擾引起的電平波動所產生的誤判斷以達到增強抗電磁干擾的目的。并在基于FORD公司的ES-XW7T-1A278-AC電磁兼容標準所搭建的CAN總線測試平臺上進行實驗,驗證了其有效性。

    標簽: CAN 車用 總線

    上傳時間: 2013-06-19

    上傳用戶:zhang469965156

  • 單相非隔離型光伏并網逆變器的研究.rar

    在能源枯竭與環境污染問題日益嚴重的今天,新能源的開發與利用愈來愈受到重視。太陽能是當前世界上最清潔、最現實、最有大規模開發利用前景的可再生能源之一。其中太陽能光伏利用受到世界各國的普遍關注。而太陽能光伏并網發電是太陽能光伏利用的主要發展趨勢,必將得到快速的發展。在并網型光伏發電系統中,逆變器是系統中最末一級或唯一一級能量變換裝置,其效率的高低、可靠性的好壞將直接影響整個并網型系統的性能和投資。按照不同的標準光伏并網逆變器的拓撲結構分為很多種,本文主要研究單相非隔離型光伏并網逆變器。 文章首先概述了光伏并網系統的發展情況并分析了當前國際金融危機對光伏產業的影響。其次,分析了當前國際市場上主要的光伏逆變器產品的特點,概括了光伏并網系統中光伏陣列的配置。隨后,本文以單相全橋拓撲為模型分析了非隔離型并網系統在采用不同的PWM調制策略下的共模電流,指出了抑制共模電流需滿足的條件。對于全橋和半橋拓撲,分析了不同的濾波方式對共模電流抑制的影響。總結了能夠抑制共模電流的實用電路拓撲并提出了一種能夠抑制共模電流的新拓撲。對不同拓撲的損耗情況在文章中進行了比較。 對于非隔離型并網系統中的逆變器易向電網注入直流分量的問題,首先分析了直流分量產生的原因及其導致變壓器產生的直流偏磁飽和現象。在此基礎上,總結了抑制直流分量的方法,指出了半橋拓撲能夠抑制直流分量。對于并網電流的控制,工程上通常采用比例積分控制器,而比例積分控制器在理論上無法實現無靜差控制,因此,本文對能夠實現無靜差控制的比例諧振控制器進行了簡要分析。最后,在非隔離型1.5kW實驗平臺上對共模電流和直流分量的抑制方法進行了驗證。

    標簽: 單相 光伏并網 非隔離型

    上傳時間: 2013-07-30

    上傳用戶:科學怪人

  • 高速低壓低功耗CMOSBiCMOS運算放大器設計.rar

    近年來,以電池作為電源的微電子產品得到廣泛使用,因而迫切要求采用低電源電壓的模擬電路來降低功耗。目前低電壓、低功耗的模擬電路設計技術正成為微電子行業研究的熱點之一。 在模擬集成電路中,運算放大器是最基本的電路,所以設計低電壓、低功耗的運算放大器非常必要。在實現低電壓、低功耗設計的過程中,必須考慮電路的主要性能指標。由于電源電壓的降低會影響電路的性能,所以只實現低壓、低功耗的目標而不實現優良的性能(如高速)是不大妥當的。 論文對國內外的低電壓、低功耗模擬電路的設計方法做了廣泛的調查研究,分析了這些方法的工作原理和各自的優缺點,在吸收這些成果的基礎上設計了一個3.3 V低功耗、高速、軌對軌的CMOS/BiCMOS運算放大器。在設計輸入級時,選擇了兩級直接共源一共柵輸入級結構;為穩定運放輸出共模電壓,設計了共模負反饋電路,并進行了共模回路補償;在偏置電路設計中,電流鏡負載并不采用傳統的標準共源-共柵結構,而是采用適合在低壓工況下的低壓、寬擺幅共源-共柵結構;為了提高效率,在設計時采用了推挽共源極放大器作為輸出級,輸出電壓擺幅基本上達到了軌對軌;并采用帶有調零電阻的密勒補償技術對運放進行頻率補償。 采用標準的上華科技CSMC 0.6μpm CMOS工藝參數,對整個運放電路進行了設計,并通過了HSPICE軟件進行了仿真。結果表明,當接有5 pF負載電容和20 kΩ負載電阻時,所設計的CMOS運放的靜態功耗只有9.6 mW,時延為16.8ns,開環增益、單位增益帶寬和相位裕度分別達到82.78 dB,52.8 MHz和76°,而所設計的BiCMOS運放的靜態功耗達到10.2 mW,時延為12.7 ns,開環增益、單位增益帶寬和相位裕度分別為83.3 dB、75 MHz以及63°,各項技術指標都達到了設計要求。

    標簽: CMOSBiCMOS 低壓 低功耗

    上傳時間: 2013-06-29

    上傳用戶:saharawalker

  • FPGA中多標準可編程IO端口的設計.rar

    現場可編程門陣列(FPGA,Field Programmable Gate Array)是可編程邏輯器件的一種,它的出現是隨著微電子技術的發展,設計與制造集成電路的任務已不完全由半導體廠商來獨立承擔。系統設計師們更愿意自己設計專用集成電路(ASIC,Application Specific Integrated Circuit).芯片,而且希望ASIC的設計周期盡可能短,最好是在實驗室里就能設計出合適的ASIC芯片,并且立即投入實際應用之中。現在,FPGA已廣泛地運用于通信領域、消費類電子和車用電子。 本文中涉及的I/O端口模塊是FPGA中最主要的幾個大模塊之一,它的主要作用是提供封裝引腳到CLB之間的接口,將外部信號引入FPGA內部進行邏輯功能的實現并把結果輸出給外部電路,并且根據需要可以進行配置來支持多種不同的接口標準。FPGA允許使用者通過不同編程來配置實現各種邏輯功能,在IO端口中它可以通過選擇配置方式來兼容不同信號標準的I/O緩沖器電路。總體而言,可選的I/O資源的特性包括:IO標準的選擇、輸出驅動能力的編程控制、擺率選擇、輸入延遲和維持時間控制等。 本文是關于FPGA中多標準兼容可編程輸入輸出電路(Input/Output Block)的設計和實現,該課題是成都華微電子系統有限公司FPGA大項目中的一子項,目的為在更新的工藝水平上設計出能夠兼容單端標準的I/O電路模塊;同時針對以前設計的I/O模塊不支持雙端標準的缺點,要求新的電路模塊中擴展出雙端標準的部分。文中以低壓雙端差分標準(LVDS)為代表構建雙端標準收發轉換電路,與單端標準比較,LVDS具有很多優點: (1)LVDS傳輸的信號擺幅小,從而功耗低,一般差分線上電流不超過4mA,負載阻抗為100Ω。這一特征使它適合做并行數據傳輸。 (2)LVDS信號擺幅小,從而使得該結構可以在2.5V的低電壓下工作。 (3)LVDS輸入單端信號電壓可以從0V到2.4V變化,單端信號擺幅為400mV,這樣允許輸入共模電壓從0.2V到2.2V范圍內變化,也就是說LVDS允許收發兩端地電勢有±1V的落差。 本文采用0.18μm1.8V/3.3V混合工藝,輔助Xilinx公司FPGA開發軟件ISE,設計完成了可以用于Virtex系列各低端型號FPGA的IOB結構,它有靈活的可配置性和出色的適應能力,能支持大量的I/O標準,其中包括單端標準,也包括雙端標準如LVDS等。它具有適應性的優點、可選的特性和考慮到被文件描述的硬件結構特征,這些特點可以改進和簡化系統級的設計,為最終的產品設計和生產打下基礎。設計中對包括20種IO標準在內的各電器參數按照用戶手冊描述進行仿真驗證,性能參數已達到預期標準。

    標簽: FPGA 標準 可編程

    上傳時間: 2013-05-15

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  • AD8221中文資料.rar

    AD8221中文資料,儀器儀表放大器。高共模抑制比

    標簽: 8221 AD

    上傳時間: 2013-07-31

    上傳用戶:songrui

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