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分時(shí)調(diào)(diào)度

  • 利用Verilog_HDL實現(xiàn)基于FPGA的分頻方法

    利用Verilog_HDL實現(xiàn)基于FPGA的分頻方法

    標(biāo)簽： Verilog_HDL FPGA 分頻

    上傳時間： 2013-11-20

    上傳用戶：atdawn

  • Verilog_實現(xiàn)任意占空比、任意分頻的方法

    Verilog_實現(xiàn)任意占空比、任意分頻的方法

    標(biāo)簽： Verilog 分頻

    上傳時間： 2013-11-20

    上傳用戶：ccxzzhm

  • 簡單分頻時序邏輯分頻電路設(shè)計

    簡單分頻時序邏輯電路設(shè)計分頻電路，有圖，有代碼

    標(biāo)簽： 分頻 時序邏輯 電路設(shè)計

    上傳時間： 2014-01-21

    上傳用戶：924484786

  • 用VerilogHDL實現(xiàn)基于FPGA的通用分頻器的設(shè)計

    用VerilogHDL實現(xiàn)基于FPGA的通用分頻器的設(shè)計

    標(biāo)簽： VerilogHDL FPGA 分頻器

    上傳時間： 2015-01-02

    上傳用戶：oooool

  • 基于FPGA的小數(shù)分頻實現(xiàn)方法

    基于FPGA的小數(shù)分頻實現(xiàn)方法

    標(biāo)簽： FPGA 小數(shù)分頻 實現(xiàn)方法

    上傳時間： 2013-11-05

    上傳用戶：feifei0302

  • 差分線對的PCB設(shè)計要點

      信號完整性是高速數(shù)字系統(tǒng)中要解決的一個首要問題之一，如何在高速PCB 設(shè)計過程中充分考慮信號完整性因素,并采取有效的控制措施,已經(jīng)成為當(dāng)今系統(tǒng)設(shè)計能否成功的關(guān)鍵。在這方面，差分線對具有很多優(yōu)勢，比如更高的比特率 ,更低的功耗 ,更好的噪聲性能和更穩(wěn)定的可靠性等。目前，差分線對在高速數(shù)字電路設(shè)計中的應(yīng)用越來越廣泛，電路中最關(guān)鍵的信號往往都要采用差分線對設(shè)計。介紹了差分線對在PCB 設(shè)計中的一些要點，并給出具體設(shè)計方案。

    標(biāo)簽： PCB 差分線

    上傳時間： 2013-10-26

    上傳用戶：lps11188

  • 差分信號PCB布局布線誤區(qū)

     誤區(qū)一：認為差分信號不需要地平面作為回流路徑，或者認為差分走線彼此為對方提供回流途徑。造成這種誤區(qū)的原因是被表面現(xiàn)象迷惑，或者對高速信號傳輸?shù)臋C理認識還不夠深入。雖然差分電路對于類似地彈以及其它可能存在于電源和地平面上的噪音信號是不敏感的。地平面的部分回流抵消并不代表差分電路就不以參考平面作為信號返回路徑，其實在信號回流分析上，差分走線和普通的單端走線的機理是一致的，即高頻信號總是沿著電感最小的回路進行回流，最大的區(qū)別在于差分線除了有對地的耦合之外，還存在相互之間的耦合，哪一種耦合強，那一種就成為主要的回流通路。

    標(biāo)簽： PCB 差分信號 布局布線

    上傳時間： 2013-10-25

    上傳用戶：zhaiyanzhong

  • 基于FPGA的恒溫晶振頻率校準(zhǔn)系統(tǒng)的設(shè)計

    為滿足三維大地電磁勘探技術(shù)對多個采集站的同步需求，基于FPGA設(shè)計了一種晶振頻率校準(zhǔn)系統(tǒng)。系統(tǒng)可以調(diào)節(jié)各采集站的恒溫壓控晶體振蕩器同步于GPS，從而使晶振能夠輸出高準(zhǔn)確度和穩(wěn)定度的同步信號。系統(tǒng)中使用FPGA設(shè)計了高分辨率的時間間隔測量單元，達到0.121 ns的測量分辨率，能對晶振分頻信號與GPS秒脈沖信號的時間間隔進行高精度測量，縮短了頻率校準(zhǔn)時間。同時在FPGA內(nèi)部使用PicoBlaze嵌入式軟核處理器監(jiān)控系統(tǒng)狀態(tài)，并配合滑動平均濾波法對測量得到的時間間隔數(shù)據(jù)實時處理，有效地抑制了GPS秒脈沖波動對頻率校準(zhǔn)的影響。

    標(biāo)簽： FPGA 恒溫晶振 頻率校準(zhǔn)

    上傳時間： 2013-11-17

    上傳用戶：www240697738

  • PCB LAYOUT設(shè)計規(guī)范手冊

    　　PCB Layout Rule Rev1.70, 規(guī)範(fàn)內(nèi)容如附件所示, 其中分為: 　　(1) ”PCB LAYOUT 基本規(guī)範(fàn)”:為R&D Layout時必須遵守的事項, 否則SMT,DIP,裁板時無法生產(chǎn). 　　(2) “錫偷LAYOUT RULE建議規(guī)範(fàn)”: 加適合的錫偷可降低短路及錫球. 　　(3) “PCB LAYOUT 建議規(guī)範(fàn)”:為製造單位為提高量產(chǎn)良率,建議R&D在design階段即加入PCB Layout. 　　(4) ”零件選用建議規(guī)範(fàn)”: Connector零件在未來應(yīng)用逐漸廣泛, 又是SMT生產(chǎn)時是偏移及置件不良的主因,故製造希望R&D及採購在購買異形零件時能顧慮製造的需求, 提高自動置件的比例.

    標(biāo)簽： LAYOUT PCB 設(shè)計規(guī)范

    上傳時間： 2013-11-03

    上傳用戶：tzl1975

  • 一種用EPROM實現(xiàn)的天線方位比較電路

    本文介紹了實現(xiàn)天線方位碼可停在任意角度的實際電路設(shè)計，該設(shè)計采用數(shù)值大小比較器比較模擬天線方位與EPROM全譯碼送出的二進制數(shù)據(jù)（即利用撥碼開關(guān)設(shè)定的數(shù)據(jù)作為控制輸入的角度）。當(dāng)需要比較的數(shù)據(jù)達到一致時，便控制了模擬天線即555振蕩器脈沖到分頻計數(shù)器的輸入，分頻計數(shù)器停止計數(shù)，天線停在撥碼開關(guān)設(shè)定的角度，這里實際電路角度控制精確度為1度，如果需要提高精確度，只是增加位數(shù)，基本方法不變。

    標(biāo)簽： EPROM 天線 比較電路

    上傳時間： 2014-07-25

    上傳用戶：digacha

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