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分立

通過FPGA提高工業(yè)應用靈活性的5種方法

　　可編程邏輯器件（PLD）是嵌入式工業(yè)設計的關鍵元器件。在工業(yè)設計中，PLD已經(jīng)從提供簡單的膠合邏輯發(fā)展到使用FPGA作為協(xié)處理器。該技術在通信、電機控制、I/O模塊以及圖像處理等應用中支持 I/O 擴展，替代基本的微控制器（MCU）或者數(shù)字信號處理器（DSP）。　　隨著系統(tǒng)復雜度的提高，F(xiàn)PGA還能夠集成整個芯片系統(tǒng)（SoC），與分立的 MCU、DSP、ASSP，以及 ASIC解決方案相比，大幅度降低了成本。不論是用作協(xié)處理器還是SoC，Altera FPGA在您的工業(yè)應用中都具有以下優(yōu)點：　　1. 設計集成——使用FPGA作為協(xié)處理器或者SoC，在一個器件平臺上集成 IP和軟件堆棧，從而降低成本。　　2. 可重新編程能力——在一個公共開發(fā)平臺的一片 FPGA中，使工業(yè)設計能夠適應協(xié)議、IP以及新硬件功能的發(fā)展變化。　　3. 性能調(diào)整——通過FPGA中的嵌入式處理器、定制指令和IP模塊，增強性能，滿足系統(tǒng)要求。　　4. 過時保護——較長的 FPGA 產(chǎn)品生命周期，通過 FPGA 新系列的器件移植，延長工業(yè)產(chǎn)品的生命周期，保護硬件不會過時。　　5. 熟悉的工具——使用熟悉的、功能強大的集成工具，簡化設計和軟件開發(fā)、IP集成以及調(diào)試。

標簽： FPGA 工業(yè)應用

上傳時間： 2013-11-18

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透過USB設定FPGA

本文探討如何透過USB來設定各種采用FPGA的系統(tǒng)與實現(xiàn)現(xiàn)場升級的彈性。這種方法還可用來取代熱門的JTAG組態(tài)介面，讓用戶不再需要用到機板上分立的JTAG連結(jié)器，就能降低成本并減少占用電路板的空間。

標簽： FPGA USB 設定

上傳時間： 2015-01-01

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protel99元件庫大全

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標簽： protel 99 元件庫

上傳時間： 2013-10-11

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FPGA連接DDR2的問題討論

我采用XC4VSX35或XC4VLX25 FPGA來連接DDR2 SODIMM和元件。SODIMM內(nèi)存條選用MT16HTS51264HY-667(4GB)，分立器件選用8片MT47H512M8。設計目標：當客戶使用內(nèi)存條時，8片分立器件不焊接；當使用直接貼片分立內(nèi)存顆粒時，SODIMM內(nèi)存條不安裝。請問專家：1、在設計中，先用Xilinx MIG工具生成DDR2的Core后，管腳約束文件是否還可更改？若能更改，則必須要滿足什么條件下更改？生成的約束文件中，ADDR，data之間是否能調(diào)換？ 2、對DDR2數(shù)據(jù)、地址和控制線路的匹配要注意些什么？通過兩只100歐的電阻分別連接到1.8V和GND進行匹配和通過一只49.9歐的電阻連接到0.9V進行匹配，哪種匹配方式更好？ 3、V4中，PCB LayOut時，DDR2線路阻抗單端為50歐，差分為100歐？Hyperlynx仿真時，那些參數(shù)必須要達到那些指標DDR2-667才能正常工作？ 4、若使用DDR2-667的SODIMM內(nèi)存條，能否降速使用？比如降速到DDR2-400或更低頻率使用？ 5、板卡上有SODIMM的插座，又有8片內(nèi)存顆粒，則物理上兩部分是連在一起的，若實際使用時，只安裝內(nèi)存條或只安裝8片內(nèi)存顆粒，是否會造成信號完成性的影響？若有影響，如何控制？ 6、SODIMM內(nèi)存條(max:4GB)能否和8片分立器件(max:4GB)組合同時使用，構(gòu)成一個(max:8GB)的DDR2單元？若能，則布線阻抗和FPGA的DCI如何控制？地址和控制線的TOP圖應該怎樣？ 7、DDR2和FPGA（VREF pin）的參考電壓0.9V的實際工作電流有多大？工作時候，DDR2芯片是否很燙，一般如何考慮散熱？ 8、由于多層板疊層的問題，可能頂層和中間層的銅箔不一樣后，中間的夾層后度不一樣時，也可能造成阻抗的不同。請教DDR2-667的SODIMM在8層板上的推進疊層？

標簽： FPGA DDR2 連接問題討論

上傳時間： 2013-10-21

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利用2602型系統(tǒng)數(shù)字源表構(gòu)建IC測試系統(tǒng)

消費電子產(chǎn)品，如手機、PDA（個人數(shù)字助理）、數(shù)碼相機以及便攜式娛樂系統(tǒng)，正在變得更小、更快和更便宜，而且這類新產(chǎn)品的面市時間也比以往更短了。為了與時俱進，半導體、無源和有源器件行業(yè)正不斷推動其研發(fā)工藝向集成度和復雜度更高的水平進步。這種在更小的空間內(nèi)集成更多電路技術的進步，實現(xiàn)了在系統(tǒng)芯片(SoC)上集成模擬、數(shù)字甚至射頻電路。類似地，分立器件制造商也在單一芯片上集成了多個部件，從而實現(xiàn)更高的電路密度。

標簽： 2602 數(shù)字源表 IC測試

上傳時間： 2013-11-19

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報道了利用20 fs激光脈沖在兩種多孔微結(jié)構(gòu)光纖產(chǎn)生超連續(xù)譜的現(xiàn)象

報道了利用20 fs激光脈沖在兩種多孔微結(jié)構(gòu)光纖產(chǎn)生超連續(xù)譜的現(xiàn)象，光纖長度均為40 cm，連續(xù)譜展寬范圍分別是420—980 nm 和570—920 nm 。實驗上證明了不僅僅具有周期性結(jié)構(gòu)的微結(jié)構(gòu)光纖可以用于產(chǎn)生超連續(xù)譜，由無序填充氣孔組成的多孔微結(jié)構(gòu)光纖也可以出現(xiàn)類似的超強非線性和超連續(xù)譜展寬。分析表明，小模場面積和高非線性系數(shù)更有利于產(chǎn)生寬的超連續(xù)譜，完全光子帶隙的存在導致了光譜的分立結(jié)。

標簽： 激光脈沖光纖超連續(xù)譜

上傳時間： 2015-08-19

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經(jīng)典的單片機復位電路

經(jīng)典的單片機復位電路，用電阻，電容，三極管等分立元件搭建

標簽： 單片機復位電路

上傳時間： 2015-09-22

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MAX II CPLD具有靈活的可編程接口

MAX II CPLD具有靈活的可編程接口，合并了分立的FLASH存儲器件，能快速和容易地配置FPGA，DSP，ASIC等。本中文手冊將讓用戶對CPLD有一個宏觀的認識。

標簽： CPLD MAX II 可編程接口

上傳時間： 2016-09-18

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LCD 因其輕薄短小,低功耗,無輻射,平面直角顯示,以及影像穩(wěn)定等特點,當今應用非常廣泛。CPLD(復雜可編程邏輯器件) 是一種具有豐富可編程功能引腳的可編程邏輯器件,不僅可實現(xiàn)常規(guī)的

LCD 因其輕薄短小,低功耗,無輻射,平面直角顯示,以及影像穩(wěn)定等特點,當今應用非常廣泛。CPLD(復雜可編程邏輯器件) 是一種具有豐富可編程功能引腳的可編程邏輯器件,不僅可實現(xiàn)常規(guī)的邏輯器件功能,還可以實現(xiàn)復雜而獨特的時序邏輯功能。并且具有ISP (在線可編程) [1 ] 功能,便于進行系統(tǒng)設計和現(xiàn)場對系統(tǒng)進行功能修改、調(diào)試、升級。通常CPLD 芯片都有著上萬次的重寫次數(shù),即用CPLD[ 2 ] 進行硬件設計,就像軟件設計一樣靈活、方便。而現(xiàn)今LCD 的控制大都采用專用控制芯片,且一般都采用進口芯片,成本較高。并且為了保證在特定環(huán)境下控制芯片能正常工作,往往要加上必需的與門、非門、以及HC244 ,HC245 、HC373 等元件,這樣不僅提高的成本,也因分立元件的引入而降低了電路的可靠性。本設計的目的是采用Xilinx 公司生產(chǎn)的一片XC95288 和一片XC95144 來實現(xiàn) LCD 控制器以及其外圍控制,時序邏輯的全部功能,使得LCD 控制系統(tǒng)故障率和開發(fā)成本大大降低,并使LCD 控制系統(tǒng)有強大的功能可擴展性。

標簽： CPLD LCD 可編程邏輯器件低功耗

上傳時間： 2016-09-25

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簡單的數(shù)字電路設計

簡單的數(shù)字電路設計，全部由分立的IC實現(xiàn)，實物已經(jīng)做出過。實現(xiàn)兩個四位二進制數(shù)相加，和一個四位二進制移位的功能。仿照MCU指令進行設計，有2位二進制操作碼，8位輸入和5位輸出端，內(nèi)部時鐘控制電路。對于了解8位或者16位的MCU指令時序邏輯有點幫助.

標簽： 數(shù)字電路設計

上傳時間： 2014-01-15

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