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  • JPEG2000標準中算術編碼的FPGA設計與碼率控制算法的研究

    JPEG2000是由ISO/ITU-T組織下的IECJTC1/SC29/WG1小組制定的下一代靜止圖像壓縮標準,其優良的壓縮特性使得它將具有廣泛的應用領域。JPEG2000算法非常復雜,圖像編碼過程占用了大量的處理器時間開銷和內存開銷,因而通過對JPEG2000算法進行優化并采用硬件電路來實現JPEG2000標準的部分或全部內容,對加快編碼速度從而擴展其應用領域有重要的意義。 本文的研究主要包括兩方面的內容,其一是JPEG2000算術編碼器算法的研究與硬件設計,其二是JPEG2000碼率控制算法的研究與優化算法的設計。在研究算術編碼器過程中,首先研究了JPEG2000中基于上下文的MQ算術編碼器的編碼原理和編碼流程,之后采用有限狀態機和二級流水線技術,并在不影響關鍵路徑的情況下通過對算術編碼步驟優化采用硬件描述語言對算術編碼器進行了設計,并通過了功能仿真與綜合。實驗證明該設計不但編碼速度快,而且流水線短,硬件設計的復雜度低且易于控制。 在研究碼率控制算法過程中,首先結合率失真理論建立了算法的數學模型,并驗證了該算法的有效性,之后深入分析了該數學模型的實現流程,找出影響算法效率的關鍵路徑。在對算法優化時采用黃金分割點算法代替原來的二分查找法,并使用了碼塊R-D斜率最值記憶和碼率誤差控制算法。實驗證明,采用優化算法在增加少量系統資源的情況下使得計算效率提高了60%以上。之后,分析了率失真理論與JPEG2000中PCRD-opt算法的具體實現,又提出了一種失真更低的比特分配方案,即按照“失真/碼長”值從大到小通道編碼順序進行編碼,通過對該算法的仿真驗證,得出在固定碼率條件下新算法將產生更少的失真。

    標簽: JPEG 2000 FPGA 標準

    上傳時間: 2013-07-13

    上傳用戶:long14578

  • 帶碼率控制的近無損圖像壓縮

    數字圖像的壓縮是解決圖像數據量大、存儲和傳輸困難的基本措施。圖像壓縮的方法很多,一般可分為有損壓縮和無損壓縮兩大類。有損壓縮允許一定程度的信息丟失,在滿足實際應用的條件下能夠取得較高的壓縮比;無損壓縮不允許信息丟失,但是壓縮比難以提高。在醫學圖像、遙感圖像等應用領域,對于圖像的壓縮比和失真度都有著較高要求,因此需要采用近無損壓縮的方法。近無損壓縮是有損壓縮和無損壓縮的一個折衷,允許一定的失真,能夠獲得高保真還原圖像的同時,得到比無損壓縮更高的壓縮比。 JPEG-LS是連續色調靜止圖像無損和近無損壓縮的國際標準,算法復雜度低,壓縮性能優越,但是JPEG-LS對不同圖像壓縮時壓縮比不可控制。本文在研究JPEG-LS近無損圖像壓縮算法的基礎上,針對具體應用背景,提出了一種基于塊的近無損壓縮方法。進一步利用圖像局部紋理特性分析,對不同特性的區域容忍不同的信息丟失程度,實現了對圖像壓縮的碼率控制。針對某工程應用中的具體要求,我們以FPGA為平臺,采用Verilog HDL語言對改進算法進行了硬件實現。 實驗結果證明,這種基于塊的具有碼率控制的近無損圖像壓縮算法,在實現較為精確的碼率控制的同時,能夠獲得較高的還原圖像質量,而且硬件實現復雜度低,能夠滿足對圖像的實時壓縮要求。

    標簽: 碼率控制 圖像壓縮

    上傳時間: 2013-06-18

    上傳用戶:zzbbqq99n

  • 基于FPGA的頻率域MPEG2碼率轉換

    近年來,隨著網絡技術的發展和視頻編碼標準受到廣泛接受,視頻點播、視頻流和遠程教育等基于網絡的多媒體業務逐漸普及。為了對擁有不同終端資源,不同接入網絡以及不同興趣的用戶提供靈活的多媒體數據訪問服務,多媒體數據的內容需要根據應用環境動態調整,轉碼正是實現這一挑戰性任務的關鍵技術之一。 視頻轉碼對時間的要求非??量?,以至于用高速的通用微處理器芯片也無法在規定的時間內完成必要的運算。因此,必須為這樣的運算設計一個專用的高速硬線邏輯電路,在高速FPGA器件上實現或制成高速專用集成電路。用高密度的FPGA來構成完成轉碼算法所需的電路系統,實現專用集成電路的功能,因其成本低、設計周期短、功耗小、可靠性高、使用靈活等優點而成為適合本課題的最佳選擇。 本文根據MPEG-2中可變長編碼(VLC)理論,采用了兩級查找表減少了VLC存儲空間的使用,完成VLC編碼的實現。根據MPEG-2中關于System Packet的定義,針對FPGA可實現性,以空間換取復雜度的減少,實現了PES包的打包模塊。根據MPEG-2相應的轉碼理論,完成了對系統解碼模塊相應的連接和調試,對解碼模塊以真實的bit流進行了貼近板級的情況的仿真。根據MPEG-2中TM5的算法的局限性,分析得出只需要對P幀進行相應處理即可改進場景變換對視頻質量的影響,完成對TM5的算法的改進。通過性能估算和電路仿真,各模塊的吞吐率能夠滿足轉碼系統的要求。

    標簽: MPEG2 FPGA 頻率 碼率

    上傳時間: 2013-07-22

    上傳用戶:shinesyh

  • 基于FPGA的實時圖像融合處理系統

    隨著多媒體技術發展,數字圖像處理已經成為眾多應用系統的核心和基礎。圖像處理作為一種重要的現代技術,已經廣泛應用于軍事指揮、大視場展覽、跟蹤雷達、電視會議、導航等眾多領域。因而,實現高分辨率高幀率圖像實時處理的技術不僅具有廣泛的應用前景,而且對相關領域的發展也具有深遠意義。 大視場可視化系統由于屏幕尺寸很大,只有在特制的曲面屏幕上才能使細節得到充分地展現。為了在曲面屏幕上正確的顯示圖像,需要在投影前實時地對圖像進行幾何校正和邊緣融合。而現場可編程門陣列(FPGA)則是用硬件處理實時圖像數據的理想選擇,基于FPGA的圖像處理技術是世界范圍內廣泛關注的研究領域。 本課題的主要工作就是設計一個以FPGA為核心的硬件系統,該系統可對高分辨率高刷新率(1024*768@60Hz)的視頻圖像實時地進行幾何校正和邊緣融合。 論文首先介紹了圖像處理的幾何原理,然后提出了基于FPGA的大視場實時圖像融合處理系統的設計方案和模塊功能劃分。系統分為算法與軟件設計,硬件電路設計和FPGA邏輯設計三個大的部分。本論文主要負責FPGA的邏輯設計。圍繞FPGA的邏輯設計,論文先介紹了系統涉及的關鍵技術,以及使用Verilog語言進行邏輯設計的基本原則。 論文重點對FPGA內部模塊設計進行了詳細的闡述。仲裁與控制模塊是頂模塊的主體部分,主要實現系統狀態機和時序控制;參數表模塊主要實現SDRAM存儲器的控制器接口,用于圖像處理時讀取參數信息。圖像處理模塊是整個系統的核心,通過調用FPGA內嵌的XtremeDSP模塊,高速地完成對圖像數據的乘累加運算。最后論文提出并實現了一種基于PicoBlaze核的12C總線接口用于配置FPGA外圍芯片。 經過對寄存器傳輸級VerilogHDL代碼的綜合和仿真,結果表明,本文所設計的系統可以應用在大視場可視化系統中完成對高分辨率高幀率圖像的實時處理。

    標簽: FPGA 實時圖像 處理系統

    上傳時間: 2013-05-19

    上傳用戶:戀天使569

  • 基于FPGA的誤碼率測試儀設計

    基于FPGA的誤碼率測試儀設計基于FPGA的誤碼率測試儀設計

    標簽: FPGA 誤碼率 試儀設計

    上傳時間: 2013-08-02

    上傳用戶:1159797854

  • 直接數字頻率合成器的研究

    本文介紹了直接數字頻率合成器(DDS)的工作原理及基本結構,在此基礎上推導了它的理想頻譜,分析了DDS雜散的來源及抑制雜散的常用方法;重點研究了DDS中累加器和波形存儲表的設計。針對DDS輸入數據刷新率低的特點,雙層累加...

    標簽: 數字頻率合成器

    上傳時間: 2013-06-03

    上傳用戶:SimonQQ

  • 多抽樣率數字信號處理及其FPGA實現

    多抽樣率信號處理是現代信號處理理論的一個重要分支,在最近十幾年取得了巨大的發展,并在很多方面得到了成功的應用。本文分別從時域和頻域的角度深入分析了抽樣率變換的規律,并進一步研究了多抽樣率系統的高效實現理論...

    標簽: FPGA 抽樣 數字信號處理

    上傳時間: 2013-07-05

    上傳用戶:JIUSHICHEN

  • 多抽樣率數字信號處理及其FPGA實現

    多抽樣率信號處理是現代信號處理理論的一個重要分支,在最近十幾年取得了巨大的發展,并在很多方面得到了成功的應用。本文分別從時域和頻域的角度深入分析了抽樣率變換的規律,并進一步研究了多抽樣率系統的高效實現理論和方案。多抽樣率系統需要通過濾波器來改善其性能。本文分析了一般濾波器設計的方法與理論,著重研究了積分梳狀濾波器和半帶濾波器這兩種多抽樣率濾波器,并根據多抽樣率信號處理的特點以及幾種高效濾波結構和濾波器,利用積分梳狀濾波器和半帶濾波器在FPGA上設計了2~256倍可編程抽取器。為了進一步分析多相結構在多抽樣率信號處理中的應用,使用多相結構設計了具有固定倍數的內插器。在論文的最后,詳細介紹了某型號雷達信號處理機的硬件設計及其FPGA設計。關鍵字:多抽樣率信號處理 抽取 內插 多相濾波 積分梳狀濾波器 半帶濾波器

    標簽: FPGA 抽樣 數字信號處理

    上傳時間: 2013-06-12

    上傳用戶:fxf126@126.com

  • 用VHDL語言設計基于FPGA器件的高采樣率FIR濾波器

    用VHDL語言設計基于FPGA器件的高采樣率FIR濾波器,基于VHDL與CPLD器件的FIR數字濾波器的設計

    標簽: VHDL FPGA FIR 語言

    上傳時間: 2013-08-07

    上傳用戶:ukuk

  • 實現UXGA解決方案的雙通道AD9981設計準則

    借助AD9981,利用一種雙芯片“乒乓”配置可以實現超過110 MHz的像素時鐘速率。雙芯片解決方案與交替像素采樣解決方案的不同之處在于,前者可以維持全速刷新率。雙通道AD9981設計有多種實現方式。本應用筆記旨在讓用戶了解在實現這種配置時需要考慮的因素。相關變量包括布局和路由限制、時鐘選擇、圖形控制要求和最高速率要求等。

    標簽: UXGA 9981 AD 方案

    上傳時間: 2013-10-11

    上傳用戶:shinesyh

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