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功率開(kāi)關(guān)(guān)器件

此文件是對(duì)xilinx95144器件編的程序

此文件是對(duì)xilinx95144器件編的程序，編譯器采用xilinx ise5.2編譯。功能取締了單片機(jī)。

標(biāo)簽： xilinx 95144 器件程序

上傳時(shí)間： 2013-08-30

上傳用戶(hù)：bioequ
使8051能訪(fǎng)問(wèn)整個(gè)128KB的RAM空間和128KB的FlashRom空間,在CPLD內(nèi)建兩個(gè)寄存器\r\n

8051工作于11.0592MHZ,RAM擴(kuò)展為128KB的628128,FlashRom擴(kuò)展為128KB的AT29C010A\r\n 128KB的RAM分成4個(gè)區(qū)(Bank) 地址分配為0x0000-0x7FFF\r\n 128KB的FlashRom分成8個(gè)區(qū)(Bank) 地址分配為0x8000-0xBFFF\r\n 為了使8051能訪(fǎng)問(wèn)整個(gè)128KB的RAM空間和128KB的FlashRom空間,在CPLD內(nèi)建兩個(gè)寄存器\r\n RamBankReg和FlashRomBankReg用于存放高位地址

標(biāo)簽： 128 FlashRom 8051 KB

上傳時(shí)間： 2013-08-30

上傳用戶(hù)：cainaifa
嵌入式系統(tǒng)外圍接口電路的復(fù)雜可編程邏輯器件實(shí)現(xiàn)

嵌入式系統(tǒng)外圍接口電路的復(fù)雜可編程邏輯器件實(shí)現(xiàn)

標(biāo)簽： 嵌入式系統(tǒng) 外圍接口電路可編程邏輯器件

上傳時(shí)間： 2013-08-31

上傳用戶(hù)：zhouli
自己現(xiàn)在用的CPLD下載線(xiàn)原理圖用74HC244芯片\r\n

自己現(xiàn)在用的CPLD下載線(xiàn)，用74HC244芯片\r\n要注意設(shè)置下載模式

標(biāo)簽： CPLD 244 74 HC

上傳時(shí)間： 2013-08-31

上傳用戶(hù)：dancnc
Xilinx-FPGA器件管腳說(shuō)明

Xilinx-FPGA器件管腳說(shuō)明

標(biāo)簽： Xilinx-FPGA 器件管腳

上傳時(shí)間： 2013-09-03

上傳用戶(hù)：牛津鞋
這是一個(gè)用MAX+PLUSII開(kāi)發(fā)FPGA（1K30器件）開(kāi)發(fā)的李沙育圖形發(fā)生器（硬件描述語(yǔ)言部分）

這是一個(gè)用MAX+PLUSII開(kāi)發(fā)FPGA（1K30器件）開(kāi)發(fā)的李沙育圖形發(fā)生器（硬件描述語(yǔ)言部分）。

標(biāo)簽： PLUSII FPGA 1K30 MAX

上傳時(shí)間： 2013-09-03

上傳用戶(hù)：zhyfjj
TI推薦的ALTERA的FPGA電源器件選型手冊(cè)

TI推薦的ALTERA的FPGA電源器件選型手冊(cè),比較實(shí)用

標(biāo)簽： ALTERA FPGA 電源器件選型手冊(cè)

上傳時(shí)間： 2013-09-04

上傳用戶(hù)：2467478207
該文闡述了現(xiàn)場(chǎng)可編程邏輯器件FPGA的主要特點(diǎn)

該文闡述了現(xiàn)場(chǎng)可編程邏輯器件FPGA的主要特點(diǎn)，應(yīng)用FPGA芯片和VHDL硬件描述語(yǔ)言設(shè)計(jì)的模擬示波器數(shù)字信號(hào)顯示系統(tǒng)的設(shè)計(jì)原理和設(shè)計(jì)方法。

標(biāo)簽： FPGA 現(xiàn)場(chǎng)可編程邏輯器件

上傳時(shí)間： 2013-09-04

上傳用戶(hù)：qweqweqwe
計(jì)PLD/FPGA時(shí)通常采用幾種時(shí)鐘類(lèi)型

無(wú)淪是用離散邏輯、可編程邏輯，還是用全定制硅器件實(shí)現(xiàn)的任何數(shù)字設(shè)計(jì)，為了成功地操\r\n作，可靠的時(shí)鐘是非常關(guān)鍵的。設(shè)計(jì)不良的時(shí)鐘在極限的溫度、電壓或制造工藝的偏差情況下將\r\n導(dǎo)致錯(cuò)誤的行為，并且調(diào)試?yán)щy、花銷(xiāo)很大。在設(shè)計(jì)PLD/FPGA時(shí)通常采用幾種時(shí)鐘類(lèi)型。時(shí)鐘可\r\n分為如下四種類(lèi)型：全局時(shí)鐘、門(mén)控時(shí)鐘、多級(jí)邏輯時(shí)鐘和波動(dòng)式時(shí)鐘。多時(shí)鐘系統(tǒng)能夠包括上\r\n述四種時(shí)鐘類(lèi)型的任意組合。

標(biāo)簽： FPGA PLD 時(shí)鐘

上傳時(shí)間： 2013-09-04

上傳用戶(hù)：yelong0614
這是一款USB接口ISP1582器件實(shí)現(xiàn)DMA傳輸?shù)妮o助電路的硬件設(shè)計(jì)源代碼

這是一款USB接口ISP1582器件實(shí)現(xiàn)DMA傳輸?shù)妮o助電路的硬件設(shè)計(jì)源代碼

標(biāo)簽： 1582 USB ISP DMA

上傳時(shí)間： 2013-09-05

上傳用戶(hù)：1142895891

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