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功耗

基于MSP430的微功耗體外臨時心臟起搏器的設計

基于MSP430 系列單片機設計了體外臨時心臟起搏器的起搏裝置，給出了硬件設計電路和軟件的系統結構。經實驗研究，該裝置比原有的以AT89c2051 型單片機制造的體外臨時心臟起搏器在單位電池供電的情況下使用期限更長，以實現低功耗，即將原來的工作電流削減一半以上，電池更換的頻率由原先的1 次/周，降低至1 次/月。心臟起搏器是目前臨床上用于治療心搏徐緩的最有效醫療設備。當患者心臟的竇房結或心肌的神經傳導組織發生障礙時，心臟起搏器就會通過起搏裝置人為的發放電脈沖，再經體內的導管電極刺激房室搏動[7]。隨著現代電子技術的飛速發展，電子產品的低功耗設計越來越受到人們的重視。低功耗設計包括了低電壓設計、低電流設計、相應得軟硬件設計、充分利用現有資源、開發新資源等多層含意與技術[5] [6]。微功耗體外臨時心臟起搏器已經成為各國、各公司競相研究的一個重要領域。

標簽： MSP 430 微功耗心臟起搏器

上傳時間： 2013-11-18

上傳用戶：xyipie
便攜式智能儀器儀表的低功耗技術

結合單片機技術及其它相關技術的新進展，研究了便攜式智能儀器儀表的實用低功耗技術。對便攜式智能儀器儀表的低功耗設計具有指導作用。功耗問題一直是便攜式電子系統發展的主要障礙。現在，電子系統的低功耗設計作為綠色電子的基本要求，成為現代電子系統的普遍追求。電子系統的低功耗設計可實現電子終端產品便攜、節能、可靠的愿望。LSI 和VLSI 技術的發展與應用，有賴與可靠性技術和低功耗技術的發展。便攜式智能儀器儀表在許多領域有重要而廣泛的應用。單片機是便攜式智能儀器儀表的核心。在一定意義上講，便攜式智能儀器儀表是一個單片機應用系統。單片機技術及其它相關技術的迅速發展，為便攜式智能儀器儀表的低功耗設計提供了必要的條件。長壽命、高速度、低電壓與低功耗、低噪聲與高可靠性、多品種、低價格等是單片機技術發展的特點，并已取得很大進展[1]。本文將結合單片機技術及其它相關技術的新進展，討論便攜式智能儀器儀表的實用低功耗技術。這對便攜式智能儀器儀表（以下簡稱“智能儀表”）的低功耗設計具有較好的指導作用。

標簽： 便攜式低功耗技術智能儀器儀表

上傳時間： 2013-10-11

上傳用戶：tou15837271233
基于U盤的單片機低功耗海量存儲系統

本文介紹了一個以嵌入式USB 主機接口芯片SL811HS 為核心，采用U 盤為存儲介質的單片機低功耗海量存儲系統。該系統實現了儀器的便攜化，從而，為便攜儀器或嵌入式系統的外掛式海量存儲的發展開拓了新思路。近幾年，隨著Flash Memory 非易失存儲技術的發展，基于USB 接口的閃存即U 盤現已得到廣泛應用。從理論上講，以U 盤作為便攜式采集存儲系統的存儲載體完全能夠滿足長時間采集海量數據的要求。但目前所面臨的問題是，U 盤主要應用于PC 機系統中。以單片機等微處理器為核心的嵌入式系統的應用中，尚缺少與U 盤的直接接口技術。因此將單片機技術與U 盤存儲技術兩者結合起來，利用單片機直接讀寫U 盤，并通過總線方式與嵌入式系統的其它部分實現命令和數據的通信，從而實現便攜儀器或者嵌入式系統的外掛式海量存儲，具有廣闊的應用前景。而以Cypress 公司的SL811HS 為代表的嵌入式USB 主機接口芯片為這種方案的實現提供了可能。

標簽： U盤單片機低功耗海量存儲

上傳時間： 2013-10-09

上傳用戶：無聊來刷下
基于PIC單片機的低功耗讀卡器硬件設計

基于PIC單片機的低功耗讀卡器硬件設計:本文提出了一個完整的基于串口的智能讀卡器子系統設計方案并將其實現。讀卡器的設計突出了小型化的要求，全部器件使用貼片封裝。為了減小讀卡器的體積，設計中還使用了串口竊電的技術，使用串口信號線直接給讀卡器供電。為此，讀卡器使用了省電的設計，采用了省電的集成電路，并大膽簡化了許多傳統的設計電路。關鍵字：讀卡器，單片機，串口竊電 Abstract： This paper aims to put forward a complete design of Smart IC card reader based onSerial Port and propose the way of realizing it for the purpose of Network Security. SMD isadopted to make Smart IC reader smaller in this design. To reduce the volume of Smart ICreader， Serial Port powered technology is employed to get power from the signal line of Serial Port. For this reason， low-power consumption components are adopted in the design and some traditional designs are simplified to reduce the power consumption.Keywords： Card Reader； Single-chip Computer； Serial Port Powered IC 卡系統保存了加密算法所需要的工作密鑰，供加密算法對網絡上傳輸的數據加密使用，是整個系統網絡安全的核心。在IC 卡子系統中，讀卡器是一個重要的部分。它起著管理IC卡、在IC 卡和PC或網絡計算機間傳遞數據的重要作用。本文以一片PIC單片機為核心完成了基于RS232 串口的讀卡器的硬件設計。

標簽： PIC 單片機低功耗讀卡器

上傳時間： 2014-04-14

上傳用戶：wanghui2438
TEA1504開關電源低功耗控制芯片的應用

TEA1504開關電源低功耗控制芯片的應用:介紹了Philips 公司開發的Green Chip TM 綠色芯片TEA1504 的內部結構及工作原理，該控制芯片集成了開關電源的PWM 控制、高低頻模式轉換、柵極驅動和保護等功能，同時上有瞬態響應快，啟動電流過沖小，待機功耗低等特點。關鍵詞：開關電源 TEA1504 脈寬調制低功耗1 前言開關電源以其供電效率高，穩壓范圍大，體積小被越來越多的電子電器設備所采用，在大屏幕電視機、監視器、計算機等電器的待機或備用（stand-by）狀態會繼續耗電，為此，Philips 公司采用BiCOMS 工藝開發出了被之為Green Chip TM(綠色芯片)的高壓開關電源控制芯片。該類集成芯片（IC）的穩壓范圍為90～276V(AC)，能將開關電源待機功耗降至2W 以下，其本身的待機損耗小于100mW，并具有快速和高效的片內啟動電流源；在負載功率較低時，它還能自動轉換到低頻工作模式，從而降低了開關電源的損耗。高水平的集成技術使IC 的外圍元件大大減少，以實現開關電源的小型化、高效率和高可靠性。本文介紹的TEA1504 是Green Chip TM 系列IC 中的重要成員之一。

標簽： 1504 TEA 開關電源低功耗

上傳時間： 2013-12-27

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dsPIC30F看門狗定時器和低功耗模式

本章介紹dsPIC30F器件系列的看門狗定時器（WDT）和低功耗模式。dsPIC DSC 器件有兩種低功耗模式，可以通過執行PWRSAV指令進入：• 休眠模式：CPU、系統時鐘源和任何依靠系統時鐘源工作的外設都被禁止。這是器件的最低功耗模式。• 空閑模式：CPU 被禁止，但是系統時鐘源繼續工作。外設繼續工作，但可以有選擇地禁止。WDT在使能時使用內部LPRC 時鐘源工作，而且如果WDT沒有被軟件清零，它可以通過復位器件來檢測系統軟件的異常情況。可以使用WDT后分頻器選擇不同的WDT超時周期。WDT也可用于將器件從休眠或空閑模式喚醒。

標簽： dsPIC 30F 30 看門狗定時器

上傳時間： 2014-02-01

上傳用戶：金苑科技
80C51便攜式產品中的低功耗設計

80C51單片機由于功能全面、開發工具較為完善、衍生產品豐富、大量的設計資源可以繼承和共享，得到廣泛的應用。我們設計的一款手持線PDA產品，也選擇80C51單片機作為主、輔CPU，還具備點陣液晶顯示屏、導電橡膠鍵盤、雙IC卡接口、EEPROM存儲器、實時時鐘和串行通信口。由于使用80C51單片機開發，高級語言編程，大大降低了設計的技術風險，產品在較短的時間內就推向了市場。但是，同一些低速的微控制器（如4位單片機）和高速的RISC處理器相比，80C51單片機在功耗上沒有優勢。為了在PDA類產品中發揮80C51單片機的上述特長，我們通過采取軟、硬件配合的一系列措施，加強低電壓、低功耗設計，取得了良好的效果。該機使用一顆3V鈕扣式鋰電池，開機時工作電池小于4mA，瞬間最大工作電流小于20mA,瞬間最大工作電流小于20mA，關機電流小于2μA。一顆電池可以使用較長的時間，達到滿意的設計指標。一、低電壓低功耗設計理論在一個器件中，功耗通常用電流消耗來表示。下式表明消耗的電池與器件特性之間的關系：Icc = C ∫ Vda ≈ ΔV · C · f （1）式中：Icc是器件消耗的電流；Δ是電壓變化的幅值；C是器件電容和輸出容性負載的大小；f是器件運行頻率。從公式（1）可以得到降低系統功耗的理論依據。將器件供電電壓從5V降低3V，可以至少降低40%的功耗。降低器件的工作頻率，也能成比例地降低功耗。

標簽： 80C51 便攜式產品低功耗設計

上傳時間： 2013-10-13

上傳用戶：shaojie2080
基于功耗管理的DSP處理器設計

一種具有功耗管理特性的DSP處理器的結構設計。該處理器采用4級流水線和增強型的哈佛并行系統結構及完善的時鐘管理模塊,提供了一種DSP處理器的集成設計。

標簽： DSP 功耗管理處理器

上傳時間： 2013-10-13

上傳用戶：星仔
FPGA功耗優化

FPGA功耗優化

標簽： FPGA 功耗優化

上傳時間： 2014-12-28

上傳用戶：2218870695
采用低成本FPGA實現高效的低功耗PCIe接口

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標簽： FPGA PCIe 低功耗接口

上傳時間： 2013-11-16

上傳用戶：huangld