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功耗

藍(lán)牙4.0 BLE低功耗解決方案

藍(lán)牙4.0低功耗 ●鑒于蘋果產(chǎn)品對藍(lán)牙4.0的開發(fā)政策，藍(lán)牙模塊可以不用解密芯片與蘋果產(chǎn)品取得通信，結(jié)合APP軟件，使用藍(lán)牙指令和數(shù)據(jù)實(shí)現(xiàn)對藍(lán)牙健康醫(yī)療設(shè)備，藍(lán)牙玩具，藍(lán)牙家居設(shè)備，藍(lán)牙工業(yè)設(shè)備的控制和數(shù)據(jù)顯示 ● 藍(lán)牙模塊：RB105（CSR 1000 藍(lán)牙4.0 BLE） ●同時兼容IOS、android、windows 8

標(biāo)簽： 4.0 BLE 藍(lán)牙低功耗

上傳時間： 2013-12-11

上傳用戶：xhwst
Cortex-M0 LPC1114功耗測試報告

由LPC1114芯片數(shù)據(jù)手冊可得：芯片內(nèi)部IRC精度±1%，作為主時鐘可滿足串口波特率對時鐘精度的要求，而看門狗振蕩器精度為±25%，誤差較大不能滿足串口對于時鐘精度的要求。但是看門狗振蕩器的功耗比內(nèi)部RC振蕩器的功耗低。因此設(shè)定以下2種測試方案：測試方法1：LPC1114進(jìn)行A/D轉(zhuǎn)換時使用看門狗振蕩器作為主時鐘源，時鐘頻率為1MHz，串口通信時將主時鐘源切換到內(nèi)部RC振蕩器輸出，時鐘頻率為1MHz，完成串口通信后時鐘再次切換到看門狗振蕩器輸出，如此循環(huán)執(zhí)行；

標(biāo)簽： Cortex-M 1114 LPC 功耗測試

上傳時間： 2013-11-13

上傳用戶：潛水的三貢
多功能低功耗海洋數(shù)據(jù)采集器的設(shè)計

為了克服國內(nèi)數(shù)據(jù)采集器通用性不強(qiáng)，論文以C8051F120為控制核心設(shè)計了通用多功能低功耗海洋數(shù)據(jù)采集器。多功能低功耗海洋數(shù)據(jù)采集器采用B1203LS非線性變壓模塊，降低了系統(tǒng)的功耗；采用了OCM12864-8液晶顯示設(shè)計，實(shí)現(xiàn)了系統(tǒng)的菜單化管理；采用大容量存儲器AT45DB041，可以存儲大量歷史數(shù)據(jù)；并提供了RS232接口可以實(shí)現(xiàn)遠(yuǎn)程有線或者無線傳輸。整個系統(tǒng)有體積小、功耗低、太陽能供電的特點(diǎn)，完全達(dá)到設(shè)計要求，有較大的實(shí)用價值和應(yīng)用前景。

標(biāo)簽： 多功能低功耗海洋數(shù)據(jù) 采集器

上傳時間： 2013-11-05

上傳用戶：lyy1234
FPGA功耗優(yōu)化

FPGA功耗優(yōu)化

標(biāo)簽： FPGA 功耗優(yōu)化

上傳時間： 2014-01-22

上傳用戶：agent
采用低成本FPGA實(shí)現(xiàn)高效的低功耗PCIe接口

　　白皮書：采用低成本FPGA實(shí)現(xiàn)高效的低功耗PCIe接口　　了解一個基于DDR3存儲器控制器的真實(shí)PCI Express® （PCIe®） Gen1x4參考設(shè)計演示高效的Cyclone V FPGA怎樣降低系統(tǒng)總成本，同時實(shí)現(xiàn)性能和功耗目標(biāo)。點(diǎn)擊馬上下載！

標(biāo)簽： FPGA PCIe 低功耗接口

上傳時間： 2013-10-18

上傳用戶：康郎
Altera公司 Cyclone V 28nm FPGA功耗優(yōu)勢

Cyclone V FPGA功耗優(yōu)勢：采用低功耗28nm FPGA活的最低系統(tǒng)功耗（英文資料）

標(biāo)簽： Cyclone Altera FPGA 28

上傳時間： 2015-01-01

上傳用戶：xauthu
Cyclone V FPGA：采用低功耗28nm FPGA減少總系統(tǒng)成本

本文主要介紹Cyclone V FPGA的一個很明顯的特性，也可以說是一個很大的優(yōu)勢，即：采用低功耗28nm FPGA減少總系統(tǒng)成本

標(biāo)簽： FPGA Cyclone 28 nm

上傳時間： 2013-11-11

上傳用戶：aeiouetla
賽靈思如何讓7系列FPGA的功耗減半

賽靈思采用專為 FPGA 定制的芯片制造工藝和創(chuàng)新型統(tǒng)一架構(gòu)，讓 7 系列 FPGA 的功耗較前一代器件降低一半以上。

標(biāo)簽： FPGA 賽靈思功耗減

上傳時間： 2013-10-10

上傳用戶：sklzzy
降低賽靈思28nm 7系列FPGA的功耗

本白皮書介紹了有關(guān)賽靈思 28 nm 7 系列 FPGA 功耗的幾個方面，其中包括臺積電 28nm高介電層金屬閘 (HKMG) 高性能低功耗（28nm HPL 或 28 HPL）工藝的選擇。

標(biāo)簽： FPGA 28 nm 賽靈思

上傳時間： 2013-10-24

上傳用戶：wcl168881111111
WP370 -采用智能時鐘門控技術(shù)降低動態(tài)開關(guān)功耗

　　賽靈思推出業(yè)界首款自動化精細(xì)粒度時鐘門控解決方案，該解決方案可將 Virtex®-6 和 Spartan®-6 FPGA 設(shè)計方案的動態(tài)功耗降低高達(dá) 30%。賽靈思智能時鐘門控優(yōu)化可自動應(yīng)用于整個設(shè)計，既無需在設(shè)計流程中添加更多新的工具或步驟，又不會改變現(xiàn)有邏輯或時鐘，從而避免設(shè)計修改。此外，在大多數(shù)情況下，該解決方案都能保留時序結(jié)果。

標(biāo)簽： 370 WP 智能時鐘動態(tài)

上傳時間： 2015-01-02

上傳用戶：wutong

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