對CAN協議的詳細注解，和功能的描述這本CAN 規范技術規范由兩部分組成： • A 部分：CAN 的報文格式說明（按CAN1.2 規范定義）。 • B 部分：標準格式和擴展格式的說明。 為了兼容CAN2.0，要求CAN 的儀器應兼容A 部分或B 部分。
上傳時間： 2017-07-09
上傳用戶：hongmo
【問題描述】 在一個N*N的點陣中，如N=4,你現在站在（1，1），出口在（4，4）。你可以通過上、下、左、右四種移動方法，在迷宮內行走，但是同一個位置不可以訪問兩次，亦不可以越界。表格最上面的一行加黑數字A[1..4]分別表示迷宮第I列中需要訪問并僅可以訪問的格子數。右邊一行加下劃線數字B[1..4]則表示迷宮第I行需要訪問并僅可以訪問的格子數。如圖中帶括號紅色數字就是一條符合條件的路線。 給定N，A[1..N] B[1..N]。輸出一條符合條件的路線，若無解，輸出NO ANSWER。（使用U，D，L，R分別表示上、下、左、右。） 2 2 1 2 （4，4） 1 （2，3） （3，3） （4，3） 3 （1，2） （2，2） 2 （1，1） 1 【輸入格式】 第一行是數m (n < 6 )。第二行有n個數，表示a[1]..a[n]。第三行有n個數，表示b[1]..b[n]。 【輸出格式】 僅有一行。若有解則輸出一條可行路線，否則輸出“NO ANSWER”。
標簽： 點陣
上傳時間： 2014-06-21
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特點： 精確度0.1%滿刻度 可作各式數學演算式功能如:A+B/A-B/AxB/A/B/A&B(Hi or Lo)/|A|/ 16 BIT類比輸出功能 輸入與輸出絕緣耐壓2仟伏特/1分鐘(input/output/power) 寬范圍交直流兩用電源設計 尺寸小,穩定性高
上傳時間： 2014-12-23
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觸發器是時序邏輯電路的基本構成單元，按功能不同可分為 RS 觸發器、 JK 觸發器、 D 觸發器及 T 觸發器四種，其功能的描述可以使用功能真值表、激勵表、狀態圖及特性方程。只要增加門電路便可以實現不同功能觸發器的相互轉換，例如要將 D 觸發器轉換為 JK 觸發器，轉換的關鍵是推導出 D 觸發器的輸入端 D 與 JK 觸發器的輸入端J 、 K 及狀態輸出端 Qn 的邏輯表達式，然后用門電路去實現該邏輯表達式。具體的設計方法有公式法和圖表法兩種。
上傳時間： 2014-12-23
上傳用戶：lbbyxmoran
特點(FEATURES) 精確度0.1%滿刻度 (Accuracy 0.1%F.S.) 可作各式數學演算式功能如:A+B/A-B/AxB/A/B/A&B(Hi or Lo)/|A| (Math functioA+B/A-B/AxB/A/B/A&B(Hi&Lo)/|A|/etc.....) 16 BIT 類比輸出功能(16 bit DAC isolating analog output function) 輸入/輸出1/輸出2絕緣耐壓2仟伏特/1分鐘(Dielectric strength 2KVac/1min. (input/output1/output2/power)) 寬范圍交直流兩用電源設計(Wide input range for auxiliary power) 尺寸小,穩定性高(Dimension small and High stability)
上傳時間： 2013-11-24
上傳用戶：541657925
摘要: 串行傳輸技術具有更高的傳輸速率和更低的設計成本, 已成為業界首選, 被廣泛應用于高速通信領域。提出了一種新的高速串行傳輸接口的設計方案, 改進了Aurora 協議數據幀格式定義的弊端, 并采用高速串行收發器Rocket I/O, 實現數據率為2.5 Gbps的高速串行傳輸。關鍵詞: 高速串行傳輸; Rocket I/O; Aurora 協議 為促使FPGA 芯片與串行傳輸技術更好地結合以滿足市場需求, Xilinx 公司適時推出了內嵌高速串行收發器RocketI/O 的Virtex II Pro 系列FPGA 和可升級的小型鏈路層協議———Aurora 協議。Rocket I/O支持從622 Mbps 至3.125 Gbps的全雙工傳輸速率, 還具有8 B/10 B 編解碼、時鐘生成及恢復等功能, 可以理想地適用于芯片之間或背板的高速串行數據傳輸。Aurora 協議是為專有上層協議或行業標準的上層協議提供透明接口的第一款串行互連協議, 可用于高速線性通路之間的點到點串行數據傳輸, 同時其可擴展的帶寬, 為系統設計人員提供了所需要的靈活性[4]。但該協議幀格式的定義存在弊端,會導致系統資源的浪費。本文提出的設計方案可以改進Aurora 協議的固有缺陷,提高系統性能, 實現數據率為2.5 Gbps 的高速串行傳輸, 具有良好的可行性和廣闊的應用前景。
上傳時間： 2013-11-06
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摘要: 串行傳輸技術具有更高的傳輸速率和更低的設計成本, 已成為業界首選, 被廣泛應用于高速通信領域。提出了一種新的高速串行傳輸接口的設計方案, 改進了Aurora 協議數據幀格式定義的弊端, 并采用高速串行收發器Rocket I/O, 實現數據率為2.5 Gbps的高速串行傳輸。關鍵詞: 高速串行傳輸; Rocket I/O; Aurora 協議 為促使FPGA 芯片與串行傳輸技術更好地結合以滿足市場需求, Xilinx 公司適時推出了內嵌高速串行收發器RocketI/O 的Virtex II Pro 系列FPGA 和可升級的小型鏈路層協議———Aurora 協議。Rocket I/O支持從622 Mbps 至3.125 Gbps的全雙工傳輸速率, 還具有8 B/10 B 編解碼、時鐘生成及恢復等功能, 可以理想地適用于芯片之間或背板的高速串行數據傳輸。Aurora 協議是為專有上層協議或行業標準的上層協議提供透明接口的第一款串行互連協議, 可用于高速線性通路之間的點到點串行數據傳輸, 同時其可擴展的帶寬, 為系統設計人員提供了所需要的靈活性[4]。但該協議幀格式的定義存在弊端,會導致系統資源的浪費。本文提出的設計方案可以改進Aurora 協議的固有缺陷,提高系統性能, 實現數據率為2.5 Gbps 的高速串行傳輸, 具有良好的可行性和廣闊的應用前景。
上傳時間： 2013-10-13
上傳用戶：lml1234lml
本論文敘述了我校學成績管理的現狀以及Visual basic6.0語言的概況.重點介紹了學生成績管理系統的實現過程：包括系統分析、 系統調查、 數據流程分析、功能設計、 數據庫設計、 系統物理配置方案、 系統實現、 系統測試和調試.本系統主要功能有用戶管理、學生注冊、班級信息錄入、學生信息錄入、班級課程錄入、學校專業信息錄入、課程信息錄入、學生成績錄入、教師信息錄入、數據...........包括功能需求描述、數據庫設計等內容.第四章介紹了本系統的具體實現.第五章關于本系統開發過程中的結論及體會.
上傳時間： 2014-01-06
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本論文敘述了我校學成績管理的現狀以及Visual basic6.0語言的概況。重點介紹了學生成績管理系統的實現過程：包括系統分析、 系統調查、 數據流程分析、功能設計、 數據庫設計、 系統物理配置方案、 系統實現、 系統測試和調試。本系統主要功能有用戶管理、學生注冊、班級信息錄入、學生信息錄入、班級課程錄入、學校專業信息錄入、課程信息錄入、學生成績錄入、教師信息錄入等等。包括功能需求描述、數據庫設計等內容。第四章介紹了本系統的具體實現。第五章關于本系統開發過程中的結論及體會。
上傳時間： 2013-12-19
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本論文敘述了聯機考試系統的現狀以及C#語言的概況。重點介紹了聯機考試系統的實現過程：包括系統分析、 系統調查、 數據流程分析、功能設計、 數據庫設計、 系統物理配置方案、 系統實現、 系統測試和調試。本系統主要模塊有管理員模塊、教師模塊、學生模塊、幫助模塊、測試模塊、打包和部署模塊、用戶手冊模塊、C#編碼規范模塊、。。。。。。。。。。。包括功能需求描述、數據庫設計等內容。第四—十章介紹了本系統的具體實現。第十一章—十三章關于本系統開發過程中的結論及體會。
上傳時間： 2016-05-31
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