本文在闡述卷積碼編解碼器基本工作原理的基礎上，提出了在MAX+PlusⅡ開發平臺上基于VHDL語言設計（2，1，6）卷積碼編解碼器的方法。
上傳時間： 2013-06-16
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隨著印制電路板功能的日益增強，結構日趨復雜，系統中各個功能單元之間的連線間距越來越細密，基于探針的電路系統測試方法已經很難滿足現在的測試需要。邊界掃描測試(BST)技術通過將邊界掃描寄存器單元安插在集成電路內部的每個引腳上，相當于設置了施加激勵和觀測響應的內建虛擬探頭，通過該技術可以大大的提高數字系統的可觀測性和可控性，降低測試難度。針對這種測試需求，本文給出了基于FPGA的邊界掃描控制器設計方法。 完整的邊界掃描測試系統主要由測試控制部分和目標器件構成，其中測試控制部分由測試圖形、數據的生成與分析及邊界掃描控制器兩部分構成。而邊界掃描控制器是整個系統的核心，它主要實現JTAG協議的自動轉換，產生符合IEEE標準的邊界掃描測試總線信號，而邊界掃描測試系統工作性能主要取決與邊界掃描控制器的工作效率。因此，設計一個能夠快速、準確的完成JTAG協議轉換，并且具有通用性的邊界掃描控制器是本文的主要研究工作。 本文首先從邊界掃描技術的基本原理入手，分析邊界掃描測試的物理基礎、邊界掃描的測試指令及與可測性設計相關的標準，提出了邊界掃描控制器的總體設計方案。其次，采用模塊化設計思想、VHDL語言描述來完成要實現的邊界掃描控制器的硬件設計。然后，利用自頂向下的驗證方法，在對控制器內功能模塊進行基于Testbench驗證的基礎上，利用嵌入式系統的設計思想，將所設計的邊界掃描控制器集成到SOPC中，構成了基于SOPC的邊界掃描測試系統。并且對SOPC系統進行軟硬件協同仿真，實現對邊界掃描控制器的功能驗證后將其應用到實際的測試電路當中。最后，在基于SignalTapⅡ硬件調試的基礎上，軟硬件結合對整個系統可行性進行了測試。從測試結果看，達到了預期的設計目標，該邊界掃描控制器的設計方案是正確可行的。 本文設計的邊界掃描控制器具有自主知識產權，可以與其他處理器結合構成完整的邊界掃描測試系統，并且為SOPC系統提供了一個很有實用價值的組件，具有很明顯的現實意義。
上傳時間： 2013-07-20
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文章首先分析比較了光伏并網逆變器的各種主電路結構優缺點，提出適合小 功率光伏系統的兩級式并網結構，并對前級DC-DC電路和后級DC-AC分別進行 了電路結構的選擇。
上傳時間： 2013-06-14
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周立功的一份文檔，介紹源碼公開的MCS-51單片機宏匯編器，本是一應屆生的習作，是學習編譯原理和C程序設計的“靶子”，雖然該軟件未完全達到滿意效果，不過與Keil公司的A51配合起來使用還是不錯的。
上傳時間： 2013-05-19
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基于FPGA技術的HDLC幀收發器的設計與實現
上傳時間： 2013-05-24
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USBISP下載器驅動USBISP下載器驅動及說明(USBISP配置用戶用)\RZ-USBISP使用說明
上傳時間： 2013-07-03
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隨著數字電視全國范圍丌播時間表的臨近，數字電視技術得到很大發展，數字電視信號在信源基帶數據和信道傳輸等方面已經進一步標準化，數字電視傳播途徑也越來越廣，在衛星、地面及有線電視網中傳輸數字電視信號得到迅速發展。借著2008年奧運的東風，數字電視領域的應用研究方興未艾。 本課題目的是完成有線數字電視廣播系統的重要設備--調制器的設計和實現，核心器件選用FPGA芯片。系統硬件實現以國家標準GY/T 170-2001(有線數字電視廣播信道編碼與調制規范)為主要依據，以Xilinx公司的Virtex系列(Virtex 4，Virtex 5)芯片及相關開發板(ML402、ML506)為平臺，主要任務是基于相關標準對其實用技術進行研究和開發。完成了信道編碼和調制的模塊劃分、Verilog HLD程序的編寫(或IP核的調用)和仿真以及在板調試和聯調等工作，設計目的是在提高整個系統集成度的前提下實現多頻點調制。 本文在研究現有數字電視網絡技術和相關產品的基礎上，以國標GY/T170-2001為主要依據并參閱了其他的相關標準，提出了多頻點QAM調制器的實現方案。整個工作包括：模塊劃分，完成了基帶物理接口(輸入)、包頭反轉與隨機化、RS編碼、卷積交織、碼流變換、差分編碼、星座映射、基帶成型(包括Nyquist濾波器、半帶濾波器、CIC濾波器的設計或模塊調用)、高端DAC的配置(輸出)等模塊的Verilog HLD程序的編寫(或者IP核調用)和仿真等工作；成功進行了開發板板級調試，調試的過程中充分利用Xilinx公司的開發板和調試軟件ChipScope，成功設計了驗證方案并進行了模塊驗證；最后進行了各模塊聯調工作，設計了系統驗證方案并成功完成對整個系統的驗證工作。 經測試表明，該系統主要性能達到國家相關標準GY/T 198-2003(有線數字電視廣播QAM調制器技術要求和測量方法)規定的技術指標，可以進入樣機試生產環節。
上傳時間： 2013-04-24
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Multisim11.0加破解及漢化補丁
上傳時間： 2013-04-24
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FPGA(Field Programmable Gate Arrays)是目前廣泛使用的一種可編程器件，FPGA的出現使得ASIC(Application Specific Integrated Circuits)產品的上市周期大大縮短，并且節省了大量的開發成本。目前FPGA的功能越來越強大，滿足了目前集成電路發展的新需求，但是其結構同益復雜，規模也越來越大，內部資源的種類也R益豐富，但同時也給測試帶來了困難，FPGA的發展對測試的要求越來越高，對FPGA測試的研究也就顯得異常重要。 本文的主要工作是提出一種開關盒布線資源的可測性設計，通過在FPGA內部加入一條移位寄存器鏈對開關盒進行配置編程，使得開關盒布線資源測試時間和測試成本減少了99％以上，而且所增加的芯片面積僅僅在5％左右，增加的邏輯資源對FPGA芯片的使用不會造成任何影響，這種方案采用了小規模電路進行了驗證，取得了很好的結果，是一種可行的測試方案。 本文的另一工作是采用一種FPGA邏輯資源的測試算法對自主研發的FPGA芯片FDP250K的邏輯資源進行了嚴格、充分的測試，從FPGA最小的邏輯單元LC開始，首先得到一個LC的測試配置，再結合SLICE內部兩個LC的連接關系得到一個SLICE邏輯單元的4種測試配置，并且采用陣列化的測試方案，同時測試芯片內部所有的邏輯單元，使得FPGA內部的邏輯資源得完全充分的測試，測試的故障覆蓋率可達100％，測試配置由配套編程工具產生，測試取得了完滿的結果。
上傳時間： 2013-06-29
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本課題涉及先進的FPGA技術引入到數控插補時某些算法的改進，主要目的是更好的利用FPGA具有系統芯片化、高可靠性、開發設計周期短等特點，及具有系統內可再編程的性能，來解決目前軟件插補速度慢而硬件插補設計復雜、調整和修...
上傳時間： 2013-04-24
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