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原廠直銷(xiāo)

  • 直放站中的自動電平那個控制ALC

    ALC(Automatic level control自動電平控制)是直放站系統中極為重要的一環,它是指當放大器輸出信號電平到達ALC設定值時,增加輸入信號電平,放大器對輸出信號電平的控制能力。

    標簽: ALC 直放站 電平 控制

    上傳時間: 2013-11-02

    上傳用戶:hasan2015

  • uCOSII的多任務操作系統全部原代碼

    u C / O S 是一種公開源代碼、結構小巧、具有可剝奪實時內核的實時操作系統,主要用于嵌入式應用設計,本內容主要包含了多任務操作系統的源代碼

    標簽: uCOSII 多任務操作系統 代碼

    上傳時間: 2013-10-13

    上傳用戶:sun_pro12580

  • 頻譜分析儀、功率計、信號發生器等原程序

    頻譜分析儀、功率計、信號發生器等原程序

    標簽: 頻譜分析儀 功率計 信號發生器 程序

    上傳時間: 2014-12-31

    上傳用戶:jiangshandz

  • IBM 原廠低級格式化 程序

    IBM 原廠低級格式化 程序

    標簽: IBM 格式化 程序

    上傳時間: 2013-11-06

    上傳用戶:lxm

  • Samsung 三星原廠低級格式化 程序

    三星原廠低級格式化

    標簽: Samsung 三星 格式化 程序

    上傳時間: 2013-11-10

    上傳用戶:lalalal

  • IBM 原廠低級格式化 程序

    IBM 原廠低級格式化 程序

    標簽: IBM 格式化 程序

    上傳時間: 2013-10-21

    上傳用戶:雨出驚人love

  • Samsung 三星原廠低級格式化 程序

    三星原廠低級格式化

    標簽: Samsung 三星 格式化 程序

    上傳時間: 2013-10-30

    上傳用戶:atdawn

  • Arduino入門_動手玩轉Arduino

    Arduino,是一塊基于開放源代碼的USB接口Simple i/o接口板(包括12通道數字GPIO,4通道PWM輸出,6-8通道10bit ADC輸入通道),并且具有使用類似Java,C語言的IDE集成開發環境。 讓您可以快速使用Arduino語言與Flash或Processing…等軟件,作出互動作品。 Arduino可以使用開發完成的電子元件例如Switch或sensors或其他控制器、LED、步進馬達或其他輸出裝置。Arduino也可以獨立運作成為一個可以跟軟件溝通的接口,例如說:flash、processing、Max/MSP、VVVV 或其他互動軟件…。Arduino開發IDE接口基于開放源代碼原,可以讓您免費下載使用開發出更多令人驚艷的互動作品。 特色: 1、開放源代碼的電路圖設計,程序開發接口免費下載,也可依需求自己修改。 2、使用低價格的微處理控制器(ATMEGA8或ATmega128)。可以采用USB接口供電,不需外接電源。也可以使用外部9VDC輸入 3、Arduino支持ISP在線燒,可以將新的“bootloader”固件燒入ATmega8或ATmega128芯片。有了bootloader之后,可以通過串口或者USB to Rs232線更新固件。 4、可依據官方提供的Eagle格式PCB和SCH電路圖,簡化Arduino模組,完成獨立運作的微處理控制。可簡單地與傳感器,各式各樣的電子元件連接(EX:紅外線,超音波,熱敏電阻,光敏電阻,伺服馬達,…等) 5、支持多種互動程序,如:Flash、Max/Msp、VVVV、PD、C、Processing……等 6、應用方面,利用Arduino,突破以往只能使用鼠標,鍵盤,CCD等輸入的裝置的互動內容,可以更簡單地達成單人或多人游戲互動。

    標簽: Arduino

    上傳時間: 2013-10-17

    上傳用戶:cuiyashuo

  • XAPP520將符合2.5V和3.3V I/O標準的7系列FPGA高性能I/O Bank進行連接

    XAPP520將符合2.5V和3.3V I/O標準的7系列FPGA高性能I/O Bank進行連接  The I/Os in Xilinx® 7 series FPGAs are classified as either high range (HR) or high performance (HP) banks. HR I/O banks can be operated from 1.2V to 3.3V, whereas HP I/O banks are optimized for operation between 1.2V and 1.8V. In circumstances that require an HP 1.8V I/O bank to interface with 2.5V or 3.3V logic, a range of options can be deployed. This application note describes methodologies for interfacing 7 series HP I/O banks with 2.5V and 3.3V systems

    標簽: XAPP FPGA Bank 520

    上傳時間: 2013-11-06

    上傳用戶:wentianyou

  • Xilinx FPGA全局時鐘資源的使用方法

    目前,大型設計一般推薦使用同步時序電路。同步時序電路基于時鐘觸發沿設計,對時鐘的周期、占空比、延時和抖動提出了更高的要求。為了滿足同步時序設計的要求,一般在FPGA設計中采用全局時鐘資源驅動設計的主時鐘,以達到最低的時鐘抖動和延遲。 FPGA全局時鐘資源一般使用全銅層工藝實現,并設計了專用時鐘緩沖與驅動結構,從而使全局時鐘到達芯片內部的所有可配置單元(CLB)、I/O單元 (IOB)和選擇性塊RAM(Block Select RAM)的時延和抖動都為最小。為了適應復雜設計的需要,Xilinx的FPGA中集成的專用時鐘資源與數字延遲鎖相環(DLL)的數目不斷增加,最新的 Virtex II器件最多可以提供16個全局時鐘輸入端口和8個數字時鐘管理模塊(DCM)。與全局時鐘資源相關的原語常用的與全局時鐘資源相關的Xilinx器件原語包括:IBUFG、IBUFGDS、BUFG、BUFGP、BUFGCE、 BUFGMUX、BUFGDLL和DCM等,如圖1所示。  

    標簽: Xilinx FPGA 全局時鐘資源

    上傳時間: 2013-11-20

    上傳用戶:563686540

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