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可視角度

  • Altera可重配置PLL使用手冊0414-3

    Altera可重配置PLL使用手冊0414-3。

    標簽: Altera 0414 PLL 可重配置

    上傳時間: 2013-11-08

    上傳用戶:秦莞爾w

  • 基于Arria V和Cyclone V精度可調DSP模塊的高性能DSP應用與實現

         本文是基于Arria V和Cyclone V精度可調DSP模塊的高性能DSP應用與實現(英文資料)

    標簽: DSP Cyclone Arria 精度可調

    上傳時間: 2014-12-28

    上傳用戶:CHINA526

  • verilog可綜合與不可綜合語句概述

    關于Verilog中的可綜合語句和不可綜合語句的匯總介紹

    標簽: verilog

    上傳時間: 2013-12-09

    上傳用戶:青春給了作業95

  • 基于FPGA部分動態可重構的信號解調系統的實現

        針對調制樣式在不同環境下的變化,采用了FPGA部分動態可重構的新方法,通過對不同調制樣式信號的解調模塊的動態加載,來實現了不同環境下針對不同調制樣式的解調。這種方式比傳統的設計方式具有更高的靈活性、可擴展性,并減低了成本和功耗。該設計方案同時也介紹了FPGA部分動態可重構的概念和特點,可以對其它通信信號處理系統設計提供一定的參考。

    標簽: FPGA 部分動態可重構 信號解調系統

    上傳時間: 2013-11-11

    上傳用戶:GeekyGeek

  • 基于動態可重構FPGA的容錯技術研究

    針對重構文件的大小、動態容錯時隙的長短、實現的復雜性、模塊間通信方式、冗余資源的比例與布局等關鍵問題進行了分析。并對一些突出問題,提出了基于算法和資源多級分塊的解決方法,闡述了新方法的性能,及其具有的高靈活性高、粒度等參數可選擇、重構布線可靠性高、系統工作頻率有保障的優點。

    標簽: FPGA 動態可重構 容錯 技術研究

    上傳時間: 2014-12-28

    上傳用戶:Yue Zhong

  • WP369可擴展式處理平臺-各種嵌入式系統的理想解決方案

    WP369可擴展式處理平臺-各種嵌入式系統的理想解決方案 :Delivering unrivaled levels of system performance,flexibility, scalability, and integration to developers,Xilinx's architecture for a new Extensible Processing Platform is optimized for system power, cost, and size. Based on ARM's dual-core Cortex™-A9 MPCore processors and Xilinx’s 28 nm programmable logic,the Extensible Processing Platform takes a processor-centric approach by defining a comprehensive processor system implemented with standard design methods. This approach provides Software Developers a familiar programming environment within an optimized, full featured,powerful, yet low-cost, low-power processing platform.

    標簽: 369 WP 擴展式 處理平臺

    上傳時間: 2013-10-22

    上傳用戶:685

  • WP369-可擴展式處理平臺各種嵌入式系統的理想解決方案

        賽靈思的新型可擴展式處理平臺架構可為開發人員提供無與倫比的系統性能、靈活性、可擴展性和集成度,并為降低系統功耗、成本和縮小尺寸進行了精心優化。   可擴展式處理平臺基于 ARM 的雙核 Cortex™-A9MPCore 處理器以及賽靈思的 28nm 可編程邏輯之上,采用以處理器為核心的設計方案,并能定義通過標準設計方法實施的綜合處理器系統。這種方案可為軟件開發人員在功能齊備且強大的優化型低成本低功耗處理平臺上提供熟悉的編程環境。

    標簽: 369 WP 擴展式 處理平臺

    上傳時間: 2013-11-20

    上傳用戶:杏簾在望

  • 可重配置PLL使用手冊

    本文檔主要是以Altera公司的Stratix II系列的FPGA器件為例,介紹了其內嵌的增強型可重配置PLL在不同的輸入時鐘頻率之間的動態適應,其目的是通過提供PLL的重配置功能,使得不需要對FPGA進行重新編程就可以通過軟件手段完成PLL的重新配置,以重新鎖定和正常工作。

    標簽: PLL 可重配置 使用手冊

    上傳時間: 2013-11-30

    上傳用戶:liuqy

  • 一種可變位速率的位同步器的設計與仿真

    大部分傳統的位同步器是針對固定位速率遙測系統來設計的,這不能滿足一些可變位速率遙測接收機的需求。因此,提出一種基于FPGA實現的位同步器的設計,它能適應不同位速率的遙測系統。同時,對這種位同步器的實現進行了仿真,驗證其正確性和可實現性。

    標簽: 速率 位同步器 仿真

    上傳時間: 2013-11-01

    上傳用戶:qb1993225

  • 可編程FM鎖相發射機的實現

    文中設計了一種可編程的FM鎖相發射機。利用Atmega8實現與計算機的串口通信,實現對鎖相環芯片和數字電位器的配置,達到改變輸出頻率和調制頻偏的目的。發射機輸出頻率覆蓋2 200~2 300 MHz,調制響應100 Hz~3.5 MHz,能夠滿足大部分FM體制遙測系統的需要。

    標簽: 可編程 發射機 鎖相

    上傳時間: 2013-10-23

    上傳用戶:181992417

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