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同步rs觸發(fā)器

DSP為T(mén)MS320F240,帶編碼器,電機(jī)是三相交流永磁同步電機(jī) 歡迎大家一起討論!!!!! 這是ASM文件,可不是PDF文件,你可以直接用. 如果用TMS320LF2

DSP為T(mén)MS320F240,帶編碼器,電機(jī)是三相交流永磁同步電機(jī) 歡迎大家一起討論!!!!! 這是ASM文件,可不是PDF文件,你可以直接用. 如果用TMS320LF2407A有些地方指令要修改一下

標(biāo)簽： 320 TMS DSP 240

上傳時(shí)間： 2015-09-02

上傳用戶：ynwbosss
針對(duì)特定微處理器而開(kāi)發(fā)的程式

針對(duì)特定微處理器而開(kāi)發(fā)的程式，其功能是控制基本的I/O，使之有時(shí)鐘的功能

標(biāo)簽： 程式

上傳時(shí)間： 2015-09-06

上傳用戶：李彥東
BB公司的AD轉(zhuǎn)換器ADS7864在嵌入式linux（優(yōu)龍s3c2410平臺(tái)）下的驅(qū)動(dòng)。通過(guò)驅(qū)動(dòng)AD從而實(shí)現(xiàn)三相電流、三相電壓的同步采樣。對(duì)做電網(wǎng)監(jiān)控的朋友肯定有幫助。

BB公司的AD轉(zhuǎn)換器ADS7864在嵌入式linux（優(yōu)龍s3c2410平臺(tái)）下的驅(qū)動(dòng)。通過(guò)驅(qū)動(dòng)AD從而實(shí)現(xiàn)三相電流、三相電壓的同步采樣。對(duì)做電網(wǎng)監(jiān)控的朋友肯定有幫助。

標(biāo)簽： s3c2410 linux 7864 ADS

上傳時(shí)間： 2014-01-17

上傳用戶：stampede
使用VHDL設(shè)計(jì)一個(gè)適用於ETSI OFDM的時(shí)間和頻率同步處理器

使用VHDL設(shè)計(jì)一個(gè)適用於ETSI OFDM的時(shí)間和頻率同步處理器

標(biāo)簽： VHDL ETSI OFDM

上傳時(shí)間： 2015-09-21

上傳用戶：luke5347
dsp實(shí)驗(yàn)測(cè)試程序,包括指令實(shí)驗(yàn)、存儲(chǔ)器、串口、同步串口、步進(jìn)電機(jī)、硬件中斷、定時(shí)器、交通燈、直流電機(jī)、濾波器、正弦波發(fā)生器、語(yǔ)音錄放、EXAM_C、顯示屏

dsp實(shí)驗(yàn)測(cè)試程序,包括指令實(shí)驗(yàn)、存儲(chǔ)器、串口、同步串口、步進(jìn)電機(jī)、硬件中斷、定時(shí)器、交通燈、直流電機(jī)、濾波器、正弦波發(fā)生器、語(yǔ)音錄放、EXAM_C、顯示屏

標(biāo)簽： EXAM_C dsp 實(shí)驗(yàn) 串口

上傳時(shí)間： 2015-09-26

上傳用戶：水口鴻勝電器
一種面向RS碼的卷積交織與解交織器,基于MATLAB平臺(tái)

一種面向RS碼的卷積交織與解交織器,基于MATLAB平臺(tái)

標(biāo)簽： MATLAB RS碼卷積交織器

上傳時(shí)間： 2013-12-18

上傳用戶：xhz1993
4位乘法器,4位除法器 8位數(shù)據(jù)鎖存器,8位相等比較器,帶同步復(fù)位的狀態(tài) 機(jī),元件例化與層次設(shè)計(jì),最高優(yōu)先級(jí)編碼器

4位乘法器,4位除法器 8位數(shù)據(jù)鎖存器,8位相等比較器,帶同步復(fù)位的狀態(tài) 機(jī),元件例化與層次設(shè)計(jì),最高優(yōu)先級(jí)編碼器

標(biāo)簽： 乘法器 8位除法器數(shù)據(jù)

上傳時(shí)間： 2014-12-07

上傳用戶：pompey
主要是RS-232串行接口技術(shù)并且通過(guò)了串行收發(fā)器UART的開(kāi)發(fā)實(shí)例演示了接口設(shè)計(jì)的基本步驟程序

主要是RS-232串行接口技術(shù)并且通過(guò)了串行收發(fā)器UART的開(kāi)發(fā)實(shí)例演示了接口設(shè)計(jì)的基本步驟程序

標(biāo)簽： UART 232 RS 串行

上傳時(shí)間： 2015-12-13

上傳用戶：lindor
基于PLD的RS碼編譯碼器設(shè)計(jì)

基于PLD的RS碼編譯碼器設(shè)計(jì)，用VHDL語(yǔ)言編寫(xiě)，編譯通過(guò)，測(cè)試結(jié)果正確。

標(biāo)簽： PLD RS碼編譯碼器

上傳時(shí)間： 2016-01-17

上傳用戶：13188549192
DPLL由鑒相器模K加減計(jì)數(shù)器脈沖加減電路同步建立偵察電路模N分頻器構(gòu)成. 整個(gè)系統(tǒng)的中心頻率(即signal_in和signal_out的碼速率的2倍) 為clk/8/N. 模K

DPLL由鑒相器模K加減計(jì)數(shù)器脈沖加減電路同步建立偵察電路模N分頻器構(gòu)成. 整個(gè)系統(tǒng)的中心頻率(即signal_in和signal_out的碼速率的2倍) 為clk/8/N. 模K加減計(jì)數(shù)器的K值決定DPLL的精度和同步建立時(shí)間,K越大,則同步建立時(shí)間長(zhǎng),同步精度高.反之則短,低.

標(biāo)簽： signal_out signal_in DPLL 模

上傳時(shí)間： 2013-12-26

上傳用戶：希醬大魔王