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  • VHDL寫的LMS算法程序。利用本地正弦信號

    VHDL寫的LMS算法程序。利用本地正弦信號,根據LMS算法對輸入信號進行跟蹤。用以產生和輸入信號同頻同相的本地信號。

    標簽: VHDL LMS 算法 程序

    上傳時間: 2013-09-03

    上傳用戶:chenlong

  • ALLEGRO V16進階學習

        本章的主要內容介紹Allegro 如何載入Netlist,進而認識新式轉法和舊式轉法有何不同及優缺點的分析,通過本章學習可以對Allegro 和Capture 之間的互動關係,同時也能體驗出Allegro 和Capture 同步變更屬性等強大功能。

    標簽: ALLEGRO V16 進階

    上傳時間: 2013-12-23

    上傳用戶:ANRAN

  • Allegro SPB V15.2 版新增功能

    15.2 已經加入了有關貫孔及銲點的Z軸延遲計算功能. 先開啟 Setup - Constraints - Electrical constraint sets  下的 DRC 選項.  點選 Electrical Constraints dialog box 下 Options 頁面 勾選 Z-Axis delay欄. 

    標簽: Allegro 15.2 SPB

    上傳時間: 2013-10-08

    上傳用戶:王慶才

  • 改進的基于模型匹配的快速目標識別

    文中建立不同類型目標的模型匹配數據庫;采用最小周長多邊形構造目標主體輪廓的近似多邊形,以簡化目標主體輪廓減少算法處理的數據量;提取具有仿射不變性的多邊形頂點個數、最長線段兩側頂點個數、同底三角形面積比向量特征不變量對待識別目標進行描述,應用3個特征量在模型匹配數據庫中逐一進行分層遍歷搜索匹配。實驗表明,基于模型匹配的目標識別算法能夠快速的識別目標,提高了目標識別的實時性,同時能夠判定目標所處的姿態狀況。

    標簽: 模型匹配 目標識別

    上傳時間: 2013-10-20

    上傳用戶:q3290766

  • 工業監控和便攜式儀器的6通道SAR型ADC

    14 位 LTC®2351-14 是一款 1.5Msps、低功率 SAR 型 ADC,具有 6 個同時采樣差分輸入通道。它采用單 3V 工作電源,並具有 6 個獨立的采樣及保持放大器 (S/HA) 和一個 ADC。

    標簽: SAR ADC 工業監控 便攜式

    上傳時間: 2013-11-16

    上傳用戶:dbs012280

  • 最優噪聲整形濾波器的設計

    在需要對信號進行再量化的場合,可以通過加入dither來避免小信號再量化所產生的諧波失真,但同時會使噪聲功率增加。這種情況下,可以利用人耳的心理聲學特性,通過噪聲整形來降低噪聲的可聞性,提高實際的信噪比,改善音質。本文提出了兩種新的設計最優噪聲整形濾波器的方法-遺傳算法和非線性優化算法,并分別實現了原采樣率下和過采樣率下基于心理聲學模型的最優噪聲整形濾波的設計。結果證明,該方法靈活方便、實現效果良好。

    標簽: 整形濾波器

    上傳時間: 2014-01-05

    上傳用戶:testAPP

  • 基于NSCT域各向異性雙變量萎縮圖像去噪

    提出了一種用各向異性雙變量拉普拉斯函數模型去模擬NSCT域的系數的圖像去噪算法,這種各向異性雙邊拉普拉斯模型不僅考慮了NSCT系數相鄰尺度間的父子關系,同時滿足自然圖像不同尺度間NSCT系數方差具有各向異性的特征,基于這種統計模型,文中先推導出了一種各向異性雙變量收縮函數的近似形式,然后基于貝葉斯去噪法和局部方差估計將這種新的閾值收縮函數應用于NSCT域,實驗結果表明文中提出的方法同小波域 BiShrink算法、小波域ProbShrink算法、小波域NeighShrink算法相比,能夠有效地去除圖像的高斯噪聲,提高了圖像的峰值信噪比;并較完整地保持了圖像的紋理和邊緣等細節信息,從而明顯改善了圖像的視覺效果。

    標簽: NSCT 變量 圖像去噪

    上傳時間: 2013-10-23

    上傳用戶:thuyenvinh

  • 電流型運算放大器在應用電路中的特性研究

      文中簡要介紹了電流型運放的特性,著重對電流型運放的應用電路進行測試,研究電流型運放的應用特性。實驗中,選擇典型電流型運放及電壓型運放構建負阻變換器、電壓跟隨器和同相比例放大器,通過對此3類應用電路的測試,分析、總結運放參數對特殊應用電路的影響,為電路設計者在具體電路的設計中恰當選擇適合的放大器提供參考。

    標簽: 電流型 應用電路 運算放大器

    上傳時間: 2013-10-18

    上傳用戶:13736136189

  • 基于FPGA和虛擬儀器的DDS信號發生器設計

    將虛擬儀器技術同FPGA技術結合,設計了一個頻率可控的DDS任意波形信號發生器。在闡述直接數字頻率合成技術的工作原理、電路構成的基礎上,分別介紹了上位機虛擬儀器監控面板的功能和結構,以及實現DDS功能的下位機FPGA器件各模塊化電路的作用。經過設計和電路測試,輸出波形達到了技術要求,工作穩定可靠。

    標簽: FPGA DDS 虛擬儀器 信號發生器

    上傳時間: 2013-10-28

    上傳用戶:sglccwk

  • 定時器芯片555,556,7555,7556之關的聯系與區別

    555 定時器是一種模擬和數字功能相結合的中規模集成器件。一般用雙極性工藝制作的稱為 555,用 CMOS 工藝制作的稱為 7555,除單定時器外,還有對應的雙定時器 556/7556。555 定時器的電源電壓范圍寬,可在 4.5V~16V 工作,7555 可在 3~18V 工作,輸出驅動電流約為 200mA,因而其輸出可與 TTL、CMOS 或者模擬電路電平兼容。 555 定時器成本低,性能可靠,只需要外接幾個電阻、電容,就可以實現多諧振蕩器、單穩態觸發器及施密特觸發器等脈沖產生與變換電路。它也常作為定時器廣泛應用于儀器儀表、家用電器、電子測量及自動控制等方面。555 定時器的內部包括兩個電壓比較器,三個等值串聯電阻,一個 RS 觸發器,一個放電管 T 及功率輸出級。它提供兩個基準電壓VCC /3 和 2VCC /3 555 定時器的功能主要由兩個比較器決定。兩個比較器的輸出電壓控制 RS 觸發器和放電管的狀態。在電源與地之間加上電壓,當 5 腳懸空時,則電壓比較器 A1 的反相輸入端的電壓為 2VCC /3,A2 的同相輸入端的電壓為VCC /3。若觸發輸入端 TR 的電壓小于VCC /3,則比較器 A2 的輸出為 1,可使 RS 觸發器置 1,使輸出端 OUT=1。如果閾值輸入端 TH 的電壓大于 2VCC/3,同時 TR 端的電壓大于VCC /3,則 A1 的輸出為 1,A2 的輸出為 0,可將 RS 觸發器置 0,使輸出為 0 電平。

    標簽: 7555 7556 555 556

    上傳時間: 2013-10-15

    上傳用戶:PresidentHuang

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