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單片機(jī)(jī)常用

用于便攜式呼吸機(jī)的無位置傳感器無刷直流電機(jī)控制系統(tǒng).rar

隨著人們生活水平的提高，肥胖逐漸成為一種社會疾病，肥胖容易使人患上阻塞性睡眠呼吸暫停綜合癥，嚴(yán)重影響生活質(zhì)量，嚴(yán)重時(shí)甚至危及生命。研制性能良好低成本的呼吸機(jī)有很好的實(shí)際意義。本論文論述了一種基于dsPIC30F3010控制器及無刷直流電機(jī)(BrushlessDirectCurrentMotor，簡稱BLDCM)的呼吸機(jī)控制器，實(shí)現(xiàn)了反電勢法無位置傳感器無刷直流電機(jī)的運(yùn)行控制。論文從基本電磁定律出發(fā)，分析了無刷直流電動機(jī)結(jié)構(gòu)和工作原理，建立了無刷直流電動機(jī)的數(shù)學(xué)模型，在此基礎(chǔ)上詳細(xì)分析了“反電勢法”無刷直流電機(jī)控制原理，深入研究了三種反電勢過零檢測方法，并對檢測電路移相產(chǎn)生的轉(zhuǎn)子位置誤差進(jìn)行了分析，給出了補(bǔ)償方法。對無刷直流電動機(jī)無位置傳感器控制中的關(guān)鍵問題——起動方法進(jìn)行研究，介紹了“反電勢法”無刷直流電機(jī)控制常用的起動方法，深入討論了“三段式”起動技術(shù)。針對傳統(tǒng)“三段式”起動的缺點(diǎn)，論文提出了一種新的外同步到自同步的切換方式。綜合上述，本系統(tǒng)以dsPIC30F3010單片機(jī)為控制器，設(shè)計(jì)了“反電勢法”無刷直流電機(jī)無位置傳感器控制系統(tǒng)的硬件電路，詳細(xì)介紹了電路各個(gè)組成部分的工作原理，同時(shí)介紹了控制系統(tǒng)中采用的硬件抗干擾措施。結(jié)合dsPIC30F3010的特點(diǎn)，充分利用其片內(nèi)的資源，設(shè)計(jì)了系統(tǒng)的軟件。實(shí)驗(yàn)結(jié)果表明系統(tǒng)能夠控制電機(jī)順利起動，而且實(shí)現(xiàn)了電機(jī)正確的換相和穩(wěn)定的運(yùn)行。

標(biāo)簽： 便攜式呼吸機(jī) 無位置傳感器

上傳時(shí)間： 2013-07-26

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用一片CPLD實(shí)現(xiàn)數(shù)字鎖相環(huán),用VHDL或V語言.rar

用一片CPLD實(shí)現(xiàn)數(shù)字鎖相環(huán),用VHDL或V語言

標(biāo)簽： CPLD VHDL 數(shù)字鎖相環(huán)

上傳時(shí)間： 2013-05-27

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51單片機(jī)常用工具包.rar

51常用的一些工具包括時(shí)鐘計(jì)算，等等

標(biāo)簽： 51單片機(jī) 工具包

上傳時(shí)間： 2013-07-05

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常用電子元器件參考資料.rar

常用電子元器件參考資料打基礎(chǔ)資料不錯

標(biāo)簽： 常用電子元器件參考資料

上傳時(shí)間： 2013-06-03

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常用模擬集成電路應(yīng)用手冊.rar

常用模擬集成電路，主要介紹運(yùn)放、乘法器、有源濾波器、開關(guān)電容濾波等。

標(biāo)簽： 模擬集成電路應(yīng)用手冊

上傳時(shí)間： 2013-05-17

上傳用戶：1966640071
基于FPGA的ADC并行測試方法研究.rar

高性能ADC產(chǎn)品的出現(xiàn)，給混合信號測試領(lǐng)域帶來前所未有的挑戰(zhàn)。并行ADC測試方案實(shí)現(xiàn)了多個(gè)ADC測試過程的并行化和實(shí)時(shí)化，減少了單個(gè)ADC的平均測試時(shí)間，從而降低ADC測試成本。本文實(shí)現(xiàn)了基于FPGA的ADC并行測試方法。在閱讀相關(guān)文獻(xiàn)的基礎(chǔ)上，總結(jié)了常用ADC參數(shù)測試方法和測試流程。使用FPGA實(shí)現(xiàn)時(shí)域參數(shù)評估算法和頻域參數(shù)評估算法，并對2個(gè)ADC在不同樣本數(shù)條件下進(jìn)行并行測試。通過在FPGA內(nèi)部實(shí)現(xiàn)ADC測試時(shí)域算法和頻域算法相結(jié)合的方法來搭建測試系統(tǒng)，完成音頻編解碼器WM8731L的控制模式接口、音頻數(shù)據(jù)接口、ADC測試時(shí)域算法和頻域算法的FPGA實(shí)現(xiàn)。整個(gè)測試系統(tǒng)使用Angilent 33220A任意信號發(fā)生器提供模擬激勵信號，共用一個(gè)FPGA內(nèi)部實(shí)現(xiàn)的采樣時(shí)鐘控制模塊。并行測試系統(tǒng)將WM8731.L片內(nèi)的兩個(gè)獨(dú)立ADC的串行輸出數(shù)據(jù)分流成左右兩通道，并對其進(jìn)行串并轉(zhuǎn)換。然后對左右兩個(gè)通道分別配置一個(gè)FFT算法模塊和時(shí)域算法模塊，并行地實(shí)現(xiàn)了ADC參數(shù)的評估算法。在樣本數(shù)分別為128和4096的實(shí)驗(yàn)條件下，對WM8731L片內(nèi)2個(gè)被測.ADC并行地進(jìn)行參數(shù)評估，被測參數(shù)包括增益GAIN、偏移量OFFSET、信噪比SNR、信號與噪聲諧波失真比SINAD、總諧波失真THD等5個(gè)常用參數(shù)。實(shí)驗(yàn)結(jié)果表明，通過在FPGA內(nèi)配置2個(gè)獨(dú)立的參數(shù)計(jì)算模塊，可并行地實(shí)現(xiàn)對2個(gè)相同ADC的參數(shù)評估，減小單個(gè)ADC的平均測試時(shí)間。 FPGA片內(nèi)實(shí)時(shí)評估算法的實(shí)現(xiàn)節(jié)省了測試樣本傳輸至自動測試機(jī)PC端的時(shí)間。而且只需將HDL代碼多次復(fù)制，就可實(shí)現(xiàn)多個(gè)被測ADC在同一時(shí)刻并行地被評估，配置靈活。基于FPGA的ADC并行測試方法易于實(shí)現(xiàn)，具有可行性，但由于噪聲的影響，測試精度有待進(jìn)一步提高。該方法可用于自動測試機(jī)的混合信號選項(xiàng)卡或測試子系統(tǒng)。關(guān)鍵詞：ADC測試；并行；參數(shù)評估；FPGA；FFT

標(biāo)簽： FPGA ADC 并行測試

上傳時(shí)間： 2013-07-11

上傳用戶：tdyoung
高速實(shí)時(shí)信號處理系統(tǒng)的FPGA軟件設(shè)計(jì)與實(shí)現(xiàn).rar

隨著現(xiàn)代DSP、FPGA等數(shù)字芯片的信號處理能力不斷提高，基于軟件無線電技術(shù)的現(xiàn)代通信與信息處理系統(tǒng)也得到了更為廣泛的應(yīng)用。軟件無線電的基本思想是以一個(gè)通用、標(biāo)準(zhǔn)、模塊化的硬件系統(tǒng)作為其應(yīng)用平臺，把盡可能多的無線及個(gè)人通信和信號處理的功能用軟件來實(shí)現(xiàn)，從而將無線通信新系統(tǒng)、新產(chǎn)品的開發(fā)逐步轉(zhuǎn)移到軟件上來。另一方面，現(xiàn)代信號處理系統(tǒng)對數(shù)據(jù)的處理速度、處理精度和動態(tài)范圍的要求也越來越高，需要每秒完成幾千萬到幾百億次運(yùn)算。因此研制具備高速實(shí)時(shí)信號處理能力的通用硬件平臺越來越受到業(yè)界的重視。 @@ 目前的高速實(shí)時(shí)信號處理系統(tǒng)一般均采用DSP+FPGA的架構(gòu)，其中DSP主要負(fù)責(zé)完成系統(tǒng)通信和基帶信號處理算法，而FPGA主要完成信號預(yù)處理等前端算法，并提供系統(tǒng)常用的各種外部接口邏輯。本文的主要工作就在于完成通用型高速實(shí)時(shí)信號處理系統(tǒng)的FPGA軟件設(shè)計(jì)。 @@ 本文提出了一種基于多DSP與FPGA的通用高速實(shí)時(shí)信號處理系統(tǒng)的架構(gòu)。綜合考慮各方面因素，作者選擇使用兩片ADSP-TS201浮點(diǎn)DSP以混合耦合模型構(gòu)成系統(tǒng)信號處理核心；以Xilinx公司最新的高性能FPGA Virtex-5系列的XC5VLX50T提供系統(tǒng)所需的各種接口，包括與ADSP-TS201的高速Linkport接口以及SPI、UART、SPORT等常用外設(shè)接口。此外，作者還選擇了ADSP-BF533定點(diǎn)DSP加入系統(tǒng)當(dāng)中以擴(kuò)展系統(tǒng)音視頻信號處理能力，體現(xiàn)系統(tǒng)的通用性。 @@ 基于FPGA的嵌入式系統(tǒng)設(shè)計(jì)正逐漸成為現(xiàn)代FPGA應(yīng)用的一個(gè)熱點(diǎn)。結(jié)合課題需要，作者以Xilinx公司的MicroBlze軟核處理器為核心在Virtex-5片內(nèi)設(shè)計(jì)了一個(gè)嵌入式系統(tǒng)，完成了對CF卡、DDR2 SDRAM存儲器的讀寫控制，并利用片內(nèi)集成的三態(tài)以太網(wǎng)MAC硬核模塊，實(shí)現(xiàn)了系統(tǒng)與上位PC機(jī)之間的以太網(wǎng)通信鏈路。此外，為擴(kuò)展系統(tǒng)功能，適應(yīng)未來可能的軟件升級，進(jìn)一步提高系統(tǒng)的通用性，還將嵌入式實(shí)時(shí)操作系統(tǒng)μC/OS-II移植到MicroBlaze處理器上。 @@ 最后，作者介紹了基于Xilinx RocketIO GTP收發(fā)器的高速串行傳輸設(shè)計(jì)的關(guān)鍵技術(shù)和基本的設(shè)計(jì)方法，充分體現(xiàn)了目前高速實(shí)時(shí)信號處理系統(tǒng)的發(fā)展要求和趨勢。 @@關(guān)鍵詞：高速實(shí)時(shí)信號處理；FPGA；Virtex-5；嵌入式系統(tǒng)；MicroBlaze

標(biāo)簽： FPGA 實(shí)時(shí)信號處理系統(tǒng)

上傳時(shí)間： 2013-05-17

上傳用戶：wangchong
基于FPGA的8051單片機(jī)IP核設(shè)計(jì)及應(yīng)用.rar

單片微型計(jì)算機(jī)(單片機(jī))是將微處理器CPU、程序存儲器、數(shù)據(jù)存儲器、定時(shí)/計(jì)數(shù)器、輸入/輸出并行接口等集成在一起。由于單片機(jī)具有專門為嵌入式系統(tǒng)設(shè)計(jì)的體系結(jié)構(gòu)與指令系統(tǒng)，所以它最能滿足嵌入式系統(tǒng)的應(yīng)用要求。Intel公司生產(chǎn)的MCS-51系列單片機(jī)是我國目前應(yīng)用最廣的單片機(jī)之一。隨著可編程邏輯器件設(shè)計(jì)技術(shù)的發(fā)展，每個(gè)邏輯器件中門電路的數(shù)量越來越多，一個(gè)邏輯器件就可以完成本來要由很多分立邏輯器件和存儲芯片完成的功能。這樣做減少了系統(tǒng)的功耗和成本，提高了性能和可靠性。FPGA就是目前最受歡迎的可編程邏輯器件之一。IP核是將一些在數(shù)字電路中常用但比較復(fù)雜的功能塊，設(shè)計(jì)成可修改參數(shù)的模塊，讓其他用戶可以直接調(diào)用這些模塊，這樣就大大減輕了工程師的負(fù)擔(dān)，避免重復(fù)勞動。隨著FPGA的規(guī)模越來越大，設(shè)計(jì)越來越復(fù)雜，使用IP核是一個(gè)發(fā)展趨勢。本課題結(jié)合FPGA與8051單片機(jī)的優(yōu)點(diǎn)，主要針對以下三個(gè)方面研究： (1)FPGA開發(fā)平臺的硬件實(shí)現(xiàn)選用Xilinx公司的XC3S500E-PQ208-4-C作為核心器件，采用Intel公司的EEPROM芯片2816A和SRAM芯片6116作為片內(nèi)程序存儲器，搭建FPGA的硬件開發(fā)平臺。 (2)用VHDL語言實(shí)現(xiàn)8051IP核分析研究8051系列單片機(jī)內(nèi)部各模塊結(jié)構(gòu)以及各部分的連接關(guān)系，實(shí)現(xiàn)了基于FPGA的8051IP核。主要包括如下幾個(gè)模塊：CPU模塊、片內(nèi)數(shù)據(jù)存儲器模塊、定時(shí)/計(jì)數(shù)器模塊、并行端口模塊、串行端口模塊、中斷處理模塊、同步復(fù)位模塊等。 (3)基于FPGA的8051IP核應(yīng)用用所設(shè)計(jì)的8051IP核，實(shí)現(xiàn)了對一個(gè)4×4鍵盤的監(jiān)測掃描、鍵盤確認(rèn)、按鍵識別等應(yīng)用。

標(biāo)簽： FPGA 8051 單片機(jī)

上傳時(shí)間： 2013-06-21

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基于FPGA的H.264變換量化、去方塊濾波研究及設(shè)計(jì).rar

H.264/AVC是由國際電信聯(lián)合會的視頻專家組和國際標(biāo)準(zhǔn)化組織的運(yùn)動圖像專家組組成的聯(lián)合視頻小組制定的下一代視頻壓縮標(biāo)準(zhǔn)。新標(biāo)準(zhǔn)采用了一些先進(jìn)算法，因此具有優(yōu)異的壓縮性能和極好的網(wǎng)絡(luò)親和性，滿足低碼率情況下的高質(zhì)量視頻的傳輸。 H.264/AVC采用的先進(jìn)算法包括多模式幀間預(yù)測、1/4像素精度預(yù)測、整數(shù)變換量化、去方塊濾波和熵編碼。本論文著重對整數(shù)變換與量化、去方塊濾波做了研究。整數(shù)變換是一種只有加法和移位的運(yùn)算，量化可以通過查表和乘法操作就可以完成，避免了反變換的時(shí)候失配問題，沒有精度損失；去方塊濾波是一種用來去除低碼率情況下的每個(gè)宏塊的塊效應(yīng)，提高了解碼圖像的外觀。本文主要從算法研究和硬件實(shí)現(xiàn)兩方面著手，在算法研究方面設(shè)計(jì)了一個(gè)可視化測試軟件，在硬件實(shí)現(xiàn)方面主要對整數(shù)變換、量化和去方塊濾波做了研究和實(shí)現(xiàn)。視頻壓縮技術(shù)的關(guān)鍵在于視頻壓縮算法及其芯片的實(shí)現(xiàn)，F(xiàn)PGA可重復(fù)使用，設(shè)計(jì)修改靈活，片內(nèi)資源豐富，具備DSP模塊等優(yōu)勢。在本論文的目標(biāo)實(shí)現(xiàn)部分模塊FPGA的硬件設(shè)計(jì)，用Verilog完成了關(guān)鍵部分的設(shè)計(jì)。首先簡要介紹了視頻壓縮基本原理，常用視頻壓縮標(biāo)準(zhǔn)及其特性以及國內(nèi)外的研究動態(tài)，并對H.264標(biāo)準(zhǔn)基本檔次所涉及的核心技術(shù)進(jìn)行了詳細(xì)介紹，兩種分層結(jié)構(gòu)分別討論。其次在掌握了H.264.算法及編解碼流程的基礎(chǔ)上，設(shè)計(jì)了基于H.264編解碼的可視化軟件平臺。然后詳細(xì)介紹了整數(shù)變換、量化、反變換和反量化核心模塊的設(shè)計(jì)和實(shí)現(xiàn)，并在Altera的軟件和開發(fā)板上進(jìn)行了仿真驗(yàn)證；對去方塊濾波算法做了軟件研究測試，并給出了一種改進(jìn)的硬件整體結(jié)構(gòu)設(shè)計(jì)。最后，對全文工作進(jìn)行了總結(jié)和對未來研究工作做了展望。我在課題中所做的主要工作有： 1.查閱相關(guān)文獻(xiàn)，熟悉H.264.標(biāo)準(zhǔn)及整數(shù)變換、量化和去方塊濾波等算法。 2.用VC++完成了基于H.264編解碼的可視化軟件平臺設(shè)計(jì)。 3.用Verilog完成了整數(shù)變換量化、反變換反量化模塊FPGA設(shè)計(jì)與驗(yàn)證。 4.去方塊濾波器的算法研究、仿真和硬件整體結(jié)構(gòu)設(shè)計(jì)。

標(biāo)簽： FPGA 264 變換

上傳時(shí)間： 2013-04-24

上傳用戶：lanjisu111
大功率單片開關(guān)電源設(shè)計(jì).rar

0 引言　　開關(guān)電源具有效率高、重量輕、體積小，穩(wěn)壓范圍寬等突出優(yōu)點(diǎn)，從20世紀(jì)中期問世以來，發(fā)展極其迅猛，在計(jì)算機(jī)、通信、航天、辦公和家用電器等方面得到了廣泛的應(yīng)用，大有取代線性穩(wěn)壓電源之勢。提高電路的集成化是開關(guān)電源的追求之一，對中小功率開關(guān)電源來說是實(shí)現(xiàn)單片集成化。開關(guān)集成穩(wěn)壓器是指將控制電路、功率開關(guān)管和保護(hù)電路等集成在一個(gè)芯片內(nèi)，而由開關(guān)集成穩(wěn)壓器構(gòu)成的開關(guān)電源就稱之為單片開關(guān)電源。

標(biāo)簽： 大功率單片開關(guān) 電源設(shè)計(jì)

上傳時(shí)間： 2013-04-24

上傳用戶：zl5712176