一網打盡各種常用紅外遙控編碼的波形和資料，無一漏網
上傳時間： 2013-07-12
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常用運放電路的設計與制作 了解各種常用類型運放電路的設計并區分它們的不同
上傳時間： 2013-08-05
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常用ARM7TDMI(-S)指令集及匯編，
上傳時間： 2013-06-28
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函數發生器又名任意波形發生器，是一種常用的信號源，廣泛應用于通信、雷達、導航等現代電子技術領域。信號發生器的核心技術是頻率合成技術，主要方法有：直接模擬頻率合成、鎖相環頻率合成（PLL）、直接數字合成技術（DDS）。DDS是開環系統，無反饋環節，輸出響應速度快，頻率穩定度高。因此直接數字頻率合成技術是目前頻率合成的主要技術之一，其輸出信號具有相對較大的帶寬、快速的相位捷變、極高的相位分辨率和相位連續等優點。本文的主要工作是采用SOPC結合虛擬儀器技術，進行DDS智能函數發生器的研制。 本文介紹了虛擬儀器技術的基本理論，簡要闡述了儀器驅動程序、VISA等相關技術。對SOPC技術進行了深入的研究：SOPC技術是基于可編程邏輯器件的可重構片上系統，它作為SOC和CPLD/FPGA相結合的一項綜合技術，結合了兩者的優點，集成了硬核或軟核CPU、DSP、鎖相環、存儲器、I/O接口及可編程邏輯，可以靈活高效地解決SOC方案，而且設計周期短，設計成本低，非常適合本設計的應用。本文還對基于DDS原理的設計方案進行了分析，介紹了DDS的基本理論以及數學綜合，在研究DDS原理的基礎上，利用SOPC技術，在一片FPGA芯片上實現了整個函數發生器的硬件集成。 本文就函數發生器的設計制定了整體方案，對軟硬件設計原理及實現方法進行了具體的介紹，包括整個系統的硬件電路，SOPC片上系統和PC端軟件的設計。在設計中，LabVIEW波形編輯軟件和函數發生器二者采用異步串口進行通信。利用LabVIEW的強大功能，把波形的編輯，系統的設置放到計算機上完 成，具有人機界面友好、系統升級方便、節約硬件成本等諸多優勢。同時充分利用了FPGA內部大量的邏輯資源，將DDS模塊和微處理器模塊集成到一個單片FPGA上，改變了傳統的系統設計思路。通過對系統仿真和實際測試，結果表明該智能型函數發生器不僅能產生理想的輸出信號，還具有集成度高、穩定性好和擴展性強等優點。關鍵詞：智能型函數發生器，虛擬儀器，可編程片上系統，直接數字合成技術，NiosⅡ處理器。
上傳時間： 2013-07-09
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隨著人們生活水平的提高，肥胖逐漸成為一種社會疾病，肥胖容易使人患上阻塞性睡眠呼吸暫停綜合癥，嚴重影響生活質量，嚴重時甚至危及生命。研制性能良好低成本的呼吸機有很好的實際意義。本論文論述了一種基于dsPIC30F3010控制器及無刷直流電機(BrushlessDirectCurrentMotor，簡稱BLDCM)的呼吸機控制器，實現了反電勢法無位置傳感器無刷直流電機的運行控制。 論文從基本電磁定律出發，分析了無刷直流電動機結構和工作原理，建立了無刷直流電動機的數學模型，在此基礎上詳細分析了“反電勢法”無刷直流電機控制原理，深入研究了三種反電勢過零檢測方法，并對檢測電路移相產生的轉子位置誤差進行了分析，給出了補償方法。 對無刷直流電動機無位置傳感器控制中的關鍵問題——起動方法進行研究，介紹了“反電勢法”無刷直流電機控制常用的起動方法，深入討論了“三段式”起動技術。針對傳統“三段式”起動的缺點，論文提出了一種新的外同步到自同步的切換方式。 綜合上述，本系統以dsPIC30F3010單片機為控制器，設計了“反電勢法”無刷直流電機無位置傳感器控制系統的硬件電路，詳細介紹了電路各個組成部分的工作原理，同時介紹了控制系統中采用的硬件抗干擾措施。結合dsPIC30F3010的特點，充分利用其片內的資源，設計了系統的軟件。實驗結果表明系統能夠控制電機順利起動，而且實現了電機正確的換相和穩定的運行。
上傳時間： 2013-07-26
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用一片CPLD實現數字鎖相環,用VHDL或V語言
上傳時間： 2013-05-27
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51常用的一些工具 包括時鐘計算，等等
上傳時間： 2013-07-05
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常用電子元器件參考資料 打基礎資料 不錯
上傳時間： 2013-06-03
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常用模擬集成電路，主要介紹運放、乘法器、有源濾波器、開關電容濾波等。
上傳時間： 2013-05-17
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高性能ADC產品的出現，給混合信號測試領域帶來前所未有的挑戰。并行ADC測試方案實現了多個ADC測試過程的并行化和實時化，減少了單個ADC的平均測試時間，從而降低ADC測試成本。 本文實現了基于FPGA的ADC并行測試方法。在閱讀相關文獻的基礎上，總結了常用ADC參數測試方法和測試流程。使用FPGA實現時域參數評估算法和頻域參數評估算法，并對2個ADC在不同樣本數條件下進行并行測試。 通過在FPGA內部實現ADC測試時域算法和頻域算法相結合的方法來搭建測試系統，完成音頻編解碼器WM8731L的控制模式接口、音頻數據接口、ADC測試時域算法和頻域算法的FPGA實現。整個測試系統使用Angilent 33220A任意信號發生器提供模擬激勵信號，共用一個FPGA內部實現的采樣時鐘控制模塊。并行測試系統將WM8731.L片內的兩個獨立ADC的串行輸出數據分流成左右兩通道，并對其進行串并轉換。然后對左右兩個通道分別配置一個FFT算法模塊和時域算法模塊，并行地實現了ADC參數的評估算法。 在樣本數分別為128和4096的實驗條件下，對WM8731L片內2個被測.ADC并行地進行參數評估，被測參數包括增益GAIN、偏移量OFFSET、信噪比SNR、信號與噪聲諧波失真比SINAD、總諧波失真THD等5個常用參數。實驗結果表明，通過在FPGA內配置2個獨立的參數計算模塊，可并行地實現對2個相同ADC的參數評估，減小單個ADC的平均測試時間。 FPGA片內實時評估算法的實現節省了測試樣本傳輸至自動測試機PC端的時間。而且只需將HDL代碼多次復制，就可實現多個被測ADC在同一時刻并行地被評估，配置靈活。基于FPGA的ADC并行測試方法易于實現，具有可行性，但由于噪聲的影響，測試精度有待進一步提高。該方法可用于自動測試機的混合信號選項卡或測試子系統。 關鍵詞：ADC測試；并行；參數評估；FPGA；FFT
上傳時間： 2013-07-11
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