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單片機(jī)電路

  • 基于FPGA的多功能多路舵機(jī)控制器的實(shí)現(xiàn)

    伺服舵機(jī)作為基本的輸出執(zhí)行機(jī)構(gòu)廣泛應(yīng)用于 遙控航模以及人形機(jī)器人的控制中。舵機(jī)是一種位 置伺服的驅(qū)動(dòng)器,其控制信號(hào)是PWM信號(hào).,利 用占空比的變化改變舵機(jī)的位置,也可使用FPGA、 模擬電路、單片機(jī)來(lái)產(chǎn)生舵機(jī)的控制信號(hào)舊。應(yīng) 用模擬電路產(chǎn)生PWM信號(hào),應(yīng)用的元器件較多, 會(huì)增加電路的復(fù)雜程度;若用單片機(jī)產(chǎn)生PWM信 號(hào),當(dāng)信號(hào)路數(shù)較少時(shí)單片機(jī)能滿足要求,但當(dāng) PWM信號(hào)多于4路時(shí),由于單片機(jī)指令是順序執(zhí) 行的,會(huì)產(chǎn)生較大的延遲,從而使PWM信號(hào)波形 不穩(wěn),導(dǎo)致舵機(jī)發(fā)生顫振。

    標(biāo)簽: FPGA 多功能 多路 舵機(jī)

    上傳時(shí)間: 2014-12-28

    上傳用戶:ainimao

  • 七天玩轉(zhuǎn)Altera:學(xué)習(xí)FPGA必經(jīng)之路

             七天玩轉(zhuǎn)Altera:學(xué)習(xí)FPGA必經(jīng)之路包括基礎(chǔ)篇、時(shí)序篇和驗(yàn)證篇三個(gè)部分。

    標(biāo)簽: Altera FPGA

    上傳時(shí)間: 2013-10-11

    上傳用戶:woshinimiaoye

  • 采用FPGA的多路高壓IGBT驅(qū)動(dòng)觸發(fā)器研制

    為有效控制固態(tài)功率調(diào)制設(shè)備,提高系統(tǒng)的可調(diào)性和穩(wěn)定性,介紹了一種基于現(xiàn)場(chǎng)可編程門陣列( FPGA)和微控制器(MCU) 的多路高壓IGBT 驅(qū)動(dòng)觸發(fā)器的設(shè)計(jì)方法和實(shí)現(xiàn)電路。該觸發(fā)器可選擇內(nèi)或外觸發(fā)信號(hào),可遙控或本控,能產(chǎn)生多路頻率、寬度和延時(shí)獨(dú)立可調(diào)的脈沖信號(hào),信號(hào)的輸入輸出和傳輸都使用光纖。將該觸發(fā)器用于高壓IGBT(3300 V/ 800 A) 感應(yīng)疊加脈沖發(fā)生器中進(jìn)行實(shí)驗(yàn)測(cè)試,給出了實(shí)驗(yàn)波形。結(jié)果表明,該多路高壓IGBT驅(qū)動(dòng)觸發(fā)器輸出脈沖信號(hào)達(dá)到了較高的調(diào)整精度,頻寬’脈寬及延時(shí)可分別以步進(jìn)1 Hz、0. 1μs、0. 1μs 進(jìn)行調(diào)整,滿足了脈沖發(fā)生器的要求,提高了脈沖功率調(diào)制系統(tǒng)的性能。

    標(biāo)簽: FPGA IGBT 多路 驅(qū)動(dòng)

    上傳時(shí)間: 2013-10-22

    上傳用戶:zhulei420

  • 基于FPGA的多路高速串并轉(zhuǎn)換器設(shè)計(jì)

    高速串并轉(zhuǎn)換器的設(shè)計(jì)是FPGA 設(shè)計(jì)的一個(gè)重要方面,傳統(tǒng)設(shè)計(jì)方法由于采用FPGA 的內(nèi)部邏輯資源來(lái)實(shí)現(xiàn),從而限制了串并轉(zhuǎn)換的速度。該研究以網(wǎng)絡(luò)交換調(diào)度系統(tǒng)的FGPA 驗(yàn)證平臺(tái)中多路高速串并轉(zhuǎn)換器的設(shè)計(jì)為例,詳細(xì)闡述了1 :8DDR 模式下高速串并轉(zhuǎn)換器的設(shè)計(jì)方法和16 路1 :8 串并轉(zhuǎn)換器的實(shí)現(xiàn)。結(jié)果表明,采用Xilinx Virtex24 的ISERDES 設(shè)計(jì)的多路串并轉(zhuǎn)換器可以實(shí)現(xiàn)800 Mbit/ s 輸入信號(hào)的串并轉(zhuǎn)換,并且減少了設(shè)計(jì)復(fù)雜度,縮短了開(kāi)發(fā)周期,能滿足設(shè)計(jì)要求。關(guān)鍵詞:串并轉(zhuǎn)換;現(xiàn)場(chǎng)可編程邏輯陣列;Xilinx ; ISERDES

    標(biāo)簽: FPGA 多路 串并轉(zhuǎn)換

    上傳時(shí)間: 2013-11-03

    上傳用戶:王小奇

  • 帶解碼四路無(wú)線遙控接收模塊

    帶解碼四路無(wú)線遙控接收模塊

    標(biāo)簽: 解碼 無(wú)線遙控 接收模塊

    上傳時(shí)間: 2013-11-13

    上傳用戶:小眼睛LSL

  • 片上網(wǎng)絡(luò)的SystemC建模研究

    為了實(shí)現(xiàn)軟硬件協(xié)同設(shè)計(jì)和提高仿真速度的需求,采用SystemC語(yǔ)言的建模方法,通過(guò)對(duì)片上網(wǎng)絡(luò)體系結(jié)構(gòu)的研究,提出了一種片上網(wǎng)絡(luò)的建模方案,并對(duì)一個(gè)mesh結(jié)構(gòu)完成了SystemC的建模設(shè)計(jì)。該模型可在系統(tǒng)級(jí)和寄存器傳輸級(jí)上使用同一個(gè)測(cè)試平臺(tái),且具有仿真速度快的特點(diǎn),達(dá)到了設(shè)計(jì)要求。

    標(biāo)簽: SystemC 片上網(wǎng)絡(luò) 建模

    上傳時(shí)間: 2013-10-23

    上傳用戶:ks201314

  • 鏈路自適應(yīng)技術(shù)在LTE中的應(yīng)用

    參照3GPP LTE的E-UTRA物理層規(guī)范,提出了一種鏈路自適應(yīng)方案。實(shí)時(shí)調(diào)整傳輸功率以補(bǔ)償信道的衰落,建立SNR-BLER曲線,在給定滿足一定業(yè)務(wù)的目標(biāo)BLER的條件下,找到各個(gè)MCS的SNR切換門限值,從而實(shí)現(xiàn)鏈路自適應(yīng)。仿真結(jié)果表明,在保證通信質(zhì)量的前提下,自適應(yīng)方案比固定MCS有著明顯的頻譜效率增益,使無(wú)線資源得到優(yōu)化配置;同時(shí)刪減了頻譜效率沒(méi)有增益的MCS,降低系統(tǒng)復(fù)雜度。

    標(biāo)簽: LTE 鏈路 自適應(yīng)技術(shù) 中的應(yīng)用

    上傳時(shí)間: 2013-12-22

    上傳用戶:xsnjzljj

  • 一種低延時(shí)片上網(wǎng)絡(luò)路由器的設(shè)計(jì)與實(shí)現(xiàn)

    通過(guò)分析流水線結(jié)構(gòu)和單周期結(jié)構(gòu)的片上網(wǎng)絡(luò)路由器,提出了一種低延時(shí)片上網(wǎng)絡(luò)路由器的設(shè)計(jì),并在SMIC 0.13um Mixed-signal/RF 1.2V/3.3V工藝進(jìn)行流片驗(yàn)證。芯片測(cè)試結(jié)果表明,該路由器可以在300 MHz時(shí)鐘頻率下工作,并且在相同負(fù)載下,與其他結(jié)構(gòu)的路由器相比較,其能夠在較低延時(shí)下完成數(shù)據(jù)包傳送功能。

    標(biāo)簽: 低延時(shí) 片上網(wǎng)絡(luò) 路由器

    上傳時(shí)間: 2014-12-28

    上傳用戶:bakdesec

  • NE602單片頻率轉(zhuǎn)換器

    NE602單片頻率轉(zhuǎn)換器

    標(biāo)簽: 602 NE 頻率轉(zhuǎn)換器

    上傳時(shí)間: 2013-11-08

    上傳用戶:wivai

  • 路漫漫其修遠(yuǎn)兮:Android必須改進(jìn)的八個(gè)地方

    路漫漫其修遠(yuǎn)兮:Android必須改進(jìn)的八個(gè)地方

    標(biāo)簽: Android

    上傳時(shí)間: 2013-11-22

    上傳用戶:asdfasdfd

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