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單相變壓器

  • 三相電源缺相及相序檢測程序

    三相電源缺相及相序檢測程序，包含完整的定時器子程序

    標簽： 三相電源 缺相 相序檢測 程序

    上傳時間： 2014-01-22

    上傳用戶：R50974

  • 數字鎖相環實現源碼

    數字鎖相環實現源碼，有很大的參考價值。 由 鑒相器 模K加減計數器 脈沖加減電路 同步建立偵察電路 模N分頻器 構成.

    標簽： 數字鎖相環 源碼

    上傳時間： 2014-01-04

    上傳用戶：zq70996813

  • 1. 以單極 2相磁化方式使步進電機正向旋轉 2. 按中斷開關的話

    1. 以單極 2相磁化方式使步進電機正向旋轉 2. 按中斷開關的話，正-〉逆，逆-〉正 旋轉。 3. 不使用delay函數，使用定時器/計數器

    標簽： 單極 中斷 磁化 方式

    上傳時間： 2014-12-06

    上傳用戶：xuanchangri

  • （1）變換模塊 本模塊包含兩部分內容：利用 反變換規則將 坐標系下的兩相電流轉換成三相電流；利用間接矢量控制

    （1）變換模塊 本模塊包含兩部分內容：利用 反變換規則將 坐標系下的兩相電流轉換成三相電流；利用間接矢量控制，得到轉子角位移，公式如下（2） 電流滯環控制器(Hysteresis current controller)模塊（3） 電壓源型逆變器(Voltage sourse inverter,VSI)模塊 （4） 變換模塊（5） 感應電機(IM)模塊 該感應電機模型是基于交流電機的電路方程、轉矩方程以及運動方程建立起來的。該仿真模塊為一個三輸入、六輸出的系統子模塊。輸入為 坐標系中定子電壓，輸出則是 坐標系中的轉子電流和轉子磁鏈，以及輸出的轉矩。（6） 電流反饋模塊（7）速度控制器模塊

    標簽： 變換模塊 分 三相電流 變換

    上傳時間： 2014-03-10

    上傳用戶：yy541071797

  • 設計一個智力競賽搶答器

    設計一個智力競賽搶答器，可同時供8名選手或8個代表隊參加比賽，他們的編號分別是0、1、2、3、4、5、6、7，各用一個搶答按鈕，按鈕的編號與選手的編號相對應，分別是So、S1、S2、S3、S4、S5、S6、S7。 ② 給節目主持人設置一個控制開關，用來控制系統的清零(編號顯示數碼管滅燈)和搶答的開始。 ③ 搶答器具有數據鎖存和顯示的功能。搶答開始后，若有選手按動搶答按鈕，編號立即鎖存，并在LED數碼管上顯示出選手的編號，同時蜂鳴器給出音響提示。此外，要封鎖輸入電路，禁止其他選手搶答。優先搶答選手的編號一直保持到主持人將系統清零為止。 • 擴展功能

    標簽： 競賽 搶答器

    上傳時間： 2016-04-27

    上傳用戶：sdq_123

  • c8051120鎖相環

    c8051120鎖相環，定時器3的初始化和使用

    標簽： c8051120 鎖相環

    上傳時間： 2014-01-16

    上傳用戶：xiaoyunyun

  • 識別器的主要思想主要是對輸入字符串的分析

    識別器的主要思想主要是對輸入字符串的分析，把以空格為分隔符的字符串識別成單個單詞。再進行單詞詞義匹配，就是把單詞和預先定義好的基礎單詞表進行對比，如果能找到相匹配的詞義，即對應的單詞數字，則按序將這些以阿拉伯數字輸出，如果匹配失敗，則將原單詞字符原樣輸出，非法字符忽略輸出。

    標簽： 識別器 字符串 分 輸入

    上傳時間： 2013-11-29

    上傳用戶：haoxiyizhong

  • 基于FPGA設計數字鎖相環

    基于FPGA設計數字鎖相環，提出了一種由微分超前/滯后型檢相器構成數字鎖相環的Verilog-HDL建模方案

    標簽： FPGA 數字鎖相環

    上傳時間： 2013-12-25

    上傳用戶：dyctj

  • 增量旋轉編碼器選型有哪些注意事項？ 應注意三方面的參數： 1． 械安裝尺寸

    增量旋轉編碼器選型有哪些注意事項？ 應注意三方面的參數： 1． 械安裝尺寸，包括定位止口，軸徑，安裝孔位；電纜出線方式；安裝空間體積；工作環 境防護等級是否滿足要求。 2． 分辨率，即編碼器工作時每圈輸出的脈沖數，是否滿足設計使用精度要求。 3．電氣接口，編碼器輸出方式常見有推拉輸出（F 型HTL 格式），電壓輸出（E），集電極開路（C，常見C 為NPN 型管輸出，C2 為PNP 型管輸出），長線驅動器輸出。其輸出方式應和其控制系統的接口電路相匹配。如何使用增量編碼器？

    標簽： 增量 參數 旋轉編碼器 方面

    上傳時間： 2014-01-12

    上傳用戶：trepb001

  • FPGA 實現基于ISA接口的3路編碼器計數

    FPGA 實現基于ISA接口的3路編碼器計數，和3路PWM/DA輸出 編碼器計數包括倍頻、鑒相 PWM實現12位分辨率

    標簽： FPGA ISA 接口 編碼器

    上傳時間： 2016-08-20

    上傳用戶：edisonfather

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