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國密算法

  • 基于FFT算法的FPGA實現報告

    基于FFT算法的FPGA實現報告

    標簽: FPGA FFT 算法 報告

    上傳時間: 2014-01-22

    上傳用戶:363186

  • 基于FPGA的FFT算法實現

    基于FPGA的FFT算法實現

    標簽: FPGA FFT 算法

    上傳時間: 2014-12-28

    上傳用戶:chongchongsunnan

  • 基于FPGA的FIR數字濾波器算法實現

    基于FPGA的FIR數字濾波器算法實現

    標簽: FPGA FIR 數字濾波器 算法

    上傳時間: 2013-11-12

    上傳用戶:xz85592677

  • 物聯網智能交通擁堵判別算法的研究與實現

        針對城市道路交叉口的常發性交通擁堵現象,依據RFID檢測系統的特點,提出了一種基于物聯網前端信息采集技術的交通流檢測方法。并且對城市道路交叉口采集到的交通流量相對增量、車輛的時間占有率相對增量以及地點平均車速等信息進行了對比性分析和統計推導,從理論上論證了交通擁擠產生時的交通流特點,然后以此為基礎給出了交通擁擠事件出現時的判別準則,構造出相應的擁擠檢測指標及判別算法。最后利用Matlab編程再結合實際交通測量數據驗證了算法的正確性。

    標簽: 物聯網 智能交通 判別 法的研究

    上傳時間: 2014-12-28

    上傳用戶:GavinNeko

  • Xmodem協議中CRC算法的FPAG實現

    基于解決Xmodem協議中CRC校驗的目的,以經典的LFSR硬件電路為基礎,采用了按字節并行運算CRC校驗碼,以及多字節CRC算法的方法。在Quartus II環境下,通過以VHDL語言仿真試驗,得出Xmodem協議中CRC校驗,以多字節循環并行CRC算法能夠滿足高速實時性要求的結論。

    標簽: Xmodem FPAG CRC 協議

    上傳時間: 2013-11-18

    上傳用戶:lty6899826

  • WP409利用Xilinx FPGA打造出高端比特精度和周期精度浮點DSP算法實現方案

    WP409利用Xilinx FPGA打造出高端比特精度和周期精度浮點DSP算法實現方案: High-Level Implementation of Bit- and Cycle-Accurate Floating-Point DSP Algorithms with Xilinx FPGAs

    標簽: Xilinx FPGA 409 DSP

    上傳時間: 2013-11-07

    上傳用戶:defghi010

  • 基于FPGA的相關干涉儀算法的研究與實現

    提出一種利用FPGA實現相關干涉儀測向算法的方法,給出了測向系統的結構和組成框圖,并詳細介紹了FPGA內部模塊的劃分及設計流程,最后結合實際設計出一種實現方案,并討論了該方案在寬帶測向中較原有實現方式的優勢。為了使算法更適于FPGA實現,提出了一種新的相位樣本選取方法,并仿真驗證了該方法與傳統方法的等效性。

    標簽: FPGA 干涉儀 法的研究

    上傳時間: 2013-11-11

    上傳用戶:1142895891

  • AES中SubBytes算法在FPGA的實現

    介紹了AES中,SubBytes算法在FPGA的具體實現.構造SubBytes的S-Box轉換表可以直接查找ROM表來實現.通過分析SubBytes算法得到一種可行性硬件邏輯電路,從而實現SubBytes變換的功能.

    標簽: SubBytes FPGA AES 算法

    上傳時間: 2013-11-30

    上傳用戶:hzy5825468

  • 一種混沌偽隨機序列發生器的FPGA實現

    隨著混沌理論應用于產生偽隨機序列的發展,用現場可編程邏輯門陣列實現了基于TD—ERCS混沌的偽隨機序列發生器.為了便于硬件實現并減少硬件占用資源.對原算法(即基于TD—ERCS構造偽隨機序列發生器的算法)進行了適當改進,密鑰空間縮減到2⋯.設計采用雙精度浮點運算,選用Cyclone系列的EPIC20F400芯片。完成了CPRSG的系統仿真實驗.系統的硬件電路占用17716個邏輯單元,占芯片資源88%,工作頻率50 MHz,EPRS產生速率10 Mbps.

    標簽: FPGA 混沌 偽隨機序列 發生器

    上傳時間: 2013-10-28

    上傳用戶:crazyer

  • 基于FPGA的PAL-VGA轉換器的實現

    介紹了基于Xilinx Spartan- 3E FPGA XC3S250E 來完成分辨率為738×575 的PAL 制數字視頻信號到800×600 的VGA 格式轉換的實現方法。關鍵詞: 圖像放大; PAL; VGA; FPGA 目前, 絕大多數監控系統中采用的高解析度攝像機均由47 萬像素的CCD 圖像傳感器采集圖像, 經DSP 處理后輸出的PAL 制數字視頻信號不能直接在VGA 顯示器上顯示, 而在許多場合需要在VGA 顯示器上實時監視, 這就需要將隔行PAL 制數字視頻轉換為逐行視頻并提高幀頻, 再將每幀圖像放大到800×600 或1 024×768。常用的圖像放大的方法有很多種, 如最臨近賦值法、雙線性插值法、樣條插值法等[ 1] 。由于要對圖像進行實時顯示, 本文采用一種近似的雙線性插值方法對圖像進行放大。隨著微電子技術及其制造工藝的發展, 可編程邏輯器件的邏輯門密度有了很大提高, 現場可編程邏輯門陣列( FPGA) 有著邏輯資源豐富和可重復以及系統配置的靈活性, 同時隨著微處理器、專用邏輯器件以及DSP 算法以IP Core 的形式嵌入到FPGA 中[ 2] , FPGA 的功能越來越強, 因此FPGA 在現代電子系統設計中發揮著越來越重要的作用。本課題的設計就是采用VHDL 描述, 基于FPGA 來實現的。

    標簽: PAL-VGA FPGA 轉換器

    上傳時間: 2013-12-03

    上傳用戶:aa54

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