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基于單片機函數發生器

  • STM32驅動LCD12864仿真實驗程序(基于實現多級菜單)

    1、這個是我工作實習,項目經理給的51單片機驅動LCD12864的源代碼,代碼架構看完了,我用stm32移植過來的,這個是實現一個多級菜單的功能,不過每個子菜單項的功能還并未完善,如需添加功能請自行添加2、因為是移植的代碼,所以仿真效果并不是很好,按鍵的反應比較慢,如果按快了,會出現仿真卡死,具體原因我還沒去查。所以你們仿真操作的時候,按鍵稍微慢些3、51單片機的源代碼是基于3片Ks0108來寫的,而仿真的LCD12864內部只有2片Ks0108,所以界面可能會有bug的地方,如果有開發板的同學,可以拿有3片Ks0108的LCD來試下,不過代碼有些地方需要稍微更改下,我新買的開發板還沒到,你們就自己加油吧4、打包的文件里面有51單片機的所有工程文件和移植后的stm32工程文件,外加仿真工程原理圖仿真原理圖如下(proteus仿真工程文件可到本帖附件中下載)代碼我就不貼了,我貼幾個圖片吧,這個第一次用,不太會,代碼貼上去漢字還是亂碼,我只是想拿點積分下點資料的,我太難了

    標簽: stm32 lcd12864

    上傳時間: 2022-04-13

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  • 基于FPGA的CCD探測系統

    隨著圖像采集系統的廣泛應用,人們對CCD探測系統的要求日益提高。傳統的CCD探測系統由于結構復雜,造價較高,已不能滿足日益廣泛的應用需要。本文設計了一套基于單片FPGA的小型化與經濟化的CCD探測系統,能夠滿足空間光強的測量并實現光信號的識別和處理。本文研究了CCD探測系統的基本結構。設計了基于單片FPGA的CCD探測系統的硬件電路原理圖,完成了硬件電路板制作與調試。系統FPGA選用Altera公司的低成本FPGA芯片EP2C20Q240,電路板采用雙層板設計,實現了CCD探測系統的小型化與經濟化的目標。利用FPGA器件實現了CCD驅動時序脈沖的設計、實現了單采樣與相關雙采樣的控制程序設計,利用FPGA的數字信號處理功能實現了相關雙采樣的信號處理。基于FPGA的可編程特性,在不改變外部電路的基礎上,通過程序的改變,對CCD驅動頻率、模數轉換器采樣時刻的選擇進行方便調節。系統與上位機的數據傳輸接口采用了網絡傳輸方案,充分發揮了網絡傳輸的遠距離傳輸、遠程訪問、信息共享等優勢,系統采用基于FPGA的Nios IⅡ嵌入式處理器系統,通過對其應用軟件的開發,實現了系統與上位機之間數據的可靠性傳輸。

    標簽: fpga ccd

    上傳時間: 2022-06-23

    上傳用戶:xsr1983

  • XILINX+FPGA片上嵌入式系統的用戶IP開發.

    隨著FPGA技術的發展,在FPGA上實現片上系統在技術上已經可能。基于FPGA片上系統開發已成為目前FPGA應用的一個熱點。但是基于FPGA片上系統對使用者的知識要求比較高,使用流程比較復雜,參考資料不多。成為目前開發者應用的瓶頸。本書針對基于FPGA片上系統開發的核心,用戶IP的開發,并結合XILINX的嵌入式開發工具EDK,詳細講解了怎么去開發和調試客戶自己的用戶硬件外設(用戶IP),使得開發者可以很快地熟練使用EDK,進行自己的片上系統開發。書中內容主要針對嵌入式用戶硬件外設的開發流程和調試方法,不涉及開發語言的細節。在使用本書前必須熟練掌握硬件描述語言。本書基于XILINX的嵌入式開發平臺,講解了嵌入式系統的基本概念:FPGA原理和MicroBlaze處理器和最新的多端口內存控制器(MPMC)。以基于3個不同總線和接口的試驗,詳細講述了怎樣開發用戶自定義IP。本書前三章以基本概念介紹為主。后四章以試驗為主,分別介紹了在XILINX嵌入式開發平臺上常用接口上用戶IP開發的實現:第4章是介紹了EDK工具的使用流程;第5章是PLB總線的用戶IP的開發;第6章是FSL總線的用戶IP的開發;第7章是多端口內存控制器(mpmc)中NPI接口的用戶IP的開發。

    標簽: xilinx fpga 嵌入式系統

    上傳時間: 2022-07-28

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  • 基于DSP的異步電動機節能軟起動器的研究.rar

    電機直接啟動時產生幾倍于額定電流的沖擊電流,不僅對電網造成不良影響,而且嚴重的影響電機的使用壽命。為了改善電機的啟動特性,在電機領域采用由晶閘管控制的電機軟啟動器,基于電機軟啟動器的優良特性,本文提出了一種基于高速數字處理器TMS320LF2407A的高性能的異步電動機軟起動器。 異步電機在輕載運行時,功率損耗增大,功率因數和效率都大大降低,造成了大量電能的浪費。本文從理論上分析了影響損耗的各種因素,提出了降壓節能方案,然后進行了相關實驗驗證方案效果。 本文利用MATLAB搭建了軟起動器系統的仿真模型,對軟起動的控制方式進行了仿真研究。仿真結果表明該軟起動器系統可以有效地減小異步電動機起動時對電網的沖擊。本文同時也闡述了晶閘管調壓電路及軟起動器主電路的工作原理、軟起動器的硬件結構和功能以及軟件設計。 利用TMS320LF2407A和89S52組成的雙CPU系統,研制了性能優良、操作簡易、界面清晰的三相異步電動機軟啟動器,本文給出了系統的硬件結構、軟件設計思想和相關的實驗曲線。實驗證明,系統具有良好的控制特性。

    標簽: DSP 異步電動機 節能

    上傳時間: 2013-06-24

    上傳用戶:erkuizhang

  • 基于直接轉矩控制的專用變頻器的研究.rar

    直接轉矩控制技術(DTC)是繼矢量控制技術之后交流調速領域中新興的控制技術,它采用空間矢量分析的方法,直接在定子坐標系下計算并控制異步電機的轉矩和磁鏈,采用定子磁場定向,直接對逆變器的開關狀態進行最佳控制,從而能夠快速而準確地控制異步電動機的轉矩和磁鏈,以獲得轉矩的高動態性能。目前在高速離心機行業,普遍采用通用型變頻器,其通用性好,但參數較多,價格較貴,為了降低成本增強控制性能,本文利用直接轉矩控制技術的優點,采用直接轉矩控制策略設計并制作了針對高速離心機的專用變頻器。 本文介紹了異步電動機和逆變器的基本數學模型,分析了異步電機直接轉矩控制的基本原理,以及直接轉矩控制系統的基本組成,對直接轉矩控制系統進行了仿真研究,建立了基于MATLAB/Simulink的仿真系統,介紹了仿真模型的各組成部分,包括3/2變換、定子磁鏈、電機轉矩觀測模型、轉矩調節器、磁鏈調節器、扇區判斷、開關表選擇等,給出了系統加減負載和加減轉速仿真結果,仿真結果表明了其磁鏈軌跡近似為圓形,系統具有良好的動態和穩態性能,同時證明了建立的轉矩和磁鏈觀測模型以及控制算法的正確性和可行性。根據仿真實現方法以及結果的指導,設計并制作了整個系統的硬件電路,包括主電路(單相整流、濾波、制動電路、啟動限流電路、逆變電路)、控制電路(DSP、驅動隔離放大、采樣)并對各器件進行選型,給出了硬件各部分電路圖;最后介紹了系統的軟件流程以及各模塊的程序實現,系統的軟件部分采用C語言進行編程,實現了定子相電流的采樣、定子相電壓的計算、定子磁鏈的計算和開關信號的輸出等功能。在分別對硬件和軟件各部分進行調試后,進行了系統的聯合調試,以TMS320F2808作為控制器,在一臺功率為1.5KW的交流異步電機上實現了直接轉矩控制。

    標簽: 直接轉矩控制 變頻器

    上傳時間: 2013-05-31

    上傳用戶:y307115118

  • 基于BOOST變換器的高功率因數軟開關電源的研究.rar

    隨著電力電子技術的發展,對大功率、高性能的開關電源要求也越來越高。功率因數校正(PFC)技術是當前電力電子技術研究的熱點問題。大多數電力電子裝置通過整流器與電網接口,而傳統的二極管或晶閘管整流裝置會產生大量的諧波電流,對電網造成污染。許多國家和國際組織相繼制定了一系列限制用電設備諧波的標準。有源功率因數校正技術能夠有效的消除整流裝置的諧波,因此具有廣泛的應用前景。 本文首先分析了開關電源的發展現狀及發展要求,詳細地闡述了開關電源的基本構成和基本組態。然后研究了ZVT-Boost軟開關PFC電路的基本結構、基本工作原理及軟開關實現原理,在此基礎上確定了主電路結構,并制定了控制系統方案。 鑒于功率要求,本文采用兩級PFC電路。因此對常見的DC-DC變換器的拓撲結構、原理特性進行分析。并針對各自的變換器建立了簡化模型,基于所建立的模型分析了變換器的特性,列出各變換器的優缺點及在設計開關電源時的選用原則。最后,對所設計的系統進行了仿真分析。 本文根據用戶的要求研究設計了一種大功率高性能開關電源。該開關電源分為前級和后級,前級為采用BOOST結構的單相有源功率因數校正電路,后級為采用移相控制軟開關技術的全橋變換器。最后研制出了實驗樣機,并給出了實驗樣機的功率因數校正電路和移相全橋軟開關變換電路的實驗波形。

    標簽: BOOST 變換器 高功率因數

    上傳時間: 2013-04-24

    上傳用戶:朗朗乾坤

  • 基于PIC的智能異步電機軟起動器的研究.rar

    為了減小異步電機在起動過程中過高電流對電網的沖擊,消除傳統降壓起動對電器和機械設備的不利影響,提高電機的起動特性,本文基于電力電子技術對異步電機的軟起動進行了較為深刻的研究。 本文介紹并設計了一種基于PIC18F4550的新型的軟起動器。在功能上,除了具有一般的電壓斜坡軟起動和電流限流軟起動功能,還增加了專門針對泵類負載的轉矩閉環泵控軟起動模式。這種起動方式有效的降低了水泵起動和停止時造成的水錘,并減輕了管路系統的振蕩。同時,針對異步電動機軟起動過程中出現的電流、電磁轉矩以及轉速振蕩問題,分析了引起振蕩的影響因素及其產生原因,采用以電流關斷時刻為晶閘管觸發基準來抑制振蕩問題。 文章首先分析研究了異步電機的基本結構和工作原理,確定了軟起動器所采用的基本原理和控制方法。分析得出為改善泵類負載起動性能所采用的轉矩閉環泵控制策略以及為減小振蕩所采用的關斷角控制方法的可行性。 其次,本課題對傳統的軟起動器的改進進行了嘗試。采用Microchip公司的PIC18F4550芯片為控制核心。在此基礎上,詳細介紹了交流采樣電路、同步觸發電路以及通迅接口電路等硬件電路。軟件方面采用C語言和匯編語言混合編程實現模塊化程序的設計,在文中較為詳細地介紹了控制系統各部分軟件的設計思想和實現,其中包括主程序流程、各種起動方式的控制程序等。 在文章最后給出了基于MATLAB搭建的軟起動系統的仿真模型,仿真結果表明這種帶泵控制功能的軟起動器可以有效的減小電機起動過程中過高電流對電網的沖擊,優化了電機的起動性能。

    標簽: PIC 異步電機 軟起動器

    上傳時間: 2013-06-13

    上傳用戶:wang5829

  • 基于DSP的三電平SVPWM逆變器的研究.rar

    近年來在運動控制領域三電平中壓變頻器的開發研究得到了廣泛關注,三電平逆變器使得電壓型逆變器的大容量化、高性能化成為可能,研究和開發三電平逆變器,無論在技術上還是在實際應用上都有十分重要的意義。 本文首先論述了三電平逆變器的原理,詳細分析了一種控制策略—空間電壓矢量法,給出PWM波的計算公式和開關動作次序,并仿真出波形。 其次闡述了三電平逆變器的主電路構成、功率器件MOSFET的驅動技術和基于DSP2407A控制系統硬件電路設計,并據此設計出了一套小容量三電平逆交器實驗裝置。 最后介紹了三電平空間電壓矢量控制算法的實現和軟件設計,給出了實驗裝置的運行結果,并分析了設計中存在的問題。

    標簽: SVPWM DSP 三電平

    上傳時間: 2013-04-24

    上傳用戶:tfyt

  • 基于DSP控制的三電平逆變器的研究.rar

    高壓變頻調速技術節能效果顯著,多電平逆變器是其常用的一種電路拓撲形式。三電平逆變器能降低功率器件耐壓要求、降低諧波含量,普遍地采用電壓空間矢量脈寬調制的控制策略。將DSP數字控制技術應用于三電平逆變器不僅簡化了系統的硬件結構,提高系統性能,還可以實現系統的優化控制。 本文首先簡要介紹了三電平逆變器的拓撲結構和控制策略,并闡述了二極管箝位式三電平逆變器電路結構和電壓空間矢量脈寬調制控制策略的實現方法。在此基礎上,通過對逆變器的工作過程分析,建立了逆變器的數學模型。并提出了一種能控制逆變器直流側電容中點電位平衡并且能降低開關損耗的電壓空間矢量脈寬調制方法。 本文在綜述人工神經網絡技術的基礎上,提出一種基于復合人工神經網絡的電壓空間矢量脈寬調制算法,充分利用人工神經網絡的快速并行處理能力、學習能力,縮短了計算時間,降低了由控制延時引起的諧波成分。最后在MATIAB/Simulink環境下,結合ANN工具箱建立了仿真模型。仿真結果證明了基于復合人工神經網絡算法的可行性。 本文進行了三電平逆變器的主電路、開關器件驅動電路、電流電壓檢測電路和保護電路等的設計。根據三電平逆變器主電路功率開關多,驅動信號不能共地的特點,本文設計一種利用光耦隔離驅動功率開關器件的驅動保護電路,降低電磁干擾,并在過流等異常情況下實時保護功率開關器件。最后以TMS320LF2407DSP為數字控制平臺,實現了三電平逆變器的電壓空間矢量脈寬調制控制策略。

    標簽: DSP 控制 三電平逆變器

    上傳時間: 2013-07-07

    上傳用戶:natopsi

  • 基于FPGA的RS255,223編解碼器的高速并行實現.rar

    隨著信息時代的到來,用戶對數據保護和傳輸可靠性的要求也在不斷提高。由于信道衰落,信號經信道傳輸后,到達接收端不可避免地會受到干擾而出現信號失真。因此需要采用差錯控制技術來檢測和糾正由信道失真引起的信息傳輸錯誤。RS(Reed—Solomon)碼是差錯控制領域中一類重要的線性分組碼,由于它編解碼結構相對固定,性能強,不但可以糾正隨機差錯,而且對突發錯誤的糾錯能力也很強,被廣泛應用在數字通信、數據存儲系統中,以滿足對數據傳輸通道可靠性的要求。因此設計一款高性能的RS編解碼器不但具有很大的應用意義,而且具有相當大的經濟價值。 本文首先介紹了線形分組碼及其子碼循環碼、BCH碼的基礎理論知識,重點介紹了BCH碼的重要分支RS碼的常用編解碼算法。由于其算法在有限域上進行,接著介紹了有限域的有關理論。基于RS碼傳統的單倍結構,本文提出了一種八倍并行編碼及九倍并行解碼方案,并用Verilog HDL語言實現。其中編碼器基于傳統的線性反饋移位寄存器除法電路并進行八倍并行擴展,譯碼器關鍵方程求解模塊基于修正的歐幾里德算法設計了一種便于硬件實現的脈動關鍵方程求解結構,其他模塊均采用九倍并行實現。由于進行了超前運算、流水線及并行處理,使編解碼的數據吞吐量大為提高,同時延時更小。 本論文設計了C++仿真平臺,并與HDL代碼結果進行了對比驗證。Verilog HDL代碼經過modelsim仿真驗證,并在ALTERA STRATIX3 EP3SL15OF1152C2 FPGA上進行綜合驗證以及靜態時序分析,綜合軟件為QUATURSⅡ V8.0。驗證及測試表明,本設計在滿足編解碼基本功能的基礎上,能夠實現數據的高吞吐量和低延時傳輸,達到性能指標要求。本論文在基于FPGA的RS(255,223)編解碼器的高速并行實現方面的研究成果,具有通用性、可移植性,有一定的理論及經濟價值。

    標簽: FPGA 255 223

    上傳時間: 2013-04-24

    上傳用戶:思琦琦

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