隨著城市居民住房的發展,樓房用表需求量不斷增大,傳統的把多個電能表掛在一起的計量方式越來越顯出它的弊端;即體積大,成本高,工程造價高,不利于新型住房的集中用電管理。多用戶、多功能智能電表不僅能很好地解決上述問題,還能實現很多智能化的功能。 多用戶多功能智能電能表可同時計量48戶居民的用電量。該電能表采用2塊LPC2294控制,以完成數據的通信和采集;采用2塊ARM,以減輕CUP的負擔,提高系統的多功能化和智能化。相對于單用戶電表,多用戶電表有多達32路以上通道,采用同一系統進行分時處理,該系統采用12位A/D轉換芯片AD8364,能保證數據采集的精度和速度。上位機還能實現與銀聯系統聯網,可遠程控制用戶的用電。多用戶、多功能電能表在靈活性、多功能化、智能化、精度等方面都有優勢。
上傳時間: 2013-04-24
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采用現場可編程門陣列(FPGA)可以快速實現數字電路,但是用于生成FPGA編程的比特流文件的CAD工具在編制大規模電路時常常需要數小時的時間,以至于許多設計者甚至通過在給定FPGA上采用更多的資源,或者以犧牲電路速度為代價來提高編制速度。電路編制過程中大部分時間花費在布線階段,因此有效的布線算法能極大地減少布線時間。 許多布線算法已經被開發并獲得應用,其中布爾可滿足性(SAT)布線算法及幾何查找布線算法是當前最為流行的兩種。然而它們各有缺點:基于SAT的布線算法在可擴展性上有很大缺陷;幾何查找布線算法雖然具有廣泛的拆線重布線能力,但當實際問題具有嚴格的布線約束條件時,它在布線方案的收斂方面存在很大困難。基于此,本文致力于探索一種能有效解決以上問題的新型算法,具體研究工作和結果可歸納如下。 1、在全面調查FPGA結構的最新研究動態的基礎上,確定了一種FPGA布線結構模型,即一個基于SRAM的對稱陣列(島狀)FPGA結構作為研究對象,該模型僅需3個適合的參數即能表示布線結構。為使所有布線算法可在相同平臺上運行,選擇了美國北卡羅來納州微電子中心的20個大規模電路作為基準,并在布線前采用VPR399對每個電路都生成30個布局,從而使所有的布線算法都能夠直接在這些預制電路上運行。 2、詳細研究了四種幾何查找布線算法,即一種基本迷宮布線算法Lee,一種基于協商的性能驅動的布線算法PathFinder,一種快速的時延驅動的布線算法VPR430和一種協商A
上傳時間: 2013-05-18
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多功能車輛總線一類設備是一個在列車通信網(TCN,TrainCommunication Network)中普遍使用的網絡接口單元。目前我國的新式列車大多采用列車通信網傳輸列車中大量的控制和服務信息。但使用的列車通信網產品主要為國外進口,因此迫切需要研制具有自主知識產權的列車通信網產品。 論文以一類設備控制器的設計為核心,采取自頂向下的模塊設計方法。將設備控制器分為同步層和數據處理層來分別實現對幀的發送與接收處理和對幀數據的提取與存儲處理。 同步層包含幀的識別模塊、曼徹斯特譯碼模塊、曼徹斯特編碼與幀封裝三個模塊。幀識別模塊檢測幀的起始位并對幀類型進行判斷。譯碼模塊根據采集的樣本值來判斷曼徹斯特編碼的值,采樣的難點在于非理想信號帶來的采樣誤差,論文使用結合位同步的多點采樣法來提高采樣質量。幀分界符中的非數據符不需要進行曼徹斯特編碼,編碼時在非數據符位關閉編碼電路使非數據符保持原來的編碼輸出。 數據處理層以主控單元(MCU,Main Control Unit)和通信存儲器為設計核心。MCU是控制器的核心,對接收的主幀進行分析,判斷是從通信存儲器相應端口取出應答從幀并發送,還是準備接收從幀并存入通信存儲器。通信存儲器存儲設備的通信數據,合適的地址分配能簡化MCU的控制程序,論文固定了通信存儲器端口大小使MCU可以根據一個固定的公式進行端口的遍歷從而簡化了MCU程序的復雜度。數據在傳輸中由于受到干擾和沖突等問題而出現錯誤,論文采用循環冗余檢驗碼結合偶檢驗擴展來對傳輸數據進行差錯控制。 最后,使用FPGA和硬件描述語言Verilog HDL開發出了MVB一類設備。目前該一類設備已運用在SS4G電力機車的制動控制單元(BCU.Brake Control Unit)中并在鐵道科學研究院通過了TCN通信測試。一類設備的成功研制為列車通信網中總線管理器等高類設備的開發奠定了堅實的基礎。
上傳時間: 2013-07-27
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在過去的十幾年間,FPGA取得了驚人的發展:集成度已達到1000萬等效門、速度可達到400~500MHz。隨著FPGA的集成度不斷增大,在高密度FPGA中,芯片上時鐘的分布質量就變得越來越重要。時鐘延時和時鐘相位偏移已成為影響系統性能的重要因素。現在,解決時鐘延時問題主要使用時鐘延時補償電路。 為了消除FPGA芯片內的時鐘延時,減小時鐘偏差,本文設計了內置于FPGA芯片中的延遲鎖相環,采用一種全數字的電路結構,將傳統DLL中的用模擬方式實現的環路濾波器和壓控延遲鏈改進為數字方式實現的時鐘延遲測量電路,和延時補償調整電路,配合特定的控制邏輯電路,完成時鐘延時補償。在輸入時鐘頻率不變的情況下,只需一次調節過程即可完成輸入輸出時鐘的同步,鎖定時間較短,噪聲不會積累,抗干擾性好。 在Smic0.18um工藝下,設計出的時鐘延時補償電路工作頻率范圍從25MHz到300MHz,最大抖動時間為35ps,鎖定時間為13個輸入時鐘周期。另外,完成了時鐘相移電路的設計,實現可編程相移,為用戶提供與輸入時鐘同頻的相位差為90度,180度,270度的相移時鐘;時鐘占空比調節電路的設計,實現可編程占空比,可以提供占空比為50/50的時鐘信號;時鐘分頻電路的設計,實現頻率分頻,提供1.5,2,2.5,3,4,5,8,16分頻時鐘。
上傳時間: 2013-07-06
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多層PCB電路板設計方法,詳盡的介紹了多層板的設計,圖文并茂。(PROTEL)
上傳時間: 2013-06-20
上傳用戶:nairui21
無線局域網是計算機網絡技術和無線通信技術相結合的產物,是利用無線媒介傳輸信息的計算機網絡。在無線通信信道中,由于多徑時延不可避免地存在符號間干擾,正交頻分復用(OFDM)作為一種可以有效對抗符號間干擾(ISI)和提高頻譜利用率的高速傳輸技術,引起了廣泛關注。在無線局域網(WLAN)系統中,OFDM調制技術已經被采用作為其物理層標準,并且公認為是下一代無線通信系統中的核心技術。基于IEEE802.11a的無線局域網標準的物理層采用了OFDM技術,能有效的對抗多徑信道衰落,達到54Mbps的速度,而未來而的IEEE802.11n將達到100Mbps的高速。因此,研發以OFDM為核心的原型機研究非常有必要。 本文在深入理解OFDM技術的同時,結合相應的EDA工具對系統進行建模并基于IEEE802.11a物理層標準給出了一種OFDM基帶發射機系統的FPGA實現方案。整個設計采用目前主流的自頂向下的設計方法,由總體設計至詳細設計逐步細化。在系統功能模塊的FPGA實現過程中,針對Xilinx一款160萬門的Spartan-3E XCS1600E芯片,依照:IEEE802.11a幀格式,對發射機系統各個模塊進行了詳細設計和仿真: (1)訓練序列生成模塊,包括長,短訓練序列; (2)信令模塊,包括卷積編碼,交織,BPSK調制映射; (3)數據模塊,包括加擾,卷積編碼,刪余,交織,BPSK/QPSK/16QAM/64QAM調制映射; (4)OFDM處理部分,包括導頻插入,加循環前綴,IFFT處理; (5)對整個發射處理部分聯調,并給出仿真結果另外,還完成了接收機部分模塊的FPGA設計,并給出了相應的頂層結構與仿真波形。最后提出了改進和進一步開發的方向。
上傳時間: 2013-04-24
上傳用戶:李彥東
基于FPGA的UHF多協議RFID基帶信號處理
上傳時間: 2013-07-18
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隨著現代集成電路技術的發展,鎖相環已經成為集成電路設計中非常重要的一個部分,所以對鎖相環的研究具有積極的現實意義。然而傳統的鎖相環大多是數模混合電路,在工藝上與系統芯片中的數字電路存在兼容問題。因此設計一...
上傳時間: 2013-06-09
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感應電機具有可靠性好、結構簡單、耐腐蝕、效率好、結構緊湊、價格低廉和體積小等優點,成為工業伺服控制的主要傳動裝置然而,感應電機又是一個多變量、強耦合的非線性系統,磁鏈和轉矩的非線性耦合及參數時變,使得感應電機的控制十分復雜,特別是在實際電機控制系統中,還需要考慮硬件和周圍環境等多種因素的干擾,致使實現高性能的感應電機控制系統更加困難 本文研究感應電機的高性能控制策略,綜述了感應電機高性能控制策略的發展歷程和感應電機模糊控制的發展現狀,分析了實際電機控制系統控制器選型中各個嵌入式微處理器的基本性能和優缺點在給出三相坐標系和二相坐標系中的感應電機數學模型之后,從理論上闡述了模糊控制和矢量控制的基本原理,針對傳統的PI控制器參數整定繁瑣,系統魯棒性差的缺點,論文將模糊控制技術應用于感應電機的變頻調速,采用CRI推理法,設計了一種參數自整定模糊PI矢量控制器,利用Matlab對基于模糊PI控制的感應電機控制系統進行了仿真,并對采用兩種控制器實現的感應電機調速控制系統進行了比較、分析仿真結果表明模糊控制的控制性能優于常規的PI調節器 論文對基于ARM的感應電機數字控制技術進行了系統研究,闡述了采用LPC2214ARM微處理器構成數字感應電機變頻調速系統的方法,給出了一種高性能感應電機的數字實現方案,詳細介紹了系統硬件結構的組成及軟件模塊的功能,并給出了主要算法的參考代碼,為實際電機控制器的選型和開發提供了一個新的思路
上傳時間: 2013-08-03
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電力行業標準DL/T 645-2007:多功能電能表通信協議。
上傳時間: 2013-04-24
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