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多路復(fù)用

c8051f040/c8051f041/c8051f042/

C8051F040/1/2/3/4/5/6/7混合信號(hào)ISP FLASH 微控制器數(shù) 據(jù) 手冊(cè) C8051F04x 系列器件是完全集成的混合信號(hào)片上系統(tǒng)型MCU，具有64 個(gè)數(shù)字I/O 引腳（C8051F040/2/4/6）或32 個(gè)數(shù)字I/O 引腳（C8051F041/3/5/7），片內(nèi)集成了一個(gè)CAN2.0B 控制器。下面列出了一些主要特性；有關(guān)某一產(chǎn)品的具體特性參見表1.1。􀁹 高速、流水線結(jié)構(gòu)的8051 兼容的CIP-51 內(nèi)核（可達(dá)25MIPS）􀁹 控制器局域網(wǎng)（CAN2.0B）控制器，具有32 個(gè)消息對(duì)象，每個(gè)消息對(duì)象有其自己的標(biāo)識(shí)􀁹 全速、非侵入式的在系統(tǒng)調(diào)試接口（片內(nèi)）􀁹 真正12 位（C8051F040/1）或10 位（C8051F042/3/4/5/6/7）、100 ksps 的ADC，帶PGA 和8 通道模擬多路開關(guān)􀁹 允許高電壓差分放大器輸入到12/10 位ADC（60V 峰-峰值），增益可編程􀁹 真正8 位500 ksps 的ADC，帶PGA 和8 通道模擬多路開關(guān)（C8051F040/1/2/3）􀁹 兩個(gè)12 位DAC，具有可編程數(shù)據(jù)更新方式（C8051F040/1/2/3）􀁹 64KB（C8051F040/1/2/3/4/5）或32KB（C8051F046/7）可在系統(tǒng)編程的FLASH 存儲(chǔ)器􀁹 4352（4K+256）字節(jié)的片內(nèi)RAM􀁹 可尋址64KB 地址空間的外部數(shù)據(jù)存儲(chǔ)器接口􀁹 硬件實(shí)現(xiàn)的SPI、SMBus/ I2C 和兩個(gè)UART 串行接口􀁹 5 個(gè)通用的16 位定時(shí)器􀁹 具有6 個(gè)捕捉/比較模塊的可編程計(jì)數(shù)器/定時(shí)器陣列􀁹 片內(nèi)看門狗定時(shí)器、VDD 監(jiān)視器和溫度傳感器具有片內(nèi)VDD 監(jiān)視器、看門狗定時(shí)器和時(shí)鐘振蕩器的C8051F04x 系列器件是真正能獨(dú)立工作的片上系統(tǒng)。所有模擬和數(shù)字外設(shè)均可由用戶固件使能/禁止和配置。FLASH 存儲(chǔ)器還具有在系統(tǒng)重新編程能力，可用于非易失性數(shù)據(jù)存儲(chǔ)，并允許現(xiàn)場(chǎng)更新8051 固件。片內(nèi)JTAG 調(diào)試電路允許使用安裝在最終應(yīng)用系統(tǒng)上的產(chǎn)品MCU 進(jìn)行非侵入式（不占用片內(nèi)資源）、全速、在系統(tǒng)調(diào)試。該調(diào)試系統(tǒng)支持觀察和修改存儲(chǔ)器和寄存器，支持?jǐn)帱c(diǎn)、觀察點(diǎn)、單步及運(yùn)行和停機(jī)命令。在使用JTAG 調(diào)試時(shí)，所有的模擬和數(shù)字外設(shè)都可全功能運(yùn)行。每個(gè)MCU 都可在工業(yè)溫度范圍（-45℃到+85℃）工作，工作電壓為2.7 ~ 3.6V。端口I/O、/RST和JTAG 引腳都容許5V 的輸入信號(hào)電壓。C8051F040/2/4/6 為100 腳TQFP 封裝（見圖1.1 和圖1.3的框圖）。C8051F041/3/5/7 為64 腳TQFP 封裝（見圖1.2 和圖1.4 的框圖）。

標(biāo)簽： 8051 040 041 042

上傳時(shí)間： 2013-10-24

上傳用戶：hwl453472107
基于FPGA的DDR2 SDRAM存儲(chǔ)器用戶接口設(shè)計(jì)

使用功能強(qiáng)大的FPGA來實(shí)現(xiàn)一種DDR2 SDRAM存儲(chǔ)器的用戶接口。該用戶接口是基于XILINX公司出產(chǎn)的DDR2 SDRAM的存儲(chǔ)控制器，由于該公司出產(chǎn)的這種存儲(chǔ)控制器具有很高的效率，使用也很廣泛，可知本設(shè)計(jì)具有很大的使用前景。本設(shè)計(jì)通過采用多路高速率數(shù)據(jù)讀寫操作仿真驗(yàn)證，可知其完全可以滿足時(shí)序要求，由綜合結(jié)果可知其使用邏輯資源很少，運(yùn)行速率很高，基本可以滿足所有設(shè)計(jì)需要。

標(biāo)簽： SDRAM FPGA DDR2 存儲(chǔ)器

上傳時(shí)間： 2013-11-07

上傳用戶：GavinNeko
基于FPGA的視頻圖像畫面分割器的設(shè)計(jì)

　　系統(tǒng)結(jié)構(gòu)如圖 1所示，從系統(tǒng) 結(jié) 構(gòu)圖可以看出，系統(tǒng)主要包括視頻信號(hào)輸入模塊，視頻信號(hào)處理模塊和視頻信號(hào)輸出模塊等 3個(gè)部分組成。各個(gè)模塊主要功能為：視頻輸入模塊將采集的多路視頻信號(hào) 轉(zhuǎn) 換成數(shù) 字信號(hào) 送到F P GA；視頻處理模塊主要有F P GA 完成，根據(jù) 需要對(duì)輸入的數(shù)字視頻信號(hào)進(jìn)行處理；視頻輸出模塊將 F P GA處理后的信號(hào)轉(zhuǎn)換成模擬信號(hào)輸出到顯示器。

標(biāo)簽： FPGA 視頻圖像畫面分割器

上傳時(shí)間： 2013-11-11

上傳用戶：shawvi
FPGA在信息處理機(jī)中的應(yīng)用

信息處理機(jī)(圖1)用于完成導(dǎo)彈上多路遙測(cè)信息的采集、處理、組包發(fā)送。主要功能包括高速1553B總線的數(shù)據(jù)收發(fā)、422接口設(shè)備的數(shù)據(jù)加載與檢測(cè)、多路數(shù)據(jù)融合和數(shù)據(jù)接收、處理、組包發(fā)送的功能。其中，總線數(shù)據(jù)和其他422接口送來的數(shù)據(jù)同時(shí)進(jìn)行并行處理;各路輸入信息按預(yù)定格式進(jìn)行融合與輸出;數(shù)據(jù)輸出速率以高速同步422口的幀同步脈沖為源，如果高速同步422口異常不影響總線數(shù)據(jù)和其它422口的數(shù)據(jù)融合與輸出功能。在CPU發(fā)生異常或總線數(shù)據(jù)異常時(shí)不影響其它422口數(shù)據(jù)的融合與輸出功能;能夠?qū)目偩€上接收的數(shù)據(jù)進(jìn)行二次篩選、組包，并發(fā)送往總線，供其它設(shè)備接收。

標(biāo)簽： FPGA 信息處理中的應(yīng)用

上傳時(shí)間： 2013-11-22

上傳用戶：suicone
基于Web服務(wù)器的電網(wǎng)監(jiān)控系統(tǒng)的設(shè)計(jì)

基于三星公司的ARM11芯片S3c6410和可剪裁可移植的Linux操作系統(tǒng)，搭配51單片機(jī)構(gòu)建嵌入式Web服務(wù)器，實(shí)現(xiàn)對(duì)電網(wǎng)的監(jiān)控。該系統(tǒng)可實(shí)現(xiàn)多路電網(wǎng)欠壓、過壓狀態(tài)的判定，并實(shí)時(shí)地采集環(huán)境畫面和溫度，采用TCP/IP通信協(xié)議連接到遠(yuǎn)程計(jì)算機(jī)上，實(shí)現(xiàn)了在遠(yuǎn)程計(jì)算機(jī)利用Web頁(yè)面的方式動(dòng)態(tài)顯示電網(wǎng)狀態(tài)、溫度和環(huán)境畫面等信息的功能。

標(biāo)簽： Web 服務(wù)器電網(wǎng)監(jiān)控系統(tǒng)

上傳時(shí)間： 2014-12-29

上傳用戶：Altman
基于CDMA信道倍增的警用移動(dòng)視頻監(jiān)控系統(tǒng)

基于通過應(yīng)用公安信息化手段以提高公安部門現(xiàn)場(chǎng)執(zhí)法效能的目的，提出基于CDMA多通道技術(shù)的巡邏車視頻監(jiān)控系統(tǒng)。系統(tǒng)通過捆綁多個(gè)CDMA鏈路通道，并在傳輸控制中使用多路捆綁處理，實(shí)現(xiàn)實(shí)時(shí)采集和傳輸現(xiàn)場(chǎng)執(zhí)法數(shù)據(jù)，及時(shí)跟蹤記錄執(zhí)法現(xiàn)場(chǎng)。系統(tǒng)實(shí)現(xiàn)了遠(yuǎn)程扁平化指揮，可以有效控制局勢(shì)和精確打擊犯罪，并對(duì)警察保護(hù)自身合法權(quán)益提供有效保障。

標(biāo)簽： CDMA 信道警用移動(dòng)視頻

上傳時(shí)間： 2014-12-29

上傳用戶：comer1123
0～±10V/0～±20mA 雙向模擬信號(hào)隔離放大器

雙向直流（電壓/電流）信號(hào)隔離轉(zhuǎn)換器是一種混合集成電路。產(chǎn)品主要用于工業(yè)控制系統(tǒng)中模擬信號(hào)輸入輸出控制，系統(tǒng)內(nèi)部通過dsp、plc的da轉(zhuǎn)換輸出信號(hào)來顯示和控制其它裝置的可調(diào)輸出，現(xiàn)場(chǎng)工作電壓、電流和各種運(yùn)行參數(shù)的監(jiān)測(cè)及系統(tǒng)外部增加4-20ma（0-20ma）/0-5v標(biāo)準(zhǔn)信號(hào)接口等。該ic為標(biāo)準(zhǔn)sip12 pin符合ul-94的阻燃封裝,占用pcb板面積少，裝入儀器內(nèi)部可以并聯(lián)安裝實(shí)現(xiàn)多路信號(hào)的監(jiān)測(cè)、隔離和轉(zhuǎn)換。ic在同一芯片上集成了一個(gè)多隔離的dc/dc變換電源和一組模擬信號(hào)隔離放大器，輸入及輸出側(cè)寬爬電距離及內(nèi)部隔離措施使該芯片可達(dá)到3000vdc絕緣電壓。sunyuan　iso em系列產(chǎn)品使用非常方便，免零點(diǎn)和增益調(diào)節(jié)，無需外接調(diào)節(jié)電位器等任何元件，即可實(shí)現(xiàn)工業(yè)現(xiàn)場(chǎng)信號(hào)的隔離轉(zhuǎn)換功能。

標(biāo)簽： 10 20 mA 模擬信號(hào)

上傳時(shí)間： 2013-10-21

上傳用戶：windgate
基于FPGA的DDR2 SDRAM存儲(chǔ)器用戶接口設(shè)計(jì)

使用功能強(qiáng)大的FPGA來實(shí)現(xiàn)一種DDR2 SDRAM存儲(chǔ)器的用戶接口。該用戶接口是基于XILINX公司出產(chǎn)的DDR2 SDRAM的存儲(chǔ)控制器，由于該公司出產(chǎn)的這種存儲(chǔ)控制器具有很高的效率，使用也很廣泛，可知本設(shè)計(jì)具有很大的使用前景。本設(shè)計(jì)通過采用多路高速率數(shù)據(jù)讀寫操作仿真驗(yàn)證，可知其完全可以滿足時(shí)序要求，由綜合結(jié)果可知其使用邏輯資源很少，運(yùn)行速率很高，基本可以滿足所有設(shè)計(jì)需要。

標(biāo)簽： SDRAM FPGA DDR2 存儲(chǔ)器

上傳時(shí)間： 2013-10-14

上傳用戶：zxh122
基于VHDL的FPGA和Nios II實(shí)例精煉（劉福奇）

　　基于VHDL的FPGA和Nios II 實(shí)例精煉【作者：劉福奇；出版社：北京航空航天大學(xué)出版社】（本書優(yōu)酷視頻地址：http://www.youku.com/playlist_show/id_5882081.html）　　內(nèi)容簡(jiǎn)介：本書分為4個(gè)部分：Quartus Ⅱ軟件的基本操作、VHDL語法介紹、FPGA設(shè)計(jì)實(shí)例和Nios Ⅱ設(shè)計(jì)實(shí)例；總結(jié)了編者幾年來的FPGA設(shè)計(jì)經(jīng)驗(yàn)，力求給初學(xué)者或是想接觸這方面知識(shí)的讀者提供一種快速入門的方法；適合電子相關(guān)專業(yè)的大學(xué)生、FPGA的初學(xué)者以及對(duì)FPGA有興趣的電子工程師。初學(xué)者可以按照步驟學(xué)習(xí)。本書中提及到時(shí)間計(jì)算問題，不光提出有時(shí)間戳的方法，還介紹了一種通過讀取定時(shí)器的寄存器來計(jì)算時(shí)間的方法。其實(shí)，有人認(rèn)為，本書最好的部分是：DMA的實(shí)現(xiàn)說明（本書從3個(gè)方面講述了DMA的使用）。現(xiàn)在學(xué)習(xí)Verilog HDL的人或許比較多，但是用VHDL的人可以學(xué)習(xí)下，這本書還是很不錯(cuò)的。

標(biāo)簽： VHDL FPGA Nios

上傳時(shí)間： 2014-07-10

上傳用戶：米米陽(yáng)123
基于FPGA的視頻圖像畫面分割器的設(shè)計(jì)

　　系統(tǒng)結(jié)構(gòu)如圖 1所示，從系統(tǒng) 結(jié) 構(gòu)圖可以看出，系統(tǒng)主要包括視頻信號(hào)輸入模塊，視頻信號(hào)處理模塊和視頻信號(hào)輸出模塊等 3個(gè)部分組成。各個(gè)模塊主要功能為：視頻輸入模塊將采集的多路視頻信號(hào) 轉(zhuǎn) 換成數(shù) 字信號(hào) 送到F P GA；視頻處理模塊主要有F P GA 完成，根據(jù) 需要對(duì)輸入的數(shù)字視頻信號(hào)進(jìn)行處理；視頻輸出模塊將 F P GA處理后的信號(hào)轉(zhuǎn)換成模擬信號(hào)輸出到顯示器。

標(biāo)簽： FPGA 視頻圖像畫面分割器

上傳時(shí)間： 2013-11-09

上傳用戶：xiaoyunyun