目前，大型設(shè)計(jì)一般推薦使用同步時(shí)序電路。同步時(shí)序電路基于時(shí)鐘觸發(fā)沿設(shè)計(jì)，對(duì)時(shí)鐘的周期、占空比、延時(shí)和抖動(dòng)提出了更高的要求。為了滿足同步時(shí)序設(shè)計(jì)的要求，一般在FPGA設(shè)計(jì)中采用全局時(shí)鐘資源驅(qū)動(dòng)設(shè)計(jì)的主時(shí)鐘，以達(dá)到最低的時(shí)鐘抖動(dòng)和延遲。 FPGA全局時(shí)鐘資源一般使用全銅層工藝實(shí)現(xiàn)，并設(shè)計(jì)了專用時(shí)鐘緩沖與驅(qū)動(dòng)結(jié)構(gòu)，從而使全局時(shí)鐘到達(dá)芯片內(nèi)部的所有可配置單元(CLB)、I/O單元 (IOB)和選擇性塊RAM(Block Select RAM)的時(shí)延和抖動(dòng)都為最小。為了適應(yīng)復(fù)雜設(shè)計(jì)的需要，Xilinx的FPGA中集成的專用時(shí)鐘資源與數(shù)字延遲鎖相環(huán)(DLL)的數(shù)目不斷增加，最新的 Virtex II器件最多可以提供16個(gè)全局時(shí)鐘輸入端口和8個(gè)數(shù)字時(shí)鐘管理模塊(DCM)。與全局時(shí)鐘資源相關(guān)的原語(yǔ)常用的與全局時(shí)鐘資源相關(guān)的Xilinx器件原語(yǔ)包括：IBUFG、IBUFGDS、BUFG、BUFGP、BUFGCE、 BUFGMUX、BUFGDLL和DCM等，如圖1所示。
標(biāo)簽： Xilinx FPGA 全局時(shí)鐘資源
上傳時(shí)間： 2013-11-20
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工藝流程波峰焊中的成型工作，是生產(chǎn)過(guò)程中效率最低的部分之一，相應(yīng)帶來(lái)了靜電損壞風(fēng)險(xiǎn)并使交貨期延長(zhǎng)，還增加了出錯(cuò)的機(jī)會(huì)。雙面貼裝A面布有大型IC器件，B面以片式元件為主充分利用PCB空間，實(shí)現(xiàn)安裝面積最小化，效率高單面混裝* 如果通孔元件很少，可采用回流焊和手工焊的方式一面貼裝、另一面插裝* 如果通孔元件很少，可采用回流焊和手工焊的方式
上傳時(shí)間： 2013-11-10
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通用陣列邏輯GAL實(shí)現(xiàn)基本門(mén)電路的設(shè)計(jì) 一、實(shí)驗(yàn)?zāi)康?1.了解GAL22V10的結(jié)構(gòu)及其應(yīng)用； 2.掌握GAL器件的設(shè)計(jì)原則和一般格式； 3.學(xué)會(huì)使用VHDL語(yǔ)言進(jìn)行可編程邏輯器件的邏輯設(shè)計(jì)； 4.掌握通用陣列邏輯GAL的編程、下載、驗(yàn)證功能的全部過(guò)程。 二、實(shí)驗(yàn)原理 1. 通用陣列邏輯GAL22V10 通用陣列邏輯GAL是由可編程的與陣列、固定（不可編程）的或陣列和輸出邏輯宏單元（OLMC）三部分構(gòu)成。GAL芯片必須借助GAL的開(kāi)發(fā)軟件和硬件，對(duì)其編程寫(xiě)入后，才能使GAL芯片具有預(yù)期的邏輯功能。GAL22V10有10個(gè)I/O口、12個(gè)輸入口、10個(gè)寄存器單元，最高頻率為超過(guò)100MHz。 ispGAL22V10器件就是把流行的GAL22V10與ISP技術(shù)結(jié)合起來(lái)，在功能和結(jié)構(gòu)上與GAL22V10完全相同，并沿用了GAL22V10器件的標(biāo)準(zhǔn)28腳PLCC封裝。ispGAl22V10的傳輸時(shí)延低于7.5ns，系統(tǒng)速度高達(dá)100MHz以上，因而非常適用于高速圖形處理和高速總線管理。由于它每個(gè)輸出單元平均能夠容納12個(gè)乘積項(xiàng)，最多的單元可達(dá)16個(gè)乘積項(xiàng)，因而更為適用大型狀態(tài)機(jī)、狀態(tài)控制及數(shù)據(jù)處理、通訊工程、測(cè)量?jī)x器等領(lǐng)域。ispGAL22V10的功能框圖及引腳圖分別見(jiàn)圖1-1和1-2所示。 另外，采用ispGAL22V10來(lái)實(shí)現(xiàn)諸如地址譯碼器之類的基本邏輯功能是非常容易的。為實(shí)現(xiàn)在系統(tǒng)編程，每片ispGAL22V10需要有四個(gè)在系統(tǒng)編程引腳，它們是串行數(shù)據(jù)輸入(SDI)，方式選擇(MODE)、串行輸出(SDO)和串行時(shí)鐘(SCLK)。這四個(gè)ISP控制信號(hào)巧妙地利用28腳PLCC封裝GAL22V10的四個(gè)空腳，從而使得兩種器件的引腳相互兼容。在系統(tǒng)編程電源為+5V，無(wú)需外接編程高壓。每片ispGAL22V10可以保證一萬(wàn)次在系統(tǒng)編程。 ispGAL22V10的內(nèi)部結(jié)構(gòu)圖如圖1-3所示。 2.編譯、下載源文件 用VHDL語(yǔ)言編寫(xiě)的源程序，是不能直接對(duì)芯片編程下載的，必須經(jīng)過(guò)計(jì)算機(jī)軟件對(duì)其進(jìn)行編譯，綜合等最終形成PLD器件的熔斷絲文件(通常叫做JEDEC文件，簡(jiǎn)稱為JED文件)。通過(guò)相應(yīng)的軟件及編程電纜再將JED數(shù)據(jù)文件寫(xiě)入到GAL芯片，這樣GAL芯片就具有用戶所需要的邏輯功能。 3.工具軟件ispLEVER簡(jiǎn)介 ispLEVER 是Lattice 公司新推出的一套EDA軟件。設(shè)計(jì)輸入可采用原理圖、硬件描述語(yǔ)言、混合輸入三種方式。能對(duì)所設(shè)計(jì)的數(shù)字電子系統(tǒng)進(jìn)行功能仿真和時(shí)序仿真。編譯器是此軟件的核心，能進(jìn)行邏輯優(yōu)化，將邏輯映射到器件中去，自動(dòng)完成布局與布線并生成編程所需要的熔絲圖文件。軟件中的Constraints Editor工具允許經(jīng)由一個(gè)圖形用戶接口選擇I/O設(shè)置和引腳分配。軟件包含Synolicity公司的“Synplify”綜合工具和Lattice的ispVM器件編程工具，ispLEVER軟件提供給開(kāi)發(fā)者一個(gè)簡(jiǎn)單而有力的工具。
上傳時(shí)間： 2013-11-17
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數(shù)字地模擬地的布線規(guī)則,如何降低數(shù)字信號(hào)和模擬信號(hào)間的相互干擾呢？在設(shè)計(jì)之前必須了解電磁兼容(EMC)的兩個(gè)基本原則：第一個(gè)原則是盡可能減小電流環(huán)路的面積；第二個(gè)原則是系統(tǒng)只采用一個(gè)參考面。相反，如果系統(tǒng)存在兩個(gè)參考面，就可能形成一個(gè)偶極天線(注：小型偶極天線的輻射大小與線的長(zhǎng)度、流過(guò)的電流大小以及頻率成正比)；而如果信號(hào)不能通過(guò)盡可能小的環(huán)路返回，就可能形成一個(gè)大的環(huán)狀天線(注：小型環(huán)狀天線的輻射大小與環(huán)路面積、流過(guò)環(huán)路的電流大小以及頻率的平方成正比)。在設(shè)計(jì)中要盡可能避免這兩種情況。 有人建議將混合信號(hào)電路板上的數(shù)字地和模擬地分割開(kāi)，這樣能實(shí)現(xiàn)數(shù)字地和模擬地之間的隔離。盡管這種方法可行，但是存在很多潛在的問(wèn)題，在復(fù)雜的大型系統(tǒng)中問(wèn)題尤其突出。最關(guān)鍵的問(wèn)題是不能跨越分割間隙布線，一旦跨越了分割間隙布線，電磁輻射和信號(hào)串?dāng)_都會(huì)急劇增加。在PCB設(shè)計(jì)中最常見(jiàn)的問(wèn)題就是信號(hào)線跨越分割地或電源而產(chǎn)生EMI問(wèn)題。 如圖1所示，我們采用上述分割方法，而且信號(hào)線跨越了兩個(gè)地之間的間隙，信號(hào)電流的返回路徑是什么呢？假定被分割的兩個(gè)地在某處連接在一起(通常情況下是在某個(gè)位置單點(diǎn)連接)，在這種情況下，地電流將會(huì)形成一個(gè)大的環(huán)路。流經(jīng)大環(huán)路的高頻電流會(huì)產(chǎn)生輻射和很高的地電感，如果流過(guò)大環(huán)路的是低電平模擬電流，該電流很容易受到外部信號(hào)干擾。最糟糕的是當(dāng)把分割地在電源處連接在一起時(shí)，將形成一個(gè)非常大的電流環(huán)路。另外，模擬地和數(shù)字地通過(guò)一個(gè)長(zhǎng)導(dǎo)線連接在一起會(huì)構(gòu)成偶極天線。
標(biāo)簽： 數(shù)字地 布線規(guī)則 模擬
上傳時(shí)間： 2013-10-19
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探討了船舶發(fā)動(dòng)機(jī)短路故障原因，和診斷方法和處理程序。
標(biāo)簽： 大型 發(fā)電機(jī) 短路 故障分析
上傳時(shí)間： 2013-11-16
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485電梯樓層控制器外接四個(gè)Wiegand讀卡器，實(shí)現(xiàn)4個(gè)門(mén)的進(jìn)入刷卡，該門(mén)禁控制器選用目前最先進(jìn)的集成方案設(shè)計(jì)而成的新一代門(mén)禁控制產(chǎn)品。485電梯樓層控制器使用標(biāo)準(zhǔn)的485工業(yè)串口通訊，通訊距離可達(dá)1200米，一條總線可以接255臺(tái)各類485門(mén)禁控制器；具有性能穩(wěn)定、通訊快、容量大、兼容性強(qiáng)、組網(wǎng)方便等特性，其卓越性能在國(guó)內(nèi)外眾多大型門(mén)禁系統(tǒng)工程和一卡通系統(tǒng)中得到廣泛證實(shí)。信息由深圳澳普AOPU實(shí)業(yè)有限公司提供。
上傳時(shí)間： 2013-10-16
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485單門(mén)門(mén)禁控制器，使用標(biāo)準(zhǔn)的485工業(yè)串口通訊，通訊距離可達(dá)1200米，一條總線可以接255臺(tái)各類485門(mén)禁控制器；外接四個(gè)Wiegand讀卡器，實(shí)現(xiàn)2個(gè)門(mén)進(jìn)出刷卡，該門(mén)禁控制器選用目前最先進(jìn)的集成方案設(shè)計(jì)而成的新一代門(mén)禁控制產(chǎn)品。具有性能穩(wěn)定、通訊快、容量大、兼容性強(qiáng)、組網(wǎng)方便等特性，其卓越性能在國(guó)內(nèi)外眾多大型門(mén)禁系統(tǒng)工程和一卡通系統(tǒng)中得到廣泛證實(shí)。信息由深圳奧普實(shí)業(yè)有限公司發(fā)布。
標(biāo)簽： 門(mén)禁控制器
上傳時(shí)間： 2013-11-18
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變槳距風(fēng)機(jī)和雙饋風(fēng)機(jī)即將成為主流，關(guān)于plc的閉環(huán)控制是其中非常重要的一環(huán)。 本文主要介紹的就是。并且在大型設(shè)備中也會(huì)有先關(guān)運(yùn)用。
標(biāo)簽： PLC 風(fēng)力發(fā)電 中的應(yīng)用
上傳時(shí)間： 2013-10-22
上傳用戶：jinyao
組態(tài)王軟件是一種通用的工業(yè)監(jiān)控軟件，它融過(guò)程控制設(shè)計(jì)、現(xiàn)場(chǎng)操作以及工廠資源管理于一體，將一個(gè)企業(yè)內(nèi)部的各種生產(chǎn)系統(tǒng)和應(yīng)用以及信息交流匯集在一起，實(shí)現(xiàn)最優(yōu)化管理。它基于Microsoft Windows XP/NT/2000 操作系統(tǒng)，用戶可以在企業(yè)網(wǎng)絡(luò)的所有層次的各個(gè)位置上都可以及時(shí)獲得系統(tǒng)的實(shí)時(shí)信息。采用組態(tài)王軟件開(kāi)發(fā)工業(yè)監(jiān)控工程，可以極大地增強(qiáng)用戶生產(chǎn)控制能力、提高工廠的生產(chǎn)力和效率、提高產(chǎn)品的質(zhì)量、減少成本及原材料的消耗。它適用于從單一設(shè)備的生產(chǎn)運(yùn)營(yíng)管理和故障診斷，到網(wǎng)絡(luò)結(jié)構(gòu)分布式大型集中監(jiān)控管理系統(tǒng)的開(kāi)發(fā)。
標(biāo)簽： 6.53 組態(tài)王 培訓(xùn)教程
上傳時(shí)間： 2013-11-11
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針對(duì)大型構(gòu)件內(nèi)部微損傷難以及時(shí)發(fā)現(xiàn)排除，給生活生產(chǎn)造成安全隱患的現(xiàn)狀，基于波包提取技術(shù)，利用波包的虛擬時(shí)間逆?zhèn)鞑ィO(shè)計(jì)了一種新的傳感器陣列，并在理論上推導(dǎo)了該傳感器陣列二維成像的運(yùn)算公式，最后利用MATLAB編程模擬仿真了用該傳感器陣列進(jìn)行無(wú)損檢測(cè)時(shí)的二維成像結(jié)果，結(jié)果表明其成像結(jié)果的綜合精度可以達(dá)到98.7%，因此用該傳感器陣列進(jìn)行大型構(gòu)件內(nèi)部微損傷的探測(cè)對(duì)于發(fā)現(xiàn)安全隱患、排除安全隱患具有重大的指導(dǎo)意義。
標(biāo)簽： 提取技術(shù) 傳感器 二維 成像技術(shù)
上傳時(shí)間： 2013-11-12
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