C51單片機(jī)實(shí)現(xiàn)液晶秒表以及簡單計(jì)算器 電路是一個(gè)51最小系統(tǒng),沒有采用總線方式,而簡單的連線方式,上有4*4矩陣鍵盤,一數(shù)碼管,89S51單片機(jī),串口下載線,數(shù)碼管顯示鎖存芯片\蜂鳴器\1602液晶. 代碼已經(jīng)調(diào)試成功過,可以實(shí)現(xiàn)時(shí)間的調(diào)整.4*4矩陣鍵盤,第一排前三列是實(shí)現(xiàn)小時(shí)\分鐘\秒的加.第二排前三列是實(shí)現(xiàn)小時(shí)\分鐘\秒的減.當(dāng)然還可以通過設(shè)置矩陣鍵盤的鍵值,來實(shí)現(xiàn)加\減\乘\除四則運(yùn)算,由數(shù)碼管顯示參與運(yùn)算的數(shù)字以及最終的運(yùn)算結(jié)果.
上傳時(shí)間： 2015-08-17
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簡易數(shù)字頻率計(jì)利用復(fù)雜可編程邏輯器件FPGA,VHDL編程將所有功能模塊集成在一塊芯片上。功能模塊包括時(shí)基脈沖發(fā)生器、計(jì)數(shù)器、數(shù)據(jù)鎖存器和顯示電路4部分。設(shè)計(jì)時(shí)先分別設(shè)計(jì)各功能模塊，并調(diào)試得到正確仿真結(jié)果，然后將各個(gè)功能模塊組合起來。最后作整體仿真、下載，得到實(shí)物。由于采用純數(shù)字硬件設(shè)計(jì)制作，穩(wěn)定性、可靠性遠(yuǎn)遠(yuǎn)高于使用單片機(jī)或模擬方式實(shí)現(xiàn)的系統(tǒng)，外圍電路簡單。該數(shù)字頻率計(jì)達(dá)到預(yù)期要求，實(shí)現(xiàn)了可變量程測量，測量范圍0.1Hz—9999MHz，精度可達(dá)0.1Hz。
上傳時(shí)間： 2016-03-20
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上傳時(shí)間： 2016-08-02
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利用Serial ComPort與GPS機(jī)器作資料傳輸並可以儲存為google map應(yīng)用檔
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上傳時(shí)間： 2017-02-25
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applet在線上繪圖,允許在瀏覽器上繪圖,最後儲存成各式的圖檔
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上傳時(shí)間： 2017-09-08
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該系統(tǒng)是一款磁卡閱讀存儲器，根據(jù)用戶要求解決了普通閱讀器只能實(shí)時(shí)連接計(jì)算機(jī)，不能單獨(dú)使用的問題。而且針對作為特殊用途的磁卡，要求三道磁道都記錄數(shù)據(jù)，并且第三磁道記錄格式與標(biāo)準(zhǔn)規(guī)定的記錄格式不同時(shí)，系統(tǒng)配套的應(yīng)用程序?qū)ζ渥隽苏_譯碼、顯示。 @@ 整個(gè)系統(tǒng)包括單片機(jī)控制的閱讀存儲器硬件部分，和配套使用的計(jì)算機(jī)界面應(yīng)用程序軟件部分。其中硬件電路包括磁條譯碼芯片、外部存儲器芯片、串口電平轉(zhuǎn)換芯片等等，所有的工作過程都是由單片機(jī)控制。我們這里選用紫外線擦除的87C52單片機(jī)，電路使用的集成電路芯片都是采用SMT封裝器件，極大縮小了讀存器的體積，使用簡單，攜帶方便。 @@ 磁條譯碼芯片采用的是中青科技有限公司出品的M3-230.LQ F/2F解碼器集成電路。該IC實(shí)現(xiàn)了磁信號到電信號的轉(zhuǎn)換。外部存儲器則是使用的8K Bytes的24LC65集成芯片，擴(kuò)展8片，總?cè)萘窟_(dá)到8×8K。 @@ MAXIM公司出品的MAX232實(shí)現(xiàn)了單片機(jī)TTL電平到RS232接口電平的轉(zhuǎn)換，從而與計(jì)算機(jī)串口實(shí)現(xiàn)硬件連接。 @@ 計(jì)算機(jī)界面顯示程序采用當(dāng)今使用最廣的面向?qū)ο缶幊陶Z言Visual Basic 6.0版本(以后簡稱VB)，并且使用VB帶有的串口通信控件MScomm，通過設(shè)置其屬性，使其和下位機(jī)單片機(jī)協(xié)議保持一致，進(jìn)而進(jìn)行正確的串口通信。關(guān)于磁道上數(shù)據(jù)記錄的譯碼，則是通過對每條磁道上數(shù)據(jù)記錄進(jìn)行多次實(shí)驗(yàn)，認(rèn)真分析，進(jìn)而得到了各條磁道各自的編碼規(guī)則，按照其規(guī)則對其譯碼顯示。這部分程序也是通過VB編程語言實(shí)現(xiàn)的。另外，計(jì)算機(jī)應(yīng)用程序部分還實(shí)現(xiàn)了對下位機(jī)讀存器的擦除控制。 @@關(guān)鍵詞：磁卡，閱讀存儲器，單片機(jī)，串口通信，track3數(shù)據(jù)譯碼
上傳時(shí)間： 2013-08-05
上傳用戶：黃華強(qiáng)
MP3音樂是目前最為流行的音樂格式，因其音質(zhì)、復(fù)雜度與壓縮比的完美折中，占據(jù)著廣闊的市場，不僅在互聯(lián)網(wǎng)上廣為流傳，而且在便攜式設(shè)備領(lǐng)域深受人們喜愛。本文以MPEG-1的MP3音頻解碼器為研究對象，在實(shí)時(shí)性、面積等約束條件下，研究MP3解碼電路的設(shè)計(jì)方法，實(shí)現(xiàn)FPGA原型芯片，研究MP3原型芯片的驗(yàn)證方法。 論文的主要貢獻(xiàn)如下： (1)使用算法融合方法合并MP3解碼過程的相關(guān)步驟，以減少緩沖區(qū)存儲單元的容量和訪存次數(shù)。如把重排序步驟融合到反量化模塊，可以減少一半的讀寫RAM操作；把IMDCT模塊內(nèi)部的三個(gè)算法步驟融合在一起進(jìn)行設(shè)計(jì)，可以省去存儲中間計(jì)算結(jié)果的緩存區(qū)單元。 (2)反量化、立體聲處理等模塊中，采用流水線設(shè)計(jì)技術(shù)，設(shè)置寄存器把較長的組合邏輯路徑隔開，提高了電路的性能和可靠性；使用連續(xù)訪問公共緩存技術(shù)，合理規(guī)劃各計(jì)算子模塊的工作時(shí)序，將數(shù)據(jù)計(jì)算的時(shí)間隱藏在訪存過程中；充分利用頻率線的零值區(qū)特性，有效地減少數(shù)據(jù)計(jì)算量，加快了數(shù)據(jù)處理的速度。 (3)設(shè)計(jì)了MP3硬件解碼器的FPGA原型芯片。采用Verilog HDL硬件描述語言設(shè)計(jì)RTL級電路，完成功能仿真，以Altera公司Stratix II系列的EP2S180 FPGA開發(fā)板為平臺，實(shí)現(xiàn)MP3解碼器的FPGA原型芯片。MP3硬件解碼器在Stratix II EP2S180器件內(nèi)的資源利用率約為5％，其中組合邏輯查找表ALUT為7189個(gè)，寄存器共有4024個(gè)，系統(tǒng)頻率可達(dá)69.6MHz，充分滿足了MP3解碼過程的實(shí)時(shí)性要求。實(shí)驗(yàn)結(jié)果表明，MP3音頻解碼FPGA原型芯片可正常播放聲音，解碼音質(zhì)良好。
上傳時(shí)間： 2013-07-01
上傳用戶：xymbian
內(nèi)置譯碼器的步進(jìn)電機(jī)微步進(jìn)驅(qū)動(dòng)芯片
標(biāo)簽： 內(nèi)置 譯碼器 步進(jìn)電機(jī) 步進(jìn)
上傳時(shí)間： 2013-06-07
上傳用戶：eeworm
計(jì)數(shù)器,分頻器,鎖存器,驅(qū)動(dòng)器分冊
標(biāo)簽： 計(jì)數(shù)器 分頻器 分 鎖存器
上傳時(shí)間： 2013-04-15
上傳用戶：eeworm
專輯類-執(zhí)行器件相關(guān)專輯-43冊-296M 內(nèi)置譯碼器的步進(jìn)電機(jī)微步進(jìn)驅(qū)動(dòng)芯片.pdf
標(biāo)簽： 內(nèi)置 譯碼器 步進(jìn)電機(jī)
上傳時(shí)間： 2013-04-24
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