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布線算法

  • 指紋識別認證算法硬件實現

    指紋識別作為生物特征識別的一種,在身份識別上有著其他手段不可比擬的優(yōu)越性:人的指紋具有唯一性和穩(wěn)定性;隨著指紋傳感器性能的提高和價格的降低.指紋的采集相對容易;指紋識別算法已經比較成熟

    標簽: 指紋識別 算法 硬件實現

    上傳時間: 2013-07-28

    上傳用戶:chongcongying

  • 基于FPGA的中頻數字化若干關鍵算法

    軟件無線電技術自20世紀90年代提出以后,在許多通信系統(tǒng)中得到了廣泛應用。本文研究了一種軟件無線電數字通信系統(tǒng)方案的設計,并著重研究了其中中頻處理單元的設計和實現。針對實際應用,本文提出了一個基于FPGA和DSP的軟件無線電中頻/基帶數字化處理系統(tǒng)的設計方案。該系統(tǒng)的特點是所有的中頻信號處理算法全部由軟件實現,它主要包括高速A/D、超大規(guī)模FPGA芯片、高速DSP芯片和外部存儲器等,其中超大規(guī)模FPGA芯片和高速的DSP芯片是系統(tǒng)的核心。DSP芯片采用的是TI公司的C6416,FPGA芯片采用的是Xilinx公司的XC2V2000FG676,既兼顧速度和靈活性,又具有較強的通用性。 本文根據“基于FPGA的中頻數字化處理平臺的建立及若干關鍵算法的實現”研究課題,主要完成了軟件無線電通信系統(tǒng)中頻數字化若干關鍵算法實現的任務,具體包括通用數字中頻板的設計、中頻板上FPGA和DSP、D/A的接口設計、各種數字通信關鍵技術(數字上/下變頻、調制解調、信道編譯碼、交織解交織等)的FPGA實現。本文研究的系統(tǒng)分別在Matlab、ISE、Modelsim、Visual DSP++、ChipScope Pro等軟件中進行了仿真和驗證,并已交付使用。結果表明,本文提出的方案正確可行,達到了預定要求。本文的工作對其它軟件無線電系統(tǒng)的實現也具有較大的參考價值。

    標簽: FPGA 中頻數字化 關鍵算法

    上傳時間: 2013-04-24

    上傳用戶:thinode

  • 交織與解交織的算法研究及FPGA實現

    本文主要研究了數字聲音廣播系統(tǒng)(DAB)內交織器與解交織器的算法及硬件實現方法。時間交織器與解交織器的硬件實現可以有幾種實現方案,本文對其性能進行了分析比較,選擇了一種工程中實用的設計方案進行設計,并將設計結果以FPGA設計驗證。時間解交織器的交織速度、電路面積、占用內存、是設計中主要因素,文中采用了單口SRAM實現,減少了對存儲器的使用,利用lC設計的優(yōu)化設計方法來改善電路的面積。硬件實現是采用工業(yè)EDA標準Top-to-Down設計思想來設計時間解交織,使用verilogHDL硬件描述語言來描述解交織器,用Cadence Nc-verilog進行仿真,Debussy進行debug,在Altera公司的FPGA開發(fā)板上進行測試,然后用ASIC實現。測試結果證明:時間解交織器的輸出正確,實現速度較快,占用面積較小。

    標簽: FPGA 算法研究

    上傳時間: 2013-04-24

    上傳用戶:梧桐

  • 連續(xù)相位調制研究及其解調算法

    本文主要研究了近年來發(fā)展很快的一種高效的調制技術——連續(xù)相位調制(CPM)。與其它調制技術相比,它具有較高的帶寬和功率利用率,這也令它在通信資源日益緊張的今天得到了越來越多的關注。CPM信號包含大量的信號形式,它們的共同特點是信號包絡恒定、相位連續(xù),尤其適合于無線通信。 本文首先介紹了CPM信號的一般表達式及其功率譜密度公式,在此基礎上對CPM信號特性做了分析研究,并對其功率譜密度進行了計算機仿真,分析得出了CPM信號各調制參數的取值對其譜特性的影響;然后對CPM信號的各種解調方法進行了深入研究,對不同方法的解調性能作了仿真,通過比較分析得出解調性能、調制參數與系統(tǒng)實現復雜度之間相互制約的關系;最后,在前面分析研究的基礎上,完成了一個實際通信系統(tǒng)中信號檢測算法的。FPGA實現。

    標簽: 相位調制 解調算法

    上傳時間: 2013-05-29

    上傳用戶:baiom

  • 自適應濾波器算法設計及其FPGA實現

    自適應濾波器是智能天線技術中核心部分-自適應波束成形器的關鍵技術,算法的高效穩(wěn)定性及硬件時鐘速率的快慢是判斷波束成形器性能優(yōu)劣的主要標準。 首先選取工程領域最常用的自適應橫向LMS濾波算法作為研究對象,提出了利用最小均方誤差意義下自適應濾波器的輸出信號與主通道噪聲信號的等效關系,得到濾波器最佳自適應參數的方法。并分析了在平穩(wěn)和非平穩(wěn)環(huán)境噪聲下,濾波器的收斂速度、權系數穩(wěn)定性、跟蹤輸入信號的能力和信噪比的改善等特性。 在分析梯度自適應格型算法的基礎上,提出利用最佳反射系數的收斂性和穩(wěn)定性,得到了梯度自適應格型濾波器的定步長改進方法;并以改進的梯度自適應格型和線性組合器組成梯度自適應格型聯合處理算法,在同樣環(huán)境噪聲下,相比自適應橫向LMS算法,其各項性能指標都得到了極大地改善,而且有利于節(jié)省硬件資源。 設計了自適應橫向LMS濾波器和梯度自適應格型聯合處理濾波器的電路模型,并用馳豫超前技術對兩類濾波器進行了流水線優(yōu)化。利用Altera公司的CycloneⅡ系列EP2C5T144C6芯片和多種EDA工具,完成了濾波器的FPGA硬件設計與仿真實現。并以FPGA實現的3節(jié)梯度自適應格型聯合處理器為核心,設計了一種TD-SCDMA系統(tǒng)的自適應波束成形器,分析表明可以很好地利用系統(tǒng)提供的參考信號對下行波束進行自適應成形。

    標簽: FPGA 自適應濾波器 算法設計

    上傳時間: 2013-07-16

    上傳用戶:xyipie

  • IMDCT算法研究及其FPGA實現

    近年來,隨著多媒體技術的迅猛發(fā)展,電子、計算機、通訊和娛樂之間的相互融合、滲透越來越多,而數字音頻技術則是應用最為廣泛的技術之一。MP3(MPEG-1 Audio LayerⅢ)編解碼算法作為數字音頻的解決方案,在便攜式多媒體產品中得到了廣泛流行。 在已有的便攜式MP3系統(tǒng)實現方案中,低速處理器與專用硬件結合的SOC設計方案結合了硬件實現方式和軟件實現方式的優(yōu)點,具有成本低、升級容易、功能豐富等特點。IMDCT(反向改進離散余弦變換)是編解碼算法中一個運算量大調用頻率高的運算步驟,因此適于硬件實現,以降低處理器的開銷和功耗,來提高整個系統(tǒng)的性能。 本文首先闡述了MP3音頻編解碼標準和流程,以及IMDCT常用的各種實現算法。在此基礎上選擇了適于硬件實現的遞歸循環(huán)實現方法,并在已有算法的基礎上進行了改進,減小了所需硬件資源需求并保持了運算速度。接著提出了模塊總體設計方案,結合算法進行了實現結構的優(yōu)化,并在EDA環(huán)境下具體實現,用硬件描述語言設計、綜合、仿真,且下載到Xilinx公司的VirtexⅡ系列xc2v1000FPGA器件中,在減小硬件資源的同時快速地實現了IMDCT,經驗證功能正確。

    標簽: IMDCT FPGA 算法研究

    上傳時間: 2013-06-11

    上傳用戶:亮劍2210

  • Morlet小波分析的BOTDR信號處理

    基于布里淵散射的分布式光纖傳感器是當前國內外研究的熱點。本文介紹了基于布里淵散射的分布式光纖傳感器的的原理、應用;布里淵時域反射技術(BOTDR)和布里淵時域分析技術(BOTDA)的原理。 受激布里淵散射(SBS)的過程中,入射光和散射光滿足耦合振幅方程組。我們對該方程組采用有限差分法進行數值計算,并用Matlab模擬計算過程,對布里淵散射信號進行分析。 根據布里淵散射信號的特點,我們采用基于Morlet小波變換的DSP信號算法來處理 BOTDR傳感信號。通過對該算法的核心單元——快速傅立葉變換(FFT)的硬件實現,我們在Stratix FPGA上實現了基于Morlet小波變換的DSP算法的硬件電路設計。 最后,在此基礎上,我們對電路功能進行實際的仿真和驗證,并和Matlab得到結果進行比較和分析。

    標簽: Morlet BOTDR 小波分析 信號處理

    上傳時間: 2013-07-22

    上傳用戶:牛布牛

  • 改進的圖像自嵌入水印算法及其MATLAB實現

    提出通過對分塊圖像的DCT 系數進行動態(tài)范圍壓縮來改進傳統(tǒng)的基于DCT 變換的圖像自嵌入水印算法,并結合灰度變換函數與JPEG 標準量化表重新設計了DCT 系數碼長分配表,大幅度提升了量化過程保留的圖

    標簽: MATLAB 圖像 水印算法

    上傳時間: 2013-07-28

    上傳用戶:小鵬

  • 藍牙跳頻技術研究及其改進算法

    本文研究了藍牙的跳頻算法,結合SystemView和Matlab兩種軟件,對其跳頻內核進行仿真和分析。同時,對一種特別用于藍牙的跳頻改進方案——鏈路狀態(tài)歷史紀錄表的方法進行研究。關鍵字: 藍牙

    標簽: 藍牙 技術研究 改進算法 跳頻

    上傳時間: 2013-07-06

    上傳用戶:小草123

  • 圖像處理算法研究及硬件設計

    隨著圖像分辨率的越來越高,軟件實現的圖像處理無法滿足實時性的需求;同時FPGA等可編程器件的快速發(fā)展使得硬件實現圖像處理變得可行。如今基于FPGA的圖像處理研究成為了國內外的一個熱門領域。 本文在FPGA平臺上,用Verilog HDL實現了一個研究圖像處理算法的可重復配置的硬件模塊架構,架構包括PC機預處理和通信軟件,控制模塊,計算單元,存儲器模塊和通信適配模塊五個部分。其中的計算模塊負責具體算法的實現,根據不同的圖像處理算法可以獨立實現。架構為計算模塊實現了一個可添加、移出接口,不同的算法設計只要符合該接口就可以方便的加入到模塊架構中來進行調試和運行。 在硬件架構的基礎上本文實現了排序濾波,中值濾波,卷積運算及高斯濾波,形態(tài)學算子運算等經典的圖像處理算法。討論了FPGA的圖像處理算法的設計方法及優(yōu)化策略,通過性能分析,FPGA實現圖像處理在時間上比軟件處理有了很大的提高;通過結果的比較,發(fā)現FPGA的處理結果達到了軟件處理幾乎同等的效果水平。最后本文在實現較大圖片處理和圖像處理窗口的大小可配置性方面做了一定程度的討論和改進,提高了算法的可用性,同時為進一步的研究提供了更加便利的平臺。 整個設計都是在ISE8.2和ModelSim第三方仿真軟件環(huán)境下開發(fā)的,在xilinx的Spartan-3E XC3S500E硬件平臺上實現。在軟件仿真過程中利用了ISE8.2自帶仿真工具和ModelSim結合使用。 本課題為制造FPGA的專用圖像處理芯片做了有益的探索性研究,為實現FPGA為核心處理芯片的實時圖像處理系統(tǒng)有著積極的作用。

    標簽: 圖像處理 算法研究 硬件設計

    上傳時間: 2013-05-30

    上傳用戶:水瓶kmoon5

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