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  • 無意間在網(wǎng)上找到這本書,已經(jīng)絕版了也很難找到所以放上來分享給大家,提供大家學(xué)習(xí) 本書對SCSI的介紹偏重於軟件開發(fā)方面。在介紹了SCSI的基本概念後

    無意間在網(wǎng)上找到這本書,已經(jīng)絕版了也很難找到所以放上來分享給大家,提供大家學(xué)習(xí) 本書對SCSI的介紹偏重於軟件開發(fā)方面。在介紹了SCSI的基本概念後,介紹了SCSI編程的程序化方法,並在DOS和Windows下研究了ASPI(高級SCSI編程接口),在Windows和Windows NT下研究了ASPI32的擴(kuò)展,在介紹SCSI在UNIX平臺的應(yīng)用時,把重點(diǎn)放在了Linux平臺上

    標(biāo)簽: SCSI 基本概念

    上傳時間: 2014-01-07

    上傳用戶:qunquan

  • 基于平均功率和RLS自適應(yīng)算法的并聯(lián)型有源濾波器.rar

    隨著電力電子技術(shù)的飛速發(fā)展,越來越多的電力電子裝置被廣泛應(yīng)用到各個領(lǐng)域,其中相當(dāng)一部分負(fù)荷具有非線性或具有時變特性,使電網(wǎng)中暫態(tài)沖擊、無功功率、高次諧波及三相不平衡問題日趨嚴(yán)重,給電網(wǎng)的供電質(zhì)量造成嚴(yán)重的污染和損耗.因此,對電力系統(tǒng)進(jìn)行諧波抑制和無功補(bǔ)償,提高電網(wǎng)供電質(zhì)量變得十分重要.電力有源濾波器(Active Power Filter,簡稱APF)與無源濾波器相比,APF具有高度可控制和快速響應(yīng)特性,并且能跟蹤補(bǔ)償各次諧波、自動產(chǎn)生所需變化的無功功率和諧波功率,其特性不受系統(tǒng)影響,無諧波放大威脅.并聯(lián)型電力有源濾波器(Shunt Active Power Filter,簡稱SAPF)更是得到了廣泛的應(yīng)用. 近年來,自適應(yīng)算法中的遞推最小二乘法(簡稱RLS)應(yīng)用越來越廣泛,該算法簡單,收斂速度快.應(yīng)用基于RLS自適應(yīng)算法的濾波器(簡稱RLS濾波器),可以快速有效的濾除雜波,同時自動調(diào)整濾波器參數(shù),不斷改進(jìn)濾波性能,最終得到所需的信號. 本文研究了基于平均功率和RLS自適應(yīng)算法的并聯(lián)型有源濾波器.它的參考電流是一個同電網(wǎng)相電壓同相位的三相平衡的有功電流,它包含兩個分量:一個是由實(shí)測的三相負(fù)載瞬時功率計(jì)算得到的,基于平均功率算法的電網(wǎng)應(yīng)該為負(fù)載各相提供的有功電流瞬時參考值;另一個是為了維持有源濾波器中逆變器的直流母線電壓基本恒定,主要通過RLS濾波器計(jì)算得出的電網(wǎng)各相應(yīng)該提供的有功電流瞬時參考值.兩個分量的計(jì)算共同構(gòu)成了該有源濾波器參考電流的計(jì)算.補(bǔ)償電流指令值與實(shí)際補(bǔ)償電流比較生成控制逆變橋工作的PWM脈沖,生成補(bǔ)償電流,達(dá)到補(bǔ)償負(fù)載無功和抑制諧波的目的. 應(yīng)用RLS濾波器得到維持直流母線電壓恒定的直流側(cè)有功系數(shù)A<,dc>,克服了傳統(tǒng)PI控制中參數(shù)難以得到且由于參數(shù)過于敏感而導(dǎo)致補(bǔ)償后電流紋波太大的問題.使得當(dāng)穩(wěn)態(tài)時SAPF自身的功率損耗和暫態(tài)負(fù)載變化時因?yàn)橹绷鱾?cè)電容提供電網(wǎng)和負(fù)載之間的有功功率差而引起的電壓的波動迅速反饋到指令電流的計(jì)算中.RLS算法收斂快,SAPF實(shí)時性大大提高.基于該方法的SAPF結(jié)構(gòu)簡單,無需鎖相器. 根據(jù)本文的算法應(yīng)用MATAB建立了仿真系統(tǒng),仿真結(jié)果表明基于該算法的SAPF的可行性和實(shí)時性.

    標(biāo)簽: RLS 功率 自適應(yīng)算法

    上傳時間: 2013-04-24

    上傳用戶:mfhe2005

  • FPGA可促進(jìn)嵌入式系統(tǒng)設(shè)計(jì)改善即時應(yīng)用性能

    FPGA可促進(jìn)嵌入式系統(tǒng)設(shè)計(jì)改善即時應(yīng)用性能,臺灣人寫的,關(guān)于FPGA應(yīng)用的技術(shù)文章

    標(biāo)簽: FPGA 嵌入式 系統(tǒng) 性能

    上傳時間: 2013-08-20

    上傳用戶:liuwei6419

  • pcb layout design(臺灣硬件工程師15年經(jīng)驗(yàn)

    PCB LAYOUT 術(shù)語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數(shù)零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設(shè)計(jì)之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設(shè)計(jì)之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內(nèi)層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內(nèi)層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範(fàn)圍,不與零件腳相接。10. THERMAL PAD:多層板內(nèi)NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或?qū)住?1. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應(yīng)相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點(diǎn)2. Test Point : ATE 測試點(diǎn)供工廠ICT 測試治具使用ICT 測試點(diǎn) LAYOUT 注意事項(xiàng):PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點(diǎn)),其原則如下:1. 一般測試點(diǎn)大小均為30-35mil,元件分布較密時,測試點(diǎn)最小可至30mil.測試點(diǎn)與元件PAD 的距離最小為40mil。2. 測試點(diǎn)與測試點(diǎn)間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點(diǎn)必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點(diǎn)留於錫爐著錫面上(Solder Side)。5. 測試點(diǎn)必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點(diǎn)設(shè)置處:Setup􀃆pads􀃆stacks

    標(biāo)簽: layout design pcb 硬件工程師

    上傳時間: 2013-10-22

    上傳用戶:pei5

  • 一種平均電流控制型開關(guān)調(diào)節(jié)系統(tǒng)的建模

    文中對BUCK型DC_DC變換器進(jìn)行了系統(tǒng)建模。為了得到包含平均電流調(diào)節(jié)開關(guān)控制方式的雙環(huán)控制系統(tǒng)的簡化模型,提出了一種電流環(huán)閉環(huán)傳遞函數(shù)的近似函數(shù),并分別對電流控制器,電流補(bǔ)償網(wǎng)絡(luò)和功率級進(jìn)行了建模,采用Mathcad進(jìn)行仿真,得到系統(tǒng)相位裕度達(dá)到54°的結(jié)果。

    標(biāo)簽: 電流控制 開關(guān)調(diào)節(jié)系統(tǒng) 建模

    上傳時間: 2014-12-24

    上傳用戶:lunshaomo

  • 全橋DCDC變換器平均電流控制模式控制分析

    全橋DCDC變換器平均電流控制模式控制分析

    標(biāo)簽: DCDC 全橋 變換器

    上傳時間: 2013-11-18

    上傳用戶:jackgao

  • pcb layout design(臺灣硬件工程師15年經(jīng)驗(yàn)

    PCB LAYOUT 術(shù)語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數(shù)零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設(shè)計(jì)之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設(shè)計(jì)之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內(nèi)層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內(nèi)層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範(fàn)圍,不與零件腳相接。10. THERMAL PAD:多層板內(nèi)NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或?qū)住?1. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應(yīng)相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點(diǎn)2. Test Point : ATE 測試點(diǎn)供工廠ICT 測試治具使用ICT 測試點(diǎn) LAYOUT 注意事項(xiàng):PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點(diǎn)),其原則如下:1. 一般測試點(diǎn)大小均為30-35mil,元件分布較密時,測試點(diǎn)最小可至30mil.測試點(diǎn)與元件PAD 的距離最小為40mil。2. 測試點(diǎn)與測試點(diǎn)間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點(diǎn)必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點(diǎn)留於錫爐著錫面上(Solder Side)。5. 測試點(diǎn)必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點(diǎn)設(shè)置處:Setup􀃆pads􀃆stacks

    標(biāo)簽: layout design pcb 硬件工程師

    上傳時間: 2013-11-17

    上傳用戶:cjf0304

  • 基于刪除平均和單元平均的CFAR檢測器性能分析

    分析了所提3種檢測器的在均勻和非均勻背景下的檢測性能。結(jié)果表明,在均勻背景和多目標(biāo)環(huán)境下,對局部估計(jì)進(jìn)行平均的檢測器性能最優(yōu)。

    標(biāo)簽: CFAR 刪除 檢測器 性能分析

    上傳時間: 2013-10-21

    上傳用戶:蠢蠢66

  • 編程計(jì)算磁盤上(或某一目錄下)所有文件的平均長度。 編程計(jì)算磁盤上(或某一目錄及其各級子目錄)每目錄的平均文件個數(shù)。

    編程計(jì)算磁盤上(或某一目錄下)所有文件的平均長度。 編程計(jì)算磁盤上(或某一目錄及其各級子目錄)每目錄的平均文件個數(shù)。

    標(biāo)簽: 目錄 編程 磁盤 計(jì)算

    上傳時間: 2014-11-02

    上傳用戶:woshiayin

  • k平均聚類算法

    k平均聚類算法,實(shí)現(xiàn)聚類的圖形顯示

    標(biāo)簽: 聚類算法

    上傳時間: 2015-01-20

    上傳用戶:zhengjian

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