專輯類-國標類相關專輯-313冊-701M GB-T-17172-1997-四一七-條碼.pdf
上傳時間： 2013-04-24
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專輯類-國標類相關專輯-313冊-701M GB-T-2470-1995-電子設備用固定電阻器、固定電容器型號命名方法.pdf
上傳時間： 2013-06-19
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專輯類-國標類相關專輯-313冊-701M GB-T-2828.1-2003-計數抽樣檢驗程序-第一部分-81頁-5.2M.pdf
上傳時間： 2013-04-24
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TMS320F281X系列DSP的C語言頭文件和外設例程
上傳時間： 2013-07-16
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可以打開pdg文件，即裝即用！！！！！！！！111
上傳時間： 2013-04-24
上傳用戶：royzhangsz
ARM的開發流程、最小系統、啟動文件詳解：包括最小系統實例詳解和軟件環境介紹
上傳時間： 2013-04-24
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印制電路板設計技術指導文件,印制電路板設計技術指導文件
上傳時間： 2013-08-02
上傳用戶：dave520l
本論文結合珠海市科技攻關項目"SVG在辦公套件中的應用研究及開發"和金山軟件股份有限公司“演示文稿在線美化-SVG渲染引擎開發”項目，以打印機驅動程序、SVG、C＃、C和JavaScript為基礎，重點研究了SVG文件的生成、解析、顯示及其應用。 本文緒論部分綜述了本課題的研究背景、研究目的、研究意義及SVG在諸多領域的應用前景，然后從SVG標準的發展、SVG文件的生成及渲染三個方面分別介紹了國內外研究現狀及本課題的主要研究內容。接著詳細介紹了可擴展標記語言XML以及可縮放矢量圖形SVG。在此基礎上，探討了如何將各種格式的文檔轉換為SVG文件，提出了一個通用的方法一利用打印機驅動程序輸出SVG文件，詳細介紹了打印體系結構、打印機驅動程序功能、打印機驅動程序組件、Windows打印流程及打印機驅動程序相關的DDI函數。在比較了DOM和SAX這兩種XML解析方式的基礎上，鑒于SVG自身的特點及渲染時對SVG元素隨機訪問的需要，采用DOM接口實現了基于．Net Framework XML解析模型的SVG解析框架，采用GDI+實現了SVG顯示框架；同時給出了SVG文檔對象模型與GDI+圖形對象模型的具體映射關系，并基于此映射模型實現了SVG靜態圖形圖像正確高效的顯示。本論文根據SVG相關標準對SVG技術進行了一些應用研究，有助于SVG技術在相關行業的應用。 論文通過一個SVG文件轉換實例和一個SVG文件渲染實例例證了SVG文件生成與SVG文件解析和顯示的可行性。
上傳時間： 2013-04-24
上傳用戶：shinesyh
H．264/AVC規范是由國際電聯(ITU-T)和國際標準化組織(ISO)聯合制定的新一代視頻編解碼標準。它具有如下四個特點：低碼流，和MPEG2等壓縮技術相比，在同等圖像質量下，采用H.264技術壓縮后的數據量只有MPEG2的1/8；高圖象質量，復雜的算法保證了低碼流條件下圖像仍能保留豐富的細節；容錯能力強，提供了解決在不穩定網絡環境下容易發生的丟包等錯誤的必要工具；網絡適應性強，提供了網絡適應層，數據能在不同網絡上傳輸。但由此帶來的代價是復雜度極高的編碼過程，尤其是在嵌入式系統中實現具有很大的挑戰性。 本文主要介紹了基于H.264標準的開源代碼T264向DM642平臺的移植和優化。優化綜合運用了上層和底層的實現方法實現。上層的方法例如使用CCS提供的條件優化代碼優化功能，使用IMGLIB中高度優化的函數等，其特點是簡便易行，效果良好；底層的實現方法例如使用DM642特有的內聯函數，用線性匯編的方式實現算法等，特點是提高了代碼運行的并行性，但需要對DM642和H.264有很深刻的理解。 目前本設計已成功完成H.264.算法在DM642開發板上的運行，壓縮QCIF格式視頻的速度隨圖像復雜度的不同達到了35-50幀每秒。此后本設計還繼續使用優化后的編碼器實現了監控用視頻服務器的原型，使得攝像頭采集的視頻數據在DM642開發板上壓縮后傳輸至PC機，且能夠在PC端用配套的程序成功解碼并播放。
上傳時間： 2013-06-23
上傳用戶：qqiang2006
高性能ADC產品的出現，給混合信號測試領域帶來前所未有的挑戰。并行ADC測試方案實現了多個ADC測試過程的并行化和實時化，減少了單個ADC的平均測試時間，從而降低ADC測試成本。 本文實現了基于FPGA的ADC并行測試方法。在閱讀相關文獻的基礎上，總結了常用ADC參數測試方法和測試流程。使用FPGA實現時域參數評估算法和頻域參數評估算法，并對2個ADC在不同樣本數條件下進行并行測試。 通過在FPGA內部實現ADC測試時域算法和頻域算法相結合的方法來搭建測試系統，完成音頻編解碼器WM8731L的控制模式接口、音頻數據接口、ADC測試時域算法和頻域算法的FPGA實現。整個測試系統使用Angilent 33220A任意信號發生器提供模擬激勵信號，共用一個FPGA內部實現的采樣時鐘控制模塊。并行測試系統將WM8731.L片內的兩個獨立ADC的串行輸出數據分流成左右兩通道，并對其進行串并轉換。然后對左右兩個通道分別配置一個FFT算法模塊和時域算法模塊，并行地實現了ADC參數的評估算法。 在樣本數分別為128和4096的實驗條件下，對WM8731L片內2個被測.ADC并行地進行參數評估，被測參數包括增益GAIN、偏移量OFFSET、信噪比SNR、信號與噪聲諧波失真比SINAD、總諧波失真THD等5個常用參數。實驗結果表明，通過在FPGA內配置2個獨立的參數計算模塊，可并行地實現對2個相同ADC的參數評估，減小單個ADC的平均測試時間。 FPGA片內實時評估算法的實現節省了測試樣本傳輸至自動測試機PC端的時間。而且只需將HDL代碼多次復制，就可實現多個被測ADC在同一時刻并行地被評估，配置靈活。基于FPGA的ADC并行測試方法易于實現，具有可行性，但由于噪聲的影響，測試精度有待進一步提高。該方法可用于自動測試機的混合信號選項卡或測試子系統。 關鍵詞：ADC測試；并行；參數評估；FPGA；FFT
上傳時間： 2013-07-11
上傳用戶：tdyoung
