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復變函數與積分變換(馬柏林)課后的習題答案

  • D觸發器組成的_2N_1_2分頻電路

    D觸發器組成的_2N_1_2分頻電路

    標簽: D觸發器 分頻電路

    上傳時間: 2013-10-12

    上傳用戶:lyy1234

  • 差分信號的設置與布線

    差分對信號的設置與布線

    標簽: 差分信號 布線

    上傳時間: 2013-11-13

    上傳用戶:wuchunzhong

  • 分頻電路學習文檔

    分頻

    標簽: 分頻電路 文檔

    上傳時間: 2014-12-23

    上傳用戶:redherr

  • 數字電路講座:寄存器計數器分頻器

    數字電路講座:寄存器計數器分頻器

    標簽: 數字電路 寄存器 分頻器 講座

    上傳時間: 2013-10-27

    上傳用戶:DXM35

  • 基于HVS的空域分塊數字水印技術

     數字水印作為一種防護技術,在數字產品的保護認證方面越發顯得重要,成為當前計算機領域研究的熱點問題之一。提出了一種在空域采用分塊重復嵌入水印信息和HVS相結合的水印技術。實驗結果說明,分塊技術在空域的使用提高了水印的嵌入強度和降低計算復雜度,該算法在抵抗旋轉、裁剪、縮放方面等有較強能力;水印算法與HVS技術的有效性相結合,數字水印具有很好的掩蔽性。

    標簽: HVS 分塊 數字水印技術

    上傳時間: 2013-10-23

    上傳用戶:qwerasdf

  • 基于幀間差分與模板匹配相結合的運動目標檢測

    基于圖形處理器單元(GPU)提出了一種幀間差分與模板匹配相結合的運動目標檢測算法。在CUDA-SIFT(基于統一計算設備架構的尺度不變特征變換)算法提取圖像匹配特征點的基礎上,優化隨機采樣一致性算法(RANSAC)剔除圖像中由于目標運動部分產生的誤匹配點,運用背景補償的方法將靜態背景下的幀間差分目標檢測算法應用于動態情況,實現了動態背景下的運動目標檢測,通過提取目標特征與后續多幀圖像進行特征匹配的方法最終實現自動目標檢測。實驗表明該方法對運動目標較小、有噪聲、有部分遮擋的圖像序列具有良好的目標檢測效果。

    標簽: 幀間差分 模板匹配 運動目標檢測

    上傳時間: 2013-10-09

    上傳用戶:ifree2016

  • PCB布線的直角走線、差分走線和蛇形線基礎理論

    PCB布線的直角走線、差分走線和蛇形線基礎理論

    標簽: PCB 布線 差分走線 走線

    上傳時間: 2013-10-10

    上傳用戶:haohao

  • 差分信號PCB布局布線誤區

     誤區一:認為差分信號不需要地平面作為回流路徑,或者認為差分走線彼此為對方提供回流途徑。造成這種誤區的原因是被表面現象迷惑,或者對高速信號傳輸的機理認識還不夠深入。雖然差分電路對于類似地彈以及其它可能存在于電源和地平面上的噪音信號是不敏感的。地平面的部分回流抵消并不代表差分電路就不以參考平面作為信號返回路徑,其實在信號回流分析上,差分走線和普通的單端走線的機理是一致的,即高頻信號總是沿著電感最小的回路進行回流,最大的區別在于差分線除了有對地的耦合之外,還存在相互之間的耦合,哪一種耦合強,那一種就成為主要的回流通路。

    標簽: PCB 差分信號 布局布線

    上傳時間: 2014-12-22

    上傳用戶:tiantian

  • 差分阻抗

    當你認為你已經掌握了PCB 走線的特征阻抗Z0,緊接著一份數據手冊告訴你去設計一個特定的差分阻抗。令事情變得更困難的是,它說:“……因為兩根走線之間的耦合可以降低有效阻抗,使用50Ω的設計規則來得到一個大約80Ω的差分阻抗!”這的確讓人感到困惑!這篇文章向你展示什么是差分阻抗。除此之外,還討論了為什么是這樣,并且向你展示如何正確地計算它。 單線:圖1(a)演示了一個典型的單根走線。其特征阻抗是Z0,其上流經的電流為i。沿線任意一點的電壓為V=Z0*i( 根據歐姆定律)。一般情況,線對:圖1(b)演示了一對走線。線1 具有特征阻抗Z11,與上文中Z0 一致,電流i1。線2具有類似的定義。當我們將線2 向線1 靠近時,線2 上的電流開始以比例常數k 耦合到線1 上。類似地,線1 的電流i1 開始以同樣的比例常數耦合到線2 上。每根走線上任意一點的電壓,還是根據歐姆定律,

    標簽: 差分阻抗

    上傳時間: 2013-10-20

    上傳用戶:lwwhust

  • IC封裝製程簡介(IC封裝制程簡介)

    半導體的產品很多,應用的場合非常廣泛,圖一是常見的幾種半導體元件外型。半導體元件一般是以接腳形式或外型來劃分類別,圖一中不同類別的英文縮寫名稱原文為   PDID:Plastic Dual Inline Package SOP:Small Outline Package SOJ:Small Outline J-Lead Package PLCC:Plastic Leaded Chip Carrier QFP:Quad Flat Package PGA:Pin Grid Array BGA:Ball Grid Array         雖然半導體元件的外型種類很多,在電路板上常用的組裝方式有二種,一種是插入電路板的銲孔或腳座,如PDIP、PGA,另一種是貼附在電路板表面的銲墊上,如SOP、SOJ、PLCC、QFP、BGA。    從半導體元件的外觀,只看到從包覆的膠體或陶瓷中伸出的接腳,而半導體元件真正的的核心,是包覆在膠體或陶瓷內一片非常小的晶片,透過伸出的接腳與外部做資訊傳輸。圖二是一片EPROM元件,從上方的玻璃窗可看到內部的晶片,圖三是以顯微鏡將內部的晶片放大,可以看到晶片以多條銲線連接四周的接腳,這些接腳向外延伸並穿出膠體,成為晶片與外界通訊的道路。請注意圖三中有一條銲線從中斷裂,那是使用不當引發過電流而燒毀,致使晶片失去功能,這也是一般晶片遭到損毀而失效的原因之一。   圖四是常見的LED,也就是發光二極體,其內部也是一顆晶片,圖五是以顯微鏡正視LED的頂端,可從透明的膠體中隱約的看到一片方型的晶片及一條金色的銲線,若以LED二支接腳的極性來做分別,晶片是貼附在負極的腳上,經由銲線連接正極的腳。當LED通過正向電流時,晶片會發光而使LED發亮,如圖六所示。     半導體元件的製作分成兩段的製造程序,前一段是先製造元件的核心─晶片,稱為晶圓製造;後一段是將晶中片加以封裝成最後產品,稱為IC封裝製程,又可細分成晶圓切割、黏晶、銲線、封膠、印字、剪切成型等加工步驟,在本章節中將簡介這兩段的製造程序。

    標簽: 封裝 IC封裝 制程

    上傳時間: 2014-01-20

    上傳用戶:蒼山觀海

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