計算機部件要具有通用性，適應不同系統與不同用戶的需求，設計必須模塊化。計算機部件產品(模塊)供應出現多元化。模塊之間的聯接關系要標準化，使模塊具有通用性。模塊設計必須基于一種大多數廠商認可的模塊聯接關系，即一種總線標準?？偩€的標準總線是一類信號線的集合是模塊間傳輸信息的公共通道，通過它，計算機各部件間可進行各種數據和命令的傳送。為使不同供應商的產品間能夠互換，給用戶更多的選擇，總線的技術規范要標準化?？偩€的標準制定要經周密考慮，要有嚴格的規定。總線標準（技術規范）包括以下幾部分：機械結構規范：模塊尺寸、總線插頭、總線接插件以及按裝尺寸均有統一規定。功能規范：總線每條信號線（引腳的名稱）、功能以及工作過程要有統一規定。電氣規范：總線每條信號線的有效電平、動態轉換時間、負載能力等?？偩€的發展情況S-100總線：產生于1975年，第一個標準化總線，為微計算機技術發展起到了推動作用。IBM-PC個人計算機采用總線結構（Industry Standard Architecture, ISA)并成為工業化的標準。先后出現8位ISA總線、16位ISA總線以及后來兼容廠商推出的EISA（Extended ISA)32位ISA總線。為了適應微處理器性能的提高及I/O模塊更高吞吐率的要求，出現了VL-Bus(VESA Local Bus)和PCI(Peripheral Component Interconnect,PCI）總線。適合小型化要求的PCMCIA(Personal Computer Memory Card International Association)總線，用于筆記本計算機的功能擴展?？偩€的指標計算機主機性能迅速提高,各功能模塊性能也要相應提高,這對總線性能提出更高的要求?？偩€主要技術指標有幾方面：總線寬度：一次操作可以傳輸的數據位數，如S100為8位，ISA為16位，EISA為32位，PCI-2可達64位。總線寬度不會超過微處理器外部數據總線的寬度?？倲倒ぷ黝l率：總線信號中有一個CLK時鐘，CLK越高每秒鐘傳輸的數據量越大。ISA、EISA為8MHz，PCI為33.3MHz, PCI-2可達達66.6MHz。單個數據傳輸周期：不同的傳輸方式，每個數據傳輸所用CLK周期數不同。ISA要2個，PCI用1個CLK周期。這決定總線最高數據傳輸率。5. 總線的分類與層次系統總線：是微處理器芯片對外引線信號的延伸或映射，是微處理器與片外存儲器及I/0接口傳輸信息的通路。系統總線信號按功能可分為三類：地址總線（Where）：指出數據的來源與去向。地址總線的位數決定了存儲空間的大小。系統總線：數據總線（What）提供模塊間傳輸數據的路徑，數據總線的位數決定微處理器結構的復雜度及總體性能?？刂瓶偩€（When）：提供系統操作所必需的控制信號，對操作過程進行控制與定時。擴充總線：亦稱設備總線，用于系統I/O擴充。與系統總線工作頻率不同，經接口電路對系統總統信號緩沖、變換、隔離，進行不同層次的操作（ISA、EISA、MCA)局部總線：擴充總線不能滿足高性能設備（圖形、視頻、網絡）接口的要求，在系統總線與擴充總線之間插入一層總線。由于它經橋接器與系統總線直接相連，因此稱之為局部總線（PCI）。
上傳時間： 2013-11-09
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TMS320F28335DSP在電力電子變流器中、性能優勢分析
上傳時間： 2013-11-20
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為了滿足對隨機數性能有一定要求的系統能夠實時檢測隨機數性能的需求，提出了一種基于FPGA的隨機數性能檢測設計方案。根據NIST的測試標準，采用基于統計的方法，在FPGA內部實現了對隨機序列的頻率測試、游程測試、最大游程測試、離散傅里葉變換測試和二元矩陣秩測試。與現在常用的隨機數性能測試軟件相比，該設計方案，能靈活嵌入到需要使用隨機數的系統中，實現對隨機性能的實時檢測。實際應用表明，該設計具有使用靈活、測試準確、實時輸出結果的特點，達到了設計要求。
上傳時間： 2013-11-13
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電子發燒友網核心提示：Altera公司昨日宣布，在業界率先在28 nm FPGA器件上成功測試了復數高性能浮點數字信號處理（DSP）設計。獨立技術分析公司Berkeley設計技術有限公司（BDTI）驗證了能夠在 Altera Stratix V和Arria V 28 nm FPGA開發套件上簡單方便的高效實現Altera浮點DSP設計流程，同時驗證了要求較高的浮點DSP應用的性能。本文是BDTI完整的FPGA浮點DSP分析報告。 Altera的浮點DSP設計流程經過規劃，能夠快速適應可參數賦值接口的設計更改，其工作環境包括來自MathWorks的MATLAB和 Simulink，以及Altera的DSP Builder高級模塊庫，支持FPGA設計人員比傳統HDL設計更迅速的實現并驗證復數浮點算法。這一設計流程非常適合設計人員在應用中采用高性能 DSP，這些應用包括，雷達、無線基站、工業自動化、儀表和醫療圖像等。
上傳時間： 2014-12-28
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Virtex™-5 器件包括基于第二代高級硅片組合模塊 (ASMBL™) 列架構的多平臺 FPGA 系列。集成了為獲得最佳性能、更高集成度和更低功耗設計的若干新型架構元件，Virtex-5 器件達到了比以往更高的系統性能水平。
上傳時間： 2013-10-29
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今年年底北斗衛星導航系統已基本完成地球靜止軌道衛星和傾斜地球同步軌道衛星的建設工作。目前，在中國及周邊地區北斗導航系統已經可以單獨提供定位服務。本文對GPS/北斗組合系統以及GPS北斗單獨系統在上海的定位性能進行了評估，分析了在不同模式下的可視衛星數量、幾何精度因子、定位的穩定性和準確性。結果表明組合定位進一步提高了單獨系統模式下的定位性能，北斗系統目前在水平方向上的定位精度已經達到10米級。
上傳時間： 2013-10-20
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基于IEEE802.11協議中PCF/DCF技術，在無線局域網（WLAN）中，介紹了GPF的系統結構和數據幀格式等。分別對基于IEEE802.11b媒體接入控制（MAC）協議、基于IEEE802.11e媒體接入控制（MAC）協議以及基于業務劃分Qos的GPF仿真的時間參數和接入原則等進行了說明。在PWLAN的3種測試環境下，對802.11b、802.11e、GPF協議的整體性能進行了仿真，并對其結果進行了分析。
上傳時間： 2013-11-15
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為了使更多的計算機網絡工作者了解和接受IPv6， 本文以兩種不同的網絡協議FTP協議和HTTP協議為例，以實驗的方式研究了它們分別在IPv6和IPv4環境下對不同大小的文件進行網絡傳輸的性能差異。通過對實驗過程中采集的傳輸速率的計算和對比研究，發現IPv6在FTP協議和HTTP協議上文件傳輸速率比IPv4快，得出了整體而言IPv6的傳輸性能優于IPv4的結論。
上傳時間： 2013-11-12
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衛星導航接收機接收到的衛星信號十分微弱，同時面臨著復雜電磁環境的干擾，因而抗干擾問題成為研究的熱點。目前有很多種抗干擾技術及算法僅局限于理論研究和數字仿真，無法在實際干擾環境下測試抗干擾接收機的抗干擾性能。本文在研究波束形成天線抗干擾算法的基礎上，基于微波暗室環境下建立抗干擾接收機的半物理仿真環境，實現衛星信號多天線輸出、復雜干擾環境的模擬，對四波束、八波束天線抗干擾接收機進行了仿真測試，結果表明波束形成天線抗干擾接收機在輸入干信比相同的情況下，波束數目越多抗干擾接收機性能越好。
上傳時間： 2013-10-20
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在擴頻通信中，Rake接收是抵抗多徑衰落的有效方法。本文首先介紹無線移動通信的信道特性，然后對Rake接收的基本原理和接收機結構進行詳細描述，并對Rake接收性能進行了仿真比較。仿真結果表明，在多徑信道條件下，Rake接收方式能很好的改善接收系統誤碼性能；采用GOLD序列擴頻比m序列擴頻方式時，Rake接收方法性能提高的更明顯。
上傳時間： 2013-11-16
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