軌道電路是列車運(yùn)行實(shí)現(xiàn)自動(dòng)控制和遠(yuǎn)程控制的基礎(chǔ)設(shè)備之一，鐵路信號(hào)系統(tǒng)是保證運(yùn)輸安全的基礎(chǔ)設(shè)施，是實(shí)現(xiàn)鐵路統(tǒng)一指揮調(diào)度，保證列車運(yùn)行安全、提高運(yùn)輸效率和質(zhì)量的關(guān)鍵技術(shù)設(shè)備，也是鐵路信息化的重要技術(shù)領(lǐng)域。 基于ARM與DSP的鐵路信號(hào)測(cè)試儀主要作用是及時(shí)測(cè)試鐵路信號(hào)狀況，反映鐵路運(yùn)行的情況。開發(fā)此套系統(tǒng)是集測(cè)試25Hz相敏軌道電路的電壓自動(dòng)記錄儀以及相位差監(jiān)測(cè)儀、ZPW-2000A的載頻與低頻測(cè)試功能于一體，是性價(jià)比較高、功能齊全的監(jiān)測(cè)管理系統(tǒng)，它發(fā)揮了ARM控制性好與DSP計(jì)算速度快的優(yōu)勢(shì)，實(shí)現(xiàn)了互補(bǔ)。由于采用的主要是集成芯片，所以體積小，重量輕，功耗低和便于攜帶，便于現(xiàn)場(chǎng)檢測(cè)。在滿足要求的前提下，為降低開發(fā)成本提高可靠性，CPU采用LPC2210的ARM7芯片。為使測(cè)試儀直觀、操作簡(jiǎn)便，系統(tǒng)提供了良好的人機(jī)界面，包括顯示，按鍵操作等。 論文對(duì)FFT以及相關(guān)算法進(jìn)行了分析和Matlab仿真；論文中給出了時(shí)鐘電路、LCD電路、數(shù)據(jù)存儲(chǔ)器Flash、JTAG等各功能模塊的設(shè)計(jì)原理，完成了硬件電路設(shè)計(jì)；系統(tǒng)軟件設(shè)計(jì)遵循模塊化、自頂向下的設(shè)計(jì)思路。在軟件設(shè)計(jì)方面，首先采用的是傳統(tǒng)主循環(huán)控制方法，功能上主要實(shí)現(xiàn)了A/D采樣程序、LCD顯示程序、數(shù)據(jù)存儲(chǔ)程序等的設(shè)計(jì)，對(duì)兩路25Hz信號(hào)電壓相位差的計(jì)算，其誤差不人于1度。為了改善系統(tǒng)性能提高系統(tǒng)的實(shí)時(shí)性，系統(tǒng)中引入實(shí)時(shí)操作系統(tǒng)μC/OS-Ⅱ，也有利于代碼移植及系統(tǒng)功能擴(kuò)展。
標(biāo)簽： ARM DSP 鐵路信號(hào) 試儀設(shè)計(jì)
上傳時(shí)間： 2013-04-24
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SST25VF016B_SOFT.C 讀寫操作
上傳時(shí)間： 2013-05-30
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隨著電力電子技術(shù)的廣泛應(yīng)用，電能污染日益嚴(yán)重，電能質(zhì)量已成為電力部門及用戶日益關(guān)注的問(wèn)題。電能質(zhì)量的好壞直接關(guān)系國(guó)民經(jīng)濟(jì)的總體效益，對(duì)電能質(zhì)量進(jìn)行監(jiān)測(cè)與分析從而提高和改善電能質(zhì)量具有重要的現(xiàn)實(shí)意義。 本文根據(jù)IEC和國(guó)家標(biāo)準(zhǔn)，并且經(jīng)過(guò)對(duì)國(guó)內(nèi)外電能質(zhì)量研究現(xiàn)狀及同類產(chǎn)品進(jìn)行認(rèn)真分析的基礎(chǔ)上，主要針對(duì)我國(guó)電力行業(yè)面臨的現(xiàn)狀提出了一套基于DSP和ARM的電能質(zhì)量監(jiān)測(cè)系統(tǒng)。 論文首先介紹電能質(zhì)量的相關(guān)概念、電能質(zhì)量的研究背景、國(guó)內(nèi)外電能質(zhì)量和電能質(zhì)量監(jiān)測(cè)裝置的研究現(xiàn)狀，以及各項(xiàng)電能指標(biāo)的監(jiān)測(cè)標(biāo)準(zhǔn)。接下來(lái)介紹了本套電能質(zhì)量監(jiān)測(cè)裝置的設(shè)計(jì)方案，說(shuō)明與以往方案相比所具有的優(yōu)點(diǎn)。之后是系統(tǒng)的軟件設(shè)計(jì)與開發(fā)調(diào)試過(guò)程，主要是ARM軟件的設(shè)計(jì)過(guò)程，包括了工程與任務(wù)的創(chuàng)建、μC/OS-II 操作系統(tǒng)的移植和各功能模塊的設(shè)計(jì)等。最后是全文的工作總結(jié)與展望。 本文所研制的電能質(zhì)量監(jiān)測(cè)裝置滿足了合作企業(yè)的設(shè)計(jì)要求，相對(duì)以往的設(shè)計(jì)，具有實(shí)時(shí)性好，性能高，體積小，成本低等優(yōu)點(diǎn)，符合電能質(zhì)量監(jiān)測(cè)的最新發(fā)展要求。
標(biāo)簽： DSP ARM 電能質(zhì)量 監(jiān)測(cè)系統(tǒng)
上傳時(shí)間： 2013-07-24
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本書中列舉了大量的例子來(lái)幫助來(lái)掌握單片機(jī)C語(yǔ)言的設(shè)計(jì)與開發(fā)
標(biāo)簽： 100 單片機(jī) C語(yǔ)言 程序設(shè)計(jì)
上傳時(shí)間： 2013-07-14
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C與指針 經(jīng)典編程書籍 軟件開發(fā)工程師必備
標(biāo)簽： 指針
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高質(zhì)量C++與C編程指南 編程語(yǔ)言經(jīng)典書籍 開發(fā)工程師必備
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嵌入式C與Cpp經(jīng)典書籍PDF版 嵌入式開發(fā)必備！
上傳時(shí)間： 2013-06-30
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水泵效率是反映水泵經(jīng)濟(jì)性能和綜合性技術(shù)指標(biāo)的參數(shù)。隨著我國(guó)節(jié)能減排工作的深入開展，用泵企業(yè)要求準(zhǔn)確、經(jīng)常性地測(cè)試水泵的效率值，掌握設(shè)備的能源利用率和設(shè)備自身狀況，評(píng)估設(shè)備運(yùn)行經(jīng)濟(jì)狀況的合理程度。目前，國(guó)內(nèi)水泵效率檢測(cè)儀器的測(cè)量精度低、實(shí)時(shí)性和可靠性較差，現(xiàn)場(chǎng)可操作性差，人機(jī)界面不夠友好。 本課題是利用ARM嵌入式系統(tǒng)來(lái)實(shí)現(xiàn)水泵效率檢測(cè)儀器的研制，旨在開發(fā)一種操作簡(jiǎn)單、便于攜帶又能滿足指導(dǎo)經(jīng)濟(jì)運(yùn)行精度要求的泵效測(cè)量裝置，將計(jì)算機(jī)技術(shù)、傳感器技術(shù)、數(shù)據(jù)采集處理技術(shù)、嵌入式系統(tǒng)技術(shù)相結(jié)合，實(shí)現(xiàn)水泵效率檢測(cè)的同時(shí)，也實(shí)現(xiàn)了水泵各項(xiàng)主要參數(shù)的測(cè)試、數(shù)據(jù)保存、傳輸及曲線擬合等功能。研究了數(shù)據(jù)采集與處理、曲線擬合、數(shù)據(jù)庫(kù)開發(fā)、通信等實(shí)現(xiàn)中的重點(diǎn)、難點(diǎn)問(wèn)題，并采取了有效的硬件和軟件抗干擾措施，確保了系統(tǒng)的穩(wěn)定性和可靠性。 本文以模塊化和結(jié)構(gòu)化的思想搭建了基于ARM9的硬件平臺(tái)，設(shè)計(jì)了專用模擬電路，研究了嵌入式操作系統(tǒng)WinCE4.2的移植，利用Platform Builder進(jìn)行了操作系統(tǒng)內(nèi)核的定制和編譯，分析了WinCE4.2 Bootloader的工作原理和架構(gòu)，根據(jù)系統(tǒng)的功能需要和硬件資源分配、設(shè)計(jì)了設(shè)備的Bootloader。 應(yīng)用層開發(fā)使用embedded Visual C++4.0開發(fā)工具，集成IDE環(huán)境，快速的開發(fā)Windows CE應(yīng)用程序。主要內(nèi)容包括：開發(fā)友好的人機(jī)界面、實(shí)現(xiàn)儀器的基本功能、顯示水泵機(jī)組的性能參數(shù)、繪制水泵性能曲線并顯示和構(gòu)建水泵性能數(shù)據(jù)庫(kù)、實(shí)現(xiàn)通信。 在樣機(jī)試制完成后，對(duì)多臺(tái)水泵進(jìn)行了試驗(yàn)，試驗(yàn)結(jié)果證明本檢測(cè)儀器具有穩(wěn)定可靠、測(cè)試精度和自動(dòng)化程度高、管理維護(hù)方便的特點(diǎn)，具有較好的技術(shù)經(jīng)濟(jì)性能。
標(biāo)簽： ARM 嵌入式系統(tǒng) 儀的研制 水泵
上傳時(shí)間： 2013-06-02
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C++ 入門基礎(chǔ)教程:C++buider入門基礎(chǔ)
標(biāo)簽： 基礎(chǔ)教程
上傳時(shí)間： 2013-07-27
上傳用戶：sun_pro12580
這篇論文在系統(tǒng)分析國(guó)內(nèi)外雷達(dá)伺服控制系統(tǒng)研究現(xiàn)狀的基礎(chǔ)上，選定以ARM為內(nèi)核的基于ARM+FPGA的雷達(dá)伺服控制器為研究對(duì)象。 首先，根據(jù)雷達(dá)伺服控制系統(tǒng)功能要求與性能指標(biāo)，進(jìn)行系統(tǒng)的硬件設(shè)計(jì)：選擇基于ARM920T的S3C2410和Altera公司的FPGA芯片EP1C12Q240作為主控芯片，ARM與FPGA的連接形式采用中斷+存儲(chǔ)器的形式；將ARM與FPGA上多余的引腳引出作為將來(lái)升級(jí)的需要；還畫出ARM+FPGA的雷達(dá)伺服控制器的系統(tǒng)圖并制作了PCB板。 其次，選用PID對(duì)伺服系統(tǒng)進(jìn)行控制，模糊神經(jīng)網(wǎng)絡(luò)綜合了模糊控制和神經(jīng)網(wǎng)絡(luò)的優(yōu)點(diǎn)，并利用模糊神經(jīng)網(wǎng)絡(luò)算法對(duì)PID參數(shù)進(jìn)行在線調(diào)整。用Matlab7.1進(jìn)行仿真，其結(jié)果表明：該控制算法對(duì)系統(tǒng)具有良好的控制效果，性能較常規(guī)PID得到較大改善。 最后，根據(jù)FPGA在伺服系統(tǒng)主要任務(wù)，用VHDL語(yǔ)言和原理圖在FPGA芯片中分別編制實(shí)現(xiàn)DAC0832接口控制功能、光電編碼器與脈沖發(fā)生電路的程序代碼；并在Quartus II6.0環(huán)境下通過(guò)仿真，且得到仿真的波形符合系統(tǒng)功能要求。采用C語(yǔ)言編寫在ARM中實(shí)現(xiàn)模糊神經(jīng)網(wǎng)絡(luò)PID控制算法的代碼，通過(guò)CodeWarrior for ARM的編譯無(wú)誤后，生成可執(zhí)行文件.axf,，調(diào)用AXD進(jìn)行在線仿真調(diào)試。仿真結(jié)果表明：模糊神經(jīng)網(wǎng)絡(luò)PID算法對(duì)伺服系統(tǒng)能夠進(jìn)行有效控制。 結(jié)果表明：ARM作為伺服控制器的內(nèi)核，其性價(jià)比與集成度高：用FPGA芯片實(shí)現(xiàn)接口電路使伺服控制器的可靠性高、速度快、可配置及連接方式靈活。因此采用基于ARM+FPGA的雷達(dá)伺服控制器，提高了系統(tǒng)的開放性、實(shí)時(shí)性、可靠性，降低了系統(tǒng)功耗，具有重要的應(yīng)用價(jià)值。
標(biāo)簽： ARMFPGA 雷達(dá) 伺服 制器設(shè)計(jì)
上傳時(shí)間： 2013-06-30
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