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截止頻率

  • 基于FPGA的頻率域MPEG2碼率轉(zhuǎn)換

    近年來,隨著網(wǎng)絡(luò)技術(shù)的發(fā)展和視頻編碼標(biāo)準(zhǔn)受到廣泛接受,視頻點播、視頻流和遠(yuǎn)程教育等基于網(wǎng)絡(luò)的多媒體業(yè)務(wù)逐漸普及。為了對擁有不同終端資源,不同接入網(wǎng)絡(luò)以及不同興趣的用戶提供靈活的多媒體數(shù)據(jù)訪問服務(wù),多媒體數(shù)據(jù)的內(nèi)容需要根據(jù)應(yīng)用環(huán)境動態(tài)調(diào)整,轉(zhuǎn)碼正是實現(xiàn)這一挑戰(zhàn)性任務(wù)的關(guān)鍵技術(shù)之一。 視頻轉(zhuǎn)碼對時間的要求非常苛刻,以至于用高速的通用微處理器芯片也無法在規(guī)定的時間內(nèi)完成必要的運算。因此,必須為這樣的運算設(shè)計一個專用的高速硬線邏輯電路,在高速FPGA器件上實現(xiàn)或制成高速專用集成電路。用高密度的FPGA來構(gòu)成完成轉(zhuǎn)碼算法所需的電路系統(tǒng),實現(xiàn)專用集成電路的功能,因其成本低、設(shè)計周期短、功耗小、可靠性高、使用靈活等優(yōu)點而成為適合本課題的最佳選擇。 本文根據(jù)MPEG-2中可變長編碼(VLC)理論,采用了兩級查找表減少了VLC存儲空間的使用,完成VLC編碼的實現(xiàn)。根據(jù)MPEG-2中關(guān)于System Packet的定義,針對FPGA可實現(xiàn)性,以空間換取復(fù)雜度的減少,實現(xiàn)了PES包的打包模塊。根據(jù)MPEG-2相應(yīng)的轉(zhuǎn)碼理論,完成了對系統(tǒng)解碼模塊相應(yīng)的連接和調(diào)試,對解碼模塊以真實的bit流進(jìn)行了貼近板級的情況的仿真。根據(jù)MPEG-2中TM5的算法的局限性,分析得出只需要對P幀進(jìn)行相應(yīng)處理即可改進(jìn)場景變換對視頻質(zhì)量的影響,完成對TM5的算法的改進(jìn)。通過性能估算和電路仿真,各模塊的吞吐率能夠滿足轉(zhuǎn)碼系統(tǒng)的要求。

    標(biāo)簽: MPEG2 FPGA 頻率 碼率

    上傳時間: 2013-07-22

    上傳用戶:shinesyh

  • 基于FPGA的誤碼率測試儀設(shè)計

    基于FPGA的誤碼率測試儀設(shè)計基于FPGA的誤碼率測試儀設(shè)計

    標(biāo)簽: FPGA 誤碼率 試儀設(shè)計

    上傳時間: 2013-08-02

    上傳用戶:1159797854

  • 多抽樣率數(shù)字信號處理及其FPGA實現(xiàn)

    多抽樣率信號處理是現(xiàn)代信號處理理論的一個重要分支,在最近十幾年取得了巨大的發(fā)展,并在很多方面得到了成功的應(yīng)用。本文分別從時域和頻域的角度深入分析了抽樣率變換的規(guī)律,并進(jìn)一步研究了多抽樣率系統(tǒng)的高效實現(xiàn)理論...

    標(biāo)簽: FPGA 抽樣 數(shù)字信號處理

    上傳時間: 2013-07-05

    上傳用戶:JIUSHICHEN

  • 多抽樣率數(shù)字信號處理及其FPGA實現(xiàn)

    多抽樣率信號處理是現(xiàn)代信號處理理論的一個重要分支,在最近十幾年取得了巨大的發(fā)展,并在很多方面得到了成功的應(yīng)用。本文分別從時域和頻域的角度深入分析了抽樣率變換的規(guī)律,并進(jìn)一步研究了多抽樣率系統(tǒng)的高效實現(xiàn)理論和方案。多抽樣率系統(tǒng)需要通過濾波器來改善其性能。本文分析了一般濾波器設(shè)計的方法與理論,著重研究了積分梳狀濾波器和半帶濾波器這兩種多抽樣率濾波器,并根據(jù)多抽樣率信號處理的特點以及幾種高效濾波結(jié)構(gòu)和濾波器,利用積分梳狀濾波器和半帶濾波器在FPGA上設(shè)計了2~256倍可編程抽取器。為了進(jìn)一步分析多相結(jié)構(gòu)在多抽樣率信號處理中的應(yīng)用,使用多相結(jié)構(gòu)設(shè)計了具有固定倍數(shù)的內(nèi)插器。在論文的最后,詳細(xì)介紹了某型號雷達(dá)信號處理機(jī)的硬件設(shè)計及其FPGA設(shè)計。關(guān)鍵字:多抽樣率信號處理 抽取 內(nèi)插 多相濾波 積分梳狀濾波器 半帶濾波器

    標(biāo)簽: FPGA 抽樣 數(shù)字信號處理

    上傳時間: 2013-06-12

    上傳用戶:fxf126@126.com

  • 用VHDL語言設(shè)計基于FPGA器件的高采樣率FIR濾波器

    用VHDL語言設(shè)計基于FPGA器件的高采樣率FIR濾波器,基于VHDL與CPLD器件的FIR數(shù)字濾波器的設(shè)計

    標(biāo)簽: VHDL FPGA FIR 語言

    上傳時間: 2013-08-07

    上傳用戶:ukuk

  • 室內(nèi)線陣CCD交匯測量捕獲率分析

    針對室內(nèi)CCD交匯測量的試驗環(huán)境,通過添加輔助光源照明,在基于CCD立靶測量原理的條件下,分析了室內(nèi)立靶影響捕獲率的原因,并建立了室內(nèi)立靶的捕獲率模型。該模型能夠為室內(nèi)立靶測量系統(tǒng)的捕獲率計算和研究提供依據(jù)。同時,對立靶捕獲率進(jìn)行了仿真分析,仿真結(jié)果表明,該系統(tǒng)的捕獲率能夠達(dá)到90%。

    標(biāo)簽: CCD 線陣 測量

    上傳時間: 2013-10-17

    上傳用戶:13160677563

  • 多路輸出開關(guān)電源交叉調(diào)整率

    多路輸出開關(guān)電源交叉調(diào)整率

    標(biāo)簽: 多路輸出 交叉調(diào)整率 開關(guān)電源

    上傳時間: 2013-10-31

    上傳用戶:15070202241

  • 單片機(jī)系統(tǒng)中的率表算法

    單片機(jī)系統(tǒng)中的率表算法:近年來,國內(nèi)許多單位用MOTOROLA 68HC05C8A,68HC05C9A,68HC05L5,68HC05L16等單片機(jī)開發(fā)復(fù)費率表電表。電力部門也在為開發(fā)中的復(fù)費率電表制定一些規(guī)范。復(fù)費率電表中有一項功能要求,能給出所謂最大需置。

    標(biāo)簽: 單片機(jī)系統(tǒng) 算法

    上傳時間: 2013-11-06

    上傳用戶:jackgao

  • PCB可測性設(shè)計布線規(guī)則之建議―從源頭改善可測率

    P C B 可測性設(shè)計布線規(guī)則之建議― ― 從源頭改善可測率PCB 設(shè)計除需考慮功能性與安全性等要求外,亦需考慮可生產(chǎn)與可測試。這里提供可測性設(shè)計建議供設(shè)計布線工程師參考。1. 每一個銅箔電路支點,至少需要一個可測試點。如無對應(yīng)的測試點,將可導(dǎo)致與之相關(guān)的開短路不可檢出,并且與之相連的零件會因無測試點而不可測。2. 雙面治具會增加制作成本,且上針板的測試針定位準(zhǔn)確度差。所以Layout 時應(yīng)通過Via Hole 盡可能將測試點放置于同一面。這樣就只要做單面治具即可。3. 測試選點優(yōu)先級:A.測墊(Test Pad) B.通孔(Through Hole) C.零件腳(Component Lead) D.貫穿孔(Via Hole)(未Mask)。而對于零件腳,應(yīng)以AI 零件腳及其它較細(xì)較短腳為優(yōu)先,較粗或較長的引腳接觸性誤判多。4. PCB 厚度至少要62mil(1.35mm),厚度少于此值之PCB 容易板彎變形,影響測點精準(zhǔn)度,制作治具需特殊處理。5. 避免將測點置于SMT 之PAD 上,因SMT 零件會偏移,故不可靠,且易傷及零件。6. 避免使用過長零件腳(>170mil(4.3mm))或過大的孔(直徑>1.5mm)為測點。7. 對于電池(Battery)最好預(yù)留Jumper,在ICT 測試時能有效隔離電池的影響。8. 定位孔要求:(a) 定位孔(Tooling Hole)直徑最好為125mil(3.175mm)及其以上。(b) 每一片PCB 須有2 個定位孔和一個防呆孔(也可說成定位孔,用以預(yù)防將PCB反放而導(dǎo)致機(jī)器壓破板),且孔內(nèi)不能沾錫。(c) 選擇以對角線,距離最遠(yuǎn)之2 孔為定位孔。(d) 各定位孔(含防呆孔)不應(yīng)設(shè)計成中心對稱,即PCB 旋轉(zhuǎn)180 度角后仍能放入PCB,這樣,作業(yè)員易于反放而致機(jī)器壓破板)9. 測試點要求:(e) 兩測點或測點與預(yù)鉆孔之中心距不得小于50mil(1.27mm),否則有一測點無法植針。以大于100mil(2.54mm)為佳,其次是75mil(1.905mm)。(f) 測點應(yīng)離其附近零件(位于同一面者)至少100mil,如為高于3mm 零件,則應(yīng)至少間距120mil,方便治具制作。(g) 測點應(yīng)平均分布于PCB 表面,避免局部密度過高,影響治具測試時測試針壓力平衡。(h) 測點直徑最好能不小于35mil(0.9mm),如在上針板,則最好不小于40mil(1.00mm),圓形、正方形均可。小于0.030”(30mil)之測點需額外加工,以導(dǎo)正目標(biāo)。(i) 測點的Pad 及Via 不應(yīng)有防焊漆(Solder Mask)。(j) 測點應(yīng)離板邊或折邊至少100mil。(k) 錫點被實踐證實是最好的測試探針接觸點。因為錫的氧化物較輕且容易刺穿。以錫點作測試點,因接觸不良導(dǎo)致誤判的機(jī)會極少且可延長探針使用壽命。錫點尤其以PCB 光板制作時的噴錫點最佳。PCB 裸銅測點,高溫后已氧化,且其硬度高,所以探針接觸電阻變化而致測試誤判率很高。如果裸銅測點在SMT 時加上錫膏再經(jīng)回流焊固化為錫點,雖可大幅改善,但因助焊劑或吃錫不完全的緣故,仍會出現(xiàn)較多的接觸誤判。

    標(biāo)簽: PCB 可測性設(shè)計 布線規(guī)則

    上傳時間: 2014-01-14

    上傳用戶:cylnpy

  • 基于FPGA實現(xiàn)固定倍率的圖像縮放

    基于FPGA硬件實現(xiàn)固定倍率的圖像縮放,將2維卷積運算分解成2次1維卷積運算,對輸入原始圖像像素先進(jìn)行行方向的卷積,再進(jìn)行列方向的卷積,從而得到輸出圖像像素。把圖像縮放過程設(shè)計為一個單元體的循環(huán)過程,在單元體內(nèi)部,事先計算出卷積系數(shù)。

    標(biāo)簽: FPGA 倍率 圖像

    上傳時間: 2013-12-03

    上傳用戶:fudong911

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