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  • FPGA芯片關鍵電路設計.rar

    現場可編程門陣列(FPGA)器件是能通過對其進行編程實現具有用戶規定功能的電路,特別適合集成電路的新品開發和小批量ASIC電路的生產。近幾年來,FPGA的發展非常迅速,但目前國內廠商所使用的FPGA芯片主要還是從國外進口,這種狀況除了給生產廠家帶來很大的成本壓力以外,同時也影響到國家信息產業的保密和安全問題,因此在國內自主研發FPGA便成為一種必然的趨勢。 基于上述現實狀況及國內市場的巨大需求,中國電子科技集團公司第58研究所近年來對FPGA進行了專項研究,本論文正是作為58所專項的一部分研究工作的總結。本文深入研究了FPGA的相關設計技術,并進行了實際的FPGA器件設計,研究工作的重點是在華潤上華(CSMC)0.5μm標準CMOS工藝基礎上進行具有6000有效門的FPGA的電路設計與仿真。 論文首先闡述了可編程邏輯器件的基本結構,就可編程邏輯器件的發展過程及其器件分類,對可編程只讀存儲器、現場可編程邏輯陣列、可編程陣列邏輯、通用邏輯陣列和復雜PLD等的基本結構特點進行了討論。接著討論了FPGA的基本結構與分類及它的編程技術,另外還闡述了FPGA的集成度和速率等相關問題。并根據實際指標要求確定本文研究目標FPGA的基本結構和它的編程技術,在華潤上華0.5μm標準CMOS工藝的基礎上,進行一款FPGA芯片的設計研究工作。進行了可編程邏輯單元的基本結構的設計,并用CMOS邏輯和NMOS傳輸管邏輯實現了函數發生器、快速進位鏈和觸發器的電路設計,并對其進行了仿真,達到了預期的目標。

    標簽: FPGA 芯片 電路設計

    上傳時間: 2013-08-01

    上傳用戶:baitouyu

  • 基于FPGA與DDR2-SDRAM的高速實時數據采集系統的設計與實現.rar

    數據采集處理技術是現代信號處理的基礎,廣泛應用于雷達、聲納、軟件無線電、瞬態信號測試等領域。隨著信息科學的飛速發展,人們面臨的信號處理任務越來越繁重,對數據采集處理系統的要求也越來越高。近年來FPGA由于其設計靈活性、更強的適應性及可重構性,結合SDRAM的高速、大容量、價格優勢,在設計高速實時數據采集系統時受到了廣泛的關注。 本課題重點研究了基于FPGA與DDR2-SDRAM的高速實時數據采集系統的設計與實現技術,為需要大容量存儲器的系統設計提供了新的思路。在深入研究了DDR2-SDRAM器件的基本構造與工作原理的基礎上,結合成熟的商業化IP核,提出了基于FPGA與DDR2-SDRAM的高速實時數據采集系統的設計方案,并從總體設計構想到各邏輯細節實現都進行了詳細描述。根據DDR2-SDRAM的特點,選擇合適的內存調度方案,采用Verilog HDL語言設計實現了該高速實時數據采集系統,并對系統功能進行驗證與分析,結果表明本設計完全能夠滿足系統的性能指標

    標簽: SDRAM FPGA DDR

    上傳時間: 2013-06-24

    上傳用戶:wangrong

  • 基于FPGA的π4DQPSK全數字中頻發射機和接收機的實現.rar

    本文以電子不停車收費系統課題為背景,設計并實現了基于FPGA的π/4-DOPSK全數字中頻發射機和接收機。π/4-DQPSK廣泛應用于移動通信和衛星通信中,具有頻帶利用率高、頻譜特性好、抗衰落性能強的特點。 近年來現場可編程門陣列(FPGA)器件在芯片邏輯規模和處理速度等方面性能的迅速提高,用硬件編程實現無線功能的軟件無線電技術在理論和實用化上都趨于成熟和完善,因此可以把數字調制,數字上/下變頻,數字解調在同一塊FPGA上實現,即實現了中頻發射機和接收機一體化的片上可編程系統(SOPC,System On Programmabie Chip)。 本文首先根據指標要求對數字收發機方案進行設計,確定了適合不停車收費系統的全數字發射機和接收機的結構,接著根據π/4-DQPSK發射機和接收機的理論,設計并實現了基于FPGA的成形濾波器SRRC、半帶濾波器HB和定時算法并給出性能分析,最后給出硬件測試平臺上結果和測試結果分析。

    標簽: 4DQPSK FPGA 全數字

    上傳時間: 2013-06-23

    上傳用戶:chuckbassboy

  • 基于FPGA的TS流復用器及其接口的設計與實現.rar

    在數字電視系統中,MPEG-2編碼復用器是系統傳輸的核心環節,所有的節目、數據以及各種增值服務都是通過復用打包成傳輸流傳輸出去。目前,只有少數公司掌握復用器的核心算法技術,能夠采用MPEG-2可變碼率統計復用方法提高帶寬利用率,保證高質量圖像傳輸。由于目前正處廣播電視全面向數字化過渡期間,市場潛力巨大,因此對復用器的研究開發非常重要。本文針對復用器及其接口技術進行研究并設計出成形產品。 文中首先對MPEG-2標準及NIOS Ⅱ軟核進行分析。重點研究了復用器中的部分關鍵技術:PSI信息提取及重構算法、PID映射方法、PCR校正及CRC校驗算法,給出了實現方法,并通過了硬件驗證。然后對復用器中主要用到的AsI接口和DS3接口進行了分析與研究,給出了設計方法,并通過了硬件驗證。 本文的主要工作如下: ●首先對復用器整體功能進行詳細分析,并劃分軟硬件各自需要完成的功能。給出復用器的整體方案以及ASI接口和DS3接口設計方案。 ●在FPGA上采用c語言實現了PSI信息提取與重構算法。 ●給出了實現快速的PID映射方法,并根據FPGA特點給出一種新的PID映射方法,減少了邏輯資源的使用,提高了穩定性。 ●采用Verilog設計了SI信息提取與重構的硬件平臺,并用c語言實現了SDT表的提取與重構算法,在FPGA中成功實現了動態分配內存空間。 ●在FPGA上實現了.ASI接口,主要分析了位同步的實現過程,實現了一種新的快速實現字節同步的設計。 ●在FPGA上實現了DS3接口,提出并實現了一種兼容式DS3接口設計。并對幀同步設計進行改進。 ●完成部分PCB版圖設計,并進行調試監測。 本復用器設計最大特點是將軟件設計和硬件設計進行合理劃分,硬件平臺及接口采用Verilog語言實現,PSI信息算法主要采用c語言實現。這種軟硬件的劃分使系統設計更加靈活,且軟件設計與硬件設計可同時進行,極大的提高了工作效率。 整個項目設計采用verilog和c兩種語言完成,采用Altera公司的FPGA芯片EP1C20,在Quartus和NIOS IDE兩種設計平臺下設計實現。根據此方案已經開發出兩臺帶有ASI和DS3接口的數字電視TS流復用器,經測試達到了預期的性能和技術指標

    標簽: FPGA TS流 復用器

    上傳時間: 2013-08-03

    上傳用戶:gdgzhym

  • 基于FPGA的海事衛星突發信號位同步檢測研究及實現.rar

    碼元定時恢復(位同步)技術是數字通信中的關鍵技術。位同步信號本身的抖動、錯位會直接降低通信設備的抗干擾性能,使誤碼率上升,甚至會使傳輸遭到完全破壞。尤其對于突發傳輸系統,快速、精確的定時同步算法是近年來研究的一個焦點。本文就是以Inmarsat GES/AES數據接收系統為背景,研究了突發通信傳輸模式下的全數字接收機中位同步方法,并予以實現。 本文系統地論述了位同步原理,在此基礎上著重研究了位同步的系統結構、碼元定時恢復算法以及衡量系統性能的各項指標,為后續工作奠定了基礎。 首先根據衛星系統突發信道傳輸的特點分析了傳統位同步方法在突發系統中的不足,接下來對Inmarsat系統的短突發R信道和長突發T信道的調制方式和幀結構做了細致的分析,并在Agilent ADS中進行了仿真。 在此基礎上提出了一種充分利用報頭前導比特信息的,由滑動平均、閾值判斷和累加求極值組成的快速報頭時鐘捕獲方法,此方法可快速精準地完成短突發形式下的位同步,并在FPGA上予以實現,效果良好。 在長突發形式下的報頭時鐘捕獲后還需要對后續數據進行位同步跟蹤,在跟蹤過程中本論文首先用DSP Builder實現了插值環路的位同步算法,進行了Matlab仿真和FPGA實現。并在插值環路的基礎上做出改進,提出了一種新的高效的基于移位算法的位同步方案并予以FPGA實現。最后將移位算法與插值算法進行了性能比較,證明該算法更適合于本項目中Inmarsat的長突發信道位同步跟蹤。 論文對兩個突發信道的位同步系統進行了理論研究、算法設計以及硬件實現的全過程,滿足系統要求。

    標簽: FPGA 海事衛星 信號

    上傳時間: 2013-04-24

    上傳用戶:yare

  • FPGA低功耗布局布線算法的研究與改進.rar

    本文對嵌入硬核的FPGA布線通道寬度分布和改進FPGA布局算法進行了研究。文章在嵌入硬核的FPGA布線通道寬度分布研究中,引入了四種架構,其布線通道寬度分布函數分別為均勻、脈沖、高斯和三角分布。通過修改VPR工具的源代碼,使平臺適用于具有嵌入硬核的FPGA架構,利用MCNC基準電路來測試這四種架構的性能。實驗結果表明:在以網線平均長度作為指標的測試中,通道寬度均勻分布的架構具有更短的布線長度、更優的性能。

    標簽: FPGA 低功耗 布局布線

    上傳時間: 2013-06-01

    上傳用戶:JGR2013

  • 基于FPGA的SDRAM控制器設計及應用.rar

    在國家重大科學工程HIRFL-CSR的CSR控制系統中,需要高速數據獲取和處理系統。該系統通常采用存儲器作為數據緩沖存儲。同步動態隨機存儲器SDRAM憑借其集成度高、功耗低、可靠性高、處理能力強等優勢成為最佳選擇。但是SDRAM卻具有復雜的時序,為了降低成本,所以采用目前很為流行的EDA技術,選擇可編程邏輯器件中廣泛使用的現場可編程門陣列FPGA,使用硬件描述語言VHDL,遵循先進的自頂向下的設計思想實現對SDRAM控制器的設計。 論文引言部分簡單介紹了CSR控制系統,指出論文的課題來源與實際意義。第二章首先介紹了存儲器的概況與性能指標,其次較為詳細介紹了動態存儲器DRAM的基本時序,最后對同步動態隨機存儲器SDRAM進行詳盡論述,包括性能、特點、結構以及最為重要的一些操作和時序。第三、四章分別論述本課題的SDRAM控制器硬件與軟件設計,重點介紹了具體芯片與FPGA設計技術。第五章為該SDRAM控制器在CsR控制系統中的一個經典應用,即同步事例處理器。最后對FPGA技術進行總結與展望。 本論文完整論述了控制器的設計原理和具體實現。從測試的結果來看,本控制器無論從結構上,還是軟硬件上設計均滿足了工程實際要求。

    標簽: SDRAM FPGA 制器設計

    上傳時間: 2013-07-19

    上傳用戶:dct灬fdc

  • 基于FPGA的直擴調制解調器的設計與實現.rar

    擴頻通信系統與常規的通信系統相比,具有很強的抗窄帶干擾,抗多徑干擾,抗人為干擾的能力,并具有信息隱蔽、多址保密通信等優點。在近年來得到了迅速的發展。本論文主要討論和實現了基于FPGA的直接序列擴頻信號的解擴解調處理。論文對該直擴通信系統和FPGA設計方法進行了相關研究,最后用Altera公司的最新的FPGA開發平臺Quarus Ⅱ5.0實現了相關設計。 整個系統分為兩個部分,發送部分和接收部分。發送部分主要有串并轉換、差分卷積編碼、PN碼擴頻、QPSK調制、成型濾波等模塊。接收部分主要有前端抗干擾、數字下變頻、解擴解調等模塊。 論文首先介紹了擴頻通信系統的特點以及相關技術的國內外發展現狀,并介紹了本論文的研究思路和內容。 然后,論文分析了幾種常用的窄帶干擾抑制、載波同步及PN碼同步算法,結合實際需要,設計了一種零中頻DSSS解調解擴方案。給出了抗窄帶干擾、PN碼捕獲及跟蹤以及載波同步的算法分析,采用了基于數字外差調制的自適應陷波器來進行前端窄帶干擾抑制處理,用基于自適應門限技術的滑動相關捕獲和分時復用單相關器跟蹤來改善PN碼同步的性能,用基于硬判決的COSTAS(科斯塔斯)環來減少載波提取的算法復雜度,用改進型CORDIC算法實現NCO來方便的進行擴展。 接著,論文給出了系統總體設計和發送及接受子系統的各個功能模塊的實現分析以及在Quartus Ⅱ5.0上的實現細節,給出了仿真結果。 然后論文介紹了整個系統的硬件電路設計和它在真實系統中連機調試所得到的測試結果,結果表明該系統具有性能穩定,靈活性好,生產調試容易,體積小,便于升級等特點并且達到課題各項指標的要求。 最后是對論文工作的一些總結和對今后工作的展望。

    標簽: FPGA 調制解調器

    上傳時間: 2013-05-23

    上傳用戶:磊子226

  • 軟件無線電中FIR濾波器的Matlab設計及FPGA實現.rar

    軟件無線電作為一種新的無線通信概念和體制,近年來隨著3G標準的提出,日益受到國內外相關通信廠商的重視。尤其是基于軟件無線電和智能天線技術的TD-SCDMA作為通信史上第一個“中國標準”,有望扭轉多年來我國移動通信制造業的被動局面,是實現信息產業騰飛的一個絕好機會。軟件無線電使得通信體制具有很好的通用性、靈活性和可配置性,并使系統互聯和升級變得容易。本文以軟件無線電中的FIR濾波器為線索,貫穿了信號重構、多抽樣率信號處理、積分梳狀濾波器等理論分析,重點闡釋了FIR濾波器的設計方法及濾波器的FPGA實現等技術問題。 本文首先針對軟件無線電中的多抽樣率信號處理理論進行了討論和分析。討論了軟件無線電中如何實現整數倍抽取、整數倍內插、分數倍抽樣率變換,并分析了網絡結構的等效變換、多相濾波及積分梳狀濾波器的設計理論。 緊接著重點闡述了軟件無線電中FIR濾波器的設計理論,包括窗函數法、頻率抽樣法及等紋波法。分析了各種設計方法所能達到的性能指標及優缺點,并結合工程實例給出了相關的Matlab程序。并對FIR濾波器結構的選擇及系數字長的確定等問題進行了分析。此外,也介紹了在Matlab進行輔助設計時一些常用函數和命令的用法。 本文選用FPGA來實現中頻軟件無線電,FPGA與參數化ASIC、DSP比較有很多優勢,它不但在功耗、體積、成本方面優于參數化ASIC、DSP,而且處理效率高、現場可編程性能良好。不同于DSP的單流處理方式,FPGA是多流并行處理,這種處理方式使FPGA能完成DSP難以實現的許多功能。在簡單介紹了FPGA的一般原理,以及FPGA設計中的關鍵技術和在信號處理中的設計原則以后,重點介紹了FIR濾波器的FPGA實現方法。提出了分布式算法、加法器網絡法以及分段FIFO等實現方法。最后,提出了一種QuartusII與MATLAB聯合仿真的方法。此方法能夠直觀的檢驗濾波器的濾波效果,提高設計效率。并結合工程實例詳盡的介紹了FIR濾波器的設計開發流程。

    標簽: Matlab FPGA FIR

    上傳時間: 2013-04-24

    上傳用戶:gengxiaochao

  • 基于FPGA的PCI接口運動控制卡的研究.rar

    運動控制技術是機電一體化的核心部分,提高運動控制技術水平對于提高我國的機電一體化技術具有至關重要的作用。運動控制技術的發展是制造自動化前進的旋律,是推動新的產業革命的關鍵技術。對于數控系統來說,最重要的是控制各個電機軸的運動,這是運動控制器接收并依照數控裝置的指令來控制各個電機軸運動從而實現數控加工的,數據加工中的定位控制精度、速度調節的性能等重要指標都與運動控制器直接相關。目前對數控系統的研究都集中在插入PC的NC控制器的研究上,而其核心部分就是對步進、伺服電機進行控制的運動控制卡的研究。對PC-NC來說,運動控制卡的性能很大程度上決定了整個數控系統的性能,而微電子和數字信號處理技術的發展及其應用,使運動控制卡的性能得到了不斷改進,集成度和可靠性大大提高。 本課題通過對運動控制技術的深入研究,并針對國內運動控制技術的研究起步較晚的現狀,結合當前運動控制領域的具體需要,緊跟當前運動控制技術研究的發展趨勢,吸收了數控技術和相關運動控制技術的最新成果,提出了基于PCI和FPGA的方案,研制了一款比較新穎的、功能強大的、具有很大柔性的四軸多功能運動控制卡。 本課題的具體研究主要有以下幾方面: 首先,通過對運動控制卡及運動控制系統等行業現狀的全面調研,和對運動控制技術的深入學習,在比較了幾種常用的運動控制方案的基礎上,提出了基于FPGA的運動控制設計方案,并規劃了板卡的總體設計。 其次,根據總體設計,規劃了板卡的結構,詳細劃分并實現了FPGA各部分的功能;利用光電隔離原理設計了數字輸入/輸出電路。 再次,利用FPGA的資源實現了PCI從設備接口,達到跟控制卡通信的目的,針對運動控制中的一些具體問題,如運動平穩性、實時控制以及多軸聯動等,在FPGA上設計了四軸運動控制電路,定義了各個寄存器的具體功能,設計了功能齊全的加/減速控制電路、變頻分配電路、倍頻分頻電路和三個功能各異的計數器電路等,自動降速點運動、A/B相編碼器倍頻計數電路等特殊功能。最后,進行了本運動控制卡的測試,從測試和應用結果來看,該卡達到預期的要求。

    標簽: FPGA PCI 接口

    上傳時間: 2013-07-27

    上傳用戶:zgu489

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