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提升機

  • 基于ARM的嵌入式閃存文件系統與FLASH驅動的研究與實踐

    本文以一個PDA項目為依托,在項目中,主要是開發該設備的軟件。其工作包括:上層應用程序的開發、引導程序的編寫、Linux操作系統的移植和各種外設驅動程序的編寫以及文件系統的改進。 本文首先分析了Linux操作系統的虛擬文件系統、高速緩沖區、MTD以及驅動程序模塊。接著,本文分析了JFFS2文件系統的不足,以及在大容量閃存設備中掛載速度過慢的原因。然后,本文結合JFFS2文件系統在開發過程中所出現的各種問題,以及在大容量閃存芯片上進行掛載時的性能要求,對JFFS2文件系統作了一些實際的改進。文中的創新性貢獻包括以下幾個方面: (1)在掃描一個擦除塊之前,首先把擦除塊中的所有內容讀進內存。然后,在內存中進行所有的判斷操作以及拷貝,這樣就可以減少I/O操作。另外,由于所有的拷貝操作都在內存中進行,所以掛載速度就可以有所提升。 (2)通過加入“空閑區域管理節點”對閃存中的空閑區域進行管理。這樣,在掃描的過程中,一旦發現該節點就可以跳過它所描述的空閑區域,從而加快掛載的速度。 (3)在掃描的階段中對有效數據實體進行硬鏈接數的計算,因此,臨時目錄節點就不需要創建了,這樣也免除了臨時目錄的刪除步驟,所以對掛載速度也有明顯的提高。 最后,基于以上的研究與改進,結合本項目的實際要求,對大容量閃存設備的JFFS2文件系統的掛載過程進行了改進的實踐。

    標簽: FLASH ARM 嵌入式閃存 實踐

    上傳時間: 2013-07-26

    上傳用戶:damozhi

  • 提高LED顯示屏畫質的驅動電路設計方案

    提高LED顯示屏畫質的驅動電路設計方案   ? 利用驅動芯片快速響應來提升LED顯示屏畫質   解決方案:   ? 將同一個時間內輸出電流的脈沖平均打散   ? PCB最好是4層板以上,走線部份越短越好   ? VLED與VCC分開為不同電源   ? VLED及VCC對地端加上一個大的穩壓電容

    標簽: LED 顯示屏 畫質 驅動電路

    上傳時間: 2013-06-07

    上傳用戶:gaoyining

  • 基于ARM的指紋采集系統研究

    隨著信息技術的不斷發展,安全、可靠的身份識別技術成為許多系統首先考慮的問題。指紋具有唯一性和穩定性,因此指紋采集技術是指紋識別技術中的最為重要的一個環節,伴隨著生物識別技術的不斷提高,以及指紋傳感器的性能不斷提升,指紋識別技術的應用越來越廣泛。因此,高質量的采集指紋圖像技術已經成為一個重要的研究課題。 本文的內容是基于ARM的指紋采集系統的設計。按照設計思想,系統主要包括兩個大的模塊:指紋圖像采集模塊、指紋圖像傳輸模塊。在設計工作中,根據系統的實現要求和本專業領域內最新技術的發展狀況,確定了以Samsung公司的ARM7處理器S3C44BOX和ALTERA公司的復雜可邏輯編程器件EPM240為核心的系統組成方案。 本文主要做的工作有:首先介紹了指紋識別技術的基本原理和方法,通過對不同類型指紋傳感器的比較選擇了性價比較高的電容式指紋傳感器。設計了以Samsung ARM和MBF200電容式指紋傳感器為主要組成部分的電容式指紋采集系統。在ADS1.2編譯環境下對ARM進行基于C語言和匯編語言混合編程的初始化程序,指紋采集程序以及數據傳輸程序;采用了USB技術實現系統與計算機之間的通訊,大大提高了指紋圖像數據的傳輸速度;采用CPLD對系統各個芯片之間的信號進行邏輯控制;采用SST公司的閃爍存儲器SST39VF160存放系統啟動程序Boot loader。 本文首先描述了整個系統的總體方案,然后主要從硬件電路設計和軟件編程兩個方面對系統進行了詳細的描述,硬件設計包括芯片的選型、核心芯片接口電路設計以及處理器的外圍電路設計,軟件設計包括系統主程序、指紋采集程序以及指紋數據通訊的流程圖。最后列舉了一些在調試過程中碰到的一些問題以及解決辦法,并為系統進一步優化提出了建議。

    標簽: ARM 指紋采集 系統研究

    上傳時間: 2013-07-23

    上傳用戶:zhf1234

  • 基于ARM和射頻技術的工程機械遙控器的研制

    隨著我國經濟的高速發展,各類建設工程越來越多,這導致了國家對工程機械的需求越來越大,要求也越來越高。在機械和液壓技術已發展成熟的今天,信息化和智能化成了工程機械進行產品性能提升的新的突破口。而無線遙控技術是信息化的一個重要方面。 鑒于工程機械設備對無線遙控設備的需求,本文研制了用于工程機械的無線遙控器。因為工程機械對遙控通信的可靠性、抗干擾性和通信距離都有比較高的要求,所以本文沒有選擇紅外、藍牙等技術作為通信手段,而是選用高性能的射頻芯片ADF7020來搭建射頻模塊。在控制器方面,考慮到通信過程中需要進行非常復雜的編解碼運算,所以本文選用了運算速率較快的32位ARM核微控制器LPC2119。 論文首先在對上述兩塊主芯片進行深入研究的基礎上介紹了它們的功能特點和參數性能,與此同時還介紹了嵌入式系統開發的相關知識。接著基于這兩塊芯片對遙控器的實施方案進行了設計,包括硬件系統和軟件系統兩方面的內容,這構成了論文的主體內容之一。然后論文詳細深入的研究和討論了對遙控器通信性能起關鍵作用的差錯控制系統。研究內容包括循環碼、CRC碼、RS碼和交織技術等一系列的信道編碼理論,并且給出了各種編解碼的實現方法。基于這些理論,論文設計了一種CRC碼、RS碼以及交織技術相結合的差錯控制方法并將其應用在遙控器中,實際測試證明該方法從很大程度上提升了遙控器的通信性能。此外,還實現了遙控器的跳頻功能,可以有效的抵抗同頻干擾。論文的最后簡要介紹了系統開發調試環境以及仿真工具,并總結了軟件實現過程中對一些關鍵問題的處理辦法。

    標簽: ARM 射頻技術 工程機械 遙控器

    上傳時間: 2013-05-18

    上傳用戶:yyyyyyyyyy

  • 基于ARM平臺的GDB遠程調試環境的研究與移植

    嵌入式系統開發工具在開發過程中所起的作用日益突出,相關研究、技術也隨之不斷更新。隨著硬件性能不斷提升,很多智能家電、智能手機、甚至高端游戲機都采用了嵌入式系統作為平臺進行開發。作為嵌入式開發的關鍵,調試環節成為嵌入式系統研發的主要瓶頸。在嵌入式硬件性能不斷提升的同時,嵌入式軟件規模也不斷擴大,因此調試難度也與日俱增。 本文首先簡要說明了嵌入式軟件的開發過程,回顧嵌入式交叉調試技術發展的各種技術。然后分析調試器整個框架和核心,介紹了調試器相關理論和設計思想,并分別研究、對比幾種調試技術實現途徑和方法,并對調試器中關鍵流程進行詳細闡述。 然后,針對GDB所提供i386和SPARC架構下遠程調試環境代碼進行分析,抽象出調試樁GDB進行遠程調試的核心流程,并根據具體硬件平臺差異在ARM處理器上進行代碼和遠程調試協議移植。本文編寫過程中所使用的硬件平臺是由使用ARM7處理器的S3C4510b開發板。進入測試階段,又在S3C4480開發板上進行了測試,對這套模式的可用性進行了驗證。

    標簽: ARM GDB 遠程調試 環境

    上傳時間: 2013-08-04

    上傳用戶:huyiming139

  • LPC總線接口UART控制器FPGA實現

    隨著微電子技術的快速發展,電子設備逐漸向著小型化、集成化方向發展;人們在要求設備性能不斷提升的同時,還要求設備功耗低、體積小、重量輕、可靠性高。同樣在我軍武器裝備的研制過程中,也對各武器裝備都提出了新的要求,特別是針對單兵配備的便攜設備,對體積、功耗、擴展性的要求更是嚴格。 在某手持式設備的開發項目中,需要設計一塊接口板,要求實現高達8個串行口擴展以及能源管理和數字輸入輸出接口等功能,該接口板與處理器模塊的連接總線采用LPC總線,整個手持設備除了對功能有基本的要求以外,對體積及功耗都提出了極高的要求。針對項目的具體設計要求,經過與傳統設計方法的比較,決定采用FPGA來實現LPC接口及UART控制器功能。 論文的主要目標是完成LPC接口的UART控制在FPGA中的實現。對于各模塊中的關鍵的功能部分,文中對其實現都進行了詳細的說明。整個設計全部采用硬件描述語言(HDL)實現,并且采用了分模塊的設計風格,具有很好的重用性。 為了在硬件平臺上驗證設計,還實做了FPGA驗證平臺,并用C語言編寫了測試程序。經過驗證,該方案完全實現了接口板的功能要求,并且滿足體積和功耗上的要求,取得了良好的效果。 論文通過采用FPGA作為電路設計的核心,以一種新的數字電路設計方法實現電路功能;旨在通過這種方式,不斷提高設備的性能并拓展設計者思想。

    標簽: FPGA UART LPC 總線接口

    上傳時間: 2013-05-21

    上傳用戶:poyao

  • 基于DVD應用的RS編譯碼器的研究

    糾錯碼技術是一種通過增加一定冗余信息來提高信息傳輸可靠性的有效方法。RS碼是一種典型的糾錯碼,在線性分組碼中,它具有最強的糾錯能力,既能糾正隨機錯誤,也能糾正突發錯誤,在深空通信、移動通信、磁盤陣列、光存儲及數字視頻廣播(DVB)等系統中具有廣泛的應用。 DVD是一種高容量的存儲媒質。DVD技術的應用很廣泛,在數字技術中占有重要地位。DVD系統中采用里德-所羅門乘積碼(RS-PC:Reed-Solomon ProductCode)進行糾錯,RS碼譯碼器在伺服芯片中具有重要作用。 FPGA在開發階段具有安全、方便、可隨時修改設計等不可替代的優點,在電子系統中采用FPGA可以極大的提升硬件系統設計的靈活性,可靠性,同時提高硬件開發的速度和降低系統的成本。FPGA的固有優點使其得到越來越廣泛的應用,FPGA設計技術也被越來越多的設計人員所掌握。 本文首先介紹了編碼理論和常用的RS編譯碼算法,提出RS編碼器實現方案,詳細分析了譯碼器的ME算法和改進BM算法的實現,針對ME算法提出了一種流水線結構的糾刪糾錯RS譯碼器實現方案,在譯碼器復雜度和延時上作了折衷,降低了譯碼器的復雜度并提高了最高工作頻率,利用有限域乘法器的特性對編譯碼電路進行優化。這些技術的采用大大的提高了RS編譯碼器的效率,節省了RS編譯碼器占用的資源。在Xilinx公司的Virtex-II系列FPGA上設計并成功實現了RS(208,192)編譯碼器。

    標簽: DVD RS編譯碼

    上傳時間: 2013-07-20

    上傳用戶:xinshou123456

  • 基于FPGA的靜止圖像編碼器

    遙感圖像在人類生活和軍事領域的應用日益廣泛,適合各種要求的遙感圖像編碼技術具有重要的現實意義。基于小波變換的內嵌編碼技術已成為當前靜止圖像編碼領域的主流,其中就包括基于分層樹集合分割排序(Set Partitioning inHierarchical Trees,SPIHT)的內嵌編碼算法。這種算法具有碼流可隨機獲取以及良好的恢復圖像質量等特性,因此成為實際應用中首選算法。隨著對圖像編碼技術需求的不斷增長,尤其是在軍事應用領域如衛星偵察等方面,這種編碼算法亟待轉換為可應用的硬件編碼器。 在靜止圖像編碼領域,高性能的圖像編碼器設計一直是相關研究人員不懈追求的目標。本文針對靜止圖像編碼器的設計作了深入研究,并致力于高性能的圖像編碼算法實現結構的研究,提出了具有創新性的降低計算量、存儲量,提高壓縮性能的算法實現結構,并成功應用于圖像編碼硬件系統中。這個方案還支持壓縮比在線可調,即在不改變硬件框架的條件下可按用戶要求實現16倍到2倍的壓縮,以適應不同的應用需求。本文所做的工作包括了兩個部分。 1.一種基于行的實時提升小波變換實現結構:該結構同時處理行變換和列變換,并且在圖像邊界采用對稱擴展輸出邊界數據,使得圖像小波變換時間與傳統的小波變換相比提高了將近2.6倍,提高了硬件系統的實時性。該結構還合理地利用和調度內部緩沖器,不需要外部緩沖器,大大降低了硬件系統對存儲器的要求。 2.一種采用左遍歷的比特平面并行SPIHT編碼結構:在該編碼結構中,空間定位生成樹采用深度優先遍歷方式,比特平面同時處理極大地提高了編碼速度。

    標簽: FPGA 圖像 編碼器

    上傳時間: 2013-06-17

    上傳用戶:abc123456.

  • 基于FPGA的圖像處理算法及壓縮編碼

    本文以“機車車輛輪對動態檢測裝置”為研究背景,以改進提升裝置性能為目標,研究在Altera公司的FPGA(Field Programmable Gate Array)芯片Cyclone上實現圖像采集控制、圖像處理算法、JPEG(Joint Photographic Expert Group)壓縮編碼標準的基本系統。本文使用硬件描述語言Verilog,以RedLogic的RVDK開發板作為硬件平臺,在開發工具OUARTUS2 6.0和MODELSIM SE 6.1B環境中完成軟核的設計與仿真驗證。 數據采集部分完成的功能是將由模擬攝像機拍攝到的圖像信號進行數字化,然后從數據流中提取有效數據,加以適當裁剪,最后將奇偶場圖像數據合并成幀,存儲到存儲器中。數字化及碼流產生的功能由SAA7113芯片完成,由FPGA對SAA7113芯片初始化設置、控制,并對數字化后的數據進行操作。 圖像處理算法部分考慮到實時性與算法復雜度等因素,從裝置的圖像處理流程中有選擇性地實現了直方圖均衡化、中值濾波與邊緣檢測三種圖像處理算法。 壓縮編碼部分依據JPEG標準基本系統順序編碼模式,在FPGA上實現了DCT(Discrete Cosine Transform)變換、量化、Zig-Zag掃描、直流系數DPCM(Differential Pulse Code Modulation)編碼、交流系數RLC(Run Length code)編碼、霍夫曼編碼等主要步驟,最后用實際的圖像數據塊對系統進行了驗證。

    標簽: FPGA 圖像處理 壓縮編碼 算法

    上傳時間: 2013-04-24

    上傳用戶:qazwsc

  • 基于FPGA的H264視頻編碼器設計

    隨著多媒體編碼技術的發展,視頻壓縮標準在很多領域都得到了成功應用,如視頻會議(H.263)、DVD(MPEG-2)、機頂盒(MPEG-2)等等,而網絡帶寬的不斷提升和高效視頻壓縮技術的發展使人們逐漸把關注的焦點轉移到了寬帶網絡數字電視(IPTV)、流媒體等基于傳輸的業務上來。帶寬的增加為流式媒體的發展鋪平了道路,而高效的視頻壓縮標準的出臺則是流媒體技術發展的關鍵。H.264/AVC是由國際電信聯合會和國際標準化組織共同發展的下一代視頻壓縮標準之一。新標準中采用了新的視頻壓縮技術,如多模式幀間預測、1/4像素精度預測、整數DCT變換、變塊尺寸運動補償、基于上下文的二元算術編碼(CABAC)、基于上下文的變長編碼(CAVLC)等等,這些技術的采用大大提高了視頻壓縮的效率,更有利于寬帶網絡數字電視(IPTV)、流媒體等基于傳輸的業務的實現。 本文主要根據視頻會議應用的需要對JM8.6代碼進行優化,目標是實現基于Baseline的低復雜度的CIF編碼器,并對部分功能模塊進行電路設計。在設計方法上采用自頂向下的設計方法,首先對H.264編碼器的C代碼和算法進行優化,并對優化后的結果進行測試比較,結果顯示在圖像質量沒有明顯降低的情況下,H.264編碼器編碼CIF格式視頻每秒達到15幀以上,滿足了視頻會議應用的實時性要求。然后,以C模型為參考對H.264編碼器的部分功能模塊電路進行設計。采用Verilog HDL實現了這些模塊,并在Quartus Ⅱ中進行了綜合、仿真、驗證。主要完成了Zig-zag掃描和CAVLC模塊的設計,詳細說明模塊的工作原理和過程,然后進行多組的仿真測試,結果與C模型相應部分的結果一致,證明了設計的正確性。

    標簽: FPGA H264 視頻編碼器

    上傳時間: 2013-06-11

    上傳用戶:kjgkadjg

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