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損耗

  • 基于FPGA的MJPEG編碼器

    在視頻傳輸系統(tǒng)中,最大障礙是視頻數(shù)據(jù)的大數(shù)據(jù)量傳輸。故壓縮就顯得尤為必要。MJPEG是以25幀每秒傳輸?shù)腏PEG圖像。本文根據(jù)JPEG基本壓縮模式,通過(guò)前端圖像采集芯片輸出標(biāo)準(zhǔn)的4:2:2格式的圖像流,在XILINX公司的SPARTAN IIE芯片下壓縮,獲得了良好效果,壓縮比達(dá)到10:1。中間的各個(gè)環(huán)節(jié)同MATLAB下同等壓縮相比,除了精度上有點(diǎn)差別外,基本一致。同專用芯片相比,比專用芯片靈活得多,F(xiàn)PGA內(nèi)部全部是可編程,燒寫不同的程序便可實(shí)現(xiàn)不同的壓縮。同DSP相比,壓縮時(shí)間極大的提高,同周霖的“基于DSP技術(shù)的靜態(tài)圖像壓縮編碼”一文中編碼所需的時(shí)間進(jìn)行比較(DCT變換消耗4224個(gè)指令,量化Z排序耗960指令,huffman編碼至少耗1400指令),假設(shè)令其采用6000系列DSP,指令周期為6ns,運(yùn)算速度為1336MIPS。壓縮一個(gè)8*8DCT塊,采用高檔的DSP,消耗39tJs,而采用27M的FPGA只需6us,若采用FPGA內(nèi)部自帶的DLL將時(shí)鐘倍頻到54M,則只需要3us.本設(shè)計(jì)同傳統(tǒng)的壓縮實(shí)現(xiàn)方式相比,在速度和靈活性上有了極大的提高。

    標(biāo)簽: MJPEG FPGA 編碼器

    上傳時(shí)間: 2013-04-24

    上傳用戶:TI初學(xué)者

  • 精密運(yùn)算放大器自動(dòng)校零

    運(yùn)算放大器集成電路,與其它通用集成電路一樣,向低電壓供電方向發(fā)展,普遍使用3V供電,目的是減少功耗和延長(zhǎng)電池壽命。這樣一來(lái),運(yùn)算放大器集成電路需要有更高的元件精度和降低誤差容限。運(yùn)算放大器一般位于電路系統(tǒng)的前端,對(duì)于時(shí)間和溫度穩(wěn)定性的要求是可以理解的,同時(shí)要改進(jìn)電路結(jié)構(gòu)和修調(diào)技術(shù)。當(dāng)前,運(yùn)算放大器是在封裝后用激光修調(diào)和斬波器穩(wěn)定技術(shù),這些辦法已沿用多年并且行之有效,它們?nèi)杂懈倪M(jìn)的潛力,同時(shí)近年開(kāi)發(fā)成功的數(shù)字校正技術(shù),由于獲得成功和取得實(shí)效,幾家運(yùn)算放大器集成電路生產(chǎn)商最近公開(kāi)了它們的數(shù)字修調(diào)技術(shù),本文簡(jiǎn)介如下。

    標(biāo)簽: 精密 運(yùn)算放大器 自動(dòng)校零

    上傳時(shí)間: 2013-11-17

    上傳用戶:妄想演繹師

  • 充分利用IP以及拓?fù)湟?guī)劃提高PCB設(shè)計(jì)效率

    本文探討的重點(diǎn)是PCB設(shè)計(jì)人員利用IP,并進(jìn)一步采用拓?fù)湟?guī)劃和布線工具來(lái)支持IP,快速完成整個(gè)PCB設(shè)計(jì)。從圖1可以看出,設(shè)計(jì)工程師的職責(zé)是通過(guò)布局少量必要元件、并在這些元件之間規(guī)劃關(guān)鍵互連路徑來(lái)獲取IP。一旦獲取到了IP,就可將這些IP信息提供給PCB設(shè)計(jì)人員,由他們完成剩余的設(shè)計(jì)。 圖1:設(shè)計(jì)工程師獲取IP,PCB設(shè)計(jì)人員進(jìn)一步采用拓?fù)湟?guī)劃和布線工具支持IP,快速完成整個(gè)PCB設(shè)計(jì)。現(xiàn)在無(wú)需再通過(guò)設(shè)計(jì)工程師和PCB設(shè)計(jì)人員之間的交互和反復(fù)過(guò)程來(lái)獲取正確的設(shè)計(jì)意圖,設(shè)計(jì)工程師已經(jīng)獲取這些信息,并且結(jié)果相當(dāng)精確,這對(duì)PCB設(shè)計(jì)人員來(lái)說(shuō)幫助很大。在很多設(shè)計(jì)中,設(shè)計(jì)工程師和PCB設(shè)計(jì)人員要進(jìn)行交互式布局和布線,這會(huì)消耗雙方許多寶貴的時(shí)間。從以往的經(jīng)歷來(lái)看交互操作是必要的,但很耗時(shí)間,且效率低下。設(shè)計(jì)工程師提供的最初規(guī)劃可能只是一個(gè)手工繪圖,沒(méi)有適當(dāng)比例的元件、總線寬度或引腳輸出提示。隨著PCB設(shè)計(jì)人員參與到設(shè)計(jì)中來(lái),雖然采用拓?fù)湟?guī)劃技術(shù)的工程師可以獲取某些元件的布局和互連,不過(guò),這個(gè)設(shè)計(jì)可能還需要布局其它元件、獲取其它IO及總線結(jié)構(gòu)和所有互連才能完成。PCB設(shè)計(jì)人員需要采用拓?fù)湟?guī)劃,并與經(jīng)過(guò)布局的和尚未布局的元件進(jìn)行交互,這樣做可以形成最佳的布局和交互規(guī)劃,從而提高PCB設(shè)計(jì)效率。隨著關(guān)鍵區(qū)域和高密區(qū)域布局完成及拓?fù)湟?guī)劃被獲取,布局可能先于最終拓?fù)湟?guī)劃完成。因此,一些拓?fù)渎窂娇赡鼙仨毰c現(xiàn)有布局一起工作。雖然它們的優(yōu)先級(jí)較低,但仍需要進(jìn)行連接。因而一部分規(guī)劃圍繞布局后的元件產(chǎn)生了。此外,這一級(jí)規(guī)劃可能需要更多細(xì)節(jié)來(lái)為其它信號(hào)提供必要的優(yōu)先級(jí)。

    標(biāo)簽: PCB 利用IP 拓?fù)湟?guī)劃

    上傳時(shí)間: 2013-10-12

    上傳用戶:sjyy1001

  • 磁芯電感器的諧波失真分析

    磁芯電感器的諧波失真分析 摘  要:簡(jiǎn)述了改進(jìn)鐵氧體軟磁材料比損耗系數(shù)和磁滯常數(shù)ηB,從而降低總諧波失真THD的歷史過(guò)程,分析了諸多因數(shù)對(duì)諧波測(cè)量的影響,提出了磁心性能的調(diào)控方向。 關(guān)鍵詞:比損耗系數(shù), 磁滯常數(shù)ηB ,直流偏置特性DC-Bias,總諧波失真THD  Analysis on THD of the fer rite co res u se d i n i nductancShi Yan Nanjing Finemag Technology Co. Ltd., Nanjing 210033   Abstract:    Histrory of decreasing THD by improving the ratio loss coefficient and hysteresis constant of soft magnetic ferrite is briefly narrated. The effect of many factors which affect the harmonic wave testing is analysed. The way of improving the performance of ferrite cores is put forward.  Key words: ratio loss coefficient,hysteresis constant,DC-Bias,THD  近年來(lái),變壓器生產(chǎn)廠家和軟磁鐵氧體生產(chǎn)廠家,在電感器和變壓器產(chǎn)品的總諧波失真指標(biāo)控制上,進(jìn)行了深入的探討和廣泛的合作,逐步弄清了一些似是而非的問(wèn)題。從工藝技術(shù)上采取了不少有效措施,促進(jìn)了質(zhì)量問(wèn)題的迅速解決。本文將就此熱門話題作一些粗淺探討。  一、 歷史回顧 總諧波失真(Total harmonic distortion) ,簡(jiǎn)稱THD,并不是什么新的概念,早在幾十年前的載波通信技術(shù)中就已有嚴(yán)格要求<1>。1978年郵電部公布的標(biāo)準(zhǔn)YD/Z17-78“載波用鐵氧體罐形磁心”中,規(guī)定了高μQ材料制作的無(wú)中心柱配對(duì)罐形磁心詳細(xì)的測(cè)試電路和方法。如圖一電路所示,利用LC組成的150KHz低通濾波器在高電平輸入的情況下測(cè)量磁心產(chǎn)生的非線性失真。這種相對(duì)比較的實(shí)用方法,專用于無(wú)中心柱配對(duì)罐形磁心的諧波衰耗測(cè)試。 這種磁心主要用于載波電報(bào)、電話設(shè)備的遙測(cè)振蕩器和線路放大器系統(tǒng),其非線性失真有很嚴(yán)格的要求。  圖中  ZD   —— QF867 型阻容式載頻振蕩器,輸出阻抗 150Ω, Ld47 —— 47KHz 低通濾波器,阻抗 150Ω,阻帶衰耗大于61dB,       Lg88 ——并聯(lián)高低通濾波器,阻抗 150Ω,三次諧波衰耗大于61dB Ld88 ——并聯(lián)高低通濾波器,阻抗 150Ω,三次諧波衰耗大于61dB FD   —— 30~50KHz 放大器, 阻抗 150Ω, 增益不小于 43 dB,三次諧波衰耗b3(0)≥91 dB, DP  —— Qp373 選頻電平表,輸入高阻抗, L ——被測(cè)無(wú)心罐形磁心及線圈, C  ——聚苯乙烯薄膜電容器CMO-100V-707APF±0.5%,二只。 測(cè)量時(shí),所配用線圈應(yīng)用絲包銅電磁線SQJ9×0.12(JB661-75)在直徑為16.1mm的線架上繞制 120 匝, (線架為一格) , 其空心電感值為 318μH(誤差1%) 被測(cè)磁心配對(duì)安裝好后,先調(diào)節(jié)振蕩器頻率為 36.6~40KHz,  使輸出電平值為+17.4 dB, 即選頻表在 22′端子測(cè)得的主波電平 (P2)為+17.4 dB,然后在33′端子處測(cè)得輸出的三次諧波電平(P3), 則三次諧波衰耗值為:b3(+2)= P2+S+ P3 式中:S 為放大器增益dB 從以往的資料引證, 就可以發(fā)現(xiàn)諧波失真的測(cè)量是一項(xiàng)很精細(xì)的工作,其中測(cè)量系統(tǒng)的高、低通濾波器,信號(hào)源和放大器本身的三次諧波衰耗控制很嚴(yán),阻抗必須匹配,薄膜電容器的非線性也有相應(yīng)要求。濾波器的電感全由不帶任何磁介質(zhì)的大空心線圈繞成,以保證本身的“潔凈” ,不至于造成對(duì)磁心分選的誤判。 為了滿足多路通信整機(jī)的小型化和穩(wěn)定性要求, 必須生產(chǎn)低損耗高穩(wěn)定磁心。上世紀(jì) 70 年代初,1409 所和四機(jī)部、郵電部各廠,從工藝上改變了推板空氣窯燒結(jié),出窯后經(jīng)真空罐冷卻的落后方式,改用真空爐,并控制燒結(jié)、冷卻氣氛。技術(shù)上采用共沉淀法攻關(guān)試制出了μQ乘積 60 萬(wàn)和 100 萬(wàn)的低損耗高穩(wěn)定材料,在此基礎(chǔ)上,還實(shí)現(xiàn)了高μ7000~10000材料的突破,從而大大縮短了與國(guó)外企業(yè)的技術(shù)差異。當(dāng)時(shí)正處于通信技術(shù)由FDM(頻率劃分調(diào)制)向PCM(脈沖編碼調(diào)制) 轉(zhuǎn)換時(shí)期, 日本人明石雅夫發(fā)表了μQ乘積125 萬(wàn)為 0.8×10 ,100KHz)的超優(yōu)鐵氧體材料<3>,其磁滯系數(shù)降為優(yōu)鐵

    標(biāo)簽: 磁芯 電感器 諧波失真

    上傳時(shí)間: 2014-12-24

    上傳用戶:7891

  • IC封裝製程簡(jiǎn)介(IC封裝制程簡(jiǎn)介)

    半導(dǎo)體的產(chǎn)品很多,應(yīng)用的場(chǎng)合非常廣泛,圖一是常見(jiàn)的幾種半導(dǎo)體元件外型。半導(dǎo)體元件一般是以接腳形式或外型來(lái)劃分類別,圖一中不同類別的英文縮寫名稱原文為   PDID:Plastic Dual Inline Package SOP:Small Outline Package SOJ:Small Outline J-Lead Package PLCC:Plastic Leaded Chip Carrier QFP:Quad Flat Package PGA:Pin Grid Array BGA:Ball Grid Array         雖然半導(dǎo)體元件的外型種類很多,在電路板上常用的組裝方式有二種,一種是插入電路板的銲孔或腳座,如PDIP、PGA,另一種是貼附在電路板表面的銲墊上,如SOP、SOJ、PLCC、QFP、BGA。    從半導(dǎo)體元件的外觀,只看到從包覆的膠體或陶瓷中伸出的接腳,而半導(dǎo)體元件真正的的核心,是包覆在膠體或陶瓷內(nèi)一片非常小的晶片,透過(guò)伸出的接腳與外部做資訊傳輸。圖二是一片EPROM元件,從上方的玻璃窗可看到內(nèi)部的晶片,圖三是以顯微鏡將內(nèi)部的晶片放大,可以看到晶片以多條銲線連接四周的接腳,這些接腳向外延伸並穿出膠體,成為晶片與外界通訊的道路。請(qǐng)注意圖三中有一條銲線從中斷裂,那是使用不當(dāng)引發(fā)過(guò)電流而燒毀,致使晶片失去功能,這也是一般晶片遭到損毀而失效的原因之一。   圖四是常見(jiàn)的LED,也就是發(fā)光二極體,其內(nèi)部也是一顆晶片,圖五是以顯微鏡正視LED的頂端,可從透明的膠體中隱約的看到一片方型的晶片及一條金色的銲線,若以LED二支接腳的極性來(lái)做分別,晶片是貼附在負(fù)極的腳上,經(jīng)由銲線連接正極的腳。當(dāng)LED通過(guò)正向電流時(shí),晶片會(huì)發(fā)光而使LED發(fā)亮,如圖六所示。     半導(dǎo)體元件的製作分成兩段的製造程序,前一段是先製造元件的核心─晶片,稱為晶圓製造;後一段是將晶中片加以封裝成最後產(chǎn)品,稱為IC封裝製程,又可細(xì)分成晶圓切割、黏晶、銲線、封膠、印字、剪切成型等加工步驟,在本章節(jié)中將簡(jiǎn)介這兩段的製造程序。

    標(biāo)簽: 封裝 IC封裝 制程

    上傳時(shí)間: 2014-01-20

    上傳用戶:蒼山觀海

  • 準(zhǔn)確的電源排序可防止系統(tǒng)受損

    諸如電信設(shè)備、存儲(chǔ)模塊、光學(xué)繫統(tǒng)、網(wǎng)絡(luò)設(shè)備、服務(wù)器和基站等許多復(fù)雜繫統(tǒng)都采用了 FPGA 和其他需要多個(gè)電壓軌的數(shù)字 IC,這些電壓軌必須以一個(gè)特定的順序進(jìn)行啟動(dòng)和停機(jī)操作,否則 IC 就會(huì)遭到損壞。

    標(biāo)簽: 電源排序 防止

    上傳時(shí)間: 2014-12-24

    上傳用戶:packlj

  • 電池供電單片機(jī)的低功耗設(shè)計(jì)

      隨著社會(huì)的發(fā)展, 人們生活水平的提高, 越來(lái)越多的電器產(chǎn)品進(jìn)人了尋常百姓家, 其中已經(jīng)使用或使用的很多產(chǎn)品靠電池供電, 因此, 產(chǎn)品的低工耗設(shè)計(jì)無(wú)論是從節(jié)能還是環(huán)保, 都顯得非常的重要和有意義了。

    標(biāo)簽: 電池供電 單片機(jī) 低功耗設(shè)計(jì)

    上傳時(shí)間: 2013-11-07

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  • 用超低功耗MSP430單片機(jī)設(shè)計(jì)數(shù)據(jù)采集系統(tǒng)

    用 超 低 功 耗 M SP430單 片 機(jī) 設(shè) 計(jì) 數(shù) 據(jù) 采 集 系 統(tǒng)

    標(biāo)簽: MSP 430 超低功耗 單片機(jī)設(shè)計(jì)

    上傳時(shí)間: 2013-10-19

    上傳用戶:源弋弋

  • UJA1078TW-高集成度的系統(tǒng)基礎(chǔ)芯片簡(jiǎn)介

    概述恩智浦半導(dǎo)體推出其第二代車載網(wǎng)絡(luò)CAN/LIN核的系統(tǒng)基礎(chǔ)芯片(SBC)UJA1078TW產(chǎn)品,實(shí)現(xiàn)了性能、功耗以及電子控制單元(ECU)成本的優(yōu)化,惠及車身控制模塊、車內(nèi)溫度控制、座椅控制、電動(dòng)助力轉(zhuǎn)向(EPS)、自適應(yīng)照明、雨量/光強(qiáng)傳感器、泊車輔助及傳輸模塊等廣泛的車載應(yīng)用。UJA1078TW支持車載網(wǎng)絡(luò)互聯(lián)應(yīng)用,這些應(yīng)用通過(guò)使用高速CAN作為主網(wǎng)絡(luò)接口和LIN作為本地子總線來(lái)控制電源和傳感器設(shè)備。UJA1078TW SBC產(chǎn)品集成以下功能器件: 高速CAN收發(fā)器,可相互操作和向下兼容CAN收發(fā)器TJA1042,符合ISO 11898-2 和ISO 11898-5標(biāo)準(zhǔn); LIN收發(fā)器,符合LIN 2.1、LIN2.0和SAE J2602標(biāo)準(zhǔn),并兼容LIN1.3規(guī)范; 先進(jìn)的獨(dú)立看門狗(UJA1078/ xx/WD版); 250mA的電壓調(diào)節(jié)器,用于微控制器(3.3V或5V)及外部設(shè)備的可擴(kuò)展穩(wěn)壓器(V1);還可配置外部PNP晶體管進(jìn)行擴(kuò)展,從而令電流輸出能力更強(qiáng)、耗散分布得到優(yōu)化; 獨(dú)立的電壓調(diào)節(jié)器,用來(lái)給UJA1075TW芯片內(nèi)部的CAN收發(fā)器供電; 串行外設(shè)接口(SPI)(全雙工); 2個(gè)本地喚醒輸入端口,帶循環(huán)偏置選擇; 軟備件(Limp home)輸出端口。

    標(biāo)簽: 1078 UJA TW 高集成度

    上傳時(shí)間: 2013-10-11

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  • 充分利用IP以及拓?fù)湟?guī)劃提高PCB設(shè)計(jì)效率

    本文探討的重點(diǎn)是PCB設(shè)計(jì)人員利用IP,并進(jìn)一步采用拓?fù)湟?guī)劃和布線工具來(lái)支持IP,快速完成整個(gè)PCB設(shè)計(jì)。從圖1可以看出,設(shè)計(jì)工程師的職責(zé)是通過(guò)布局少量必要元件、并在這些元件之間規(guī)劃關(guān)鍵互連路徑來(lái)獲取IP。一旦獲取到了IP,就可將這些IP信息提供給PCB設(shè)計(jì)人員,由他們完成剩余的設(shè)計(jì)。 圖1:設(shè)計(jì)工程師獲取IP,PCB設(shè)計(jì)人員進(jìn)一步采用拓?fù)湟?guī)劃和布線工具支持IP,快速完成整個(gè)PCB設(shè)計(jì)?,F(xiàn)在無(wú)需再通過(guò)設(shè)計(jì)工程師和PCB設(shè)計(jì)人員之間的交互和反復(fù)過(guò)程來(lái)獲取正確的設(shè)計(jì)意圖,設(shè)計(jì)工程師已經(jīng)獲取這些信息,并且結(jié)果相當(dāng)精確,這對(duì)PCB設(shè)計(jì)人員來(lái)說(shuō)幫助很大。在很多設(shè)計(jì)中,設(shè)計(jì)工程師和PCB設(shè)計(jì)人員要進(jìn)行交互式布局和布線,這會(huì)消耗雙方許多寶貴的時(shí)間。從以往的經(jīng)歷來(lái)看交互操作是必要的,但很耗時(shí)間,且效率低下。設(shè)計(jì)工程師提供的最初規(guī)劃可能只是一個(gè)手工繪圖,沒(méi)有適當(dāng)比例的元件、總線寬度或引腳輸出提示。隨著PCB設(shè)計(jì)人員參與到設(shè)計(jì)中來(lái),雖然采用拓?fù)湟?guī)劃技術(shù)的工程師可以獲取某些元件的布局和互連,不過(guò),這個(gè)設(shè)計(jì)可能還需要布局其它元件、獲取其它IO及總線結(jié)構(gòu)和所有互連才能完成。PCB設(shè)計(jì)人員需要采用拓?fù)湟?guī)劃,并與經(jīng)過(guò)布局的和尚未布局的元件進(jìn)行交互,這樣做可以形成最佳的布局和交互規(guī)劃,從而提高PCB設(shè)計(jì)效率。隨著關(guān)鍵區(qū)域和高密區(qū)域布局完成及拓?fù)湟?guī)劃被獲取,布局可能先于最終拓?fù)湟?guī)劃完成。因此,一些拓?fù)渎窂娇赡鼙仨毰c現(xiàn)有布局一起工作。雖然它們的優(yōu)先級(jí)較低,但仍需要進(jìn)行連接。因而一部分規(guī)劃圍繞布局后的元件產(chǎn)生了。此外,這一級(jí)規(guī)劃可能需要更多細(xì)節(jié)來(lái)為其它信號(hào)提供必要的優(yōu)先級(jí)。

    標(biāo)簽: PCB 利用IP 拓?fù)湟?guī)劃

    上傳時(shí)間: 2014-01-14

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