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放大器設(shè)(shè)計(jì)

  • 大功率運(yùn)算放大器PA46

    運(yùn)算放大器

    標(biāo)簽： PA 46 大功率 運(yùn)算放大器

    上傳時(shí)間： 2013-10-10

    上傳用戶：athjac

  • 單電源運(yùn)算放大器的偏置與去耦電路設(shè)計(jì)

    單電源運(yùn)算放大器

    標(biāo)簽： 單電源 運(yùn)算放大器 去耦 電路設(shè)計(jì)

    上傳時(shí)間： 2013-11-17

    上傳用戶：dapangxie

  • 音響放大器設(shè)計(jì)與調(diào)試

    音響放大器設(shè)計(jì)與調(diào)試

    標(biāo)簽： 音響 放大器設(shè)計(jì) 調(diào)試

    上傳時(shí)間： 2013-11-07

    上傳用戶：niumeng16

  • 運(yùn)算放大器經(jīng)典應(yīng)用

    運(yùn)算放大器經(jīng)典應(yīng)用

    標(biāo)簽： 運(yùn)算放大器

    上傳時(shí)間： 2013-11-08

    上傳用戶：wfeel

  • 比例放大器

    簡(jiǎn)單的介紹了 比例放大器的應(yīng)用和種類(lèi)

    標(biāo)簽： 比例放大器

    上傳時(shí)間： 2013-10-20

    上傳用戶：sunshine1402

  • 4-20mA，0-10V電流~電壓模擬信號(hào)光電隔離放大器

    iso　u-p-o 系列直流電壓信號(hào)隔離放大器是一種將電壓信號(hào)轉(zhuǎn)換成按比例輸出的隔離電流或電壓信號(hào)的混合集成電路。該ic內(nèi)部含有一組高隔離的dc/dc電源和電壓信號(hào)高效率耦合隔離變換電路等，可以將直流電壓小信號(hào)進(jìn)行隔離放大（u/u）輸出或直接轉(zhuǎn)換為直流電流（u /i）信號(hào)輸出。較大的輸入阻抗（≥1 mω）,較強(qiáng)的帶負(fù)載能力（電流輸出＞650ω,電壓輸出≥2kω）能實(shí)現(xiàn)小信號(hào)遠(yuǎn)程無(wú)失真的傳輸。 ic內(nèi)部可采用陶瓷基板、印刷電阻全smt的可靠工藝制作及使用新技術(shù)隔離措施，使器件能滿足信號(hào)輸入/輸出/輔助電源之間3kv三隔離和工業(yè)級(jí)寬溫度、潮濕震動(dòng)等現(xiàn)場(chǎng)環(huán)境要求。外接滿度校正和零點(diǎn)校正的多圈電位器可實(shí)現(xiàn) 0-5v/0-10v/1-5v4-20ma/0-20ma等信號(hào)之間的隔離和轉(zhuǎn)換。（精度線性高，隔離電壓3000vdc）

    標(biāo)簽： 20 10 mA 電流

    上傳時(shí)間： 2014-12-23

    上傳用戶：392210346

  • 放大器電路設(shè)計(jì)：如何避免常見(jiàn)問(wèn)題

    做放大器電路設(shè)計(jì)的請(qǐng)看！

    標(biāo)簽： 放大器 電路設(shè)計(jì)

    上傳時(shí)間： 2013-10-15

    上傳用戶：m62383408

  • 乘法DAC和運(yùn)算放大器控制交流信號(hào)的失調(diào)和幅度

    本應(yīng)用筆記介紹如何運(yùn)用本文所述電路來(lái)避免添加額外的求和放大器，以及IOUT架構(gòu)如何支持交流和直流兩種輸入，從而使該電路非常適合數(shù)據(jù)采集和儀器儀表應(yīng)用。

    標(biāo)簽： DAC 乘法 運(yùn)算放大器 控制交流

    上傳時(shí)間： 2013-11-21

    上傳用戶：czl10052678

  • 放大器類(lèi)型學(xué)習(xí)筆記

    區(qū)分放大器的其中一種方式是通過(guò)其輸出級(jí)的類(lèi)型。這種分類(lèi)由輸出器件接通的輸出周期百分比決定。基本考量是失真與功率的關(guān)系。

    標(biāo)簽： 放大器

    上傳時(shí)間： 2013-10-19

    上傳用戶：daxigua

  • 帶有增益提高技術(shù)的高速CMOS運(yùn)算放大器設(shè)計(jì)

    設(shè)計(jì)了一種用于高速ADC中的高速高增益的全差分CMOS運(yùn)算放大器。主運(yùn)放采用帶開(kāi)關(guān)電容共模反饋的折疊式共源共柵結(jié)構(gòu)，利用增益提高和三支路電流基準(zhǔn)技術(shù)實(shí)現(xiàn)一個(gè)可用于12~14 bit精度，100 MS/s采樣頻率的高速流水線（Pipelined）ADC的運(yùn)放。設(shè)計(jì)基于SMIC 0.25 μm CMOS工藝，在Cadence環(huán)境下對(duì)電路進(jìn)行Spectre仿真。仿真結(jié)果表明，在2.5 V單電源電壓下驅(qū)動(dòng)2 pF負(fù)載時(shí)，運(yùn)放的直流增益可達(dá)到124 dB，單位增益帶寬720 MHz，轉(zhuǎn)換速率高達(dá)885 V/μs，達(dá)到0.1%的穩(wěn)定精度的建立時(shí)間只需4 ns，共模抑制比153 dB。

    標(biāo)簽： CMOS 增益提高 運(yùn)算 放大器設(shè)計(jì)

    上傳時(shí)間： 2014-12-23

    上傳用戶：jiiszha

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