隨著圖像處理技術(shù)和投影技術(shù)的不斷發(fā)展，人們對(duì)高沉浸感的虛擬現(xiàn)實(shí)場(chǎng)景提出了更高的要求，這種虛擬顯示的場(chǎng)景往往由多通道的投影儀器同時(shí)在屏幕上投影出多幅高清晰的圖像，再把這些單獨(dú)的圖像拼接在一起組成一幅大場(chǎng)景的圖像。而為了給人以逼真的效果，投影的屏幕往往被設(shè)計(jì)為柱面屏幕，甚至是球面屏幕。當(dāng)圖像投影在柱面屏幕的時(shí)候就會(huì)發(fā)生幾何形狀的變化，而避免這種幾何變形的就是圖像拼接過(guò)程中的幾何校正和邊緣融合技術(shù)。 一個(gè)大場(chǎng)景可視化系統(tǒng)由投影機(jī)、投影屏幕、圖像融合機(jī)等主要模塊組成。在虛擬現(xiàn)實(shí)應(yīng)用系統(tǒng)中，要實(shí)現(xiàn)高臨感的多屏幕無(wú)縫拼接以及曲面組合顯示，顯示系統(tǒng)還需要運(yùn)用幾何數(shù)字變形及邊緣融合等圖像處理技術(shù)，實(shí)現(xiàn)諸如在平面、柱面、球面等投影顯示面上顯示圖像。而關(guān)鍵設(shè)備在于圖像融合機(jī)，它實(shí)時(shí)采集圖形服務(wù)器，或者PC的圖像信號(hào)，通過(guò)圖像處理模塊對(duì)圖像信息進(jìn)行幾何校正和邊緣融合，在處理完成后再送到顯示設(shè)備。 本課題提出了一種基于FPGA技術(shù)的圖像處理系統(tǒng)。該系統(tǒng)實(shí)現(xiàn)圖像數(shù)據(jù)的AiD采集、圖像數(shù)據(jù)在SRAM以及SDRAM中的存取、圖像在FPGA內(nèi)部的DSP運(yùn)算以及圖像數(shù)據(jù)的D/A輸出。系統(tǒng)設(shè)計(jì)的核心部分在于系統(tǒng)的控制以及數(shù)字信號(hào)的處理。本課題采用XilinxVirtex4系列FPGA作為主處理芯片，并利用VerilogHDL硬件描述語(yǔ)言在FPGA內(nèi)部設(shè)計(jì)了A/D模塊、D/A模塊、SRAM、SDRAM以及ARM處理器的控制器邏輯。 本課題在FPGA圖像處理系統(tǒng)中設(shè)計(jì)了一個(gè)ARM處理器模塊，用于上電時(shí)對(duì)系統(tǒng)在圖像變化處理時(shí)所需參數(shù)進(jìn)行傳遞，并能實(shí)時(shí)從上位機(jī)更新參數(shù)。該設(shè)計(jì)在提高了系統(tǒng)性能的同時(shí)也便于系統(tǒng)擴(kuò)展。 本文首先介紹了圖像處理過(guò)程中的幾何變化和圖像融合的算法，接著提出了系統(tǒng)的設(shè)計(jì)方案及模塊劃分，然后圍繞FPGA的設(shè)計(jì)介紹了SDRAM控制器的設(shè)計(jì)方法，最后介紹了ARM處理器的接口及外圍電路的設(shè)計(jì)。
上傳時(shí)間： 2013-04-24
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12864愛上對(duì)方阿斯頓飛俺十分阿斯頓阿斯頓飛
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隨著圖像處理技術(shù)和投影技術(shù)的不斷發(fā)展，人們對(duì)高沉浸感的虛擬現(xiàn)實(shí)場(chǎng)景提出了更高的要求，這種虛擬顯示的場(chǎng)景往往由多通道的投影儀器同時(shí)在屏幕上投影出多幅高清晰的圖像，再把這些單獨(dú)的圖像拼接在一起組成一幅大場(chǎng)景的圖像。而為了給人以逼真的效果，投影的屏幕往往被設(shè)計(jì)為柱面屏幕，甚至是球面屏幕。當(dāng)圖像投影在柱面屏幕的時(shí)候就會(huì)發(fā)生幾何形狀的變化，而避免這種幾何變形的就是圖像拼接過(guò)程中的幾何校正和邊緣融合技術(shù)。 一個(gè)大場(chǎng)景可視化系統(tǒng)由投影機(jī)、投影屏幕、圖像融合機(jī)等主要模塊組成。在虛擬現(xiàn)實(shí)應(yīng)用系統(tǒng)中，要實(shí)現(xiàn)高臨感的多屏幕無(wú)縫拼接以及曲面組合顯示，顯示系統(tǒng)還需要運(yùn)用幾何數(shù)字變形及邊緣融合等圖像處理技術(shù)，實(shí)現(xiàn)諸如在平面、柱面、球面等投影顯示面上顯示圖像。而關(guān)鍵設(shè)備在于圖像融合機(jī)，它實(shí)時(shí)采集圖形服務(wù)器，或者PC的圖像信號(hào)，通過(guò)圖像處理模塊對(duì)圖像信息進(jìn)行幾何校正和邊緣融合，在處理完成后再送到顯示設(shè)備。 本課題提出了一種基于FPGA技術(shù)的圖像處理系統(tǒng)。該系統(tǒng)實(shí)現(xiàn)圖像數(shù)據(jù)的AiD采集、圖像數(shù)據(jù)在SRAM以及SDRAM中的存取、圖像在FPGA內(nèi)部的DSP運(yùn)算以及圖像數(shù)據(jù)的D/A輸出。系統(tǒng)設(shè)計(jì)的核心部分在于系統(tǒng)的控制以及數(shù)字信號(hào)的處理。本課題采用XilinxVirtex4系列FPGA作為主處理芯片，并利用VerilogHDL硬件描述語(yǔ)言在FPGA內(nèi)部設(shè)計(jì)了A/D模塊、D/A模塊、SRAM、SDRAM以及ARM處理器的控制器邏輯。 本課題在FPGA圖像處理系統(tǒng)中設(shè)計(jì)了一個(gè)ARM處理器模塊，用于上電時(shí)對(duì)系統(tǒng)在圖像變化處理時(shí)所需參數(shù)進(jìn)行傳遞，并能實(shí)時(shí)從上位機(jī)更新參數(shù)。該設(shè)計(jì)在提高了系統(tǒng)性能的同時(shí)也便于系統(tǒng)擴(kuò)展。 本文首先介紹了圖像處理過(guò)程中的幾何變化和圖像融合的算法，接著提出了系統(tǒng)的設(shè)計(jì)方案及模塊劃分，然后圍繞FPGA的設(shè)計(jì)介紹了SDRAM控制器的設(shè)計(jì)方法，最后介紹了ARM處理器的接口及外圍電路的設(shè)計(jì)。
上傳時(shí)間： 2013-04-24
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測(cè)試儀廣泛應(yīng)用于國(guó)民經(jīng)濟(jì)和國(guó)防建設(shè)的各個(gè)領(lǐng)域，是科研和生產(chǎn)不可或缺的重要裝備之一。其工作原理是由信號(hào)發(fā)生裝置向被測(cè)對(duì)象發(fā)送激勵(lì)信號(hào)，同時(shí)由信號(hào)采集與處理裝置通過(guò)傳感器采集被測(cè)對(duì)象的響應(yīng)信號(hào)，并送到上位機(jī)進(jìn)行數(shù)據(jù)分析和處理。本文研究采用靈活的現(xiàn)場(chǎng)可編程邏輯陣列FPGA為核心，協(xié)調(diào)整個(gè)儀器的運(yùn)轉(zhuǎn)，并采用先進(jìn)的USB總線技術(shù)，將信號(hào)發(fā)生、信號(hào)采集與處理有機(jī)地集成為一體的多功能測(cè)試儀。 本文的第一章介紹了測(cè)試儀及其研究應(yīng)用現(xiàn)狀，根據(jù)儀器的成本、便攜性和通用性要求不斷提高的發(fā)展趨勢(shì)，提出了本課題的研究任務(wù)和關(guān)鍵技術(shù)； 第二章從硬件和軟件兩個(gè)方面討論了測(cè)試儀的總體設(shè)計(jì)方案，并且分別詳述了電源模塊、USB模塊、FPGA模塊、DSP模塊、A/D模塊、D/A模塊這六個(gè)功能模塊的硬件設(shè)計(jì)； 第三章討論了USB模塊相關(guān)的軟件設(shè)計(jì)，其中包含USB固件設(shè)計(jì)、驅(qū)動(dòng)程序設(shè)計(jì)和客戶應(yīng)用程序設(shè)計(jì)三個(gè)方面的內(nèi)容，詳細(xì)論述了各部分軟件的架構(gòu)和主要功能模塊的實(shí)現(xiàn)。 第四章討論了主控器FPGA的設(shè)計(jì)，是本文的核心部分。先從總體上介紹了FPGA的設(shè)計(jì)方案，然后從MCU模塊、信號(hào)采集模塊、信號(hào)發(fā)生模塊三部分具體描述了其實(shí)現(xiàn)方式。軟件設(shè)計(jì)上采用了模塊化的設(shè)計(jì)思想，使得結(jié)構(gòu)清晰，可讀性強(qiáng)，易于進(jìn)一步開發(fā)；并且靈活的使用了有限狀態(tài)機(jī)，大大提高了程序的穩(wěn)定性和運(yùn)行效率。 第五章介紹了DSP模塊的設(shè)計(jì)，討論了波形生成的原理及實(shí)現(xiàn)，并提出了與FPGA接口的方式。 第六章詳細(xì)描述了實(shí)驗(yàn)的步驟和結(jié)果，分別從單通道采樣和多通道采樣兩方面實(shí)驗(yàn)，驗(yàn)證了儀器的性能和設(shè)計(jì)的可行性。
上傳時(shí)間： 2013-06-25
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ChipScope Pro具有傳統(tǒng)邏輯分析儀的功能，是針對(duì)Xilinx Virtex Pro等系列FPGA的在線片內(nèi)信號(hào)分析工具，主要功能是通過(guò)JTAG口，實(shí)時(shí)、在線、方便地觀察到FPGA內(nèi)部的信號(hào)，給調(diào)試、故障定位提供極大的方便。ChipScope Pro的基本原理是利用FPGA中未使用的BlockRam,根據(jù)用戶設(shè)定的觸發(fā)條件將信號(hào)實(shí)時(shí)的保存到這些BlockRam中，然后通過(guò)JTAG口傳送到計(jì)算機(jī)，最后在計(jì)算機(jī)屏幕上顯示出時(shí)序波形。
上傳時(shí)間： 2013-05-22
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在V29的版本上升級(jí)。發(fā)布日期2011-08-19. -------------------------------------------------------------------------------- 歡迎使用免費(fèi)軟件《串口獵人》V31 ！ -------------------------------------------------------------------------------- 友情提醒1：本軟件如有新版本，將發(fā)布到我的博客《匠人的百寶箱》，歡迎光臨！ 友情提醒2：點(diǎn)擊右側(cè)【清除】按鈕，可清除本幫助信息。清除后如想再次查閱，請(qǐng)重啟軟件。 -------------------------------------------------------------------------------- 《串口獵人》功能簡(jiǎn)介 -------------------------------------------------------------------------------- 一、基本功能 1、支持16個(gè)COM口、自動(dòng)/手動(dòng)搜索串口、串口參數(shù)的設(shè)置和查看。 2、支持查看或修改串口控制線（DTR、RTS、DCD等等）的狀態(tài)。 3、支持基本的收、發(fā)、查看、保存、載入、清除等功能。 4、兩種收發(fā)格式：HEX碼/字符串，支持中文字符串。（英文=ASCII碼，中文=ANSI(GBK)碼）。 5、大容量的收碼區(qū)，為了加快顯示速度會(huì)把超過(guò)10K的數(shù)據(jù)自動(dòng)隱藏（可以點(diǎn)擊【全顯】鈕查看）。 6、收碼區(qū)的顯示方式可以靈活設(shè)置：原始接收數(shù)據(jù)、按幀換行、通道數(shù)據(jù)、發(fā)送數(shù)據(jù)。 7、可以為收到的數(shù)據(jù)標(biāo)注時(shí)間和來(lái)源。 8、可以自動(dòng)比對(duì)發(fā)碼區(qū)和收碼區(qū)的數(shù)據(jù)是否一致（用于自發(fā)自收測(cè)試模式）。 9、收碼區(qū)的內(nèi)容，可以點(diǎn)擊【轉(zhuǎn)發(fā)】鈕轉(zhuǎn)到發(fā)碼區(qū)。 10、可以在每次發(fā)碼之前自動(dòng)清除收碼區(qū)。 二、高級(jí)發(fā)碼功能 1、自動(dòng)發(fā)列表功能：支持多組（最多16組）數(shù)據(jù)的輪流發(fā)送。 2、自動(dòng)發(fā)文件功能：支持文件逐行發(fā)送。 3、輪發(fā)規(guī)則可以靈活設(shè)置，比如可以定時(shí)發(fā)，也可以收到應(yīng)答后立即發(fā)。 4、輪發(fā)的間隔、無(wú)應(yīng)答重發(fā)次數(shù)和循環(huán)次數(shù)均可靈活設(shè)置。 5、靈活的幀格式設(shè)置。支持自動(dòng)添加幀頭、幀尾、幀長(zhǎng)、校驗(yàn)、回車換行符。 6、幀頭、幀尾、幀長(zhǎng)、校驗(yàn)，是否要參與校驗(yàn)或計(jì)入幀長(zhǎng)，皆可靈活設(shè)置。 7、支持3種校驗(yàn)方式：SC(累加和校驗(yàn))、LRC(縱向冗余校驗(yàn))、BBC（異或和校驗(yàn)）。 8、校驗(yàn)碼和幀長(zhǎng)的長(zhǎng)度，可以選擇單/雙字節(jié)。 三、高級(jí)收碼功能 1、支持按幀接收數(shù)據(jù)。 2、能自動(dòng)進(jìn)行幀結(jié)束判定（方式非常靈活，可以按幀頭、幀尾、幀長(zhǎng)或時(shí)間）。 3、即時(shí)顯示最新一幀內(nèi)容。 4、擁有八個(gè)獨(dú)立接收通道，可以自動(dòng)從指定幀中指定位置收取有效數(shù)據(jù)。 5、每個(gè)通道的數(shù)據(jù)，可以獨(dú)自顯示、保存、清除。也可以送到收碼區(qū)去顯示。 6、可以設(shè)置通道收取數(shù)據(jù)的首地址、字節(jié)長(zhǎng)度（單字節(jié)或多字節(jié)）、碼制（HEX/BCD）、符號(hào)位形式。 7、示波器功能，可把收取的數(shù)據(jù)用波形方式顯示。示波器的通道數(shù)、倍率、偏移、周期、顏色和線寬等可調(diào)。 8、碼表功能，可把收取的數(shù)據(jù)用碼表方式顯示。（可以設(shè)置碼表的最大/最小值和報(bào)警值）。 9、柱狀圖功能，可把收取的數(shù)據(jù)用柱狀圖方式顯示。（也可以設(shè)置最大/最小值和報(bào)警值）。 10、可以把實(shí)施繪制的圖形保存為圖片。 四、其它貼心設(shè)計(jì) 1、用戶的設(shè)置內(nèi)容，可以保存/載入或恢復(fù)默認(rèn)值。可以選擇啟動(dòng)時(shí)載入默認(rèn)值還是上次設(shè)置值。 2、可以通過(guò)提示區(qū)和狀態(tài)指示了解軟件當(dāng)前工作狀態(tài)。 3、當(dāng)鼠標(biāo)停留在按鈕、文本框或其它控件上，會(huì)獲得必要的提示。 4、右下角的圖釘按鈕，可以把窗口釘在最前面，避免被其它窗口覆蓋。 5、附送串口電路、協(xié)議、碼表等參考資料。 6、在【版權(quán)信息】標(biāo)簽頁(yè)有匠人的聯(lián)系方式，歡迎交流。
標(biāo)簽： Serial Hunter V31 串口獵人
上傳時(shí)間： 2013-07-28
上傳用戶：lili1990
用UC3842做的開關(guān)電源的典型電路見圖1。過(guò)載和短路保護(hù)，一般是通過(guò)在開關(guān)管的源極串一個(gè)電阻（R4），把電流信號(hào)送到3842的第3腳來(lái)實(shí)現(xiàn)保護(hù)。當(dāng)電源過(guò)載時(shí)，3842保護(hù)動(dòng)作，使占空比減小，輸出電壓降低，3842的供電電壓Vaux也跟著降低，當(dāng)?shù)偷?842不能工作時(shí)，整個(gè)電路關(guān)閉，然后靠R1、R2開始下一次啟動(dòng)過(guò)程。這被稱為“打嗝”式（hiccup）保護(hù)。
標(biāo)簽： 開關(guān)電源 電路圖
上傳時(shí)間： 2013-04-24
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摘要本設(shè)計(jì)以VCA822、MSP430F2012、DAC7611芯片為核心，加以其它輔助電路實(shí)現(xiàn)對(duì)寬帶電壓放大器的電壓放大倍數(shù)、輸出電壓進(jìn)行精確控制。放大器的電壓放大倍數(shù)從0.2倍到20倍以0.1倍為步進(jìn)設(shè)定，輸出電壓從6mv到600mv以1mv為步進(jìn)設(shè)定，控制誤差不大于5%，放大器的帶寬大于15MHz。鍵盤和顯示電路實(shí)現(xiàn)人機(jī)交互，完成對(duì)電壓放大倍數(shù)和輸出電壓的設(shè)定和顯示。關(guān)鍵詞：程控放大器；高精度；控制電壓；電壓變換；D/A；A/D。
上傳時(shí)間： 2013-11-16
上傳用戶：iswlkje
保證Fluke產(chǎn)品從購(gòu)買日起一年內(nèi)，沒有材料和工藝上的瑕疵。本項(xiàng)擔(dān)保不包括保險(xiǎn)絲、可棄置的電池或者因意外、疏忽、誤用或非正常情況下的使用或處理而損壞的產(chǎn)品。Fluke也未曾授權(quán)予經(jīng)銷商將本保證期延長(zhǎng)。保證期間如果需要維修，請(qǐng)將測(cè)試儀表附上故障說(shuō)明送到購(gòu)買儀表的分銷商處。 本項(xiàng)保證是閣下唯一的補(bǔ)償。除此以外，F(xiàn)luke不做任何明示或默示的保證（例如保證某一特殊目的的適應(yīng)性）。同時(shí)，凡因任何原因或推測(cè)而導(dǎo)致的任何特別、間接、附帶或繼起的損壞或損失，F(xiàn)luke也一概不予負(fù)責(zé)。由于某些州或國(guó)家不允許對(duì)默示保證及附帶或繼起的損壞有所限制，故上述的責(zé)任范圍與規(guī)定或許與您無(wú)關(guān)。
標(biāo)簽： Multimeter Digital 18B 用戶手冊(cè)
上傳時(shí)間： 2013-11-07
上傳用戶：璇珠官人
6N137的結(jié)構(gòu)原理如圖1所示，信號(hào)從腳2和腳3輸入，發(fā)光二極管發(fā)光，經(jīng)片內(nèi)光通道傳到光敏二極管，反向偏置的光敏管光照后導(dǎo)通，經(jīng)電流-電壓轉(zhuǎn)換后送到與門的一個(gè)輸入端，與門的另一個(gè)輸入為使能端，當(dāng)使能端為高時(shí)與門輸出高電平，經(jīng)輸出三極管反向后光電隔離器輸出低電平。當(dāng)輸入信號(hào)電流小于觸發(fā)閾值或使能端為低時(shí)，輸出高電平，但這個(gè)邏輯高是集電極開路的，可針對(duì)接收電路加上拉電阻或電壓調(diào)整電路。
上傳時(shí)間： 2014-03-24
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