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散列函數(shù)

  • ecc 算法實現和糾錯 1。nand_trans_result函數是實現ecc的行校驗 2。nand_calculate_ecc函數是實現ecc的列校驗 3。nand_correct_data函

    ecc 算法實現和糾錯 1。nand_trans_result函數是實現ecc的行校驗 2。nand_calculate_ecc函數是實現ecc的列校驗 3。nand_correct_data函數實現1bit糾錯

    標簽: ecc nand_calculate_ecc nand_trans_result nand_correct_data

    上傳時間: 2016-01-06

    上傳用戶:二驅蚊器

  • 與 奇數魔術方陣 相同

    與 奇數魔術方陣 相同,在於求各行、各列與各對角線的和相等,而這次方陣的維度是4的倍數。

    標簽:

    上傳時間: 2013-12-18

    上傳用戶:shus521

  • 利用最大排序法進行數字的排序

    利用最大排序法進行數字的排序,將一串數列依照大小進行排列! 每次比對下一個數字最大的放至前面 依序做回圈之後 就出現結果

    標簽: 排序

    上傳時間: 2013-12-06

    上傳用戶:lz4v4

  • AVR ATmega48 SPI最簡單測試碼! 透過spi_data[x]陣列寫入想要傳送的資料

    AVR ATmega48 SPI最簡單測試碼! 透過spi_data[x]陣列寫入想要傳送的資料, 而x則是控制傳送第x筆數,而接腳輸出則在PortB的預設接腳內,只要修改spi_data就可以透過示波器看到SPI的信號了!

    標簽: spi_data ATmega AVR SPI

    上傳時間: 2014-06-09

    上傳用戶:jcljkh

  • L4_1.m: SVD轉換(程式) L4_2.m: 影像轉換的能量集中能力(程式) L4_3a.m: 小波轉換之多重解析架構(程式) L4_3b.m: 小波轉換係數與影像的方向性(程式) en

    L4_1.m: SVD轉換(程式) L4_2.m: 影像轉換的能量集中能力(程式) L4_3a.m: 小波轉換之多重解析架構(程式) L4_3b.m: 小波轉換係數與影像的方向性(程式) energy.m: 能量集中(函式) L4_1.bmp: 影像檔 L4_2.bmp: 影像檔 L4_3b.bmp: 影像檔 woman.mat: Matlab的矩陣變數檔

    標簽: 程式 SVD en 多重

    上傳時間: 2013-11-28

    上傳用戶:koulian

  • EWB經典實用列子

    EWB經典實用列子,基于單片機的經典應用。

    標簽: EWB

    上傳時間: 2013-06-22

    上傳用戶:wsm555

  • 確定雜散噪聲來源

    直接數據頻率合成器(DDS)因能產生頻率捷變且殘留相位噪聲性能卓越而著稱。另外,多數用戶都很清楚DDS輸出頻譜中存在的雜散噪聲,比如相位截斷雜散以及與相位-幅度轉換過程相關的雜散等。此類雜散是實際DDS設計中的有限相位和幅度分辨率造成的結果。

    標簽: 雜散噪聲

    上傳時間: 2013-11-18

    上傳用戶:shfanqiwei

  • pcb layout design(臺灣硬件工程師15年經驗

    PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範圍,不與零件腳相接。10. THERMAL PAD:多層板內NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或導通孔。11. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setup􀃆pads􀃆stacks

    標簽: layout design pcb 硬件工程師

    上傳時間: 2013-10-22

    上傳用戶:pei5

  • 電容器的寄生作用與雜散電容.pdf

    電容器的寄生作用與雜散電容.pdf

    標簽: 電容器 寄生 電容

    上傳時間: 2014-04-18

    上傳用戶:longlong12345678

  • 跟我學數字電子技朮

    數字電子技朮

    標簽:

    上傳時間: 2013-10-09

    上傳用戶:1101055045

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