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碼元定時(shí)恢復(fù)(位同步)技術(shù)是數(shù)字通信中的關(guān)鍵技術(shù)。位同步信號本身的抖動、錯位會直接降低通信設(shè)備的抗干擾性能，使誤碼率上升，甚至?xí)箓鬏斣獾酵耆茐摹Ｓ绕鋵τ谕话l(fā)傳輸系統(tǒng)，快速、精確的定時(shí)同步算法是近年來研究的一個焦點(diǎn)。本文就是以Inmarsat GES/AES數(shù)據(jù)接收系統(tǒng)為背景，研究了突發(fā)通信傳輸模式下的全數(shù)字接收機(jī)中位同步方法，并予以實(shí)現(xiàn)。 本文系統(tǒng)地論述了位同步原理，在此基礎(chǔ)上著重研究了位同步的系統(tǒng)結(jié)構(gòu)、碼元定時(shí)恢復(fù)算法以及衡量系統(tǒng)性能的各項(xiàng)指標(biāo)，為后續(xù)工作奠定了基礎(chǔ)。 首先根據(jù)衛(wèi)星系統(tǒng)突發(fā)信道傳輸?shù)奶攸c(diǎn)分析了傳統(tǒng)位同步方法在突發(fā)系統(tǒng)中的不足，接下來對Inmarsat系統(tǒng)的短突發(fā)R信道和長突發(fā)T信道的調(diào)制方式和幀結(jié)構(gòu)做了細(xì)致的分析，并在Agilent ADS中進(jìn)行了仿真。 在此基礎(chǔ)上提出了一種充分利用報(bào)頭前導(dǎo)比特信息的，由滑動平均、閾值判斷和累加求極值組成的快速報(bào)頭時(shí)鐘捕獲方法，此方法可快速精準(zhǔn)地完成短突發(fā)形式下的位同步，并在FPGA上予以實(shí)現(xiàn)，效果良好。 在長突發(fā)形式下的報(bào)頭時(shí)鐘捕獲后還需要對后續(xù)數(shù)據(jù)進(jìn)行位同步跟蹤，在跟蹤過程中本論文首先用DSP Builder實(shí)現(xiàn)了插值環(huán)路的位同步算法，進(jìn)行了Matlab仿真和FPGA實(shí)現(xiàn)。并在插值環(huán)路的基礎(chǔ)上做出改進(jìn)，提出了一種新的高效的基于移位算法的位同步方案并予以FPGA實(shí)現(xiàn)。最后將移位算法與插值算法進(jìn)行了性能比較，證明該算法更適合于本項(xiàng)目中Inmarsat的長突發(fā)信道位同步跟蹤。 論文對兩個突發(fā)信道的位同步系統(tǒng)進(jìn)行了理論研究、算法設(shè)計(jì)以及硬件實(shí)現(xiàn)的全過程，滿足系統(tǒng)要求。
上傳時(shí)間： 2013-04-24
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數(shù)字水印是數(shù)字信息安全領(lǐng)域研究的一個熱點(diǎn)。小波變換算法以其多分辨率分析的特性在應(yīng)用數(shù)學(xué)方面取得了一定的發(fā)展。文中結(jié)合小波算法，在數(shù)字圖像的低頻域中采用分塊方法來嵌入數(shù)字水印，改進(jìn)了小波多尺度分解算法，通過實(shí)驗(yàn)說明，該數(shù)字水印算法對數(shù)字水印的穩(wěn)定性效果明顯
上傳時(shí)間： 2013-11-08
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基于遺傳算法的組合邏輯電路的自動設(shè)計(jì)，依據(jù)給出的真值表，利用遺傳算法自動生成符合要求的組合邏輯電路。由于遺傳算法本身固有的并行性，采用軟件實(shí)現(xiàn)的方法在速度上往往受到本質(zhì)是串行計(jì)算的計(jì)算機(jī)制約，因此采用硬件化設(shè)計(jì)具有重要的意義。為了證明基于FPGA的遺傳算法的高效性，設(shè)計(jì)了遺傳算法的各個模塊，實(shí)現(xiàn)了基于FPGA的遺傳算法。
標(biāo)簽： FPGA 算法 電路設(shè)計(jì) 組合邏輯
上傳時(shí)間： 2014-01-08
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討論了PCB自動設(shè)計(jì)中版面圖形數(shù)據(jù)組織和障礙數(shù)的建立。介紹了PCB自動設(shè)計(jì)中分解算法、圖形相交算法機(jī)器在圖形數(shù)據(jù)處理中的應(yīng)用
上傳時(shí)間： 2013-11-12
上傳用戶：MATAIYES
在ZigBee網(wǎng)絡(luò)中，傳統(tǒng)的路由算法單純的減少網(wǎng)絡(luò)的總體能耗，而忽略了網(wǎng)絡(luò)能耗的不平衡導(dǎo)致局部網(wǎng)絡(luò)能量的枯竭，致使網(wǎng)絡(luò)癱瘓的問題。針對這一問題，文中從網(wǎng)絡(luò)中節(jié)點(diǎn)能耗均衡出發(fā)，提出了一種將剩余能量和能量閾值綜合考慮的路由算法。實(shí)驗(yàn)表明，該算法能有效地減緩節(jié)點(diǎn)的死亡時(shí)間，大大延長網(wǎng)絡(luò)壽命。
標(biāo)簽： ZigBee 能耗均衡 火災(zāi)監(jiān)控系統(tǒng) 路由算法
上傳時(shí)間： 2013-11-20
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在分析國內(nèi)外現(xiàn)有便攜式制動性能測試儀的特點(diǎn)和功能的基礎(chǔ)上，研制了一種基于數(shù)字加速度傳感器AIS226DS的制動性能測試儀。文中主要介紹了系統(tǒng)各部分硬件設(shè)計(jì)以及軟件總體結(jié)構(gòu)設(shè)計(jì)。利用單片機(jī)完成加速度傳感器輸出值對時(shí)間的積分算法，實(shí)現(xiàn)了對被測車輛的制動性能測試。考慮到便攜儀器低功耗需求，選用C8051f585單片機(jī)和CAT6219電源芯片，降低了整機(jī)功耗。經(jīng)靜態(tài)校準(zhǔn)和實(shí)車路試測試，該測試儀的測量精度高、穩(wěn)定性好。
上傳時(shí)間： 2013-10-22
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根據(jù)平行因子（PARAFAC）模型，研究DS-CDMA盲多用戶檢測算法。將直接三線性分解算法（DTLD）與三線性交替最小二乘（TALS）算法結(jié)合，提出一種新的DTALS-PARAFAC盲接收機(jī)，解決了三線性交替最小二乘（TALS）算法中因?yàn)槌跏贾倒烙?jì)不當(dāng)引起的收斂速度差的問題。仿真結(jié)果表明，與TALS-PARAFAC接收機(jī)相比，DTALS-PARAFAC接收機(jī)改善了誤碼率性能，并且具有更快的收斂速度。
標(biāo)簽： PARAFAC DS-CDMA 模型 接收機(jī)
上傳時(shí)間： 2013-11-24
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討論了PCB自動設(shè)計(jì)中版面圖形數(shù)據(jù)組織和障礙數(shù)的建立。介紹了PCB自動設(shè)計(jì)中分解算法、圖形相交算法機(jī)器在圖形數(shù)據(jù)處理中的應(yīng)用
上傳時(shí)間： 2014-01-25
上傳用戶：wqxstar
構(gòu)造格雷碼的分析程序，用于算法分析，用VC編寫，可以構(gòu)造n位的格雷碼
上傳時(shí)間： 2015-03-22
上傳用戶：星仔
該代碼是來自圖像模式識別vc++實(shí)現(xiàn)(清華出版社楊淑瑩編著)中聚類分析，聚類算法比較齊全
上傳時(shí)間： 2015-05-30
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