附件中資料時(shí)模擬時(shí)鐘方面的信息，可用單片機(jī)仿真軟件仿真。
標(biāo)簽： 附件 模擬 時(shí)鐘 方面
上傳時(shí)間： 2013-08-26
上傳用戶：marten
Matlab_simulink在FPGA設(shè)計(jì)中的應(yīng)用
標(biāo)簽： Matlab_simulink FPGA 中的應(yīng)用
上傳時(shí)間： 2013-08-27
上傳用戶：古谷仁美
FPGA向SRAM中寫入數(shù)據(jù)，VHDL編程
標(biāo)簽： FPGA SRAM 數(shù)據(jù)
上傳時(shí)間： 2013-08-28
上傳用戶：zhliu007
這是嵌入式中的FPGA的驅(qū)動，用在內(nèi)核驅(qū)動，希望有幫助
標(biāo)簽： FPGA 嵌入式 驅(qū)動
上傳用戶：佳期如夢
基于FPGA的快速并行FFT及其在空間太陽望遠(yuǎn)鏡圖像鎖定系統(tǒng)中的應(yīng)用
標(biāo)簽： FPGA FFT 并行 圖像
上傳用戶：lgnf
CPLD在交流電機(jī)控制系統(tǒng)中的測速應(yīng)用，里面有一段程序，希望有幫助
標(biāo)簽： CPLD 交流電機(jī) 控制系統(tǒng) 測速
上傳用戶：270189020
protel中CPLD器件的庫可以方便的放進(jìn)protel中
標(biāo)簽： protel CPLD 器件
上傳時(shí)間： 2013-08-29
上傳用戶：thuyenvinh
詳細(xì)描述了在FPGA/CPLD設(shè)計(jì)過程中應(yīng)注意的地方,和如何提高設(shè)計(jì)效率,對FPGA設(shè)計(jì)者有很好的幫助
標(biāo)簽： FPGA CPLD 過程 如何提高
上傳用戶：wfeel
介紹用FPGA設(shè)計(jì)實(shí)現(xiàn)MIL-STD1553B部接口中的曼徹斯特碼編解碼器
標(biāo)簽： MIL-STD FPGA 1553 設(shè)計(jì)實(shí)現(xiàn)
上傳時(shí)間： 2013-08-30
上傳用戶：Amygdala
FPGA讀SRAM中的數(shù)再傳給CY7C68013
標(biāo)簽： C68013 68013 FPGA SRAM
上傳用戶：15070202241
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