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數字追頻控制

  • 32BIT加法器

    32BIT加法器,輸入2個數字就可以跑出2個數字的合

    標簽: BIT 32 加法器

    上傳時間: 2015-08-09

    上傳用戶:妄想演繹師

  • s1.c是server

    s1.c是server,c.c是client, server負責接收client傳的數字進行運算並回傳,運用了同步的機制。編譯須加 -lsocket -lpthread -lrt

    標簽: server

    上傳時間: 2014-01-02

    上傳用戶:athjac

  • 根據bluelab3.5.2實例hid-keyboard做出應用

    根據bluelab3.5.2實例hid-keyboard做出應用,能發出數字鍵1-5

    標簽: hid-keyboard bluelab

    上傳時間: 2013-12-24

    上傳用戶:牧羊人8920

  • 針對Pocket PC示範一個計算機視窗

    針對Pocket PC示範一個計算機視窗,給予使用者一個包含按鍵0至9的簡易數字鍵盤、四個運算元,示範所有輸入方法必要條件。

    標簽: Pocket

    上傳時間: 2013-12-14

    上傳用戶:515414293

  • 猜數字游戲

    猜數字游戲,AI不怎么好看 但注重算法的實現,最近寫了一個猜數字的遊戲,和大家分享。 可是這些主要的目的在于研究猜數字,而非游戲本身,所以介面作的不是很好, 是文字模式的 .

    標簽: 數字

    上傳時間: 2016-08-28

    上傳用戶:yan2267246

  • 在9格寬×9格高的大九宮格中有9個3格寬×3格高的小九宮格

    在9格寬×9格高的大九宮格中有9個3格寬×3格高的小九宮格,並提供一定數量的數字。根據這些數字,利用邏輯和推理,在其他的空格上填入1到9的數字。每個數字在每個小九宮格內不能出現一樣的數字,每個數字在每行、每列也不能出現一樣的數字。 這種遊戲只需要邏輯思維能力,與數字運算無關。雖然玩法簡單,但數字排列方式卻千變萬化,所以不少教育者認為數獨是鍛鍊腦筋的好方法

    標簽:

    上傳時間: 2017-03-02

    上傳用戶:cc1915

  • Boost C++ Libraries 1.35.0

    Boost C++ Libraries Free peer-reviewed portable C++ source libraries Boost C++ Libraries 基本上是一個免費的 C++ 的跨平臺函式庫集合,基本上應該可以把它視為 C++ STL 的功能再延伸;他最大的特色在於他是一個經過「同行評審」(peer review,可參考維基百科)、開放原始碼的函式庫,而且有許多 Boost 的函式庫是由 C++ 標準委員會的人開發的,同時部分函式庫的功能也已經成為 C++ TR1 (Technical Report 1,參考維基百科)、TR2、或是 C++ 0x 的標準了。 它的官方網站是:http://www.boost.org/,包含了 104 個不同的 library;由於他提供的函式庫非常地多,的內容也非常地多元,根據官方的分類,大致上可以分為下面這二十類: 字串和文字處理(String and text processing) 容器(Containers) Iterators 演算法(Algorithms) Function objects and higher-order programming 泛型(Generic Programming) Template Metaprogramming Preprocessor Metaprogramming Concurrent Programming 數學與數字(Math and numerics) 正確性與測試(Correctness and testing) 資料結構(Data structures) 影像處理(Image processing) 輸入、輸出(Input/Output) Inter-language support 記憶體(Memory) 語法分析(Parsing) 程式介面(Programming Interfaces) 其他雜項 Broken compiler workarounds 其中每一個分類,又都包含了一個或多個函式庫,可以說是功能相當豐富。

    標簽: Boost C++ Libraries

    上傳時間: 2015-05-15

    上傳用戶:fangfeng

  • IIC接口E2PROM(AT24C64) 讀寫VERILOG 驅動源碼+仿真激勵文件: module

    IIC接口E2PROM(AT24C64) 讀寫VERILOG 驅動源碼+仿真激勵文件:module i2c_dri    #(      parameter   SLAVE_ADDR = 7'b1010000   ,  //EEPROM從機地址      parameter   CLK_FREQ   = 26'd50_000_000, //模塊輸入的時鐘頻率      parameter   I2C_FREQ   = 18'd250_000     //IIC_SCL的時鐘頻率    )   (                                                                input                clk        ,        input                rst_n      ,                                                //i2c interface                          input                i2c_exec   ,  //I2C觸發執行信號    input                bit_ctrl   ,  //字地址位控制(16b/8b)    input                i2c_rh_wl  ,  //I2C讀寫控制信號    input        [15:0]  i2c_addr   ,  //I2C器件內地址    input        [ 7:0]  i2c_data_w ,  //I2C要寫的數據    output  reg  [ 7:0]  i2c_data_r ,  //I2C讀出的數據    output  reg          i2c_done   ,  //I2C一次操作完成    output  reg          i2c_ack    ,  //I2C應答標志 0:應答 1:未應答    output  reg          scl        ,  //I2C的SCL時鐘信號    inout                sda        ,  //I2C的SDA信號                                           //user interface                       output  reg          dri_clk       //驅動I2C操作的驅動時鐘     );//localparam definelocalparam  st_idle     = 8'b0000_0001; //空閑狀態localparam  st_sladdr   = 8'b0000_0010; //發送器件地址(slave address)localparam  st_addr16   = 8'b0000_0100; //發送16位字地址localparam  st_addr8    = 8'b0000_1000; //發送8位字地址localparam  st_data_wr  = 8'b0001_0000; //寫數據(8 bit)localparam  st_addr_rd  = 8'b0010_0000; //發送器件地址讀localparam  st_data_rd  = 8'b0100_0000; //讀數據(8 bit)localparam  st_stop     = 8'b1000_0000; //結束I2C操作//reg definereg            sda_dir   ; //I2C數據(SDA)方向控制reg            sda_out   ; //SDA輸出信號reg            st_done   ; //狀態結束reg            wr_flag   ; //寫標志reg    [ 6:0]  cnt       ; //計數reg    [ 7:0]  cur_state ; //狀態機當前狀態reg    [ 7:0]  next_state; //狀態機下一狀態reg    [15:0]  addr_t    ; //地址reg    [ 7:0]  data_r    ; //讀取的數據reg    [ 7:0]  data_wr_t ; //I2C需寫的數據的臨時寄存reg    [ 9:0]  clk_cnt   ; //分頻時

    標簽: iic 接口 e2prom at24c64 verilog 驅動 仿真

    上傳時間: 2021-11-05

    上傳用戶:

  • FPGA VHDL語言DDS函數信號發生器的設計與實現

    1、              設計任務(1)                   正弦波、三角波、方波、鋸齒波輸出頻率范圍:1KHZ~1MHZ(2)                   具有頻率設置功能,頻率步驟:100HZ;(3)                   輸出信號頻率定度:優于10 ^4(4)                   輸出電壓幅度:在5K負載電阻上的電壓峰——峰值Vopp≧1V;(5)                   失真度:用示波器觀察使無明顯失真。 2、              基本要求:(1)       掌握采用FPGA硬件特性、及軟件開發工具MAXPLUSII的使用。(2)       掌握DDS函數信號發生器的原理,并采用VIIDL語言設計DDS內核單元。(3)       掌握單片機與DDS單無連接框圖原理,推導出頻率控制字、相位控制字的算法。(4)       設計鍵盤輸入電路和程序并調試。掌握鍵盤和顯示(LCD1602)配合使用的方法和技巧。(5)       掌握硬件和軟件聯合調試的方法。(6)       完成系統硬件電路的設計和制作。(7)       完成系統程序的設計。(8)       完成整個系統的設計、調試和制作。(9)       完成課程設計報告。

    標簽: fpga vhdl dds

    上傳時間: 2022-05-30

    上傳用戶:

  • 數控振蕩器的頻率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL語言描述

    數控振蕩器的頻率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL語言描述,集成在一個模塊中,提供VHDL源程序供大家學習和討論。\r\n

    標簽: VHDL 寄存器 數控振蕩器 加法器

    上傳時間: 2013-09-04

    上傳用戶:a471778

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