VIP專區(qū)-嵌入式/單片機(jī)編程源碼精選合集系列（88）資源包含以下內(nèi)容：1. 計(jì)算機(jī)并口轉(zhuǎn)3路串行DA的DLL源碼及電路,芯片MAX541/MAX5541,可以免費(fèi)申請(qǐng),8路I/O輸出,5路輸入,并口的簡單極限應(yīng)用.經(jīng)使用各項(xiàng)性能不錯(cuò),就是DA抗干擾較差,沒有較大的電磁干擾運(yùn)行.2. arm9上測(cè)試串口代碼.3. I2C controller verilog code for altera fpga platform..4. sigma-delta ADC轉(zhuǎn)換之matlab模型.5. NiosII的Flash編程指南（www.sopc.net.cn）.6. 樓宇門禁對(duì)講機(jī)主機(jī)原理圖.7. 開發(fā)環(huán)境.8. 開發(fā)環(huán)境WAVE6000.9. vb環(huán)境下用動(dòng)態(tài)規(guī)劃方法編的0/1背包問題.10. 該實(shí)驗(yàn)設(shè)計(jì)模60計(jì)數(shù)器.11. 嵌入式課程設(shè)計(jì) 頁面置換算法模擬 列出缺頁缺頁次數(shù)和缺頁率.12. DSP系列中的TMS320F2812 ADC范例程序.13. TMS320F2812 GPIO_input范例程序.14. TMS320F2812 SPI_FFDLB范例程序.15. 指令集模擬器.16. s3c44b0x的一些相關(guān)芯片資料,是官方的pdf格式,很有用.17. 大屏320240的C語言測(cè)試程序,已驗(yàn)證通過,請(qǐng)放心使用.18. 最新火熱的ＣＸ３２ 源代碼.19. 關(guān)于臺(tái)灣新茂SM5964 I2C的程序.20. gps開發(fā)專用的源代碼.21. Moore型狀態(tài)機(jī)設(shè)計(jì),基于VHDL.能夠根據(jù)微處理器的讀寫周期,分別對(duì)應(yīng)存儲(chǔ)器輸出寫使能WE和讀使能OE信號(hào)..22. 文介紹一款用AT89C51和串行ROM 制作的電子密碼鎖.23. 總線控制器 altera提供的FPGA源代碼.24. bios嵌入DOS操作系統(tǒng),可以先編譯romos.asm制作成BIN文件,加載至BIOS的ISA模塊.另外還有制作工具.25. wt89c51 watch dog proce.26. 瑞薩H8系列芯片內(nèi)置rom讀寫測(cè)試.27. Opencore提供的I2C代碼.28. 譯碼器的邏輯功能是將已賦予特定含義的一組二進(jìn)制輸入代碼的原意"翻譯"出來,變成對(duì)應(yīng)的輸出高低電平信號(hào).該程序?yàn)?-8譯碼器.基于VHDL,其開發(fā)環(huán)境是MAXPLUS2..29. 驅(qū)動(dòng)SOLOMON的SSD182.30. 驅(qū)動(dòng)三星的KS0107/KS0108.31. 驅(qū)動(dòng)ULTRCHIP的UC1682.32. 是一個(gè)帶PROTEUS仿真的8路數(shù)字電壓表.33. ＳＳＤ３的練習(xí)６的答案．快期末考試了.34. S3C2410A 的存儲(chǔ)器控制器提供訪問外部存儲(chǔ)器所需要的存儲(chǔ)器控制信號(hào)。
S3C2410A 的存儲(chǔ)器控制器有以下的特性：.35. 這是一個(gè)三星44b0的中文文檔.36. 這個(gè)arm7嵌入式蕊版的起動(dòng)代碼.37. 這個(gè)代碼是用ADS1.2平臺(tái)開發(fā)的一個(gè)mp3播放器。.38. 該程序能夠?qū)π盘?hào)進(jìn)行ＯＦＤＭ處理.39. 在網(wǎng)上看見很多人用DM413.40. 介紹了CPCI總線及快速、低功耗模數(shù)轉(zhuǎn)換器件AD976的主要特點(diǎn).
標(biāo)簽：
ADAMS
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彈簧
上傳時(shí)間：
2013-06-18
上傳用戶：eeworm
ASIC對(duì)產(chǎn)品成本和靈活性有一定的要求.基于MCU方式的ASIC具有較高的靈活性和較低的成本,然而抗干擾性和可靠性相對(duì)較低,運(yùn)算速度也受到限制.常規(guī)ASIC的硬件具有速度優(yōu)勢(shì)和較高的可靠性及抗干擾能力,然而不是靈活性較差,就是成本較高.與傳統(tǒng)硬件(CHW)相比,具有一定可配置特性的場(chǎng)可編程門陣列(FPGA)的出現(xiàn),使建立在可再配置硬件基礎(chǔ)上的進(jìn)化硬件(EHW)成為智能硬件電路設(shè)計(jì)的一種新方法.作為進(jìn)化算法和可編程器件技術(shù)相結(jié)合的產(chǎn)物,可重構(gòu)FPGA的研究屬于EHW的研究范疇,是研究EHW的一種具體的實(shí)現(xiàn)方法.論文認(rèn)為面向分類的專用類可重構(gòu)FPGA(ASR-FPGA)的研究,可使可重構(gòu)電路粒度劃分的針對(duì)性更強(qiáng)、設(shè)計(jì)更易實(shí)現(xiàn).論文研究的可重構(gòu)FPGA的BCH通訊糾錯(cuò)碼進(jìn)化電路是一類ASR-FPGA電路的具體方法,具有一定的實(shí)用價(jià)值.論文所做的工作主要包括:(1)BCH編譯碼電路的設(shè)計(jì)——求取實(shí)驗(yàn)用BCH碼的生成多項(xiàng)式和校驗(yàn)多項(xiàng)式及其相應(yīng)的矩陣并構(gòu)造實(shí)驗(yàn)用BCH碼;(2)建立基于可重構(gòu)FPGA的基核——構(gòu)造具有可重構(gòu)特性的硬件功能單元,以此作為可重構(gòu)BCH碼電路的設(shè)計(jì)基礎(chǔ);(3)構(gòu)造實(shí)現(xiàn)可重構(gòu)BCH糾錯(cuò)碼電路的方法——建立可重構(gòu)糾錯(cuò)碼硬件電路算法并進(jìn)行實(shí)驗(yàn)驗(yàn)證;(4)在可重構(gòu)糾錯(cuò)碼電路基礎(chǔ)上,構(gòu)造進(jìn)化硬件控制功能塊的結(jié)構(gòu),完成各進(jìn)化RLA控制模塊的驗(yàn)證和實(shí)現(xiàn).課題是將可重構(gòu)BCH碼的編譯碼電路的實(shí)現(xiàn)作為一類ASR-FPGA的研究目標(biāo),主要成果是根據(jù)可編程邏輯電路的特點(diǎn),選擇一種可編程樹的電路模型,并將它作為可重構(gòu)FPGA電路的基核T;通過對(duì)循環(huán)BCH糾錯(cuò)碼的構(gòu)造原理和電路結(jié)構(gòu)的研究,將基核模型擴(kuò)展為能滿足糾錯(cuò)碼電路需要的糾錯(cuò)碼基本功能單元T;以T作為再劃分的基本單元,對(duì)FPGA進(jìn)行"格式化",使T規(guī)則排列在FPGA上,通過對(duì)T的控制端的不同配置來實(shí)現(xiàn)糾錯(cuò)碼的各個(gè)功能單元;在可重構(gòu)基核的基礎(chǔ)上提出了糾錯(cuò)碼重構(gòu)電路的嵌套式GA理論模型,將嵌套式GA的染色體串作為進(jìn)化硬件描述語言,通過轉(zhuǎn)換為相應(yīng)的VHDL語言描述以實(shí)現(xiàn)硬件電路;采用RLA模型的有限狀態(tài)機(jī)FSM方式實(shí)現(xiàn)了可重構(gòu)糾錯(cuò)碼電路的EHW的各個(gè)控制功能塊.在實(shí)驗(yàn)方面,利用Xilinx FPGA開發(fā)系統(tǒng)中的VHDL語言和電路圖相結(jié)合的設(shè)計(jì)方法建立了循環(huán)糾錯(cuò)碼基核單元的可重構(gòu)模型,進(jìn)行循環(huán)糾錯(cuò)BCH碼的電路和功能仿真,在Xilinx公司的Virtex600E芯片進(jìn)行了FPGA實(shí)現(xiàn).課題在研究模型上選取的是比較基本的BCH糾錯(cuò)碼電路,立足于解決基于可重構(gòu)FPGA核的設(shè)計(jì)的基本問題.課題的研究成果及其總結(jié)的一套ASR-FPGA進(jìn)化硬件電路的設(shè)計(jì)方法對(duì)實(shí)際的進(jìn)化硬件設(shè)計(jì)具有一定的實(shí)際指導(dǎo)意義,提出的基于專用類基核FPGA電路結(jié)構(gòu)的研究方法為新型進(jìn)化硬件的器件結(jié)構(gòu)的設(shè)計(jì)也可提供一種借鑒.
標(biāo)簽：
FPGA
可重構(gòu)
通訊
糾錯(cuò)
上傳時(shí)間：
2013-07-01
上傳用戶：myworkpost
