隨著電信數據傳輸對速率和帶寬的要求變得越來越迫切,原有建成的網絡是基于話音傳輸業務的網絡,已不能適應當前的需求.而建設新的寬帶網絡需要相當大的投資且建設工期長,無法滿足特定客戶對高速數據傳輸的近期需求.反向復用技術是把一個單一的高速數據流在發送端拆散并放在兩個或者多個低速數據鏈路上進行傳輸,在接收端再還原為高速數據流.該文提出一種基于FPGA的多路E1反向復用傳輸芯片的設計方案,使用四個E1構成高速數據的透明傳輸通道,支持E1線路間最大相對延遲64ms,通過鏈路容量調整機制,可以動態添加或刪除某條E1鏈路,實現靈活、高效的利用現有網絡實現視頻、數據等高速數據的傳輸,能夠節省帶寬資源,降低成本,滿足客戶的需求.系統分為發送和接收兩部分.發送電路實現四路E1的成幀操作,數據拆分采用線路循環與幀間插相結合的方法,A路插滿一幀(30時隙)后,轉入B路E1間插數據,依此類推,循環間插所有的數據.接收電路進行HDB3解碼,幀同步定位(子幀同步和復幀同步),線路延遲判斷,FIFO和SDRAM實現多路數據的對齊,最后按照約定的高速數據流的幀格式輸出數據.整個數字電路采用Verilog硬件描述語言設計,通過前仿真和后仿真的驗證.以30萬門的FPGA器件作為硬件實現,經過綜合和布線,特別是寫約束和增量布線手動調整電路的布局,降低關鍵路徑延時,最終滿足設計要求.
上傳時間： 2013-07-16
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本文提出了一種高速Viterbi譯碼器的FPGA實現方案。這種Viterbi譯碼器的設計方案既可以制成高性能的單片差錯控制器，也可以集成到大規模ASIC通信芯片中，作為全數字接收的一部分。 本文所設計的Viterbi譯碼器采用了基四算法，與基二算法相比，其譯碼速率在理論上約提升一倍。加一比一選單元是Viterbi譯碼器最主要的瓶頸所在，本文在加一比一選模塊中采用了全并行結構的設計方法，這種方法雖然增加了硬件的使用面積，卻有效的提高了譯碼器的速率。在幸存路徑管理部分采用了兩路并行回溯的設計方法，與寄存器交換法相比，回溯算法更適用于FPGA開發設計。為了提高譯碼性能，減小譯碼差錯，本文采用較大譯碼深度的回溯算法以保證幸存路徑進行合并。實現了基于FPGA的誤碼測試儀，在FPGA內部完成誤碼驗證和誤碼計數的工作。 與基于軟件實現譯碼過程的DSP芯片不同，FPGA芯片完全采用硬件平臺對Viterbi譯碼器加以實現，這使譯碼速率得到很大的提升。針對于具體的FPGA硬件實現，本文采用了硬件描述語言VHDL來完成設計。通過對譯碼器的綜合仿真和FPGA實現驗證了該方案的可行性。譯碼器的最高譯碼輸出速率可以達到60Mbps。
上傳時間： 2013-04-24
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IEEE802旗下的無線網絡協議引領了無線網絡領域的新革命，其不斷提升的速度優勢滿足了人們對于高速無線接入的迫切要求，在這其中，OFDM技術所起的作用不可小覷。隨著FPGA、信號處理和通信技術的發展，OFDM的應用得到了長足的進步。在此情況下，以OFDM技術為核心實現數據傳輸的原型機系統顯得應情應景而且必要。 本課題在深入理解OFDM技術的同時，結合相應的EDA工具對系統進行建模并基于IEEE802.11a物理層標準給出了一種OFDM基帶傳輸的系統實現方案。整個設計采用目前主流的自頂向下的設計方法，由總體設計至詳細設計逐步細化。 在系統功能模塊的FPGA實現過程中，針對XilinxVirtex-Ⅱ芯片對各個模塊進行了詳細設計，通過采用雙端口RAM、流水、乒乓結構等處理實現高速的同步的信道編碼的功能模塊；通過比較符號定時的不同算法，給出了基于MultiplierlessCorrelator的實現結構并給出了仿真波形圖，驗證了采用該算法后符號定時模塊的資源耗費大大降低而功能卻依然和基于乘法器的符號定時模塊相當；通過對Viterbi算法進行簡化，給出了(2，1，6)卷積碼的4比特軟判決Viterbi解碼器的設計和實現。最后根據系統所選芯片XC2V3000給出了具有較高配置靈活性的基于SystemACE配置方案的FPGA的硬件原理圖設計和PCB設計。 本文首先以無線局域網和IEEE802無線網絡家族引出OFDM技術發展、研究價值及OFDM的優缺點，接下來從OFDM原理入手，簡要說明了OFDM的基本要素以及目前的研究熱點，之后在介紹完IEEE802.11a物理層標準的同時給出了本原型機系統的總體設計方案，并從硬件語言設計和FPGA硬件原理設計兩方面給出了該系統的詳細設計。 隨著OFDM技術的普及以及未來通信技術對OFDM的青睞，相信本論文的工作對OFDM基帶傳輸系統的原型設計和實現具有一定的參考價值。
上傳時間： 2013-07-13
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介紹了一種高速、高性能的單片機C8051F330，該單片機內部集成了眾多的功能部件，是真正的混合信號在片系統。本文對單片機的功能和特點做了詳細的介紹，并以一個實際的多路溫濕度測控系統為例，給出
上傳時間： 2013-07-28
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近年來，移動通信技術在全球范圍內得到了迅猛的發展及應用，各種全新的無線通信概念層出不窮、各種新的體制及其關鍵技術日新月異。由于正交頻分復用(OFDM)技術可以高效地利用頻譜資源并有效地對抗頻率選擇性衰落，多入多出(MIMO)利用多個天線實現多發多收，在不增加帶寬和發送功率的情況下，可以成倍提高信道容量，因此OFDM-MIMO技術被廣泛認為是后三代通信系統(B3G)的關鍵技術，是當今移動通信領域研究的熱點。 本文對OFDM-MIMO通信系統接收機的關鍵技術--數字下變頻，OFDM同步、解調進行了相關研究，在多天線接收板的XC2VP70-5FF1704芯片上，完成了數字下變頻，OFDM同步和解調的FPGA設計與實現。通過功能仿真、時序仿真、板級電路測試，驗證了該設計的正確性。 本文首先介紹了OFDM基本原理以其特點，然后對同步技術和數字下變頻技術作了相應的介紹。同步是OFDM系統設計中的一項關鍵技術，即是針對系統中存在的時間偏差、頻率偏差進行定時恢復、頻偏的估計與補償，來減少各種同步偏差對系統性能的影響。數字下變頻是軟件無線電的核心技術之一，其基本功能是從高速中頻數字信號中提取所需的窄帶信號，將其下變頻為基帶信號，降低數據率，以供后續DSP器件作進一步處理。 在數字下變頻器的設計和實現方面，本文先介紹了數字下變頻器的原理和基本結構，然后根據系統要求對其進行了設計，并在實現上作了一些簡化，節約了硬件資源。 在對時間同步的設計和實現方面，本文采用了利用PN序列進行時間同步的算法。在實現上根據系統實際情況將數據分為四路分別與本地PN碼做滑動相關運算，更有效的利用了同步數據，達到了更好的同步性能。 在OFDM的頻率同步的設計和實現方面，本文采用重復的PN碼兩兩相關來估計頻偏值，并聯合一個二階負反饋環路進行補償。該算法利用環路自身噪聲帶寬抑制噪聲，提高頻率估計精度，并同時利用負反饋擴大頻偏估計范圍。本文在對算法的詳細研究分析的基礎上對其進行了FPGA設計與實現。
上傳時間： 2013-04-24
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第三代移動通信系統及技術是目前通信領域的研究熱點。本系統采用了第三代移動通信系統的部分關鍵技術，采用直接序列擴頻方式實現多路寬帶信號的碼分復用傳輸。在系統設計中，我們綜合考慮了系統性能要求，功能實現復雜度與系統資源利用率，選擇了并行導頻體制、串行滑動相關捕獲方式、延遲鎖相環跟蹤機制、導頻信道估計方案和相干解擴方式，并在Quartus軟件平臺上采用VHDL語言，在FPGA芯片CycloneEP1C12Q240C8上完成了系統設計。通過對硬件測試板的測試表明文中介紹的方案和設計方法是可行和有效的。并在測試的基礎上對系統提出了改進意見。
上傳時間： 2013-06-27
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隨著TD—SCDMA技術的不斷發展，TD—SCDMA系統產品也逐步成熟并隨之完善。產品家族日益豐富，室內型宏基站、室外型宏基站、分布式基站(BBU+RRU)、微基站等系列化基站產品逐步問世，可以滿足不同場景的建網需求。而分布式基站(BBU+RRU)越來越多地受到業界的關注和重視。 本文主要從TD—SCDMA頻點拉遠系統(RRU)和軟件無線電技術的發展入手，重點研究TD—SCDMA頻點拉遠系統的FPGA設計與實現。TD—SCDMA通信系統通過靈活分配不同的上下行時隙，實現業務的不對稱性，但是多路數字中頻所構成的系統成本高和控制的復雜性，以及TDD雙工模式下，系統的峰均比隨時隙數增加而增加，對整個頻點拉遠系統的前端放大器線性輸入提出了很高的要求。TD—SCDMA系統使用軟件無線電平臺，一方面軟件算法可以有效保證時隙分配的準確性，保證對前端控制器的開關控制，以及對上下行功率讀取計算和子幀的靈活提取，另一方面靈活的DUC/CFR算法可以有效的提高頻帶利用率和抗干擾能力，有效的控制TDD系統的峰均比，有效降低系統對前端放大器線性輸出能力的要求。 本文主要研究軟件無線電中DUC和CFR的關鍵技術以及FPGA實現，DUC主要由3倍FIR內插成型濾波器、2倍插值補償濾波器以及5級CIC濾波器級聯組成；而CFR主要采用類似基帶削峰的加窗濾波的中頻削峰算法，可以降低相鄰信道的溢出，更有效的降低CF值。將DUC/CFR以單片FPGA實現，能很好提高RRU性能，減少其硬件結構，降低成本，降低功耗，增加外部環境的穩定性。
上傳時間： 2013-04-24
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本文重點研究的是補償編碼鍵控(CCK)的調制與解調算法原理，以及基于FPGA進行的系統設計實現。作為IEEE802.11b標準中關鍵的調制技術，CCK碼具有良好的相關特性，能夠在高速率傳輸數據的同時有效的克服多徑效應。本文首先對WLAN的結構和特點進行了簡單介紹，對其中的IEEE802.11b標準進行了研究，并著重分析了其物理層基帶部分的結構和規范。然后系統的介紹了CCK碼的特點，重點對11Mb/s模式下基于“基本CCK碼字集”的CCK調制原理和基于快速沃爾什變換(FWT)塊的CCK解調原理進行了分析討論。接下來通過在Matlab中對調制和解調方案的仿真，得到了正確的理論數據，并驗證了系統設計的可行性。最后在Xilinx公司的ISE6.2開發環境下，使用硬件描述語言Verilog HDL對CCK調制和解調系統在FPGA中進行了設計，然后將整個系統在ModelSim中進行了功能仿真。理論分析和仿真結果的比較表明系統設計是正確的，而且系統性能良好。 本文所設計的基于FPGA的CCK調制和解調系統具有集成度高、穩定性強和能夠在線軟件更新等特點。研究成果可以給將來設計更高性能、更高集成度的基帶WLAN芯片提供基礎。
上傳時間： 2013-06-02
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隨著科技的發展和社會的進步，數字電視已逐漸成為現代電視的主流。利用今年是奧運年的契機，研究和推廣數字電視廣播具有重大的意義。2006年8月底我國出臺的數字多媒體/電視廣播(DMB-T)標準，確立了中國自己的技術標準。以此來發展擁有自主知識產權的數字電視事業，不僅可以滿足廣大人民群眾日益增長的物質、文化要求，還可以帶動相關產業快速發展。 本課題在深入研究DMB-T國家標準的基礎上，首先對系統的調制系統進行了設計規劃，然后對信道調制的星座映射、系統信息插入、幀體數據處理、PN序列插入的幀形成模塊和成形濾波模塊進行了設計和仿真，并驗證了其正確性。 3780個子載波的時域同步正交多載波技術(TDS-OFDM)是DMB-T調制系統的關鍵技術之一。由于載波數不是2的整數次冪，考慮到實現的有效性，不能采用現已成熟的基-2或基-4的快速傅立葉變換(FFT)算法。針對調制系統中特有的3780點IFFT，課題深入分析和比較了Cooley-Tukey、Winograd和素因子三種離散快速傅立葉變換算法的特點和性能，綜合利用了三種算法優勢，考慮了算法的復雜度、運算的速度、資源的消耗，設計出一種新的算法，進行了Matlab驗證和基于FPGA(現場可編程門陣列)的仿真。分析表明，該算法所需的加法、乘法次數已很逼近4096點FFT算法。 DMB-T發射端的基帶成形濾波采用了平方根升余弦滾降濾波，由于其0.05的滾降系數在實現中比較苛刻，所以是設計的難點之一。本課題利用Matlab工具采用了等紋波最優濾波的方法設計了169階數字濾波器，其阻帶衰減達到了46.9dB，完全符合標準的要求；利用四倍插值的方法實現了I、Q合路的該濾波器的FPGA設計，并進行了設計優化，顯著降低了濾波器的運算量，大大節約了實現該濾波器所需的乘法器資源。
上傳時間： 2013-06-28
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4路無線遙控開關電路圖與工作原理，省得再去尋找，現成照做就ok。
上傳時間： 2013-06-13
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