編程器人機(jī)界面,51單片機(jī)選擇、擦除、下載編程、校驗(yàn)和讀除。
標(biāo)簽： 51 編程器 人機(jī)界面
上傳時(shí)間： 2014-01-15
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vb編程器界面,實(shí)現(xiàn)基本的編程,寫入,擦除,校驗(yàn),芯片選擇等功能
標(biāo)簽： 編程器 編程 芯片選擇
上傳時(shí)間： 2015-11-13
上傳用戶：一諾88
本文提出一個(gè)根值4 蝴蝶元素使用(m, n) - 櫃臺(tái)減少硬體複雜, 延遲時(shí)間, 和電力消費(fèi)被介入在使用常規(guī)加法器。並且一臺(tái)修改過(guò)的換向器為FFT 算法被描述與用管道運(yùn)輸?shù)膶?shí)施一起為連續(xù)輸入資料減少資料記憶要求。
標(biāo)簽： FFT 元素 修改 加法器
上傳時(shí)間： 2015-12-04
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avr 單片機(jī)usb下載器。速度很快8khex文件編成+校驗(yàn)4秒！（protel dxp）
標(biāo)簽： protel 8khex avr usb
上傳時(shí)間： 2016-01-06
上傳用戶：zhengjian
1．學(xué)習(xí)交流電壓、電流和功率的測(cè)量方法； 2．了解電壓變送器、電流變送器的工作原理和使用方法； 3．對(duì)實(shí)驗(yàn)裝置組成的測(cè)試系統(tǒng)進(jìn)行電壓和電流的標(biāo)定； 4．對(duì)給定的負(fù)載電壓和電流進(jìn)行滿量程校驗(yàn)，對(duì)給定的三個(gè)負(fù)載的有功功率進(jìn)行測(cè)量。
標(biāo)簽： 電流 電壓 交流電壓 功率
上傳時(shí)間： 2016-02-07
上傳用戶：cazjing
VHDL實(shí)現(xiàn)的奇偶校驗(yàn)功能模塊和一個(gè)外設(shè)配置寄存器的設(shè)計(jì)實(shí)例。
標(biāo)簽： VHDL 奇偶校驗(yàn) 外設(shè) 模塊
上傳時(shí)間： 2016-02-16
上傳用戶：wfl_yy
CRC校驗(yàn)串行實(shí)現(xiàn)方法,verilog源碼,利用反饋線性移位寄存器的方法,實(shí)現(xiàn)簡(jiǎn)單,適用于串行通信協(xié)議中的CRC校驗(yàn).
標(biāo)簽： CRC verilog 串行 實(shí)現(xiàn)方法
上傳時(shí)間： 2014-11-24
上傳用戶：朗朗乾坤
循環(huán)碼的編碼和譯碼算法。有兩種編碼器：K級(jí)和n-K級(jí)。配有譯法算法。輸入生成多項(xiàng)式或校驗(yàn)多項(xiàng)式，輸入信息，就能得到編碼輸出。
標(biāo)簽： n-K 多項(xiàng)式 循環(huán)碼 編碼
上傳時(shí)間： 2016-04-21
上傳用戶：xymbian
學(xué)習(xí)使用FPGA做一些簡(jiǎn)單的編碼器,RS(5,3)編碼就是5個(gè)字符中有5-3=2兩個(gè)校正字
標(biāo)簽： FPGA RS 編碼器 編碼
上傳時(shí)間： 2014-01-12
上傳用戶：風(fēng)之驕子
用于數(shù)據(jù)塊容錯(cuò)編碼校驗(yàn)的芯片的RS編碼器設(shè)計(jì)
標(biāo)簽： 數(shù)據(jù) 容錯(cuò)編碼 RS編碼器 芯片
上傳時(shí)間： 2016-07-11
上傳用戶：woshini123456
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