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核函數(shù)

這是我自己寫(xiě)的一個(gè)關(guān)于svm的核程序,希望對(duì)正在學(xué)習(xí)的朋友有所幫助.

這是我自己寫(xiě)的一個(gè)關(guān)于svm的核程序,希望對(duì)正在學(xué)習(xí)的朋友有所幫助.

標(biāo)簽： svm 程序正

上傳時(shí)間： 2015-07-05

上傳用戶(hù)：cc1915
Rational Robot使用﹕如何在GUI腳本中添加數(shù)據(jù)池。

Rational Robot使用﹕如何在GUI腳本中添加數(shù)據(jù)池。

標(biāo)簽： Rational Robot GUI

上傳時(shí)間： 2014-01-07

上傳用戶(hù)：xuanchangri
核化的直接判別分析（KDLDA）代碼

核化的直接判別分析（KDLDA）代碼，MATLAB寫(xiě)的。

標(biāo)簽： KDLDA 判別分代碼

上傳時(shí)間： 2013-12-20

上傳用戶(hù)：葉山豪
通過(guò)核來(lái)泛化的判別分析（GDA）代碼

通過(guò)核來(lái)泛化的判別分析（GDA）代碼，MATLAB寫(xiě)的。

標(biāo)簽： GDA 判別分代碼

上傳時(shí)間： 2013-12-22

上傳用戶(hù)：大融融rr
uboot針對(duì)三星公司的s3c2410（arm920T核）的初始化源代碼。

uboot針對(duì)三星公司的s3c2410（arm920T核）的初始化源代碼。

標(biāo)簽： s3c2410 uboot 920T arm

上傳時(shí)間： 2014-01-08

上傳用戶(hù)：wys0120
關(guān)于FPGA的一些常識(shí)及含IP核的VHDL設(shè)計(jì)源代碼。

關(guān)于FPGA的一些常識(shí)及含IP核的VHDL設(shè)計(jì)源代碼。

標(biāo)簽： FPGA VHDL 常識(shí) IP核

上傳時(shí)間： 2013-12-11

上傳用戶(hù)：xmsmh
VHDL中IP核之參數(shù)化觸發(fā)器中文使用介紹

VHDL中IP核之參數(shù)化觸發(fā)器中文使用介紹

標(biāo)簽： VHDL IP核參數(shù) 觸發(fā)器

上傳時(shí)間： 2014-01-16

上傳用戶(hù)：宋桃子
VHDL中IP核之參數(shù)化加減法器中文使用介紹

VHDL中IP核之參數(shù)化加減法器中文使用介紹

標(biāo)簽： VHDL IP核參數(shù) 減法器

上傳時(shí)間： 2014-01-15

上傳用戶(hù)：cursor
完整的用VERILOG語(yǔ)言開(kāi)發(fā)的USB2.0 IP核源代碼

完整的用VERILOG語(yǔ)言開(kāi)發(fā)的USB2.0 IP核源代碼，包括文檔、仿真文件

標(biāo)簽： VERILOG USB 2.0 IP核

上傳時(shí)間： 2015-07-09

上傳用戶(hù)：維子哥哥
本書(shū)主要介紹Altera公司的軟核CPU——nios和采用該CPU進(jìn)行嵌入式系統(tǒng)設(shè)計(jì)的流程與方法。并以此為著眼點(diǎn)

本書(shū)主要介紹Altera公司的軟核CPU——nios和采用該CPU進(jìn)行嵌入式系統(tǒng)設(shè)計(jì)的流程與方法。并以此為著眼點(diǎn)，介紹Altera的片上可編程系統(tǒng)SOPC的設(shè)計(jì)原理與實(shí)踐技術(shù)，引領(lǐng)讀者在低投入的情況下，較快地進(jìn)入片上系統(tǒng)soc的殿堂。

標(biāo)簽： CPU Altera nios 軟核

上傳時(shí)間： 2013-12-13

上傳用戶(hù)：haoxiyizhong